ASIC對產品成本和靈活性有一定的要求.基于MCU方式的ASIC具有較高的靈活性和較低的成本,然而抗干擾性和可靠性相對較低,運算速度也受到限制.常規ASIC的硬件具有速度優勢和較高的可靠性及抗干擾能力,然而不是靈活性較差,就是成本較高.與傳統硬件(CHW)相比,具有一定可配置特性的場可編程門陣列(FPGA)的出現,使建立在可再配置硬件基礎上的進化硬件(EHW)成為智能硬件電路設計的一種新方法.作為進化算法和可編程器件技術相結合的產物,可重構FPGA的研究屬于EHW的研究范疇,是研究EHW的一種具體的實現方法.論文認為面向分類的專用類可重構FPGA(ASR-FPGA)的研究,可使可重構電路粒度劃分的針對性更強、設計更易實現.論文研究的可重構FPGA的BCH通訊糾錯碼進化電路是一類ASR-FPGA電路的具體方法,具有一定的實用價值.論文所做的工作主要包括:(1)BCH編譯碼電路的設計——求取實驗用BCH碼的生成多項式和校驗多項式及其相應的矩陣并構造實驗用BCH碼;(2)建立基于可重構FPGA的基核——構造具有可重構特性的硬件功能單元,以此作為可重構BCH碼電路的設計基礎;(3)構造實現可重構BCH糾錯碼電路的方法——建立可重構糾錯碼硬件電路算法并進行實驗驗證;(4)在可重構糾錯碼電路基礎上,構造進化硬件控制功能塊的結構,完成各進化RLA控制模塊的驗證和實現.課題是將可重構BCH碼的編譯碼電路的實現作為一類ASR-FPGA的研究目標,主要成果是根據可編程邏輯電路的特點,選擇一種可編程樹的電路模型,并將它作為可重構FPGA電路的基核T;通過對循環BCH糾錯碼的構造原理和電路結構的研究,將基核模型擴展為能滿足糾錯碼電路需要的糾錯碼基本功能單元T;以T作為再劃分的基本單元,對FPGA進行"格式化",使T規則排列在FPGA上,通過對T的控制端的不同配置來實現糾錯碼的各個功能單元;在可重構基核的基礎上提出了糾錯碼重構電路的嵌套式GA理論模型,將嵌套式GA的染色體串作為進化硬件描述語言,通過轉換為相應的VHDL語言描述以實現硬件電路;采用RLA模型的有限狀態機FSM方式實現了可重構糾錯碼電路的EHW的各個控制功能塊.在實驗方面,利用Xilinx FPGA開發系統中的VHDL語言和電路圖相結合的設計方法建立了循環糾錯碼基核單元的可重構模型,進行循環糾錯BCH碼的電路和功能仿真,在Xilinx公司的Virtex600E芯片進行了FPGA實現.課題在研究模型上選取的是比較基本的BCH糾錯碼電路,立足于解決基于可重構FPGA核的設計的基本問題.課題的研究成果及其總結的一套ASR-FPGA進化硬件電路的設計方法對實際的進化硬件設計具有一定的實際指導意義,提出的基于專用類基核FPGA電路結構的研究方法為新型進化硬件的器件結構的設計也可提供一種借鑒.
上傳時間： 2013-07-01
上傳用戶：myworkpost
一些基于matlab/simulink的模型，以及s-function實現的網絡控制系統模型，其中計算機、網絡部分采用truetime模塊！
上傳時間： 2014-01-08
上傳用戶：小寶愛考拉
該函數仿真CDMA系統的信道，在輸入所需用戶序列和其他干擾用戶序列后在信號上疊加高斯白噪聲，干擾用戶多徑干擾和所需用戶的多徑干擾和衰落。并根據輸入延時曲線產生信道延時，輸出mul_fad_sequence為信道信號輸出，max_delay為信道最大延遲，fade_sign為瑞利信道中最大幅度分量的衰落量 mpath_amp為信道多徑的幅度因子
上傳時間： 2013-12-18
上傳用戶：woshiayin
對于移動通信系統主要有兩類衰落：大規模衰落和小規模衰落。大規模衰落表示由于大范圍內移動而引起的平均信號能量的減少或路徑損耗。而小規模衰落則表現為兩種機制：信號的時延擴展和信道的時變特性。對于無線應用，信道的時變特性是由于發射機和接收機相對移動而造成傳輸路徑的變化。這些傳播條件的變化速率影響衰落率。如果存在大量反射路徑而不存在視行信號分量，此時的小規模衰落稱為瑞利衰落(Rayleigh fading)，接收信號的包絡由瑞利概率分布函數統計描述。這種衰落也就是這次實驗我準備研究的
上傳時間： 2013-12-23
上傳用戶：gmh1314
采用eigen value來模擬各種衰落信道的源碼程序，可以仿真瑞利衰落和AWGN疊加等等的情況。有詳細注釋。
上傳時間： 2016-01-24
上傳用戶：520
無線OFDM系統中的信道估計研究，講述了無線信道的模型和關鍵參數，對基于導頻的信道估計做了深入分析
上傳時間： 2016-03-05
上傳用戶：wxhwjf
qpsk在raylaigh信道下的誤碼率曲線，及其瑞利分布函數
上傳時間： 2014-01-01
上傳用戶：yimoney
無線信道模型中的LTE信道模型的仿真程序，MATLAB仿真
上傳時間： 2014-01-26
上傳用戶：李夢晗
1.有三根桿子A,B,C。A桿上有若干碟子 2.每次移動一塊碟子,小的只能疊在大的上面 3.把所有碟子從A桿全部移到C桿上 經過研究發現，漢諾塔的破解很簡單，就是按照移動規則向一個方向移動金片： 如3階漢諾塔的移動：A→C,A→B,C→B,A→C,B→A,B→C,A→C 此外，漢諾塔問題也是程序設計中的經典遞歸問題
上傳時間： 2016-07-25
上傳用戶：gxrui1991
仿真CDMA系統的信道，在輸入所需用戶序列和其他干擾用戶序列后在信號上疊加高斯白噪聲，干擾用戶多徑干擾和所需用戶的多徑干擾和衰落。并根據輸入延時曲線產生信道延時，輸出mul_fad_sequence為信道信號輸出，max_delay為信道最大延遲，fade_sign為瑞利信道中最大幅度分量的衰落量，mpath_amp為信道多徑的幅度因子
上傳時間： 2016-08-12
上傳用戶：chenbhdt
