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正弦信號發(fā)(fā)生器

  • 基于FPGA的MJPEG視頻解碼器

    基于FPGA的MJPEG視頻解碼器的芯片設計

    標簽: MJPEG FPGA 視頻解碼器

    上傳時間: 2013-06-10

    上傳用戶:wanqunsheng

  • 基于FPGA的Turbo碼編譯碼器實現(xiàn)

    基于FPGA的Turbo碼編譯碼器實現(xiàn)基于FPGA的Turbo碼編譯碼器實現(xiàn)

    標簽: Turbo FPGA 編譯碼器

    上傳時間: 2013-06-13

    上傳用戶:ippler8

  • 基于VHDL語言的卷積碼編解碼器的設計

    本文在闡述卷積碼編解碼器基本工作原理的基礎上,提出了在MAX+PlusⅡ開發(fā)平臺上基于VHDL語言設計(2,1,6)卷積碼編解碼器的方法。

    標簽: VHDL 語言 卷積碼 編解碼器

    上傳時間: 2013-06-16

    上傳用戶:zfh920401

  • 海信HDP2968CH/HDP2978CH(ASIC機芯8380)彩電電路圖

    海信HDP2968CH彩電電路圖海信HDP2968CH彩色電視機電路圖,海信HDP2968CH彩電圖紙,海信HDP2968CH原理圖

    標簽: HDP 2968 CH 2978

    上傳時間: 2013-05-21

    上傳用戶:zhangsan123

  • 小功率光伏逆變器的設計

    文章首先分析比較了光伏并網(wǎng)逆變器的各種主電路結構優(yōu)缺點,提出適合小 功率光伏系統(tǒng)的兩級式并網(wǎng)結構,并對前級DC-DC電路和后級DC-AC分別進行 了電路結構的選擇。

    標簽: 小功率 光伏逆變器

    上傳時間: 2013-06-14

    上傳用戶:jjj0202

  • 基于FPGA技術的HDLC幀收發(fā)器

    基于FPGA技術的HDLC幀收發(fā)器的設計與實現(xiàn)

    標簽: FPGA HDLC 收發(fā)器

    上傳時間: 2013-05-24

    上傳用戶:lindor

  • USBISP下載器驅動

    USBISP下載器驅動USBISP下載器驅動及說明(USBISP配置用戶用)\RZ-USBISP使用說明

    標簽: USBISP 下載器 驅動

    上傳時間: 2013-07-03

    上傳用戶:coeus

  • ChenMobius通信系統(tǒng)的FPGA硬件實現(xiàn)

    自上個世紀九十年代以來,我國著名學者、現(xiàn)中國科學院院士、清華大學陳難先教授等人使用無窮級數(shù)的Mobius反演公式解決了一系列重要的物理學中的逆問題,開創(chuàng)了應用、推廣數(shù)論中的Mobius變換解決物理學中各種逆問題的巧妙方法,其工作在1990年當時就得到了世界著名的《NATURE》雜志的高度評價。 華僑大學蘇武潯教授等則把Mobius變換的方法應用于幾種常用波形(包括周期矩形脈沖,奇偶對稱方波和三角波等)的傅立葉級數(shù)的逆變換運算,得到正、余弦函數(shù)及一般周期信號的各種常用波形的信號展開;并求得了與各種常用波形信號函數(shù)族相正交的函數(shù)族,以用于各展開系數(shù)的計算與信息的解調(diào);而后把它們應用到通信系統(tǒng)中,提出了一種新的通信系統(tǒng),即新型Chen-Mobius通信系統(tǒng)。 本文主要完成了兩個方面的工作,Chen-Mobius多路通信系統(tǒng)的FPGA硬件設計實現(xiàn)和基于Chen-Mobius變換的語音加密雙工通信系統(tǒng)的實現(xiàn)。首先,利用嵌入MATLAB\SIMULINK中的DSPBuilder軟件對Chen-Mobius多路(四路和八路)通信系統(tǒng)進行仿真分析,對該系統(tǒng)在不同信噪比情況下的錯誤概率進行了計算,并繪出了信噪比-錯誤概率曲線;其次,利用DSPBuilder中的Signalcompiler將Chen-Mobius多路通信系統(tǒng)的主體模塊(函數(shù)及積分器的產(chǎn)生等)轉化成HDL硬件語言,后在QuartusⅡ軟件平臺上,結合利用VHDL編程的硬件程序模塊(分頻、延時、控制模塊等)構架完整的Chen-Mobius通信系統(tǒng),并對此系統(tǒng)設計綜合、引腳分配、仿真驗證、時序分析等;最后,在Altera公司的Stratix 芯片上,實現(xiàn)硬件的編程和下載,從而完成了Chen-Mobius多路通信系統(tǒng)的FPGA硬件實現(xiàn)。 另外,利用Chen-Mobius單路通信系統(tǒng)的調(diào)制、解調(diào)系統(tǒng)分別對語音信號進行加密與解密,在兩塊DE2的FPGA開發(fā)板上成功實現(xiàn)了基于Chen-Mobius變換的語音加密雙工通信。完成本設計意義重大,它為今后Chen-Mobius通信系統(tǒng)應用于通信領域的各個方面,邁開堅實的一步。

    標簽: ChenMobius FPGA 通信系統(tǒng) 硬件實現(xiàn)

    上傳時間: 2013-07-24

    上傳用戶:xaijhqx

  • 可重構24bit音頻過采樣DAC的FPGA

    基于過采樣和∑-△噪聲整形技術的DAC能夠可靠地把數(shù)字信號轉換為高精度的模擬信號(大于等于16位)。采用這一架構進行數(shù)模轉換具有諸多優(yōu)點,例如極低的失配噪聲和更高的可靠性,便于實現(xiàn)嵌入式集成等,最重要的是可以得到其他DAC結構所無法達到的精度和動態(tài)范圍。在高精度測量,音頻轉換,汽車電子等領域有著廣泛的應用價值。 本文采用∑-△結構以FPGA方式實現(xiàn)了一個具有高精度的數(shù)模轉換器,在24比特的輸入信號下,達到了約150dB的信噪比。作為一個靈活的音頻DAC實現(xiàn)方案。該DAC可以對CD/DVD/HDCD/SACD等多種制式下的音頻信號進行處理,接受并轉換采樣率為32/44.1/48/88.2/96/192kHz,字長為16/18/20/24比特的PCM數(shù)據(jù),具備良好的兼容性和通用性。 由于非線性和不穩(wěn)定性的存在,高階∑-△調(diào)制器的設計與實現(xiàn)存在較大的難度。本文綜合大量文獻中的經(jīng)驗原則和方法,闡述了穩(wěn)定的高階高精度調(diào)制器的設計流程;并據(jù)此設計了達到24bit精度和滿量程輸入范圍的的5階128倍調(diào)制器。本文創(chuàng)新性地提出了∑-△調(diào)制器的一種高效率流水線實現(xiàn)結構。分析表明,與其他常見的∑-△調(diào)制器實現(xiàn)結構相比,本方案具有結構簡單、運算單元少等優(yōu)點;此外在同樣信號采樣率下,調(diào)制器所需的時鐘頻率大大降低。 文中的過采樣濾波模塊采用三級半帶濾波器和一個可變CIC濾波器級聯(lián)組成,可以達到最高128倍的過采樣比,同時具有良好的通帶和阻帶特性。在半帶濾波器的設計中采用了CSD編碼,使結構得到了充分的簡化。 本文提出的過采樣DAC方案具有可重配置結構,讓使用者能夠方便地控制過采樣比和調(diào)制器階數(shù)。通過積分梳狀濾波器的配置,能夠獲得32/64/128倍的不同過采樣比,從而實現(xiàn)對于32~192kHz多種采樣率輸入的處理。在不同輸入字長情況下,通過調(diào)制器的重構,則可以將調(diào)制器由高精度的5階模式改變?yōu)楣母偷?階模式,滿足不同分辨率信號輸入時的不同精度要求。這是本文的另一創(chuàng)新之處。 目前,該過采樣DAC已經(jīng)在XilinxVirtexⅡ系列FPGA器件下得到硬件實現(xiàn)和驗證。測試表明,對于從32kHz到192kHz的不同輸入信號,該DAC模塊輸出1比特碼流的帶內(nèi)信噪比均能滿足24比特數(shù)據(jù)轉換應用的分辨率要求。

    標簽: FPGA bit DAC 24

    上傳時間: 2013-07-08

    上傳用戶:從此走出陰霾

  • 有線數(shù)字電視廣播系統(tǒng)信道編碼

    隨著數(shù)字電視全國范圍丌播時間表的臨近,數(shù)字電視技術得到很大發(fā)展,數(shù)字電視信號在信源基帶數(shù)據(jù)和信道傳輸?shù)确矫嬉呀?jīng)進一步標準化,數(shù)字電視傳播途徑也越來越廣,在衛(wèi)星、地面及有線電視網(wǎng)中傳輸數(shù)字電視信號得到迅速發(fā)展。借著2008年奧運的東風,數(shù)字電視領域的應用研究方興未艾。 本課題目的是完成有線數(shù)字電視廣播系統(tǒng)的重要設備--調(diào)制器的設計和實現(xiàn),核心器件選用FPGA芯片。系統(tǒng)硬件實現(xiàn)以國家標準GY/T 170-2001(有線數(shù)字電視廣播信道編碼與調(diào)制規(guī)范)為主要依據(jù),以Xilinx公司的Virtex系列(Virtex 4,Virtex 5)芯片及相關開發(fā)板(ML402、ML506)為平臺,主要任務是基于相關標準對其實用技術進行研究和開發(fā)。完成了信道編碼和調(diào)制的模塊劃分、Verilog HLD程序的編寫(或IP核的調(diào)用)和仿真以及在板調(diào)試和聯(lián)調(diào)等工作,設計目的是在提高整個系統(tǒng)集成度的前提下實現(xiàn)多頻點調(diào)制。 本文在研究現(xiàn)有數(shù)字電視網(wǎng)絡技術和相關產(chǎn)品的基礎上,以國標GY/T170-2001為主要依據(jù)并參閱了其他的相關標準,提出了多頻點QAM調(diào)制器的實現(xiàn)方案。整個工作包括:模塊劃分,完成了基帶物理接口(輸入)、包頭反轉與隨機化、RS編碼、卷積交織、碼流變換、差分編碼、星座映射、基帶成型(包括Nyquist濾波器、半帶濾波器、CIC濾波器的設計或模塊調(diào)用)、高端DAC的配置(輸出)等模塊的Verilog HLD程序的編寫(或者IP核調(diào)用)和仿真等工作;成功進行了開發(fā)板板級調(diào)試,調(diào)試的過程中充分利用Xilinx公司的開發(fā)板和調(diào)試軟件ChipScope,成功設計了驗證方案并進行了模塊驗證;最后進行了各模塊聯(lián)調(diào)工作,設計了系統(tǒng)驗證方案并成功完成對整個系統(tǒng)的驗證工作。 經(jīng)測試表明,該系統(tǒng)主要性能達到國家相關標準GY/T 198-2003(有線數(shù)字電視廣播QAM調(diào)制器技術要求和測量方法)規(guī)定的技術指標,可以進入樣機試生產(chǎn)環(huán)節(jié)。

    標簽: 有線數(shù)字電視 廣播系統(tǒng) 信道編碼

    上傳時間: 2013-04-24

    上傳用戶:jiangfire

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