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波導(dǎo)(dǎo)縫隙

  • 波導(dǎo)- 微帶探針過渡CAD技術(shù)

    本文介紹了一種基于矩形波導(dǎo)-微帶探針耦合結(jié)構(gòu)等效電路的波導(dǎo)-微帶探針過渡CAD 方法應(yīng)用商業(yè)3 維電磁場分析軟件和微波電路CAD 軟件快速完成波導(dǎo)-微帶探針過渡的優(yōu)化設(shè)計設(shè)計實例和測試結(jié)果證明了該方法的有效性

    標(biāo)簽： CAD 波導(dǎo) 微帶探針

    上傳時間： 2013-10-26

    上傳用戶：caiqinlin

  • ZMNL的相關(guān)廣義K分布寬帶雷達(dá)雜波仿真

    文中首先研究了廣義K分布模型及其統(tǒng)計特性,得到了相關(guān)系數(shù)之間的非線性關(guān)系。從而利用零記憶非線性變換(ZMNL)方法仿真了相關(guān)廣義K分布雜波,給出了基于ZMNL法的相關(guān)廣義K分布雜波序列仿真原理和算法流程圖,并仿真了幾種經(jīng)典的特殊廣義K分布。

    標(biāo)簽： ZMNL K分布 廣義 寬帶雷達(dá)

    上傳時間： 2013-10-24

    上傳用戶：cccole0605

  • AMTI對箔條雜波抑制作用的仿真

        機(jī)械動目標(biāo)顯示（AMTI）技術(shù)廣泛應(yīng)用于機(jī)械雷達(dá)系統(tǒng)，用于抑制和衰減地物等靜止物體的背景回?fù)苄盘枴Ｎ闹懈鶕?jù)AMTI的基本原理，提出利用AMTI抑制箔條慢動雜波的方法，并建立基于AMTI的機(jī)械雷達(dá)信號處理系統(tǒng)模型......

    標(biāo)簽： AMTI 雜波 仿真

    上傳時間： 2013-10-13

    上傳用戶：wmwai1314

  • 1KHz正弦波信號

    1KHz正弦波信號

    標(biāo)簽： 1KHz 正弦波信號

    上傳時間： 2014-05-28

    上傳用戶：希醬大魔王

  • 1KHz正弦波信號

    1KHz正弦波信號

    標(biāo)簽： 1KHz 正弦波信號

    上傳時間： 2013-11-30

    上傳用戶：skfreeman

  • VHDL各種D觸發(fā)器程序

    了解各種D觸發(fā)器

    標(biāo)簽： VHDL D觸發(fā)器 程序

    上傳時間： 2013-10-29

    上傳用戶：wwwe

  • 基于FPGA的激光測距回波信號高速采集研究

    在激光測距系統(tǒng)中，微弱回波信號的檢測處理一直是一個難題。本文主要討論了激光測距接收系統(tǒng)的實現(xiàn)方法，這種測距方法既適用于短距離的測量又適用于長距離的測量。首先介紹了脈沖式激光測距的原理，在此原理的基礎(chǔ)上，結(jié)合FPGA的高速信號處理能力，設(shè)計了高精度激光測距接收系統(tǒng)，并設(shè)計了回波信號接收與計數(shù)電路模塊。

    標(biāo)簽： FPGA 激光測距 回波信號 高速采集

    上傳時間： 2015-01-01

    上傳用戶：非衣2016

  • Nexys3板卡培訓(xùn)資料

    　　本資料是關(guān)于Nexys3板卡的培訓(xùn)資料。Nexys 開發(fā)板是基于最新技術(shù)Spartan-6 FPGA的數(shù)字系統(tǒng)開發(fā)平臺。它擁有48M字節(jié)的外部存儲器（包括2個非易失性的相變存儲器），以及豐富的I/O器件和接口，可以適用于各式各樣的數(shù)字系統(tǒng)。 板上自帶AdeptTM高速USB2接口可以為開發(fā)板提供電源，也可以燒錄程序到FPGA，用戶數(shù)據(jù)的傳輸速率可以達(dá)到38M字節(jié)/秒。 　　Nexys3開發(fā)板可以通過添加一些低成本的外設(shè)Pmods （可以多達(dá)30幾個）和Vmods （最新型外設(shè)）來實現(xiàn)額外的功能，例如A/D和D/A轉(zhuǎn)換器，線路板，電機(jī)驅(qū)動裝置，和實現(xiàn)裝置等等。另外，Nexys3完全兼容所有的賽靈思工具，包括免費的WebPackTM，ChipscopeTM，EDKTM（嵌入式處理器設(shè)計套件），以及其他工具。 圖 Nexys3板卡介紹

    標(biāo)簽： Nexys3 板卡 培訓(xùn)資料

    上傳時間： 2013-10-24

    上傳用戶：caiqinlin

  • XAPP520將符合2.5V和3.3V I/O標(biāo)準(zhǔn)的7系列FPGA高性能I/O Bank進(jìn)行連接

    XAPP520將符合2.5V和3.3V I/O標(biāo)準(zhǔn)的7系列FPGA高性能I/O Bank進(jìn)行連接  The I/Os in Xilinx® 7 series FPGAs are classified as either high range (HR) or high performance (HP) banks. HR I/O banks can be operated from 1.2V to 3.3V, whereas HP I/O banks are optimized for operation between 1.2V and 1.8V. In circumstances that require an HP 1.8V I/O bank to interface with 2.5V or 3.3V logic, a range of options can be deployed. This application note describes methodologies for interfacing 7 series HP I/O banks with 2.5V and 3.3V systems

    標(biāo)簽： XAPP FPGA Bank 520

    上傳時間： 2013-11-06

    上傳用戶：wentianyou

  • 多級小波逆變換實時系統(tǒng)方案

    提出了一種基于FPGA的多級小波逆變換的高速、實時的硬件解決方案。仿真驗證表明本方案能夠滿足連續(xù)輸入的數(shù)據(jù)進(jìn)行實時處理的要求,并且所設(shè)計的系統(tǒng)具有功耗低、成本低等優(yōu)點。

    標(biāo)簽： 多級 小波逆變換 實時系統(tǒng) 方案

    上傳時間： 2013-12-20

    上傳用戶：JasonC

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