混合動力汽車作為解決汽車節能、降低排放的汽車工業新技術，具有低污染和低油耗的特點，尤其在油價日益攀高的今天，成為國內外汽車發展的新熱點。驅動控制器作為混合動力汽車中的主要部件，在混合動力汽車中起到至關重要的作用，對其進行研究具有重要的理論和現實意義。 本文首先比較了常見的幾種電動汽車的性能，概括了混合動力汽車的優點，介紹了混合動力汽車發電機/電動機一體化技術的發展現狀；其次探討了幾種常用交流電動機的性能優劣。由于永磁同步電機具有高效、高功率密度以及良好的調速性能，因此該電機成為本課題混合動力汽車傳動中所使用的電機，論文建立了永磁電動機的數學模型，分析了矢量控制原理；在矢量控制原理的基礎上，設計出了基于TMS320F2812的永磁同步電機矢量控制系統的硬件結構，詳細闡述了旋轉變壓器及其解碼芯片在系統中的角度和速度的檢測原理以及系統中其他重要的單元。設計了系統的軟件結構，詳細闡述了關鍵子程序如電流采集、位置檢測程序和SVPWM產生子程序：使用UG軟件設計出控制器的殼體。最后進行了實驗研究，給出SVPWM波形、相電流波形，進行了全文總結，提出了下一步工作的建議。
上傳時間： 2013-05-21
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移動機器人是機器人研究領域中重要的一個分支，智能移動機器人集人工智能、智能控制、信息處理、圖象處理、檢測與轉換等專業技術為一體，跨計算’機、自動控制、機械、電子等多學科，成為當前智能機器人研究的重點之一。路徑規劃是移動機器人研究的一個基本而又極其重要的課題。靈活有效的路徑規劃算法能夠幫助機器人適應各種復雜的環境，大大提高機器人的應用領域，尤其是使移動機器人具備自動識別環境的能力，能在未知環境下完成一定的工作。 本文的主要任務是以LEGO Technic組件為本體，重新設計一個控制器，并據此研究移動機器人的避障和路徑規劃策略。為滿足移動機器人避障的實時性、準確性要求，需要有一個功能完善的硬件平臺，實現信息采集、處理以及避障的策略。本文設計了一套移動機器人控制器，該控制器以DSP TMS320F2407A為核心，輔之以相應的外圍電路、傳感器、人機交互、串行通信和電源等模塊。車體動力學實驗及避障實驗結果驗證了本文所設計的控制器的性能。 在對移動機器人的避障策略的研究過程中，采用了基于虛擬力場法的位置閉環控制方法，這種方法簡化了傳統避障方法的數學運算過程，提高了機器人對障礙物的反應速度。最后，設計了一套實驗系統，進行相應的避障方法實驗。結果表明，所設計的控制器能夠完成基本的實時避障功能。
上傳時間： 2013-06-30
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高速發展的DSP技術為語音信號處理領域提供了良好的發展平臺，使得實時實現各種復雜的算法稱為可能。G．729語音編碼是國際電信聯盟(ITU-T)于1996年獲準通過的采用共軛結構代數碼激勵線性預測技術的具有8 kbit/s碼速率的語音算法建議，廣泛應用于數字移動通信、IP電話和數字衛星通信中。本文研究了G．729語音編碼原理和在TMS320C5416定點DSP芯片上實時實現該編碼器過程中的軟、硬件設計。主要涉及有以下幾方面內容： 1．介紹語音編碼技術和DSP技術的發展概況。 2．研究了基于CELP結構的G．729編碼的算法原理。 3．根據G．729聲碼器實時實現的需要，介紹硬件平臺的組成，研究了系統軟件的設計和基于算法和實時需要的軟件優化。 4．利用DSP代碼調試工具對系統性能進行分析，得出測試結果。
上傳時間： 2013-07-11
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快速傅立葉變換(FFT)技術是數字信號處理中的核心技術，它已廣泛應用于數字信號處理的各個領域，長期以來一直是一個重要的研究課題。近年來，專用數字信號處理器以其優化的硬件結構和優良的性能價格比為FFT的實現提供了一種有效的途徑，其中最具有代表性的是美國TI公司的TMS320系列DSP。 本文首先分析了常用FFT算法原理，并進行了算法的討論和比較，然后詳細論述了以浮點型DSP為核心的實現FFT算法的硬件平臺的設計。平臺的硬件電路主要包括數據采集部分、數據處理部分、數據存儲部分和數據顯示部分。其中采集部分采用12位高速的A/D轉換芯片MAX197，數據處理部分采用32位浮點型DSP芯片-TMS320VC33，數據存儲部分采用了大容量的FLASH芯片——K9F2808UOA，數據顯示部分采用PHILIPS公司的高亮度、寬視角的TFT彩色液晶顯示屏。 為了擴展系統的通信能力，通信接口我們選擇CAN總線。軟件部分選用了頻率抽取基2FFT、分裂基FFT和實序列FFT算法，用C語言進行編程。最后部分是進行軟硬件的聯合調試，并在此基礎上進行了FFT算法實現。 論文結尾以實際的實驗曲線分析驗證了算法的正確性，同時針對實驗中產生的誤差找出了原因，并提出了解決的方法。實驗結果表明采用浮點DSP實現FFT算法方便且有較高的實時性，可以應用到電力系統諧波分析、振動測試及鐵路檢測等各個領域。
上傳時間： 2013-04-24
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60年代初，國際上首次將B超診斷儀應用于臨床診斷，40多年來B超診斷儀的發展極為迅速。隨著數字信號處理及計算機技術的發展，目前國際上先進水平的超聲診斷設備幾乎每一個環節都包含著數字信號處理的內容，研制全數字化的超聲診斷設備已成為發展趨勢。 @@ 基于FPGA及嵌入式操作系統的全數字超聲診斷系統具有技術含量高、便攜的特點，可用數字硬件電路來實現數據量極其龐大的超聲信息的實時處理。 @@ 本文從超聲診斷原理入手，在對超聲診斷系統中的幾個關鍵技術進行分析的基礎上，重點研究開發超聲診斷系統中數字信號處理部分的兩個核心算法。以FPGA芯片為載體，在Quartus Ⅱ平臺中采用Verilog HDL語言進行編程并仿真驗證，分別實現了數字FIR濾波器及CORDIC坐標變換兩個模塊的功能。另外，采用Verilog HDL語言對應用于圖像顯示模塊的SPI接口進行了編程設計，編譯下載至FPGA中，最終實現了與ARM A8的OMPG3530板之間高速串行數據的傳輸。 @@ 采用在單片FPGA芯片內實現數字式超聲診斷部分核心算法并與高性能ARMA8處理器相配合的數字信號處理解決方案，具有高速度、高精度、高集成度、便攜的特點，為全數字化便攜超聲診斷設備的研制打下了基礎。 @@關鍵詞：超聲診斷系統；FPGA；數字FIR濾波器；CORDIC算法；SPI總線
上傳時間： 2013-07-07
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圖像壓縮 h264等壓縮算法源碼 c語言源碼
上傳時間： 2013-05-25
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PID算法在AVR單片機上的應用，風機的閉環控制
上傳時間： 2013-04-24
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高性能ADC產品的出現，給混合信號測試領域帶來前所未有的挑戰。并行ADC測試方案實現了多個ADC測試過程的并行化和實時化，減少了單個ADC的平均測試時間，從而降低ADC測試成本。 本文實現了基于FPGA的ADC并行測試方法。在閱讀相關文獻的基礎上，總結了常用ADC參數測試方法和測試流程。使用FPGA實現時域參數評估算法和頻域參數評估算法，并對2個ADC在不同樣本數條件下進行并行測試。 通過在FPGA內部實現ADC測試時域算法和頻域算法相結合的方法來搭建測試系統，完成音頻編解碼器WM8731L的控制模式接口、音頻數據接口、ADC測試時域算法和頻域算法的FPGA實現。整個測試系統使用Angilent 33220A任意信號發生器提供模擬激勵信號，共用一個FPGA內部實現的采樣時鐘控制模塊。并行測試系統將WM8731.L片內的兩個獨立ADC的串行輸出數據分流成左右兩通道，并對其進行串并轉換。然后對左右兩個通道分別配置一個FFT算法模塊和時域算法模塊，并行地實現了ADC參數的評估算法。 在樣本數分別為128和4096的實驗條件下，對WM8731L片內2個被測.ADC并行地進行參數評估，被測參數包括增益GAIN、偏移量OFFSET、信噪比SNR、信號與噪聲諧波失真比SINAD、總諧波失真THD等5個常用參數。實驗結果表明，通過在FPGA內配置2個獨立的參數計算模塊，可并行地實現對2個相同ADC的參數評估，減小單個ADC的平均測試時間。 FPGA片內實時評估算法的實現節省了測試樣本傳輸至自動測試機PC端的時間。而且只需將HDL代碼多次復制，就可實現多個被測ADC在同一時刻并行地被評估，配置靈活。基于FPGA的ADC并行測試方法易于實現，具有可行性，但由于噪聲的影響，測試精度有待進一步提高。該方法可用于自動測試機的混合信號選項卡或測試子系統。 關鍵詞：ADC測試；并行；參數評估；FPGA；FFT
上傳時間： 2013-07-11
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電力電子裝置的控制技術隨著電力電子技術的發展而愈來愈復雜。開關電源是現代電力電子設備中不可或缺的組成部分，其質量的優劣以及體積的大小直接影響電子設備整體性能。高頻化、小型化、數字化是開關電源的發展方向。 在應用數字技術進行控制系統設計時，數字控制器的性能決定了控制系統的整體性能。數字化電力電子設備中的控制部分多以MCU/DSP為核心，以軟件實現離散域的運算及控制。在很多高頻應用的場合，目前常用的控制器(高性能單片機或DSP)的速度往往不能完全滿足要求。FPGA具有設計靈活、集成度高、速度快、設計周期短等優點，與單片機和DSP相比，FPGA具有更高的處理速度。同時FPGA應用在數字化電力電子設備中，還可以大大簡化控制系統結構，并可實現多種高速算法，具有較高的性價比。 依據FPGA的這些突出優點，本文將FPGA應用于直流開關電源控制器設計中，以實現開關電源數字化和高頻化的要求。主要研究工作如下： 介紹了基于FPGA的DC/DC數字控制器中A/D采樣控制、數字PI算法的實現；重點描述了采用混合PWM方法實現高分辨率、高精度數字PWM的設計方案，并對各模塊進行了仿真測試；用FPGA開發板進行了一部分系統的仿真和實際結果的檢測，驗證了文中的分析結論，證實了可編程邏輯器件在直流開關電源控制器設計中的應用優勢。
上傳時間： 2013-07-23
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隨著數字化技術的飛速發展，數字視頻信號的傳輸技術更是受到人們的關注。相比較其它類型的信息傳輸如文本和數據，視頻通信需要占用更多的帶寬資源，因此為了實現在帶寬受限的條件下的傳輸，視頻源必須經過大量壓縮。盡管現在的網絡狀況不斷地改善，但相對與快速增長的視頻業務而言，網絡帶寬資源仍然是遠遠不夠的。2003年3月，新一代視頻壓縮標準H．264/AVC的推出，使視頻壓縮研究進入了一個新的層次。H．264標準中包含了很多先進的視頻壓縮編碼方法，與以前的視頻編碼標準相比具有明顯的進步。在相同視覺感知質量的情況下，H．264的編碼效率比H．263提高了一倍左右，并且有更好的網絡友好性。然而，高編碼壓縮率是以很高的計算復雜度為代價的，H．264標準的計算復雜度約為H．263的3倍，所以在實際應用中必須對其算法進行優化以減低其計算復雜度。 @@ 本文首先介紹了H．264標準的研究背景，分析了國內外H．264硬件系統的研究現狀，并介紹了本文的主要工作。 @@ 接著對H．264編碼標準的理論知識、關鍵技術分別進行了介紹。 @@ 對H．264塊匹配運動估計算法進行研究，對經典的塊匹配運動估計算法通過對比分析，三步、二維等算法在搜索效率上優于全搜索算法，而全搜索算法在數據流的規則性和均勻性有著自己的優越性。 @@ 針對塊匹配運動估計全搜索算法的VLSI結構的特點，提出改進的塊匹配運動估計全搜索算法。本文基于對數據流的分析，對硬件尋址進行了研究。通過一次完整的全搜索數據流分析，改進的塊匹配運動估計算法在時鐘周期、PE資源消耗方面得到優化。 @@ 最后基于FPGA平臺對整像素運動估計模塊進行了研究。首先對運動估計模塊結構進行了功能子模塊劃分；然后對每個子模塊進行設計和仿真和對整個運動估計模塊進行聯合仿真驗證。 @@關鍵詞：H．264；FPGA；QuartusⅡ；幀間預測；運動估計；塊匹配
上傳時間： 2013-04-24
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