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測距模塊

  • 單模光纖和多模光纖的區別

    根據傳輸點模數的不同,光纖可分為單模光纖和多模光纖。所謂"模"是指以一定角速度進入光纖的一束光。單模光纖采用固體激光器做光源,多模光纖則采用發光二極管做光源。多模光纖允許多束光在光纖中同時傳播,從而形成模分散(因為每一個“模”光進入光纖的角度不同它們到達另一端點的時間也不同,這種特征稱為模分散。),模分散技術限制了多模光纖的帶寬和距離,因此,多模光纖的芯線粗,傳輸速度低、距離短,整體的傳輸性能差,但其成本比較低,一般用于建筑物內或地理位置相鄰的環境下。單模光纖只能允許一束光傳播,所以單模光纖沒有模分散特性,因而,單模光纖的纖芯相應較細,傳輸頻帶寬、容量大,傳輸距離長,但因其需要激光源,成本較高。  

    標簽: 單模光纖 多模光纖

    上傳時間: 2013-10-30

    上傳用戶:wsq921779565

  • 諾基亞LCD3310液晶取模軟件

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    標簽: 3310 LCD 諾基亞 液晶取模

    上傳時間: 2013-11-09

    上傳用戶:佳期如夢

  • zimo221取模軟件

    取模軟件

    標簽: zimo 221 取模軟件

    上傳時間: 2013-11-19

    上傳用戶:tsfh

  • 諾基亞LCD3310液晶取模軟件

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    標簽: 3310 LCD 諾基亞 液晶取模

    上傳時間: 2013-10-18

    上傳用戶:問題問題

  • 基于FPGA技術的偏振模色散自適應補償技術設計與仿真

    我國的骨干通信網上的傳輸速率已經向40 GB/s甚至是160 GB/s發展,傳輸線路以光纖作為主要的傳輸通道。與光纖相關的損耗和單模光纖的主要色散,即偏振模色散,不僅僅限制了光信號在通信過程中的傳輸距離,還很大程度上影響其通信容量。其中,偏振模色散對單模光纖高速和長距離通信的影響尤為突出。因此應現代光纖通信技術網的高速發展的需要,把當前流行的FPGA技術應用到單模光纖的偏振模色散的自適應補償技術中,用硬件描述語言來實現,可以大大提高光纖的偏振模色散自適應補償對實時性和穩定性的要求。

    標簽: FPGA 偏振模 仿真 補償技術

    上傳時間: 2014-01-22

    上傳用戶:wfeel

  • FPC模組軟板設計規范

    FPC模組軟板設計規范

    標簽: FPC 模組 軟板 設計規范

    上傳時間: 2013-10-18

    上傳用戶:kernaling

  • 如何通過仿真有效提高數?;旌显O計性

    一 、數?;旌显O計的難點 二、提高數?;旌想娐沸阅艿年P鍵 三、仿真工具在數?;旌显O計中的應用 四、小結 五、混合信號PCB設計基礎問答

    標簽: 仿真 上傳時間: 2013-10-31

    上傳用戶:bvdragon

  • GC0309模組設計指南

    GC0309模組設計指南

    標簽: 0309 GC 模組 設計指南

    上傳時間: 2013-11-24

    上傳用戶:zhangzhenyu

  • pcb layout design(臺灣硬件工程師15年經驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或導通孔。11. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-11-17

    上傳用戶:cjf0304

  • 共模干擾差模干擾及其抑制技術分析

    共模干擾和差模干擾是電子、 電氣產品上重要的干擾之一,它們 可以對周圍產品的穩定性產生嚴重 的影響。在對某些電子、電氣產品 進行電磁兼容性設計和測試的過程 中,由于對各種電磁干擾采取的抑 制措施不當而造成產品在進行電磁 兼容檢測時部分測試項目超標或通 不過EMC 測試,從而造成了大量人 力、財力的浪費。為了掌握電磁干 擾抑制技術的一些特點,正確理解 一些概念是十分必要的。共模干擾 和差模干擾的概念就是這樣一種重 要概念。正確理解和區分共模和差 模干擾對于電子、電氣產品在設計 過程中采取相應的抗干擾技術十分 重要,也有利于提高產品的電磁兼 容性。

    標簽: 共模干擾 差模 干擾

    上傳時間: 2013-11-05

    上傳用戶:410805624

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