本文的目的就是研究如何應用FPGA這種大規模的可編程邏輯器件實現CCD（Charge Coupled Device，電荷耦合器件）數字圖像的實時采集及預處理。基于對實時圖像處理系統的研究與設計，本文主要研究工作及成果如下： 1.本論文詳細的介紹了圖像采集卡的結構和基本工作原理。同時，針對高分辨率的CCD攝像機，探討了有關點目標與CCD像元一一對應的圖像采集及其硬件和軟件設計方法。 2.本文分析了星圖中弱小目標、噪聲以及背景的特點，給出了點目標的場景圖像的數學模型及復雜背景下點目標檢測的預處理方法。針對星圖灰度分布的特點，采用高斯低通濾波算法和高通濾波算法對星圖進行預處理，同時還對圖像掃描聚類算法進行了研究與分析。 3.數字信號處理器常常因為在復雜性、運算速度等方面的限制，難以實時的實現復雜的檢測算法。本文采用FPGA技術，實現了復雜背景下弱點目標的預處理算法，解決了計算、數據緩沖和存儲操作協調一致的問題，同時采用并行高密度加法器和流水線的工作方式，使整個系統的數據交換和處理速度得以很大的提高，合理的解決了資源和速度之間的相互制約問題，并在實際中取得滿意的結果。
上傳時間： 2013-07-03
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本文研制的數據采集器，用于采集導彈過載模擬試車臺的各種參數,來評價導彈在飛行過程中的性能，由于試車臺是高速旋轉體，其工作環境惡劣，受電磁干擾大，而且設備要求高，如果遇到設備故障或設備事故，其損失相當巨大，保證設備的安全性和可靠性較為困難。 本文在分析數字通信技術的基礎上，選用了基于現場可編程邏輯陣列(FPGA)采用脈沖編碼調制(PCM)通信實現多路數據采集器的設計，其優點是FPGA技術在數據采集器中可以進行模塊化設計，增加了系統的抗干擾性、靈活性和適應性，并且可以將整個PCM通信系統設計成可編程序系統，用戶只要稍加變更程序，則系統的被測路數、幀結構、碼速率、標度等均可改變以適應任何場合。并且采用合理的糾錯和加密編碼能夠實現數據在傳輸工程中的完整性和安全性。 通過對PCM通信的特點研究，研制了一套集采集與傳輸的系統。文章給出了各個模塊的具體建模與設計，系統采用的是FPGA技術來實現數據采集和信號處理，采用VHDL實現了數字復接器和分接器、編解碼器、調制與解調模塊的建模與設計。采用基于NiosII實現串口通訊，構建了實時性和準確性通信網絡，實現了數據的采集。 測試數據和數據采集的實驗結果證明，采用FPGA技術實現PCM信號的編碼、傳輸、解碼，能夠有較強的抗干擾性、抗噪聲性能好、差錯可控、易加密、易與現代技術結合，并且誤碼率較低，要遠遠優于傳統的方法。
上傳時間： 2013-04-24
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隨著嵌入式技術和網絡技術的發展和應用，充分結合兩種技術優勢的遠程數據采集終端正在不斷地被研究和開發。本文即是此背景下，綜合以往遠程數據采集終端的優缺點，對基于ARM的遠程數據采集智能終端予以研究和實現，該終端具備GPRS和INTERNET兩種接入方式。可通過RS232或A/D模塊采集用戶終端設備數據信息；在GPRS接入方式下使用GPRS無線數據終端通過GPRS網絡接入互聯網，在INTERNET接入方式下則直接接入互聯網；接入后則可向遠程控制中心上傳用戶終端據信息。本文研制的遠程數據采集終端可廣泛地應用包括環保數據采集在內的多種數據遠程采集場合。 本文主要做了以下研究工作： 1、對硬件資源進行了外圍擴展，對S3C44BOX處理器芯片的外圍硬件進行了擴展設計，使之具備了滿足使用需求的最小系統硬件資源。包括外圍存儲、LCD、鍵盤、以太網卡和GPRSi匿信模塊等。 2、運用多任務操作系統可以有效的組織并行任務的處理，本文對μc/os-Ⅱ操作系統進行了移植，對原有μc/os-Ⅱ操作系統的搶占式調度機制進行了改造，使之成為整體搶占，局部輪詢的調度機制；使之較好地滿足了實際要求。 3、無論采用GPRS方式還是INTERNET方式，設備終端與INTERNET實現通信都必須具備相應的協議。本文實現了TCP/IP有關網絡協議棧的建立，對協議進行了簡化設計，實現了兩種方式的接入，滿足了嵌入式終端的要求。 4、為了使終端具備較好的人機交互能力，構建了嵌入式圖形界面，實現了LCD圖形顯示和鍵盤輸入控制的交互功能。 通過以上工作，建立了一個功能齊全，實時可靠，基于嵌入式系統的遠程數據采集終端。
上傳時間： 2013-07-17
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目前，數字信號處理廣泛應用于通信、雷達、聲納、語音與圖像處理等領域，信號處理算法理論己趨于成熟，但其具體硬件實現方法卻值得探討。FPGA是近年來廣泛應用的超大規模、超高速的可編程邏輯器件，由于其具有高集成度、高速、可編程等優點，大大推動了數字系統設計的單片化、自動化，縮短了單片數字系統的設計周期、提高了設計的靈活性和可靠性，在超高速信號處理和實時測控方面有非常廣泛的應用。本文對FPGA的數據采集與處理技術進行研究，基于FPGA在數據采樣控制和信號處理方面的高性能和單片系統發展的新熱點，把FPGA作為整個數據采集與處理系統的控制核心。主要研究內容如下： FPGA的單片系統研究。針對數據采集與處理，對FPGA進行選型，設計了基于FPGA的單片系統的結構。把整個控制系統分為三個部分：多通道采樣控制模塊，數據處理模塊，存儲控制模塊。 多通道采樣控制模塊的設計。利用4片AD7506和一片AD7862對64路模擬量進行周期采樣，分別設計了通道選擇控制模塊和A/D轉換控制模塊，并進行了仿真，完成了基于FPGA的多通道采樣控制。 數據處理模塊的設計。FFT算法在數字信號處理中占有重要的地位，因此本文研究了FFT的硬件實現結構，提出了用FPGA實現FFT的一種設計思想，給出了總體實現框圖。分別設計了旋轉因子復數乘法器，碟形運算單元，存儲器，控制器，并分別進行了仿真。重點設計實現了FFT算法中的蝶形處理單元，采用了一種高效乘法器算法設計實現了蝶形處理單元中的旋轉因子乘法器，從而提高了蝶形處理器的運算速度，降低了運算復雜度。理論分析和仿真結果表明，狀態機控制器成功地對各個模塊進行了有序、協調的控制。 存儲控制模塊的設計。利用閃存芯片K9K1G08UOA對采集處理后的數據進行存儲，設計了FPGA與閃存的硬件連接，設計了存儲控制模塊。 本文對FFT算法的硬件實現進行了研究，結合單片系統的特點，把整個系統分為多通道采樣控制模塊，數據處理模塊，存儲控制模塊進行設計和仿真。設計采用VHDL編寫程序的源代碼。仿真測試結果表明，此FPGA單片系統可完成對實時信號的高速采集與處理。
上傳時間： 2013-07-06
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項目的研究內容是對硅微諧振式加速度計的數據采集電路開展研究工作。硅微諧振式加速度計敏感結構輸出的是兩路差分的頻率信號，因此硅微諧振式加速度計數據采集電路完成的主要任務是測出兩路頻率信號的差值。測量要求是：實現10ms內對中心諧振頻率為20kHz、標度因數為100Hz/g、量程為±50g、分辨率為1mg的硅微諧振式加速度計輸出的頻率信號的測量，等效測量誤差為±1mg。電路的控制核心為單片機，具有串行接口以便將測量結果傳送給PC機從而分析、保存測量結果。\\r\\n按研究內容設計了軟硬件。軟件采用多周期同步法
上傳時間： 2013-08-11
上傳用戶：csgcd001
摘 要: 閥門開度儀以AT89C51單片機為核心, 通過在閥門電機軸上安裝的電位計傳感器獲得閥 門電機軸的轉動角位移, 從而得出閥門的開度, 達到自動檢測的目的。詳細介紹了串行控制的10 位A /D轉換器TLC1549的特點和功能, 說明了TLC1549與AT89C51單片機在閥門開度儀中的硬件 電路和軟件程序。實踐證明, 該閥門開度儀數據采集準確可靠、工作穩定。 關鍵詞: TLC1549; AT89C51單片機; 閥門開度
上傳時間： 2013-10-14
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在借鑒傳統檢測方法的基礎上，根據壓路機振動信號與壓實程度的相關關系，提出了一種隨車壓實度實時檢測系統。該系統利用振動傳感器采集壓路機振動信號，并將該信號進行A/D轉換，放大、濾波，在時域和頻域進行數字信號處理，進而提取出壓實度實時數值。通過大量現場試驗驗證，本系統計算出的壓實度值與傳統壓實度檢測結果，具有高度的一致性和準確性。
上傳時間： 2015-01-02
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PCM－8506BS是一款基于PC/104總線的高性能同步采樣多功能數據采集卡，它完全遵循PC/104總線規范。該采集卡采用了每通道專用的模數轉換器(ADC)和信號處理電路的硬件架構，每個通道都有強大的處理能力和出色的精準度，可同步采樣多路模擬信號，可以實現直流和動態信號測量的高度準確性。PCM－8506BS具有每通道600kSPS的同步采樣速率，16位分辨率，2路模擬量輸出、8路數字I/O和2個定時/計數器。其每個模擬量輸入通道均有抗混疊濾波器以改善頻域分析性能，有豐富的觸發采集模式和觸發源供選擇，適用于多種高要求的數據采集場合，包括：電網監測、多相電機控制、高瞬變信號采集等。
上傳時間： 2013-10-17
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據說著名猶太歷史學家 Josephus有過以下的故事：在羅馬人佔領喬塔帕特後，39 個猶太人與Josephus及他的朋友躲到一個洞中，39個猶太人決定寧願死也不要被敵人到，於是決定了一個自殺方式，41個人排成一個圓圈，由第1個人開始報數，每報數到第3人該人就必須自殺，然後再由下一個重新報數，直到所有人都自殺身亡為止。 然而Josephus 和他的朋友並不想遵從，Josephus要他的朋友先假裝遵從，他將朋友與自己安排在第16個與第31個位置，於是逃過了這場死亡遊戲。
上傳時間： 2013-12-20
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與 奇數魔術方陣 相同，在於求各行、各列與各對角線的和相等，而這次方陣的維度是4的倍數。
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上傳時間： 2013-12-18
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