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無片外<b>電容</b>

  • 指紋識別算法的研究及基于FPGA的硬件實現

    隨著圖像處理和模式識別技術的進步,基于生物特征的識別技術成為蓬勃發展的高技術之一,根據IBG(InternationalBiometricGroup)組織對生物特征市場的統計和預測,該領域的收入的年增長率30-50%,到2008年,全球總收入將達到46.39億美元。而基于指紋特征的識別技術由于其獨特的可靠性,穩定性,方便快捷的特點,恰好符合了市場的需求。目前指紋識別技術是生物識別領域中應用最廣泛的識別技術,也是研究與應用的一個熱點。 SOPC片上可編程系統和嵌入式系統是當前電子設計領域中最熱門的概念。NiosⅡ是Altera公司開發的一種采用流水線技術、單指令流的RISC嵌入式處理器軟核,可以將它嵌入FPGA內部,與用戶自定義邏輯結合構成一個基于FPGA的片上系統。與嵌入式硬核相比較,嵌入式軟核具有更大的靈活性。而FPGA的高速性、恰恰滿足了指紋識別系統對速度的要求。 本文對指紋識別技術中各個環節的算法進行了較為深入的研究,結合NiosⅡ嵌入式處理器的特點,對算法進行了合理的選擇與優化,形成了一套完整的指紋識別算法,并提出了一種基于FPGA的指紋識別系統硬件設計方案。 論文的內容主要包括以下幾個方面: 1、對指紋圖像預處理、后處理和匹配算法進行了改進,提高了算法的性能;設計了一種適用于快速匹配的指紋特征數據結構;提出了一套基于特征點匹配的指紋識別算法。實驗結果表明該算法速度快、誤識率較低、可靠性較高,可以滿足實用的要求。 2、本著增加系統集成度、減小系統體積、提高便攜性、降低功耗和成本,同時提升系統的性能的原則,使用Altera公司提供的外圍設備IP核配合NiosⅡ處理器軟核搭建了一個單片嵌入式系統,然后以內嵌NiosⅡ軟核的FPGA和FPS200指紋采集器為核心芯片,外配片外RAM和Flash存儲器以及小鍵盤和LCD顯示屏等器件,設計了一個便攜式指紋識別系統,提出了一套基于FPGA的硬件設計方案。 3、利用NiosⅡ開發板對硬件設計方案進行了初步的驗證,實現了指紋采集芯片FPS200與FPGA的接口,并進行了算法的移植。 實驗結果表明本文所提出的系統設計方案是可行的。基于FPGA的自動指紋識別系統在速度、功耗、體積、擴展性方面有著獨特的優勢,具有廣闊的發展空間。最后提出了對這一設計繼續改進的思路和下一步研究的內容。

    標簽: FPGA 指紋識別 法的研究 硬件實現

    上傳時間: 2013-07-28

    上傳用戶:hxy200501

  • 基于FPGA的圖像壓縮系統

    隨著信息技術和計算機技術的飛速發展,數字信號處理已經逐漸發展成一門關鍵的技術科學。圖像處理作為一種重要的現代技術,己經在通信、航空航天、遙感遙測、生物醫學、軍事、信息安全等領域得到廣泛的應用。圖像處理特別是高分辨率圖像實時處理的實現技術對相關領域的發展具有深遠意義。另外,現場可編程門陣列FPGA和高效率硬件描述語言Verilog HDL的結合,大大變革了電子系統的設計方法,加速了系統的設計進程,為圖像壓縮系統的實現提供了硬件支持和軟件保障。 本文主要包括以下幾個方面的內容: (1)結合某工程的具體需求,設計了一種基于FPGA的圖像壓縮系統,核心硬件選用XILINX公司的Virtex-Ⅱ Pro系列FPGA芯片,存儲器件選用MICRON公司的MT48LC4M16A2SDRAM,圖像壓縮的核心算法選用近無損壓縮算法JPEG-LS。 (2)用Verilog硬件描述語言實現了JPEG-LS標準中的基本算法,為課題組成員進行算法改進提供了有力支持。 (3)用Verilog硬件描述語言設計并實現了SDRAM控制器模塊,使核心壓縮模塊能夠方便靈活地訪問片外存儲器。 (4)構建了圖像壓縮系統的測試平臺,對實現的SDRAM控制器模塊和JPEG-LS基本算法模塊進行了軟件仿真測試和硬件測試,驗證了其功能的正確性。

    標簽: FPGA 圖像壓縮系統

    上傳時間: 2013-04-24

    上傳用戶:stampede

  • 基于FPGA的數字信號發生器

    數字信號發生器是數字信號處理中不可缺少的調試設備。在某工程項目中,為了提供特殊信號,比如雷達信號,就需要設計專用的數字信號發生器,用以達到發送雷達信號的要求。在本文中提出了使用PCI接口的專用數字信號發生器方案。 該方案的目標是能夠采錄雷達信號,把信號發送到主機作為信號文件存儲起來,然后對這個信號文件進行航跡分離,得到需要的航跡信號文件。同時,信號發生器具有發送信號的功能,可以把不同形式的信號文件發送到檢測端口,用于設備調試。 在本文中系統設計主要分為硬件和軟件兩個方面來介紹: 硬件部分采用了FPGA邏輯設計加上外圍電路來實現的。在硬件設計中,最主要的是FPGA邏輯設計,包括9路主從SPI接口信號的邏輯控制,片外SDRAM的邏輯控制,PCI9054的邏輯控制,以及這些邏輯模塊間信號的同步、發送和接收。在這個過程中信號的方向是雙向的,所選用的芯片都具有雙向數據的功能。 在本文中軟件部分包括驅動軟件和應用軟件。驅動軟件采用PLXSDK驅動開發,通過控制PCI總線完成數據的采錄和發送。應用軟件中包括數據提取和數據發送,采用卡爾曼濾波器等方法。 通過實驗證明該方案完全滿足數據傳輸的要求,達到SPI傳輸的速度要求,能夠完成航跡提取,以及數據傳輸。

    標簽: FPGA 數字信號發生器

    上傳時間: 2013-07-03

    上傳用戶:xzt

  • H264視頻編碼器幀內預測系統設計

    H.264視頻編解碼標準以其高壓縮比、高圖像質量、良好的網絡適應性等優點在數字電視廣播、網絡視頻流媒體傳輸、視頻實時通信等許多方面得到了廣泛應用。提高H.264幀內預測的速度,對于實時性要求較高的場合具有重大的意義。為此,論文在總結國內外相關研究的基礎上,針對H.264幀內預測的軟件實現具有運算量大、實時性差等缺點,提出了一種基于FPGA的高并行、多流水線結構的幀內預測算法的硬件實現。    論文在詳細闡述H.264幀內預測編碼技術的基礎上,分析了17種預測模式算法,通過Matlab仿真建模,直觀地給出了預測模式的預測效果,并在JM12.2官方驗證平臺上測試比較各種預測模式對編碼性能的影響,以此為根據對幀內預測模式進行裁剪。接著論文提出了基于FPGA的幀內預測系統的設計方案,將前段采集劍的RGB圖像通過色度轉換模塊轉換成YCbCr圖像,存入片外SDRAM中,控制模塊負責讀寫數掘送入幀內預測模塊進行處理。幀內預測模塊中,采用一種并行結構的可配置處理單元,即先求和再移位最后限幅的電路結構,來計算各預測模式下的預測值,極大地減小了預測電路的復雜度。針對預測模式選擇算法,論文采用多模式并行運算的方法,即多個結構相同的殘差計算模塊,同時計算各種預測模式對應的SATD值,充分發揮FPGA高速并行處理的能力。其中Hadamard變換使用行列分離的變換方法,采用蝶形快速變換、流水線設計提高硬件的工作效率。最后,論文設計了LCD顯示模塊直觀地顯示所得到的最佳預測模式。    整個幀內預測系統被劃分成多個功能模塊,采用層次化、模塊化的設計思想,并采用流水線結構和乒乓操作來提高系統的并行性、運行速度和總線利用率。所有模塊用Verilog語言設計,由Modelsim仿真和集成開發環境ISE9.1綜合。仿真與綜合結果表明,系統時鐘頻率最高達到106.7MHz。該設計在完成功能的基礎上,能夠較好地滿足實時性要求。論文對于研究基于FPGA的H.264視頻壓縮編碼系統進行了有益的探索,具有一定的實用價值。

    標簽: H264 視頻編碼器 幀內預測 系統設計

    上傳時間: 2013-07-21

    上傳用戶:ABCD_ABCD

  • ADSP-BF531在嵌入式語音識別系統中的應用

      設計了一個嵌入式語音識別系統,該系統硬件平臺以ADSP-BF531為核心,采用離散隱馬爾可夫模型(DHMM)檢測和識別算法完成了對非特定人的孤立詞語音識別。試驗結果表明,該系統對非特定人短詞匯的綜合識別率在90%以上。該系統具有小型、高速、可靠以及擴展性好等特點;可應用于許多特定場合,有很好的市場前景。文中講述了該系統CODEC、片外RAM、ROM以及CPLD等與DSP的接口設計,語音識別運用的矢量量化、Mel倒譜參數、Viterbi等有關算法及其實際應用效果。

    標簽: ADSP-BF 531 嵌入式 中的應用

    上傳時間: 2013-10-28

    上傳用戶:rolypoly152

  • 一種DDS任意波形發生器的ROM優化方法

    提出了一種改進的基于直接頻率合成技術(DDS)的任意波形發生器在現場可編程門陣列(FPGA)上的實現方法。首先將三角波、正弦波、方波和升/降鋸齒波的波形數據寫入片外存儲器,當調用時再將相應的數據移入FPGA的片上RAM,取代分區塊的將所有類型波形數據同時存儲在片上RAM中的傳統方法;再利用正弦波和三角波的波形在4個象限的對稱性以及鋸齒波的線性特性,通過硬件反相器對波形數據和尋址地址值進行處理,實現了以1/4的數據量還原出精度不變的模擬信號,從而將整體的存儲量減小為原始設計方案的5%。經驗證,這種改進方法正確可行,能夠大大降低開發成本。

    標簽: DDS ROM 任意波形發生器

    上傳時間: 2013-12-25

    上傳用戶:日光微瀾

  • 面向小面積和大面積光電二極管的低躁聲放大器

    光電二極管可分為兩類:具高電容 (30pF 至 3000pF)的大面積光電二極管和具相對較低電容 (10pF 或更小)的較小面積光電二極管

    標簽: 光電二極管 低躁聲放大器

    上傳時間: 2013-11-21

    上傳用戶:firstbyte

  • 一種無片外電容LDO的瞬態增強電路設計

    利用RC高通電路的思想,針對LDO提出了一種新的瞬態增強電路結構。該電路設計有效地加快了LDO的瞬態響應速度,而且瞬態增強電路工作的過程中,系統的功耗并沒有增加。此LDO芯片設計采用SMIC公司的0.18 μm CMOS混合信號工藝。仿真結果表明:整個LDO是靜態電流為3.2 μA;相位裕度保持在90.19°以上;在電源電壓為1.8 V,輸出電壓為1.3 V的情況下,當負載電流在10 ns內由100 mA降到50 mA時,其建立時間由原來的和28 μs減少到8 μs;而在負載電流為100 mA的條件下,電源電壓在10 ns內,由1.8 V跳變到2.3 V時,輸出電壓的建立時間由47 μs降低為15 μs。

    標簽: LDO 無片外電容 瞬態 電路設計

    上傳時間: 2013-12-20

    上傳用戶:niumeng16

  • 透過MOSFET電壓電流最佳化控制傳導性及輻射性EMI

    經由改變外部閘極電阻(gate resistors)或增加一個跨在汲極(drain)和源極(source)的小電容來調整MOSFET的di/dt和dv/dt,去觀察它們如何對EMI產生影響。然後我們可了解到如何在效率和EMI之間取得平衡。我們拿一個有著單組輸出+12V/4.1A及初級側MOSFET AOTF11C60 (αMOSII/11A/600V/TO220F) 的50W電源轉接器(adapter)來做傳導性及輻射性EMI測試。

    標簽: MOSFET EMI 電壓電流 控制

    上傳時間: 2014-09-08

    上傳用戶:swing

  • DDR記憶體電源

    CMOS 邏輯系統的功耗主要與時脈頻率、系統內各閘極輸入電容及電源電壓有關,裝置尺寸縮小後,電源電壓也隨之降低,使得閘極大幅降低功耗。這種低電壓裝置擁有更低的功耗和更高的運作速度,因此系統時脈頻率可升高至 Ghz 範圍。

    標簽: DDR 記憶體 電源

    上傳時間: 2013-10-14

    上傳用戶:immanuel2006

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