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特殊指令

  • MPEG-2傳送流特殊信息處理的FPGA實現研究

      本文介紹了如何利用FPGA(FieldProgrammableGateArray)技術來實現傳送流特殊信息的處理,其主要內容如下:1.介紹了MPEG-2傳送流系統層的語法規范;2.描述了傳送流特殊信息之間的結構關系;3.簡要介紹了傳送流復用的原理和實現方法;4.詳細討論了如何用FPGA技術來實現對特殊信息的處理;整個項目的設計采用VHDL作為程序設計語言,都是以Xilinx的FPGA芯片及其ISE5.2i作為開發系統進行的。

    標簽: MPEG FPGA 傳送 信息處理

    上傳時間: 2013-06-11

    上傳用戶:410805624

  • SIM300的AT指令

    SIMCOM公司的SIM300的AT指令中文翻譯

    標簽: SIM 300 AT指令

    上傳時間: 2013-06-08

    上傳用戶:wlyang

  • 自定制Nios處理器的FFT算法指令

    本文深入研究了Nios 自定制指令的軟硬件接口,基于Altera 的IP 核FFT V2.2.0實現了變換長度為1024 點的高速復數FFT 算法,提出了一種在Nios 嵌入式系統中定制用戶FFT 算

    標簽: Nios FFT 定制 處理器

    上傳時間: 2013-04-24

    上傳用戶:hfmm633

  • ARM指令集仿真器的設計與實現.pdf

    指令集仿真器是目前嵌入式系統研究中一個極其重要的領域,一個靈活高效且準確度高的仿真器不僅可以實現對嵌入式系統硬件環境的仿真,而且是現代微處理器結構設計過程中性能評估的重要工具. 仿真器的性能已經成為影響整個設計效率的重要因素,在現有的指令集仿真技術中,編譯型仿真技術雖然可以獲得高的仿真速度,但其對應用的假設過于嚴格,限制了其在商業領域中的應用;解釋型仿真器雖被普遍使用,但其缺點也很明顯,由于模擬過程中需要耗費大量時間用于指令譯碼,解釋型模擬器速度往往很有限,使用性能較低。由此可見,如何減少仿真過程中的指令譯碼時間,是提高仿真器的性能的關鍵。 本文旨在提出一個指令集仿真器的原型,重點解決指令解碼過程中的速度瓶頸,在其基礎可以進行擴充和改進,以適應不同硬件平臺的需要。文章首先從ARM指令集的指令功能和編碼格式入手,通過分析和比較找出了一般常用指令的編碼和實現規律,并在此基礎上進行了高級語言的描述,其后提出了改進版解釋型指令集仿真器的設計方案,包括為提高仿真器性能,減少譯碼時間,創新性的在流程設計中加入了預解碼的步驟,同時用自己設計的壓縮算法解決了因預解碼產生大量譯碼信息而帶來的內存過度消耗難題。接下來,描述了仿真器的實現,包括指令的取指、譯碼、執行等基本功能,并著重描述了如何通過劃分存儲域和存儲塊的方式模擬真實存儲器的讀寫訪問實現。 另外,需要特別指出的是,針對仿真器中普遍存在的調試難問題,本文從一線程序開發人員的角度,在調試模塊的設計中除了斷點設置、程序暫停、恢復等基本功能外,還添加了各類監視設備和程序跟蹤的功能,以期能提高本仿真器的實用性。 在文章的結尾,提出了仿真器的驗證方案,并按照該方案對仿真器進行了功能和性能上的驗證,最后對進一步的工作進行了展望。

    標簽: ARM 指令集 仿真器

    上傳時間: 2013-08-02

    上傳用戶:宋桃子

  • 基于ARMLinux的嵌入式系統軟件測試研究與應用

    隨著人們對軟件產品質量要求的不斷提高,軟件測試技術得到越來越多的重視和應用。本文深入研究嵌入式軟件的測試技術,并將研究成果應用到測試實踐中。論文的主要工作有: 嵌入式軟件作為一種特殊的軟件,符合軟件的大多數特征,要研究嵌入式軟件測試就必須先了解軟件測試。本文研究了軟件測試基本理論和通用測試技術,對當前國內外軟件測試研究現狀和熱點做了綜合分析,為下一步研究工作打下了測試理論基礎。同時,針對嵌入式系統軟件的特點,研究了針對于嵌入式系統的軟件測試技術,分析了嵌入式系統軟件的特征及測試要求。 構建了針對嵌入式系統軟件測試的完備的測試策略是本文的重點之一。它旨在建立符合嵌入式系統軟件特性的測試策略。包括測試模型的建立、單元測試、軟件集成測試、軟件與硬件集成測試、系統測試、確認測試及回歸測試。通過對嵌入式系統軟件測試的研究,實現了對嵌入式系統軟件測試策略的優化。 在對建立嵌入式系統軟件測試環境的研究中,應用了交叉開發測試環境的概念并研究了基于駐留監控軟件、指令集模擬器以及基于JTAG的調試代理的交叉測試方法。最后搭建了基于ARM-Linux的嵌入式系統軟件測試環境。 依據嵌入式系統軟件測試的策略并根據語言學習系統的特點進行了有針對性的測試。在針對語言學習系統進行的軟件測試設計和測試實施全過程中,驗證了所提出的測試策略和測試模型,確保語言學習系統的軟件質量的同時提高了測試效率。

    標簽: ARMLinux 嵌入式系統 軟件測試

    上傳時間: 2013-04-24

    上傳用戶:qweqweqwe

  • 復費率CPU卡電能表ESAM及卡操作指令流程

    復費率CPU卡電能表ESAM及卡操作指令流程

    標簽: ESAM CPU 復費率 電能表

    上傳時間: 2013-05-22

    上傳用戶:xiaoxiang

  • 基于FPGA的精簡指令集計算機的研究與開發

    大規模可編程邏輯器件CPLD和FPGA是當今應用最廣泛的兩類可編程專用集成電路(ASIC),電子設計工程師用它可以在辦公室或實驗室里設計出所需的專用集成電路,從而大大縮短了產品上市時間,降低了開發成本.此外,可編程邏輯器件還具有靜態可重復編程和動態系統重構的特性,使得硬件的功能可以象軟件一樣通過編程來修改,這樣就極大地提高了電子系統設計的靈活性和通用性.該設計完成了在一片可編程邏輯器件上開發簡易計算機的設計任務,將單片機與單片機外圍電路集成化,能夠輸入指令、執行指令、輸出結果,具有在電子系統中應用的普遍意義,另外,也可以用于計算機組成原理的教學試驗.該文第一章簡要介紹了可編程ASIC和EDA技術的歷史、現狀、未來并對本課題作了簡要陳述.第二章在芯片設計的兩種輸入法即原理圖輸入法和HDL輸入法之間做出比較,決定選用HDL輸入法.第三章描述了具體的設計過程和設計手段,首先將簡易計算機劃分為運算器、CPU控制器、存儲器、鍵盤接口和顯示接口以及系統控制器,然后再往下分為下層子模塊.輸入法的語言使用的是Verilog HDL,鑒于篇幅所限,源代碼部分不在論文之中.第四章對設計的綜合與實現做了總結,給出了時序仿真波形圖.該文針對FPGA和RISC這兩大課題,對RISC在FPGA上的實現進行了初淺的探索與嘗試.從計算機體系結構入手,剖析了精簡指令集計算機的原理,通過該設計的實踐對ASIC和EDA的設計潛力有了更進一步的領悟.

    標簽: FPGA 指令集 計算機

    上傳時間: 2013-05-21

    上傳用戶:hewenzhi

  • 基于DSP和FPGA的運動控制技術的研究

    該課題通過對開放式數控技術的全面調研和對運動控制技術的深入研究,并針對國內運動控制技術的研究起步較晚的現狀,結合激光雕刻領域的具體需要,緊跟當前運動控制技術研究的發展趨勢,吸收了世界開放式數控技術和相關運動控制技術的最新成果,采納了基于DSP和FPGA的方案,研制了一款比較新穎的、功能強大的、具有很大柔性的四軸多功能運動控制卡.該論文主要內容如下:首先,通過對制造業、開放式數控系統、運動控制卡等行業現狀的全面調研,基于對運動系統控制技術的深入學習,在比較了幾種常用的運動控制方案的基礎上,確定了基于DSP和FPGA的運動控制設計方案,并規劃了板卡的總體結構.其次,針對運動控制中的一些具體問題,如高速、高精度、運動平穩性、實時控制以及多軸聯動等,在FPGA上設計了功能相互獨立的四軸運動控制電路,仔細規劃并定義了各個寄存器的具體功能,設計了功能完善的加/減速控制電路、變頻分配電路、倍頻分頻電路和三個功能各異的計數器電路等,完全實現了S-曲線升降速運動、自動降速點運動、A/B相編碼器倍頻計數電路等特殊功能.再次,介紹了DSP在運動控制中的作用,合理規劃了DSP指令的形成過程,并對DSP軟件的具體實現進行了框架性的設計.然后,根據光電隔離原理設計了數字輸入/輸出電路;結合DAC原理設計了四路模擬輸出電路;實現了PCI接口電路的設計;并針對常見的干擾現象,提出了有效的抗干擾措施.最后,利用運動控制卡強大的運動控制功能,并針對激光雕刻行業進行大幅圖形掃描時需要實時處理大量的圖形數據的特別需要,在板卡第四軸完全實現了激光控制功能,并基于FPGA內部的16KBit塊RAM,開辟了大量數據區以便進行大幅圖形的實時處理.

    標簽: FPGA DSP 運動控制

    上傳時間: 2013-06-09

    上傳用戶:youlongjian0

  • 用FPGA實現帶硬件浮點運算器的8051

    8051系列是至今為止最成功的單片機之一,在FPGA平臺上研究帶硬件浮點運算器的8051是對其在SoC及專用化的方向上的一次邁進。文章首先介紹了8051的基本架構,包括硬件模塊、指令系統、內存分配以及基本外設。然后講解了在設計8051時如何劃分模塊,每個模塊的功能與設計,同時也介紹了如何設計流水線來加速8051的處理速度。對于浮點運算器,文章介紹了IEEE浮點數的表示方法,包括各種特殊值的表示方法以及作用。在探討浮點運算器設計的時候首先是給出了模塊的劃分及其實現的功能,然后以生動的實例介紹了加減乘除四種浮點運算的算法。在介紹完8051與浮點運算器設計以后,文章介紹了如何將浮點運算器集成到8051上,包括硬件上的數據線接口和控制線接口,以及軟件中如何運用硬件浮點運算器。最后文章給出了此設計在ModelSim上的仿真結果以及在CyclonelIFPGA芯片上的驗證過程,可以清楚地看到,與KeilC51軟件庫的浮點運算相比,加法運算從186個時鐘周期減少到4個時鐘周期,減法運算從200個時鐘周期減少到4個時鐘周期,乘法運算從241個時鐘周期減少到4個時鐘周期,而除法則由原來的¨lO個時鐘周期減少到4個時鐘周期,可見硬件浮點運算器使8051在運算能力上有了質的提高。 筆者也在“Google”和“百度”搜索引擎上,以及“維普數據論文網’’上搜索過,都沒有發現有類似的設計,帶硬件浮點運算器的8051可謂是一次創新,希望在實際應用中能有用武之地。

    標簽: FPGA 8051 硬件 浮點運算器

    上傳時間: 2013-04-24

    上傳用戶:13081287919

  • 基于FPGA的MCS51核的VHDL語言

    本文以研究嵌入式微處理器為主,自主地設計了能夠運行MCS-51系列單片機指令的MCU系統。系統采用了VHDL 語言與原理框圖的綜合設計方法,并且在Altera公司的FPGA上通過驗證。論文深入地研究了微處理器的指令系統和數據地址通路,采用VHDL 語言完成了取指單元,指令譯碼器單元,存儲器單元和邏輯運算單元的電路模塊的設計與實現;研究了控制單元的實現方法和基于全局狀態機的設計理論,采用硬件描述語言完成了對各個控制線的相關設計與實現。論文通過原理示意圖和示例代碼的演示,著重介紹了指令譯碼器的實現方式,基于此種方式形成的譯碼電路還能夠實現更為復雜的CISC指令。 本系統采用分模塊的設計方式,把具有相同功能的邏輯電路集中到一個框圖里,使得系統的可移植性大大地提高。系統還采用層次框圖的設計方式,把明顯地具有主從關系的電路放在不同的層次里,這也使得系統模塊功能的可擴展性大大地增強。內部邏輯共分為數據存儲器模塊;程序存儲器模塊;時序控制模塊;特殊功能寄存器模塊和Core核心模塊這五個部分,文中對各個模塊的設計作了詳細的介紹。本文在最后對已實現的部分典型指令進行了邏輯仿真測試,測試結果表明,本文所設計的MCU系統能夠如預期地執行相應的指令。在指令執行的過程中,相應寄存器和總線上的值也均符合設計要求,實現了設計目標。

    標簽: FPGA VHDL MCS 51

    上傳時間: 2013-06-05

    上傳用戶:金宜

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