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異步通信接口

  • ARM和FPGA通信的接口程序

    ARM和FPGA通信的接口程序,可以讓ARM給FPGA發(fā)送參數(shù)

    標(biāo)簽: FPGA ARM 通信 接口程序

    上傳時(shí)間: 2013-08-08

    上傳用戶:litianchu

  • VHDL實(shí)現(xiàn):?jiǎn)纹瑱C(jī)與FPGA接口通信源文件

    程序主要用硬件描述語(yǔ)言(VHDL)實(shí)現(xiàn):\r\n單片機(jī)與FPGA接口通信的問(wèn)題

    標(biāo)簽: VHDL FPGA 單片機(jī) 接口通信

    上傳時(shí)間: 2013-09-06

    上傳用戶:ddddddos

  • 鍵盤接口在單片機(jī)系統(tǒng)與PC機(jī)通信中的應(yīng)用

    摘要:提出一種全新的利用鍵盤接口實(shí)現(xiàn)單片機(jī)系統(tǒng)和PC機(jī)通信的方案,介紹了鍵盤與PC機(jī)通信的原理,并成功地應(yīng)用于實(shí)際系統(tǒng)。該方案為外部單片機(jī)系統(tǒng)與3-機(jī)通信提供了一條有效的途徑。關(guān)鍵詞:鍵盤接口  單片機(jī)系統(tǒng)  時(shí)序  命令字

    標(biāo)簽: 鍵盤接口 單片機(jī)系統(tǒng) PC機(jī)通信 中的應(yīng)用

    上傳時(shí)間: 2013-11-03

    上傳用戶:drink!

  • 單片機(jī)串行通信與接口

    在計(jì)算機(jī)系統(tǒng)中,串行通信是指計(jì)算機(jī)主機(jī)與外設(shè)之間以及主機(jī)系統(tǒng)與主機(jī)系統(tǒng)之間數(shù)據(jù)的串行傳送。由于串行通信和通信制式、傳送距離以及I/O數(shù)據(jù)的串并變換等許多因素有關(guān),為進(jìn)一步學(xué)習(xí)MCS-51的串行接口打下基礎(chǔ)。

    標(biāo)簽: 單片機(jī) 串行通信 接口

    上傳時(shí)間: 2013-10-10

    上傳用戶:李彥東

  • 單片機(jī)串行通信發(fā)射機(jī)

    單片機(jī)串行通信發(fā)射機(jī) 我所做的單片機(jī)串行通信發(fā)射機(jī)主要在實(shí)驗(yàn)室完成,參考有關(guān)的書籍和資料,個(gè)人完成電路的設(shè)計(jì)、焊接、檢查、調(diào)試,再根據(jù)自己的硬件和通信協(xié)議用匯編語(yǔ)言編寫發(fā)射和顯示程序,然后加電調(diào)試,最終達(dá)到準(zhǔn)確無(wú)誤的發(fā)射和顯示。在這過(guò)程中需要選擇適當(dāng)?shù)脑侠淼碾娐穲D扎實(shí)的焊接技術(shù),基本的故障排除和糾正能力,會(huì)使用基本的儀器對(duì)硬件進(jìn)行調(diào)試,會(huì)熟練的運(yùn)用匯編語(yǔ)言編寫程序,會(huì)用相關(guān)的軟件對(duì)自己的程序進(jìn)行翻譯,并燒進(jìn)芯片中,要與對(duì)方接收機(jī)統(tǒng)一通信協(xié)議,要耐心的反復(fù)檢查、修改和調(diào)試,直到達(dá)到預(yù)期目的。單片機(jī)串行通信發(fā)射機(jī)采用串行工作方式,發(fā)射并顯示兩位數(shù)字信息,既顯示00-99,使數(shù)據(jù)能夠在不同地方傳遞。硬件部分主要分兩大塊,由AT89C51和多個(gè)按鍵組成的控制模塊,包括時(shí)鐘電路、控制信號(hào)電路,時(shí)鐘采用6MHZ晶振和30pF的電容來(lái)組成內(nèi)部時(shí)鐘方式,控制信號(hào)用手動(dòng)開關(guān)來(lái)控制,P1口來(lái)控制,P2、P3口產(chǎn)生信號(hào)并通過(guò)共陽(yáng)極數(shù)碼管來(lái)顯示,軟件采用匯編語(yǔ)言來(lái)編寫,發(fā)射程序在通信協(xié)議一致的情況下完成數(shù)據(jù)的發(fā)射,同時(shí)顯示程序?qū)Πl(fā)射的數(shù)據(jù)加以顯示。畢業(yè)設(shè)計(jì)的目的是了解基本電路設(shè)計(jì)的流程,豐富自己的知識(shí)和理論,鞏固所學(xué)的知識(shí),提高自己的動(dòng)手能力和實(shí)驗(yàn)?zāi)芰Γ瑥亩邆湟欢ǖ脑O(shè)計(jì)能力。我做得的畢業(yè)設(shè)計(jì)注重于對(duì)單片機(jī)串行發(fā)射的理論的理解,明白發(fā)射機(jī)的工作原理,以便以后單片機(jī)領(lǐng)域的開發(fā)和研制打下基礎(chǔ),提高自己的設(shè)計(jì)能力,培養(yǎng)創(chuàng)新能力,豐富自己的知識(shí)理論,做到理論和實(shí)際結(jié)合。本課題的重要意義還在于能在進(jìn)一步層次了解單片機(jī)的工作原理,內(nèi)部結(jié)構(gòu)和工作狀態(tài)。理解單片機(jī)的接口技術(shù),中斷技術(shù),存儲(chǔ)方式,時(shí)鐘方式和控制方式,這樣才能更好的利用單片機(jī)來(lái)做有效的設(shè)計(jì)。我的畢業(yè)設(shè)計(jì)分為兩個(gè)部分,硬件部分和軟件部分。硬件部分介紹:?jiǎn)纹瑱C(jī)串行通信發(fā)射機(jī)電路的設(shè)計(jì),單片機(jī)AT89C51的功能和其在電路的作用。介紹了AT89C51的管腳結(jié)構(gòu)和每個(gè)管腳的作用及各自的連接方法。AT89C51 與MCS-51 兼容,4K字節(jié)可編程閃爍存儲(chǔ)器,壽命:1000次可擦,數(shù)據(jù)保存10年,全靜態(tài)工作:0HZ-24HZ,三級(jí)程序存儲(chǔ)器鎖定,128*8 位內(nèi)部RAM,32 跟可編程I/O 線,兩個(gè)16 位定時(shí)/計(jì)數(shù)器,5 個(gè)中斷源,5 個(gè)可編程串行通道,低功耗的閑置和掉電模式,片內(nèi)震蕩和時(shí)鐘電路,P0和P1 可作為串行輸入口,P3口因?yàn)槠涔苣_有特殊功能,可連接其他電路。例如P3.0RXD 作為串行輸出口,其中時(shí)鐘電路采用內(nèi)時(shí)鐘工作方式,控制信號(hào)采用手動(dòng)控制。數(shù)據(jù)的傳輸方式分為單工、半雙工、全雙工和多工工作方式;串行通信有兩種形式,異步和同步通信。介紹了串行串行口控制寄存器,電源管理寄存器PCON,中斷允許寄存器IE,還介紹了數(shù)碼顯示管的工作方式、組成,共陽(yáng)極和共陰極數(shù)碼顯示管的電路組成,有動(dòng)態(tài)和靜態(tài)顯示兩種方式,說(shuō)明了不同顯示方法與單片機(jī)的連接。再后來(lái)還介紹了硬件的焊接過(guò)程,及在焊接時(shí)遇到的問(wèn)題和應(yīng)該注意的方面。硬件焊接好后的檢查電路、不裝芯片上電檢查及上電裝芯片檢查。軟件部分:在了解電路設(shè)計(jì)原理后,根據(jù)原理和目的畫出電路流程圖,列出數(shù)碼顯示的斷碼表,計(jì)算波特率,設(shè)置串行口,在與接受機(jī)設(shè)置相同的通信協(xié)議的基礎(chǔ)上編寫顯示和發(fā)射程序。編寫完程序還要進(jìn)行編譯,這就必須會(huì)使用編譯軟件。介紹了編譯軟件的使用和使用過(guò)程中遇到的問(wèn)題,及在編譯后燒入芯片使用的軟件PLDA,后來(lái)的加電調(diào)試,及遇到的問(wèn)題,在沒(méi)問(wèn)題后與接受機(jī)連接,發(fā)射數(shù)據(jù),直到對(duì)方準(zhǔn)確接收到。在軟件調(diào)試過(guò)程中將詳細(xì)介紹調(diào)試遇到的問(wèn)題,例如:通信協(xié)議是否相同,數(shù)碼管是否與芯片連接對(duì)應(yīng),計(jì)數(shù)器是否開始計(jì)數(shù)等。

    標(biāo)簽: 單片機(jī) 串行通信 發(fā)射機(jī)

    上傳時(shí)間: 2013-10-19

    上傳用戶:uuuuuuu

  • FPGA與ARM EPI通信,控制16路步進(jìn)電機(jī)和12路DC馬達(dá) VHDL編寫的

    FPGA與ARM EPI通信,控制16路步進(jìn)電機(jī)和12路DC馬達(dá) VHDL編寫的,,,,,

    標(biāo)簽: FPGA VHDL ARM EPI

    上傳時(shí)間: 2013-10-21

    上傳用戶:zhyfjj

  • 基于NiosII軟核處理器的步進(jìn)電機(jī)接口設(shè)計(jì)

        NiosII軟核處理器是Altera公司開發(fā),基于FPGA操作平臺(tái)使用的一款高速處理器,為了適應(yīng)高速運(yùn)動(dòng)圖像采集,提出了一種基于NiosII軟核處理的步進(jìn)電機(jī)接口設(shè)計(jì),使用verilog HDL語(yǔ)言完成該接口設(shè)計(jì),最后通過(guò)QuartusII軟件,給出了實(shí)驗(yàn)仿真結(jié)果。

    標(biāo)簽: NiosII 軟核處理器 步進(jìn)電機(jī) 接口設(shè)計(jì)

    上傳時(shí)間: 2014-12-28

    上傳用戶:jiwy

  • FPGA與ARM EPI通信,控制16路步進(jìn)電機(jī)和12路DC馬達(dá) VHDL編寫的

    FPGA與ARM EPI通信,控制16路步進(jìn)電機(jī)和12路DC馬達(dá) VHDL編寫的,,,,,

    標(biāo)簽: FPGA VHDL ARM EPI

    上傳時(shí)間: 2013-10-31

    上傳用戶:chaisz

  • 基于NiosII軟核處理器的步進(jìn)電機(jī)接口設(shè)計(jì)

        NiosII軟核處理器是Altera公司開發(fā),基于FPGA操作平臺(tái)使用的一款高速處理器,為了適應(yīng)高速運(yùn)動(dòng)圖像采集,提出了一種基于NiosII軟核處理的步進(jìn)電機(jī)接口設(shè)計(jì),使用verilog HDL語(yǔ)言完成該接口設(shè)計(jì),最后通過(guò)QuartusII軟件,給出了實(shí)驗(yàn)仿真結(jié)果。

    標(biāo)簽: NiosII 軟核處理器 步進(jìn)電機(jī) 接口設(shè)計(jì)

    上傳時(shí)間: 2015-01-02

    上傳用戶:妄想演繹師

  • 中國(guó)移動(dòng)通信互聯(lián)網(wǎng)短信網(wǎng)關(guān)接口協(xié)議2.0

    中國(guó)移動(dòng)通信互聯(lián)網(wǎng)短信網(wǎng)關(guān)接口協(xié)議2.0

    標(biāo)簽: 2.0 中國(guó)移動(dòng) 通信互聯(lián)網(wǎng) 短信

    上傳時(shí)間: 2015-01-06

    上傳用戶:chfanjiang

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