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目標(biāo)仿真

  • 基于Multisim的計算機組成原理實驗仿真

    基于Multisim的計算機組成原理實驗仿真.pdf

    標簽: Multisim 計算機組成原理 實驗仿真

    上傳時間: 2013-05-17

    上傳用戶:6546544

  • 三相異步電機矢量控制仿真模型

    實現了三相異步電機的svpwm的仿真,效果很好,自己調通并使用

    標簽: 三相異步電機 矢量控制 仿真模型

    上傳時間: 2013-07-08

    上傳用戶:1427796291

  • ADC0808的數字電壓表C語言-仿真實例

    ADC0808的數字電壓表C語言-仿真實例

    標簽: 0808 ADC 數字電壓表 C語言

    上傳時間: 2013-04-24

    上傳用戶:ljt101007

  • matlab通信仿真psk誤碼分析

    MATLAB仿真通信PSK誤碼分析,主要用來測試SNR從0到10時的系統性能-MATLAB simulation PSK communication error analysis

    標簽: matlab psk 通信 仿真

    上傳時間: 2013-04-24

    上傳用戶:924484786

  • 機載雙基地SAR成像算法的FPGA設計與實現

    雙基地合成孔徑雷達(簡稱雙基地SAR或Bistatic SAR)是一種新的成像雷達,也是當今SAR技術的一個發展方向,在軍用及民用領域都具有良好的應用前景,近年來成為研究的熱點。本文則側重于研究雙基地SAR的距離一多普勒(R-D)成像算法的實現。 在雙基地SAR系統及成像算法的研究方面,推導了雙基地SAR的系統分辨特性及雷達方程,分析了主要系統參數之間的約束關系。針對正側視機載雙基地SAR系統,本文對距離一多普勒算法進行了推廣。最后得到點目標的仿真結果。 在成像算法的FPGA實現上,在System Generator環境下對算法進行定點仿真。完成距離一多普勒成像算法的硬件實現,其中包括了FFT快速傅立葉變換、硬件乘法器、:Rocket I/O接口設計、DCM數字時鐘管理等主要部分。針對硬件實現的特點,對算法的部分運算進行了簡化。 為了對算法實現進行驗證,設計開發了該算法的硬件測試平臺。主要基于ML310評估板上XC2VP30芯片中嵌入的Power PC 405,完成其硬件部分的設計,主要包括了Aurora協議接口、RS-232串行接口、DDR RAM接口以及其它如中斷、時鐘等部分。

    標簽: FPGA SAR 機載 雙基地

    上傳時間: 2013-07-26

    上傳用戶:是王洪文

  • 三相異步電機的Matlab仿真

    三相異步電動機的Matlab仿真,在Simulink中搭建了異步電動機模型

    標簽: Matlab 三相異步電機 仿真

    上傳時間: 2013-08-03

    上傳用戶:壞天使kk

  • 手把手教你學AVR單片機C程序設計實驗程序

    目錄 第1章 概述 1.1 采用C語言提高編制單片機應用程序的效率 1.2 C語言具有突出的優點 1.3 AvR單片機簡介 1.4 AvR單片機的C編譯器簡介 第2章 學習AVR單片機C程序設計所用的軟件及實驗器材介紹 2.1 IAR Enlbedded Workbench IDE C語言編譯器 2.2 AVR Studio集成開發環境 2.3 PonyProg2000下載軟件及SL—ISP下載軟件 2.4 AVR DEM0單片機綜合實驗板 2.5 AvR單片機JTAG仿真器 2.6 并口下載器 2.7 通用型多功能USB編程器 第3章 AvR單片機開發軟件的安裝及第一個入門程序 3.1 安裝IAR for AVR 4.30集成開發環境 3.2 安裝AVR Studio集成開發環境 3.3 安裝PonyProg2000下載軟件 3.4 安裝SLISP下載軟件 3.5 AvR單片機開發過程 3.6 第一個AVR入門程序 第4章 AVR單片機的主要特性及基本結構 4.1 ATMEGA16(L)單片機的產品特性 4.2 ATMEGA16(L)單片機的基本組成及引腳配置 4.3 AvR單片機的CPU內核 4.4 AvR的存儲器 4.5 系統時鐘及時鐘選項 4.6 電源管理及睡眠模式 4.7 系統控制和復位 4.8 中斷 第5章 C語言基礎知識 5.1 C語言的標識符與關鍵字 5.2 數據類型 5.3 AVR單片機的數據存儲空間 5.4 常量、變量及存儲方式 5.5 數組 5.6 C語言的運算 5.7 流程控制 5.8 函數 5.9 指針 5.10 結構體 5.11 共用體 5.12 中斷函數 第6章 ATMEGA16(L)的I/O端口使用 6.1 ATMEGAl6(L)的I/O端口 6.2 ATMEGAl6(L)中4組通用數字I/O端口的應用設置 6.3 ATMEGA16(L)的I/O端口使用注意事項 6.4 ATMEGAl6(L)PB口輸出實驗 6.5 8位數碼管測試 6.6 獨立式按鍵開關的使用 6.7 發光二極管的移動控制(跑馬燈實驗) 6.8 0~99數字的加減控制 6.9 4×4行列式按鍵開關的使用 第7章 ATMEGAl6(L)的中斷系統使用 7.1 ATMEGA16(L)的中斷系統 7.2 相關的中斷控制寄存器 7.3 INT1外部中斷實驗 7.4 INTO/INTl中斷計數實驗 7.5 INTO/INTl中斷嵌套實驗 7.6 2路防盜報警器實驗 7.7 低功耗睡眠模式下的按鍵中斷 7.8 4×4行列式按鍵的睡眠模式中斷喚醒設計 第8章 ATMEGAl6(L)驅動16×2點陣字符液晶模塊 8.1 16×2點陣字符液晶顯示器概述 8.2 液晶顯示器的突出優點 8.3 16×2字符型液晶顯示模塊(LCM)特性 8.4 16×2字符型液晶顯示模塊(LCM)引腳及功能 8.5 16×2字符型液晶顯示模塊(LCM)的內部結構 8.6 液晶顯示控制驅動集成電路HD44780特點 8.7 HD44780工作原理 8.8 LCD控制器指令 8.9 LCM工作時序 8.10 8位數據傳送的ATMEGAl6(L)驅動16×2點陣字符液晶模塊的子函數 8.11 8位數據傳送的16×2 LCM演示程序1 8.12 8位數據傳送的16×2 LCM演示程序2 8.13 4位數據傳送的ATMEGA16(L)驅動16×2點陣字符液晶模塊的子函數 8.14 4位數據傳送的16×2 LCM演示程序 第9章 ATMEGA16(L)的定時/計數器 9.1 預分頻器和多路選擇器 9.2 8位定時/計時器T/C0 9.3 8位定時/計數器0的寄存器 9.4 16位定時/計數器T/C1 9.5 16位定時/計數器1的寄存器 9.6 8位定時/計數器T/C2 9.7 8位T/C2的寄存器 9.8 ICC6.31A C語言編譯器安裝 9.9 定時/計數器1的計時實驗 9.10 定時/計數器0的中斷實驗 9.11 4位顯示秒表實驗 9.12 比較匹配中斷及定時溢出中斷的測試實驗 9.13 PWM測試實驗 9.14 0~5 V數字電壓調整器 9.15 定時器(計數器)0的計數實驗 9.16 定時/計數器1的輸入捕獲實驗 ......

    標簽: AVR 手把手 單片機 C程序

    上傳時間: 2013-07-30

    上傳用戶:yepeng139

  • 英飛凌公司DAVE2.O軟件的使用

    介紹了Infineon(英飛凌)公司DAVE2.O軟件的使用方法和一些需注意的要點,并按照流程編寫了一個“Infineon XC164CM”的閃燈測試程序

    標簽: DAVE2 英飛凌 軟件

    上傳時間: 2013-07-13

    上傳用戶:牛布牛

  • 無線信道仿真和均衡器的FPGA設計與實現

    本文主要介紹了基于FPGA的無線信道盲均衡器的設計與實現,在算法上選擇了比較成熟的DDLMS和CMA相結合的算法,結構上采用四路正交FIR濾波器模型.在設計的過程中我們采取了用MATLAB進行算法仿真,VerilogHDL語言進行FPGA設計的策略.在硬件描述語言的設計流程中,信道盲均衡器運用了Top-Down的模塊化設計方法,大大縮短了設計周期,提高了系統的穩定性和可擴展性.測試結果表明均衡器所有的性能指標均達到預定目標,且工作性能良好,均衡效果較為理想,能夠滿足指標要求.本課題所設計和實現的信道盲均衡器,為FPGA芯片設計技術做了有益的探索性嘗試,對今后無線通信系統中的單芯片可編程系統(SOPC)的設計運用有著積極的借鑒意義.

    標簽: FPGA 無線信道 仿真 均衡器

    上傳時間: 2013-05-28

    上傳用戶:huyiming139

  • 運動估計算法的FPGA仿真與實現研究

    隨著通信技術和計算機技術的發展,多媒體的應用與服務越來越廣泛,視頻壓縮編碼技術也隨之成為非常重要的研究領域。運動估計是視頻壓縮編碼中的一項關鍵技術。由于視頻編碼系統的復雜性主要取決于運動估計算法,因此如何找到一種可靠、快速、性能優良的運動估計算法一直是視頻壓縮編碼的研究熱點。運動估計在視頻編碼器中承擔的運算量最大、控制最為復雜,由于對視頻編碼的實時性要求,因此運動估計模塊一般都采用硬件來設計。 本文的目的是在FPGA芯片上設計實現一種更優的易于硬件實現的塊匹配運動估計算法——二步搜索算法。全文首先討論了塊匹配運動估計理論及其主要技術指標,介紹了運動估計技術在MPEG-4中的應用,然后在對典型的運動估計算法進行分析比較的基礎上討論了一種性能和硬件實現難易度綜合指數較高的二步搜索算法。本文對已有的用于全搜索算法實現的VLSI結構進行了改進,設計了符合二步搜索算法要求的FPGA實現結構,并在對其理論分析之后,對實現該算法的運動估計模塊進行了功能模塊的劃分,并運用VerilogHDL硬件描述語言、ISE及Modelsim開發工具在Spartan-IIEXC2S300eFPGA芯片上完成了對各功能模塊的設計、實現與時序仿真。最后,對整個運動估計模塊進行了仿真測試,給出了其在FPGA上搭建實現后的時序仿真波形圖與占用硬件資源情況,通過對時序仿真結果可知本文設計的各功能模塊工作正常,并且能夠協同工作,整個運動估計模塊能夠正確的實現二步搜索運動估計算法,并輸出正確的運動估計結果;通過對占用硬件資源及時鐘頻率情況的分析驗證了本文設計的二步搜索運動估計算法的FPGA實現結構具備先進性和實時可實現性。

    標簽: FPGA 運動估計 算法 仿真

    上傳時間: 2013-05-27

    上傳用戶:wpt

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