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相機(jī)的

  • 基于單片機和FPGA的掃頻儀設計

    以89S52單片機和FPGA為控制核心，設計了一個測試四端網絡幅頻特性和相頻特性的掃頻儀。系統功能分為掃頻信號產生、幅頻特性測試、相頻特性測試等模塊；而操作部分包括矩陣鍵盤、點陣式液晶顯示器、波形顯示電路。系統可以測量未知網絡特定頻率點的頻率特性，此外，用戶還可以通過鍵盤設置掃頻信號的上下限，并利用示波器精確的顯示幅頻、相頻曲線。

    標簽： FPGA 單片機 掃頻儀

    上傳時間： 2013-11-15

    上傳用戶：lingfei

  • 基于單片機和SA4828通用變頻器的設計

    本文介紹了一種智能型、高精度SPWM運動控制器SA4828芯片,并且給出了其與單片機AT89C52相結合設計的通用變頻器軟硬件方案,通過單片機AT89C52對SA4828初始化編程,可以方便設定變頻器的基本參數。通過實驗結果表明,由單片機和SA4828設計的變頻器,電路簡單,操作靈活,可靠性高。

    標簽： 4828 SA 單片機 通用變頻器

    上傳時間： 2013-11-19

    上傳用戶：ZZJ886

  • 基于TMS320F2808的音頻掃頻儀

    本設計采用TMS320F2808 DSP 芯片，制作了一臺音頻頻率數字掃頻儀，能夠測量未知網絡音頻范圍內的幅頻特性。該系統具有良好的可擴展性，關鍵系統參數軟件可調，并可通過算法設計實現相頻特性的測量，同時小巧靈活，具有實時性強，精度高的特點。用戶可以通過PC 機上友好的用戶界面方便靈活地控制整個系統的工作，查看數據及觀察測試曲線。

    標簽： F2808 2808 320F TMS

    上傳時間： 2013-10-08

    上傳用戶：shawvi

  • 基于FPGA的數字穩定校正單元的實現

    　　為了實現對非相干雷達的接收相參處理，基于數字穩定校正(DSU)的原理，采用ALTERA公司的StratixⅡ系列芯片和VHDL編程語言，設計了一種基于FPGA的DSU硬件實現方法。實驗結果表明基于FPGA的DSU方法可以提高程序的執行效率和系統的實時性，可實現非相參雷達的相參化功能。

    標簽： FPGA 數字穩定校正

    上傳時間： 2013-10-14

    上傳用戶：603100257

  • 基于FPGA的寬帶數字接收機變帶寬數字下變頻器設計

    基于FPGA芯片Stratix II EP2S60F672C4設計了一個適用于寬帶數字接收機的帶寬可變的數字下變頻器（VB-DDC）。該VB-DDC結合傳統數字下變頻結構與多相濾波結構的優點，實現了對輸入中頻信號的高效高速處理，同時可以在較大范圍內對信號處理帶寬靈活配置。硬件調試結果驗證了本設計的有效性。

    標簽： FPGA 寬帶數字 接收機 帶寬

    上傳時間： 2013-11-03

    上傳用戶：23333

  • Xilinx FPGA全局時鐘資源的使用方法

    目前，大型設計一般推薦使用同步時序電路。同步時序電路基于時鐘觸發沿設計，對時鐘的周期、占空比、延時和抖動提出了更高的要求。為了滿足同步時序設計的要求，一般在FPGA設計中采用全局時鐘資源驅動設計的主時鐘，以達到最低的時鐘抖動和延遲。 FPGA全局時鐘資源一般使用全銅層工藝實現，并設計了專用時鐘緩沖與驅動結構，從而使全局時鐘到達芯片內部的所有可配置單元(CLB)、I/O單元 (IOB)和選擇性塊RAM(Block Select RAM)的時延和抖動都為最小。為了適應復雜設計的需要，Xilinx的FPGA中集成的專用時鐘資源與數字延遲鎖相環(DLL)的數目不斷增加，最新的 Virtex II器件最多可以提供16個全局時鐘輸入端口和8個數字時鐘管理模塊(DCM)。與全局時鐘資源相關的原語常用的與全局時鐘資源相關的Xilinx器件原語包括：IBUFG、IBUFGDS、BUFG、BUFGP、BUFGCE、 BUFGMUX、BUFGDLL和DCM等，如圖1所示。  

    標簽： Xilinx FPGA 全局時鐘資源

    上傳時間： 2014-01-01

    上傳用戶：maqianfeng

  • 基于物聯網的礦井溫、濕度檢測系統設計

    為了實現對礦井溫、濕度檢測，提出了一種基于物聯網的礦井溫、濕度檢測系統，并完成了系統的軟硬件測試。硬件包括由分布在礦井中的測量節點組成的無線傳感網絡，由基站節點和監控終端設備相連接形成的監控裝置，軟件采用MSP430進行編程，并實現了溫濕度信號檢測。實際應用表明，該系統具有體積小，部署方便，成本低廉等優點。

    標簽： 物聯網 濕度檢測 系統設計

    上傳時間： 2013-10-27

    上傳用戶：阿四AIR

  • 一種陣列天線幅相誤差校正方法設計

    陣列信號處理是當前信號處理的熱門方向，為信號處理帶來極大的方便，陣列信號處理中的各通道不一致問題將會給陣列信號處理帶來影響，很多文獻中介紹過關于自適應幅相誤差校正的理論及方法，但實現起來都比較耗費資源和時間，且效果有待實踐驗證。提出一種工程上可實現且計算量較小的通道校正方法-查表法。通過仿真，結果表明此方法可以對特定來向的有用信號進行較為準確的校正。

    標簽： 陣列天線 幅相誤差 校正

    上傳時間： 2014-01-12

    上傳用戶：fxf126@126.com

  • 基于FPGA的數字穩定校正單元的實現

    　　為了實現對非相干雷達的接收相參處理，基于數字穩定校正(DSU)的原理，采用ALTERA公司的StratixⅡ系列芯片和VHDL編程語言，設計了一種基于FPGA的DSU硬件實現方法。實驗結果表明基于FPGA的DSU方法可以提高程序的執行效率和系統的實時性，可實現非相參雷達的相參化功能。

    標簽： FPGA 數字穩定校正

    上傳時間： 2013-11-23

    上傳用戶：shengyj12345

  • 基于FPGA的寬帶數字接收機變帶寬數字下變頻器設計

    基于FPGA芯片Stratix II EP2S60F672C4設計了一個適用于寬帶數字接收機的帶寬可變的數字下變頻器（VB-DDC）。該VB-DDC結合傳統數字下變頻結構與多相濾波結構的優點，實現了對輸入中頻信號的高效高速處理，同時可以在較大范圍內對信號處理帶寬靈活配置。硬件調試結果驗證了本設計的有效性。

    標簽： FPGA 寬帶數字 接收機 帶寬

    上傳時間： 2013-10-13

    上傳用戶：haiya2000

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