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硬件設(shè)計(jì)

  • V3s硬件設(shè)計(jì)指南

    V3s硬件設(shè)計(jì)指南

    標(biāo)簽： v3s

    上傳時(shí)間： 2022-08-09

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  • 基于DSP的單相有源電力濾波器的硬件設(shè)計(jì).rar

    有源電力濾波器是一種新型諧波，無(wú)功補(bǔ)償裝置。和傳統(tǒng)無(wú)源的補(bǔ)償裝置相比，有源電力濾波器具有很大的優(yōu)勢(shì)，可以對(duì)諧波，無(wú)功以及負(fù)序電流實(shí)現(xiàn)實(shí)時(shí)、準(zhǔn)確的補(bǔ)償。因此，有源電力濾波器得到了廣泛的研究，并開始進(jìn)入工業(yè)應(yīng)用階段。隨著數(shù)字信號(hào)處理技術(shù)的高速發(fā)展，以全數(shù)字化控制技術(shù)實(shí)現(xiàn)的有源電力濾波器必將成為電力電子技術(shù)中新的研究熱點(diǎn)。 本論文闡述了諧波抑制的背景和目的以及國(guó)內(nèi)外諧波抑制技術(shù)的發(fā)展現(xiàn)狀，深入分析、比較了目前常用的有源濾波器的結(jié)構(gòu)和工作原理，本論文探討了單相系統(tǒng)的諧波檢測(cè)算法的各種方案及其特點(diǎn)，選用負(fù)荷電流基波有功分量法對(duì)諧波電流進(jìn)行檢測(cè)。該方法結(jié)構(gòu)簡(jiǎn)單，不僅適用于單相系統(tǒng)而且適用于三相系統(tǒng)。本文對(duì)單相有源電力濾波器進(jìn)行了硬件和軟件設(shè)計(jì)，對(duì)各硬件部分實(shí)現(xiàn)的功能進(jìn)行了具體的介紹，并給出了實(shí)現(xiàn)原理圖。軟件設(shè)計(jì)部分給出了主要程序的設(shè)計(jì)流程圖。以上設(shè)計(jì)方案在MATLAB 仿真軟件包的SIMULINK 環(huán)境下進(jìn)行了仿真實(shí)現(xiàn)，仿真結(jié)果證實(shí)了本文設(shè)計(jì)的有源電力濾波器的正確性和諧波補(bǔ)償?shù)膶?shí)時(shí)性。 在理論分析和仿真研究的基礎(chǔ)上，設(shè)計(jì)了基于TMS320F2812 DSP 控制的單相并聯(lián)型電力有源濾波器，研制了實(shí)驗(yàn)樣機(jī)，對(duì)并聯(lián)型有源電力濾波器進(jìn)行了初實(shí)驗(yàn)結(jié)果表明，本論文采用的負(fù)載電流基波有功分量算法能夠?qū)崟r(shí)，準(zhǔn)確地提取出諧波和無(wú)功分量，同時(shí)也表明，這種基于TMS320F2812 DSP 的單相有源電力濾波器具有優(yōu)良的諧波補(bǔ)償特性。

    標(biāo)簽： DSP 單相 有源電力濾波器

    上傳時(shí)間： 2013-06-19

    上傳用戶：qsbbear

  • 基于FPGA的ICT在線測(cè)試儀硬件設(shè)計(jì).rar

    焊有元件的印制電路板在線測(cè)試是印制電路板生產(chǎn)過(guò)程中的一個(gè)重要環(huán)節(jié)，關(guān)系著整個(gè)電子產(chǎn)品的質(zhì)量。本文在深入研究國(guó)內(nèi)外印制電路板自動(dòng)測(cè)試技術(shù)的基礎(chǔ)上，結(jié)合當(dāng)前先進(jìn)的電子技術(shù)，設(shè)計(jì)出一套高性能，低價(jià)位，小體積，便于攜帶和操作的印制電路板在線測(cè)試儀。 本文設(shè)計(jì)的在線測(cè)試儀系統(tǒng)包括控制器電路、信號(hào)發(fā)生電路、信號(hào)采集電路、元件測(cè)試電路、USB通信電路和開關(guān)矩陣電路等，其中控制器電路是以FPGA可編程控制芯片為核心，負(fù)責(zé)控制下位機(jī)其它所有電路的正常工作，并實(shí)現(xiàn)與上位機(jī)間的通信。 針對(duì)模擬元件的測(cè)試，本文首先探討了對(duì)印制電路板上模擬元件測(cè)試時(shí)的隔離原理，繼而詳細(xì)闡述了電阻、電容（電感）、二極管、三極管、運(yùn)算放大器等的測(cè)試方法，并分別設(shè)計(jì)了硬件測(cè)試電路。因?yàn)闇y(cè)試時(shí)需向被測(cè)元件施加測(cè)試激勵(lì)信號(hào)，本文設(shè)計(jì)并完成了一信號(hào)發(fā)生電路，可輸出幅值可調(diào)的直流恒壓源信號(hào)和直流恒流源信號(hào)、幅值和頻率都可調(diào)的交流信號(hào)。 針對(duì)數(shù)字器件的測(cè)試，本文將數(shù)字器件分為兩種，一種為具有邊界掃描功能單元的器件，另一類為非邊界掃描器件，并分別對(duì)兩種類型的數(shù)字器件的測(cè)試原理和方法進(jìn)行了詳細(xì)的描述，在文中給出了相關(guān)的硬件測(cè)試電路圖。 本設(shè)計(jì)中，所有測(cè)試激勵(lì)信號(hào)經(jīng)測(cè)試電路后輸出的測(cè)試結(jié)果都是直流電壓信號(hào)，所以本文設(shè)計(jì)了一通用信號(hào)采集電路來(lái)完成對(duì)測(cè)試結(jié)果的取樣。本文還設(shè)計(jì)了開關(guān)矩陣電路，用于將被測(cè)印制電路板上的元件接入到測(cè)試電路中。對(duì)通信電路的設(shè)計(jì)，本文采用USB通信方式與上位機(jī)進(jìn)行有效的數(shù)據(jù)交換，并通過(guò)USB接口芯片完成了硬件電路的設(shè)計(jì)。 在軟件方面，本文采用NiosⅡ C語(yǔ)言完成所有軟件設(shè)計(jì)，以協(xié)助硬件部分來(lái)完成對(duì)印制電路板的測(cè)試工作。 本文已完成各部分電路試驗(yàn)及系統(tǒng)聯(lián)調(diào)，試驗(yàn)證明設(shè)計(jì)達(dá)到了項(xiàng)目預(yù)定要求。

    標(biāo)簽： FPGA ICT 在線測(cè)試儀

    上傳時(shí)間： 2013-08-02

    上傳用戶：fywz

  • 基于FPGA的圖像處理算法研究及硬件設(shè)計(jì).rar

    隨著圖像分辨率的越來(lái)越高，軟件實(shí)現(xiàn)的圖像處理無(wú)法滿足實(shí)時(shí)性的需求；同時(shí)FPGA等可編程器件的快速發(fā)展使得硬件實(shí)現(xiàn)圖像處理變得可行。如今基于FPGA的圖像處理研究成為了國(guó)內(nèi)外的一個(gè)熱門領(lǐng)域。 本文在FPGA平臺(tái)上，用Verilog HDL實(shí)現(xiàn)了一個(gè)研究圖像處理算法的可重復(fù)配置的硬件模塊架構(gòu)，架構(gòu)包括PC機(jī)預(yù)處理和通信軟件，控制模塊，計(jì)算單元，存儲(chǔ)器模塊和通信適配模塊五個(gè)部分。其中的計(jì)算模塊負(fù)責(zé)具體算法的實(shí)現(xiàn)，根據(jù)不同的圖像處理算法可以獨(dú)立實(shí)現(xiàn)。架構(gòu)為計(jì)算模塊實(shí)現(xiàn)了一個(gè)可添加、移出接口，不同的算法設(shè)計(jì)只要符合該接口就可以方便的加入到模塊架構(gòu)中來(lái)進(jìn)行調(diào)試和運(yùn)行。 在硬件架構(gòu)的基礎(chǔ)上本文實(shí)現(xiàn)了排序?yàn)V波，中值濾波，卷積運(yùn)算及高斯濾波，形態(tài)學(xué)算子運(yùn)算等經(jīng)典的圖像處理算法。討論了FPGA的圖像處理算法的設(shè)計(jì)方法及優(yōu)化策略，通過(guò)性能分析，F(xiàn)PGA實(shí)現(xiàn)圖像處理在時(shí)間上比軟件處理有了很大的提高；通過(guò)結(jié)果的比較，發(fā)現(xiàn)FPGA的處理結(jié)果達(dá)到了軟件處理幾乎同等的效果水平。最后本文在實(shí)現(xiàn)較大圖片處理和圖像處理窗口的大小可配置性方面做了一定程度的討論和改進(jìn)，提高了算法的可用性，同時(shí)為進(jìn)一步的研究提供了更加便利的平臺(tái)。 整個(gè)設(shè)計(jì)都是在ISE8.2和ModelSim第三方仿真軟件環(huán)境下開發(fā)的，在xilinx的Spartan-3E XC3S500E硬件平臺(tái)上實(shí)現(xiàn)。在軟件仿真過(guò)程中利用了ISE8.2自帶仿真工具和ModelSim結(jié)合使用。 本課題為制造FPGA的專用圖像處理芯片做了有益的探索性研究，為實(shí)現(xiàn)FPGA為核心處理芯片的實(shí)時(shí)圖像處理系統(tǒng)有著積極的作用。

    標(biāo)簽： FPGA 圖像處理 算法研究

    上傳時(shí)間： 2013-07-29

    上傳用戶：愛(ài)順不順

  • 基于ARM的嵌入式測(cè)控硬件平臺(tái)設(shè)計(jì)

    隨著計(jì)算機(jī)技術(shù)的飛速發(fā)展，嵌入式系統(tǒng)在人們的生產(chǎn)生活中發(fā)揮著越來(lái)越重要的作用。近年來(lái)，基于ARM處理器和μC/OS-II操作系統(tǒng)的嵌入式技術(shù)已經(jīng)成為當(dāng)前嵌入式領(lǐng)域的研究熱點(diǎn)之一。 論文主要研究基于ARM7處理器和μC/OS-II操作系統(tǒng)的嵌入式測(cè)控平臺(tái)架構(gòu)，為測(cè)控系統(tǒng)開發(fā)提供一個(gè)方便功能擴(kuò)展的軟硬件環(huán)境。在此基礎(chǔ)上，以加速度計(jì)為對(duì)象，利用嵌入式系統(tǒng)的豐富資源，完成對(duì)其內(nèi)部溫度及加速度信號(hào)的采集實(shí)例。硬件設(shè)計(jì)分為核心系統(tǒng)設(shè)計(jì)和數(shù)據(jù)采集控制子系統(tǒng)設(shè)計(jì)兩部分。核心系統(tǒng)主要包括控制核心S3C44BOX模塊、存儲(chǔ)器模塊、調(diào)試接口模塊、液晶顯示模塊以及數(shù)控鍵盤模塊等。完成了母板的設(shè)計(jì)與驗(yàn)證，并預(yù)留多種接口，增強(qiáng)了可擴(kuò)展性。采集控制子系統(tǒng)作為數(shù)據(jù)采集及控制機(jī)構(gòu)，主要由A/D轉(zhuǎn)換芯片完成和串行通信模塊，用來(lái)接收傳感器傳輸?shù)臄?shù)據(jù)，經(jīng)ARM處理器分析處理后，通過(guò)串行通訊方式與下位機(jī)通信。由于有多個(gè)下位系統(tǒng)，平臺(tái)設(shè)計(jì)擴(kuò)展了8路帶高速緩沖的異步串行通信模塊。最后，對(duì)各硬件模塊進(jìn)行總體調(diào)試，并對(duì)調(diào)試結(jié)果進(jìn)行了分析。 調(diào)試結(jié)果表明，該硬件平臺(tái)不僅響應(yīng)速度快、成本低、可靠性好，而且具有良好的可移植性和可裁剪性，便于根據(jù)實(shí)際需求進(jìn)行功能擴(kuò)展和裁剪，達(dá)到了預(yù)期的設(shè)計(jì)目標(biāo)。

    標(biāo)簽： ARM 嵌入式 測(cè)控 平臺(tái)設(shè)計(jì)

    上傳時(shí)間： 2013-07-26

    上傳用戶：zhqzal1014

  • 基于ARM和CPLD的四足機(jī)器人嵌入式控制器硬件平臺(tái)設(shè)計(jì)

    運(yùn)動(dòng)控制系統(tǒng)是機(jī)器人控制系統(tǒng)的重要組成部分。本文將ARM與CPLD技術(shù)應(yīng)用于機(jī)器人運(yùn)動(dòng)控制系統(tǒng)，使控制系統(tǒng)更加開放、更加模塊化，同時(shí)ARM芯片的高速大容量的數(shù)據(jù)處理能力以及CPLD的高集成度，可編程性，能夠逾越以往控制系統(tǒng)中實(shí)時(shí)、高速、高精度的技術(shù)瓶頸. 嵌入式技術(shù)是當(dāng)今最熱門的技術(shù)之一，由于簡(jiǎn)潔、高效等優(yōu)點(diǎn)，使得其廣泛應(yīng)用在各個(gè)領(lǐng)域；所謂嵌入式系統(tǒng)就是以應(yīng)用為中心，以計(jì)算機(jī)技術(shù)為基礎(chǔ)，并且軟硬件可裁剪，適用于應(yīng)用系統(tǒng)對(duì)功能、可靠性、成本、體積、功耗有嚴(yán)格要求的專用計(jì)算機(jī)系統(tǒng)。它一般由嵌入式微處理器、外圍硬件設(shè)備、嵌入式操作系統(tǒng)以及用戶的應(yīng)用程序等四個(gè)部分組成，用于實(shí)現(xiàn)對(duì)其它設(shè)備的控制、監(jiān)視或管理等功能。 本文主要闡述了基于嵌入式處理器S3C44B0X的機(jī)器人控制器的設(shè)計(jì)過(guò)程。文章首先介紹了機(jī)器人本體規(guī)劃、嵌入式系統(tǒng)和嵌入式微處理器S3C44B0X的結(jié)構(gòu)特點(diǎn)；接著介紹了基于S3C44B0X的智能控制器的設(shè)計(jì)，包括硬件設(shè)計(jì)和CPLD軟件設(shè)計(jì)。其中控制器硬件平臺(tái)擴(kuò)展了外部存儲(chǔ)器、串行口，通過(guò)輸出PWM信號(hào)進(jìn)入驅(qū)動(dòng)電路模塊，從而實(shí)現(xiàn)控制機(jī)器人運(yùn)動(dòng)的目的。在CPLD設(shè)計(jì)過(guò)程中，引入JTAG調(diào)試接口，方便系統(tǒng)程序的下載和調(diào)試，通過(guò)自上而下、分塊設(shè)計(jì)的思想給出了QUARTUSⅡ設(shè)計(jì)環(huán)境下的軟件代碼。本系統(tǒng)利用不同任務(wù)間的切換來(lái)實(shí)現(xiàn)通信過(guò)程，而不再采用無(wú)操作系統(tǒng)的工程文件的形式，這樣不但有利于項(xiàng)目的調(diào)試，也有利于對(duì)其它接口的擴(kuò)展。最后對(duì)該控制器進(jìn)行了測(cè)試和分析。

    標(biāo)簽： CPLD ARM 四足機(jī)器人 嵌入式控制器

    上傳時(shí)間： 2013-07-19

    上傳用戶：Zxcvbnm

  • TMS320VC33系統(tǒng)的硬件設(shè)計(jì)The Hardware Design of TMS320VC33 System

    本文針對(duì)浮點(diǎn)DSP 芯片TMS320VC33 芯片的結(jié)構(gòu)特點(diǎn)，介紹了該芯片最小系統(tǒng)硬件電路設(shè)計(jì)的方法，并結(jié)合實(shí)際應(yīng)用情況，介紹了相關(guān)的時(shí)鐘電路、復(fù)位電路、JTAG 仿真接口電路、外圍存儲(chǔ)器接口電

    標(biāo)簽： TMS 320 Hardware Design

    上傳時(shí)間： 2013-06-11

    上傳用戶：jcljkh

  • 紅外動(dòng)目標(biāo)識(shí)別跟蹤系統(tǒng)DSPFPGA硬件設(shè)計(jì)與實(shí)現(xiàn)

    視頻目標(biāo)識(shí)別與跟蹤技術(shù)是當(dāng)今世界重要的研究課題,它涉及圖像處理、自動(dòng)控制、計(jì)算機(jī)應(yīng)用等學(xué)科,該文主要論述該項(xiàng)目的具體實(shí)現(xiàn)及相關(guān)理論分析,重點(diǎn)在于該系統(tǒng)的硬件模塊實(shí)現(xiàn)及分析.該系統(tǒng)的硬件模塊是典型的高速數(shù)字電路,這也是當(dāng)今世界電路設(shè)計(jì)的一大熱點(diǎn).同時(shí),該系統(tǒng)的硬件模塊不同于傳統(tǒng)的模擬、數(shù)字電路.嚴(yán)格的說(shuō)它是基于可編程芯片的系統(tǒng)(System On Programmable Chip).它與傳統(tǒng)電路的最大不同在于,硬件模塊本身不具備任何功能,但該硬件模塊可以與相應(yīng)的軟件結(jié)合(此處,我們將FPGA中的可編程指令也廣義的歸入軟件范疇),實(shí)現(xiàn)相應(yīng)的功能.換言之,該硬件模塊通過(guò)換用其他軟件,可以實(shí)現(xiàn)其他功能.所以從這個(gè)意義上講,我們也可以將其稱為基于可編程芯片的通用平臺(tái)系統(tǒng)(General System On Programmable Chip).此外,該文還對(duì)該系統(tǒng)進(jìn)行了嘗試性的層狀結(jié)構(gòu)描述,這種描述同樣適用于其它IT目的或電子系統(tǒng).

    標(biāo)簽： DSPFPGA 紅外 目標(biāo)識(shí)別 硬件設(shè)計(jì)

    上傳時(shí)間： 2013-04-24

    上傳用戶：yumiaoxia

  • 基于DSP和FPGA的自動(dòng)指紋識(shí)別系統(tǒng)硬件設(shè)計(jì)與實(shí)現(xiàn)

    隨著計(jì)算機(jī)與信息技術(shù)的發(fā)展，生物特征識(shí)別技術(shù)受到了廣泛的關(guān)注。指紋識(shí)別是生物特征識(shí)別中的一項(xiàng)重要內(nèi)容，一直以來(lái)是國(guó)內(nèi)外的研究熱點(diǎn)。 嵌入式自動(dòng)指紋識(shí)別是指指紋識(shí)別技術(shù)在嵌入式系統(tǒng)上的應(yīng)用。傳統(tǒng)的嵌入式自動(dòng)指紋識(shí)別系統(tǒng)多采用單片DSP或MIPS處理器來(lái)完成算法，由于DSP或MIPS處理器只能根據(jù)程序順序執(zhí)行，在指紋匹配過(guò)程中只能和整個(gè)庫(kù)中的指紋進(jìn)行一一匹配，因此這類系統(tǒng)在處理較大指紋庫(kù)時(shí)下匹配時(shí)間相當(dāng)長(zhǎng)。為了克服這個(gè)缺點(diǎn)，本文構(gòu)建了浮點(diǎn)DSP和FPGA協(xié)同處理構(gòu)架的硬件平臺(tái)，充分利用DSP在計(jì)算上的精確度和FPGA并行處理的特點(diǎn)，由DSP和FPGA共同處理匹配算法。 本文的主要工作如下： 1．設(shè)計(jì)了一個(gè)硬件系統(tǒng)，包括DSP處理器、FPGA、指紋傳感器、人機(jī)交互接口和USB1.1接口。同時(shí)，還設(shè)計(jì)了各硬件模塊的驅(qū)動(dòng)程序，為應(yīng)用程序提供控制接口。由于系統(tǒng)中DSP工作頻率為300MHz，其中某些器件的工作頻率達(dá)到了100MHz，因此本文還給出了一些信號(hào)完整性分析和PCB設(shè)計(jì)經(jīng)驗(yàn)。 2．編寫了Verilog程序，在FPGA中實(shí)現(xiàn)了9路指紋的并行匹配。由于FPGA本身的局限性，實(shí)現(xiàn)原有匹配算法有很大困難。在簡(jiǎn)化原有匹配算法的基礎(chǔ)上本文提出了便于FPGA實(shí)現(xiàn)“粗匹配”算法。此外，還設(shè)計(jì)了用于和DSP通信的接口模塊設(shè)計(jì)。 3．完成了系統(tǒng)應(yīng)用程序設(shè)計(jì)。在使用uC/OS-Ⅱ?qū)崟r(shí)操作系統(tǒng)的基礎(chǔ)上設(shè)計(jì)了各系統(tǒng)任務(wù)，通過(guò)調(diào)用驅(qū)動(dòng)程序控制和協(xié)調(diào)各硬件模塊，實(shí)現(xiàn)了自動(dòng)指紋識(shí)別功能。為了便于存放指紋特征信息，設(shè)計(jì)了指紋庫(kù)數(shù)據(jù)結(jié)構(gòu)，實(shí)現(xiàn)了指紋庫(kù)添加、刪除、編輯的功能。 最終，本系統(tǒng)實(shí)現(xiàn)了高效、快速的進(jìn)行指紋識(shí)別，各模塊工作穩(wěn)定。同時(shí)，模塊化的軟硬件設(shè)計(jì)使本系統(tǒng)便于進(jìn)行二次開發(fā)，快速應(yīng)用于各種場(chǎng)合。

    標(biāo)簽： FPGA DSP 自動(dòng) 指紋識(shí)別系統(tǒng)

    上傳時(shí)間： 2013-06-05

    上傳用戶：guanliya

  • 圖像處理算法研究及硬件設(shè)計(jì)

    隨著圖像分辨率的越來(lái)越高，軟件實(shí)現(xiàn)的圖像處理無(wú)法滿足實(shí)時(shí)性的需求；同時(shí)FPGA等可編程器件的快速發(fā)展使得硬件實(shí)現(xiàn)圖像處理變得可行。如今基于FPGA的圖像處理研究成為了國(guó)內(nèi)外的一個(gè)熱門領(lǐng)域。 本文在FPGA平臺(tái)上，用Verilog HDL實(shí)現(xiàn)了一個(gè)研究圖像處理算法的可重復(fù)配置的硬件模塊架構(gòu)，架構(gòu)包括PC機(jī)預(yù)處理和通信軟件，控制模塊，計(jì)算單元，存儲(chǔ)器模塊和通信適配模塊五個(gè)部分。其中的計(jì)算模塊負(fù)責(zé)具體算法的實(shí)現(xiàn)，根據(jù)不同的圖像處理算法可以獨(dú)立實(shí)現(xiàn)。架構(gòu)為計(jì)算模塊實(shí)現(xiàn)了一個(gè)可添加、移出接口，不同的算法設(shè)計(jì)只要符合該接口就可以方便的加入到模塊架構(gòu)中來(lái)進(jìn)行調(diào)試和運(yùn)行。 在硬件架構(gòu)的基礎(chǔ)上本文實(shí)現(xiàn)了排序?yàn)V波，中值濾波，卷積運(yùn)算及高斯濾波，形態(tài)學(xué)算子運(yùn)算等經(jīng)典的圖像處理算法。討論了FPGA的圖像處理算法的設(shè)計(jì)方法及優(yōu)化策略，通過(guò)性能分析，F(xiàn)PGA實(shí)現(xiàn)圖像處理在時(shí)間上比軟件處理有了很大的提高；通過(guò)結(jié)果的比較，發(fā)現(xiàn)FPGA的處理結(jié)果達(dá)到了軟件處理幾乎同等的效果水平。最后本文在實(shí)現(xiàn)較大圖片處理和圖像處理窗口的大小可配置性方面做了一定程度的討論和改進(jìn)，提高了算法的可用性，同時(shí)為進(jìn)一步的研究提供了更加便利的平臺(tái)。 整個(gè)設(shè)計(jì)都是在ISE8.2和ModelSim第三方仿真軟件環(huán)境下開發(fā)的，在xilinx的Spartan-3E XC3S500E硬件平臺(tái)上實(shí)現(xiàn)。在軟件仿真過(guò)程中利用了ISE8.2自帶仿真工具和ModelSim結(jié)合使用。 本課題為制造FPGA的專用圖像處理芯片做了有益的探索性研究，為實(shí)現(xiàn)FPGA為核心處理芯片的實(shí)時(shí)圖像處理系統(tǒng)有著積極的作用。

    標(biāo)簽： 圖像處理 算法研究 硬件設(shè)計(jì)

    上傳時(shí)間： 2013-05-30

    上傳用戶：水瓶kmoon5

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