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CPLD數(shù)字電路設(shè)計(jì)硬件描述語言一例+一本經(jīng)典教材，入門專用
標(biāo)簽： CPLD 數(shù)字 電路設(shè)計(jì) 硬件描述語言
上傳時(shí)間： 2013-09-04
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這是一款USB接口ISP1582器件實(shí)現(xiàn)DMA傳輸?shù)妮o助電路的硬件設(shè)計(jì)源代碼
標(biāo)簽： 1582 USB ISP DMA
上傳時(shí)間： 2013-09-05
上傳用戶：1142895891
此曼徹斯特碼的解碼程序是采用VHDL硬件語言編寫的。
標(biāo)簽： VHDL 硬件 曼徹斯特 語言
上傳時(shí)間： 2013-09-06
上傳用戶：zhouli
protel99se 嵌入式系統(tǒng)設(shè)計(jì)硬件設(shè)計(jì)工具
標(biāo)簽： protel 99 se 嵌入式系統(tǒng)設(shè)計(jì)
上傳時(shí)間： 2013-09-12
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硬件設(shè)計(jì)
標(biāo)簽： 硬件設(shè)計(jì) 濾波電路 軟件濾波 算法
上傳時(shí)間： 2014-12-23
上傳用戶：YYRR
硬件
標(biāo)簽： 硬件設(shè)計(jì)
上傳時(shí)間： 2013-12-25
上傳用戶：pwcsoft
華為硬件工程師培訓(xùn)資料，單片機(jī)，嵌入式。
標(biāo)簽： 華為 硬件工程師
上傳時(shí)間： 2013-10-26
上傳用戶：zhishenglu
看看華為硬件工程師怎么調(diào)電路
上傳時(shí)間： 2013-10-08
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硬件工程師手冊(cè)
標(biāo)簽： 200.8 20 硬件工程師
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為了縮短加法電路運(yùn)行時(shí)間，提高FPGA運(yùn)行效率，利用選擇進(jìn)位算法和差額分組算法用硬件電路實(shí)現(xiàn)32位加法器，差額分組中的加法單元是利用一種改進(jìn)的超前進(jìn)位算法實(shí)現(xiàn)，選擇進(jìn)位算法可使不同的分組單元并行運(yùn)算，利用低位的運(yùn)算結(jié)果選擇高位的進(jìn)位為1或者進(jìn)位為零的運(yùn)算結(jié)果，節(jié)省了進(jìn)位選擇等待的時(shí)間，最后利用XILINX進(jìn)行時(shí)序仿真，在FPGA上進(jìn)行驗(yàn)證，可穩(wěn)定運(yùn)行在高達(dá)50兆的頻率，理論分析與計(jì)算機(jī)仿真表明該算法切實(shí)可行、有效并且易于實(shí)現(xiàn)。
標(biāo)簽： 進(jìn)位 加法器 硬件 電路實(shí)現(xiàn)
上傳時(shí)間： 2013-12-19
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