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碼元同步

  • OFDM系統(tǒng)幀檢測及同步算法FPGA設(shè)計與實現(xiàn)

    正交頻分復(fù)用(OFDM)技術(shù)是一種多載波數(shù)字調(diào)制技術(shù),它具有頻譜利用率高、抗多徑能力強(qiáng)等特點,在寬帶無線多媒體通信領(lǐng)域中受到了廣泛的關(guān)注。 OFDM系統(tǒng)可分為連續(xù)工作模式和突發(fā)工作模式。在IEEE802.11a、HiperLANType2等無線局域網(wǎng)標(biāo)準(zhǔn)中采用了OFDM的突發(fā)工作模式,該模式下的接收機(jī)首先對符合某種特定格式的幀做出檢測。本文介紹了一種基于最小錯誤概率準(zhǔn)則的幀檢測算法,提出了該算法的FPGA實現(xiàn)方案。 同步技術(shù)是OFDM最關(guān)鍵的技術(shù)之一,它包括載波頻率同步和符號同步。載波頻率同步是為了糾正接收端相對于發(fā)送端的載波頻率偏移,以保證子載波間的正交性;符號同步確定OFDM符號有用數(shù)據(jù)信息的開始時刻,也就是確定FFT窗的開始時刻。本文首先介紹了一種基于自相關(guān)的載波頻率同步算法,給出了它的FPGA實現(xiàn)方案,重點講述了其中用到的Cordic算法及其實現(xiàn);然后介紹了分別基于互相關(guān)和自相關(guān)的兩種符號同步算法,給出了各自的FPGA實現(xiàn)方案,從實現(xiàn)的角度比較了兩種算法的優(yōu)缺點,并且在FPGA設(shè)計中體現(xiàn)了面積復(fù)用和流水線操作的設(shè)計思想。 文章最后介紹了系統(tǒng)調(diào)試的情況,總結(jié)出一種ChipScopePro與Matlab相結(jié)合的調(diào)試方法,該方法在FPGA調(diào)試方面具有一定的通用性。

    標(biāo)簽: OFDM FPGA

    上傳時間: 2013-07-16

    上傳用戶:Killerboo

  • 基于FPGA的全彩色LED同步顯示屏

    LED顯示屏作為一項高新科技產(chǎn)品正引起人們的高度重視,它以其動態(tài)范圍廣,亮度高,壽命長,工作性能穩(wěn)定而日漸成為顯示媒體中的佼佼者,現(xiàn)已廣泛應(yīng)用于廣告、證券、交通、信息發(fā)布等各方面,且隨著全彩屏顯示技術(shù)的日益完善,LED顯示屏有著廣闊的市場前景。 本文主要研究的對象為全彩色LED同步顯示屏控制系統(tǒng),提出了一個系統(tǒng)實現(xiàn)方案,整個系統(tǒng)分三部分組成:DVI解碼電路、發(fā)送系統(tǒng)以及接收系統(tǒng)。DVI解碼模塊用于從顯卡的DVI口獲取視頻源數(shù)據(jù),經(jīng)過T.D.M.S.解碼恢復(fù)出可供LED屏顯示的紅、綠、藍(lán)共24位像素數(shù)據(jù)和一些控制信號。發(fā)送系統(tǒng)用于將收到的數(shù)據(jù)流進(jìn)行緩存,經(jīng)處理后發(fā)送至以太網(wǎng)芯片進(jìn)行以太網(wǎng)傳輸。接收系統(tǒng)接收以太網(wǎng)上傳來的視頻數(shù)據(jù)流,經(jīng)過位分離操作后存入SRAM進(jìn)行緩存,再串行輸入至LED顯示屏進(jìn)行掃描顯示。然后,從多方面論述了該方案的可行性,仔細(xì)推導(dǎo)了LED顯示屏各技術(shù)參數(shù)之間的聯(lián)系及約束關(guān)系。 本課題采用可編程邏輯器件來完成系統(tǒng)功能,可編程邏輯器件具有高集成度、高速度、在線可編程等特點,不僅可以滿足高速圖像數(shù)據(jù)處理對速度的要求,而且增加了設(shè)計的靈活性,不需修改電路硬件設(shè)計,縮短了設(shè)計周期,還可以進(jìn)行在線升級。

    標(biāo)簽: FPGA LED 全彩色 同步顯示

    上傳時間: 2013-06-22

    上傳用戶:jennyzai

  • 基于數(shù)據(jù)符號同步的FPGA仿真實現(xiàn)

    近年來,人們對無線數(shù)據(jù)和多媒體業(yè)務(wù)的需求迅猛增加,促進(jìn)了寬帶無線通信新技術(shù)的發(fā)展和應(yīng)用。正交頻分復(fù)用 (Orthogonal Frequency Division Multiolexing,OFDM)技術(shù)已經(jīng)廣泛應(yīng)用于各種高速寬帶無線通信系統(tǒng)中。然而 OFDM 系統(tǒng)相比單載波系統(tǒng)更容易受到頻偏和時偏的影響,因此如何有效地消除頻偏和時偏,實現(xiàn)系統(tǒng)的時頻同步是 OFDM 系統(tǒng)中非常關(guān)鍵的技術(shù)。 本文討論了非同步對 OFDM 系統(tǒng)的影響,分析了當(dāng)前用于 OFDM 系統(tǒng)中基于數(shù)據(jù)符號的同步算法,并簡單介紹非基于數(shù)據(jù)符號同步技術(shù)。基于數(shù)據(jù)符號的同步技術(shù)通過加入訓(xùn)練符號或?qū)ьl等附加信息,并利用導(dǎo)頻或訓(xùn)練符號的相關(guān)性實現(xiàn)時頻同步。此算法由于加入了附加信息,降低了帶寬利用率,但同步精度相對較高,同步捕獲時間較短。 隨著電子芯片技術(shù)的快速發(fā)展,電子設(shè)計自動化 (Electronic DesignAutomation,EDA) 技術(shù)和可編程邏輯芯片 (FPGA/CPLD) 的應(yīng)用越來越受到大家的重視,為此文中對 EDA 技術(shù)和 Altera 公司制造的 FPGA 芯片的原理和結(jié)構(gòu)特點進(jìn)行了闡述,還介紹了在相關(guān)軟件平臺進(jìn)行開發(fā)的系統(tǒng)流程。 論文在對基于數(shù)據(jù)符號三種算法進(jìn)行較詳細(xì)的分析和研究的基礎(chǔ)上,尤其改進(jìn)了基于導(dǎo)頻符號的同步算法之后,利用 Altera 公司的 FPGA 芯片EP1S25F102015 在 OuartusⅡ5.0 工具平臺上實現(xiàn)了 OFDM 同步的硬件設(shè)計,然后進(jìn)行了軟件仿真。其中對基于導(dǎo)頻符號同步的改進(jìn)算法硬件設(shè)計過程了進(jìn)行了詳細(xì)闡述。不僅如此,對于基于 PN 序列幀的同步算法和基于循環(huán)前綴 (Cycle Prefix,CP) 的極大似然 (Maximam Likelihood,ML)估計同步算法也有具體的仿真實現(xiàn)。 最后,文章還對它們進(jìn)行了比較,基于導(dǎo)頻符號同步設(shè)計的同步精度比較高,但是耗費芯片的資源多,另一個缺點是沒有頻偏估計,因此運用受到一定限制。基于 PN 序列幀的同步設(shè)計使用了最少的芯片資源,但要提取 PN 序列中的信號數(shù)據(jù)有一定困難。基于循環(huán)前綴的同步設(shè)計占用了芯片 I/O 腳稍顯多。這幾種同步算法各有優(yōu)缺點,但可以根據(jù)不同的信道環(huán)境選用它們。

    標(biāo)簽: FPGA 數(shù)據(jù) 同步的 仿真實現(xiàn)

    上傳時間: 2013-04-24

    上傳用戶:斷點PPpp

  • OFDM系統(tǒng)的定時和頻率同步的實現(xiàn)

    正交頻分復(fù)用技術(shù)(OFDM)是未來寬帶無線通信中的關(guān)鍵技術(shù)。隨著用戶對實時多媒體業(yè)務(wù),高速移動業(yè)務(wù)需求的迅速增加,OFDM由于其頻譜效率高,抗多徑效應(yīng)能力強(qiáng),抗干擾性能好等特點,該技術(shù)正得到了廣泛的應(yīng)用。 OFDM系統(tǒng)的子載波之間必須保持嚴(yán)格的正交性,因此對符號定時和載波頻偏非常敏感。本課題的主要任務(wù)是分析各種算法的性能的優(yōu)劣,選取合適的算法進(jìn)行FPGA的實現(xiàn)。 本文首先簡要介紹了無線信道的傳輸特性和OFDM系統(tǒng)的基本原理,進(jìn)而對符號同步和載波同步對接收信號的影響做了分析。然后對比了非數(shù)據(jù)輔助式同步算法和數(shù)據(jù)輔助式同步算法的不同特點,決定采用數(shù)據(jù)輔助式同步算法來解決基于IEEE 802.16-2004協(xié)議的突發(fā)傳輸系統(tǒng)的同步問題。最后部分進(jìn)行了算法的實現(xiàn)和仿真,所有實現(xiàn)的仿真均在QuartusⅡ下按照IEEE 802.16-2004協(xié)議的符號和前導(dǎo)字的結(jié)構(gòu)進(jìn)行。 本文的主要工作:(1)采用自相關(guān)和互相關(guān)聯(lián)合檢測算法同時完成幀到達(dá)檢測和符號同步估計,只用接收數(shù)據(jù)的符號位做相關(guān)運算,有效地解決了判決門限需要變化的問題,同時也減少了資源的消耗;(2)在時域分?jǐn)?shù)倍頻偏估計時,利用基于流水線結(jié)構(gòu)的Cordic模塊計算長前導(dǎo)字共軛相乘后的相角,求出分?jǐn)?shù)倍頻偏的估計值;(3)采用滑動窗口相關(guān)求和的方法估計整數(shù)倍頻偏值,在此只用頻域數(shù)據(jù)的符號位做相關(guān)運算,有效地解決了傳統(tǒng)算法估計速度慢的缺點,同時也減少了資源的消耗。

    標(biāo)簽: OFDM 定時 同步的

    上傳時間: 2013-05-23

    上傳用戶:宋桃子

  • 基于FPGA的精確時鐘同步方法研究

    在工業(yè)控制領(lǐng)域,多種現(xiàn)場總線標(biāo)準(zhǔn)共存的局面從客觀上促進(jìn)了工業(yè)以太網(wǎng)技術(shù)的迅速發(fā)展,國際上已經(jīng)出現(xiàn)了HSE、Profinet、Modbus TCP/IP、Ethernet/IP、Ethernet Powerlink、EtherCAT等多種工業(yè)以太網(wǎng)協(xié)議。將傳統(tǒng)的商用以太網(wǎng)應(yīng)用于工業(yè)控制系統(tǒng)的現(xiàn)場設(shè)備層的最大障礙是以太網(wǎng)的非實時性,而實現(xiàn)現(xiàn)場設(shè)備間的高精度時鐘同步是保證以太網(wǎng)高實時性的前提和基礎(chǔ)。 IEEE 1588定義了一個能夠在測量和控制系統(tǒng)中實現(xiàn)高精度時鐘同步的協(xié)議——精確時間協(xié)議(Precision Time Protocol)。PTP協(xié)議集成了網(wǎng)絡(luò)通訊、局部計算和分布式對象等多項技術(shù),適用于所有通過支持多播的局域網(wǎng)進(jìn)行通訊的分布式系統(tǒng),特別適合于以太網(wǎng),但不局限于以太網(wǎng)。PTP協(xié)議能夠使異質(zhì)系統(tǒng)中各類不同精確度、分辨率和穩(wěn)定性的時鐘同步起來,占用最少的網(wǎng)絡(luò)和局部計算資源,在最好情況下能達(dá)到系統(tǒng)級的亞微級的同步精度。 基于PC機(jī)軟件的時鐘同步方法,如NTP協(xié)議,由于其實現(xiàn)機(jī)理的限制,其同步精度最好只能達(dá)到毫秒級;基于嵌入式軟件的時鐘同步方法,將時鐘同步模塊放在操作系統(tǒng)的驅(qū)動層,其同步精度能夠達(dá)到微秒級。現(xiàn)場設(shè)備間微秒級的同步精度雖然已經(jīng)能滿足大多數(shù)工業(yè)控制系統(tǒng)對設(shè)備時鐘同步的要求,但是對于運動控制等需求高精度定時的系統(tǒng)來說,這仍然不夠。基于嵌入式軟件的時鐘同步方法受限于操作系統(tǒng)中斷響應(yīng)延遲時間不一致、晶振頻率漂移等因素,很難達(dá)到亞微秒級的同步精度。 本文設(shè)計并實現(xiàn)了一種基于FPGA的時鐘同步方法,以IEEE 1588作為時鐘同步協(xié)議,以Ethernet作為底層通訊網(wǎng)絡(luò),以嵌入式軟件形式實現(xiàn)TCP/IP通訊,以數(shù)字電路形式實現(xiàn)時鐘同步模塊。這種方法充分利用了FPGA的特點,通過準(zhǔn)確捕獲報文時間戳和動態(tài)補(bǔ)償晶振頻率漂移等手段,相對于嵌入式軟件時鐘同步方法實現(xiàn)了更高精度的時鐘同步,并通過實驗驗證了在以集線器互連的10Mbps以太網(wǎng)上能夠達(dá)到亞微秒級的同步精度。

    標(biāo)簽: FPGA 時鐘同步 方法研究

    上傳時間: 2013-07-28

    上傳用戶:heart520beat

  • 基于FPGA的全同步數(shù)字頻率計的設(shè)計

    頻率是電子技術(shù)領(lǐng)域內(nèi)的一個基本參數(shù),同時也是一個非常重要的參數(shù)。穩(wěn)定的時鐘在高性能電子系統(tǒng)中有著舉足輕重的作用,直接決定系統(tǒng)性能的優(yōu)劣。隨著電子技術(shù)的發(fā)展,測頻系統(tǒng)使用時鐘的提高,測頻技術(shù)有了相當(dāng)大的發(fā)展,但不管是何種測頻方法,±1個計數(shù)誤差始終是限制測頻精度進(jìn)一步提高的一個重要因素。 本設(shè)計闡述了各種數(shù)字測頻方法的優(yōu)缺點。通過分析±1個計數(shù)誤差的來源得出了一種新的測頻方法:檢測被測信號,時基信號的相位,當(dāng)相位同步時開始計數(shù),相位再次同步時停止計數(shù),通過相位同步來消除計數(shù)誤差,然后再通過運算得到實際頻率的大小。根據(jù)M/T法的測頻原理,已經(jīng)出現(xiàn)了等精度的測頻方法,但是還存在±1的計數(shù)誤差。因此,本文根據(jù)等精度測頻原理中閘門時間只與被測信號同步,而不與標(biāo)準(zhǔn)信號同步的缺點,通過分析已有等精度澳孽頻方法所存在±1個計數(shù)誤差的來源,采用了全同步的測頻原理在FPGA器件上實現(xiàn)了全同步數(shù)字頻率計。根據(jù)全同步數(shù)字頻率計的測頻原理方框圖,采用VHDL語言,成功的編寫出了設(shè)計程序,并在MAX+PLUS Ⅱ軟件環(huán)境中,對編寫的VHDL程序進(jìn)行了仿真,得到了很好的效果。最后,又討論了全同步頻率計的硬件設(shè)計并給出了電路原理圖和PCB圖。對構(gòu)成全同步數(shù)字頻率計的每一個模塊,給出了較詳細(xì)的設(shè)計方法和完整的程序設(shè)計以及仿真結(jié)果。

    標(biāo)簽: FPGA 數(shù)字頻率計

    上傳時間: 2013-04-24

    上傳用戶:qqoqoqo

  • 基于FPGA的高光譜圖像實時端元提取

    由于遙感器的空間分辨力的限制以及自然界地物的復(fù)雜性,混合像元普遍存在于遙感圖像中,為了提高遙感應(yīng)用的精度,就必須解決混合像元的分解問題。而端元提取,則是光譜解混合的重要組成部分。然而,高光譜圖像巨大的數(shù)據(jù)量和...

    標(biāo)簽: FPGA 高光譜圖像

    上傳時間: 2013-06-07

    上傳用戶:維子哥哥

  • 永磁同步伺服電機(jī)(PMSM) 驅(qū)動器設(shè)計原理

    ·永磁交流伺服系統(tǒng)的驅(qū)動器經(jīng)歷了模擬式、模擬數(shù)字混合式的發(fā)展后,目前已經(jīng)進(jìn)入了全數(shù)字的時代。全數(shù)字伺服驅(qū)動器不僅克服了模擬式伺服的分散性大、零漂、低可靠性等缺點,還充分發(fā)揮了數(shù)字控制在控制精度上的優(yōu)勢和控制方法的靈活,使伺服驅(qū)動器不僅結(jié)構(gòu)簡單,而且性能更加可靠。現(xiàn)在,高性能的伺服系統(tǒng)大多數(shù)采用永磁交流伺服系統(tǒng),其中包括永磁同步交流伺服電動機(jī)和全數(shù)字交流永磁同步伺服驅(qū)動器兩部分。后者由兩部分組成:驅(qū)動

    標(biāo)簽: PMSM nbsp 永磁同步 伺服電機(jī)

    上傳時間: 2013-04-24

    上傳用戶:zhangyi99104144

  • 永磁同步電機(jī)伺服系統(tǒng)功率主回路的設(shè)計

    ·永磁同步電機(jī)伺服系統(tǒng)功率主回路的設(shè)計

    標(biāo)簽: 永磁同步電機(jī) 伺服系統(tǒng) 主回路 功率

    上傳時間: 2013-06-03

    上傳用戶:glitter

  • 基于Matlab/Simulink 的永磁同步電機(jī)(PMSM )矢量控制仿真

    ·基于Matlab/Simulink 的永磁同步電機(jī)(PMSM )矢量控制仿真

    標(biāo)簽: nbsp Simulink Matlab PMSM

    上傳時間: 2013-07-06

    上傳用戶:luopoguixiong

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