工程中使用的一段資源管理vhdl程序,有簡(jiǎn)單的分頻代碼等，希望能給你幫助
標(biāo)簽： vhdl 工程 分頻 代碼
上傳時(shí)間： 2013-08-10
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fpga的串口編程vi控件庫(kù)，提供了多種vi
標(biāo)簽： fpga 串口編程 控件
上傳時(shí)間： 2013-08-12
上傳用戶：dapangxie
杜曉斌和陳興文-FPGA和單片機(jī)串行通信接口的實(shí)現(xiàn)一文提出了FPGA與單片機(jī)實(shí)現(xiàn)數(shù)據(jù)串行通信的解決方案。在通信過(guò)程中完全遵守RS232 協(xié)議，給出了發(fā)送模塊的vhdl源代碼。\r\n
標(biāo)簽： FPGA 單片機(jī)串行 通信接口
上傳時(shí)間： 2013-08-15
上傳用戶：cylnpy
FPGA中嵌中高級(jí)課件,非常有用的課件，對(duì)于新手和老手都有很大的幫助！希望大家看了以后能夠大大的提高自己的水平！
標(biāo)簽： FPGA
上傳用戶：xdqm
《CPLD_FPGA設(shè)計(jì)及應(yīng)用》課件與實(shí)例
標(biāo)簽： CPLD_FPGA
上傳時(shí)間： 2013-08-17
上傳用戶：sklzzy
實(shí)時(shí)電話計(jì)費(fèi)系統(tǒng)是企業(yè)、事業(yè)單位信息管理的一個(gè)重要組成部分。介紹了一種用FPGA 器件實(shí)現(xiàn)電話計(jì)費(fèi)系統(tǒng)的方法, 并給出了設(shè)計(jì)框圖和詳細(xì)設(shè)計(jì)過(guò)程, 設(shè)計(jì)采用Verilog_HDL 硬件語(yǔ)言。
標(biāo)簽： 電話 單位 信息管理 分
上傳時(shí)間： 2013-08-18
上傳用戶：manking0408
本文介紹了一種新的使用串行通信進(jìn)行DSP遠(yuǎn)程在線編程方法。對(duì)設(shè)計(jì)中的主要技術(shù)：DSP與PC機(jī)的串口通信、Flash編程以及DSP自引導(dǎo)等進(jìn)行了詳細(xì)介紹。結(jié)合TI公司的TMS320VC33處理器，闡述了具體的實(shí)現(xiàn)方法
標(biāo)簽： DSP 串行通信 遠(yuǎn)程 編程方法
上傳時(shí)間： 2013-08-19
上傳用戶：zhangfx728
adi串行AD AD9229的控制使用ISE平臺(tái) Verilog語(yǔ)言\r\n
標(biāo)簽： 9229 adi ISE AD
上傳用戶：1417818867
異步通信串行口設(shè)計(jì)實(shí)例，很實(shí)用。比較經(jīng)典。
標(biāo)簽： FPGA-UART 異步通信 串行口 設(shè)計(jì)實(shí)例
上傳時(shí)間： 2013-08-20
上傳用戶：gundamwzc
5分鐘學(xué)會(huì)使用CPLD,經(jīng)典資料，有想學(xué)習(xí)CPLD的朋友有福了
標(biāo)簽： CPLD 分
上傳時(shí)間： 2013-08-22
上傳用戶：xmsmh
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