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秒脈沖

  • 基于FPGA的混沌加密芯片技術(shù)研究

    利用混沌的對初值和參數(shù)敏感、偽隨機(jī)以及遍歷等特性設(shè)計(jì)的加密方案,相對傳統(tǒng)加密方案而言,表現(xiàn)出許多優(yōu)越性能,尤其在快速置亂和擴(kuò)散數(shù)據(jù)方面.目前,大多數(shù)混沌密碼傾向于軟件實(shí)現(xiàn),這些實(shí)現(xiàn)方案中數(shù)據(jù)串行處理且吞吐量有限,因而不適合硬件實(shí)現(xiàn).該論文分別介紹了適合FPGA(現(xiàn)場可編程門陣列)并行實(shí)現(xiàn)的序列密碼和分組密碼方案.序列密碼方案,對傳統(tǒng)LFSR(線性反饋移位寄存器)進(jìn)行改進(jìn),采用非線性的混沌方程代替LFSR中的線性反饋方程,進(jìn)而構(gòu)造出基于混沌偽隨機(jī)數(shù)發(fā)生器的加密算法.分組密碼方案,從圖像置亂的快速性考慮,將兩維混沌映射擴(kuò)展到三維空間;同時(shí),引入另一種混沌映射對圖像數(shù)據(jù)進(jìn)行擴(kuò)散操作,以有效地抵抗統(tǒng)計(jì)和差分攻擊.對于這兩種方案,文中給出了VHDL(硬件描述語言)編程、FPGA片內(nèi)功能模塊設(shè)計(jì)、加密效果以及硬件性能分析等.其中,序列密碼硬件實(shí)現(xiàn)方案,在不考慮通信延時(shí)的情況下,可以達(dá)到每秒61.622兆字節(jié)的加密速度.實(shí)驗(yàn)結(jié)果表明,這兩種加密算法的FPGA實(shí)現(xiàn)方案是可行的,并且能夠得到較高的安全性和較快的加密速度.

    標(biāo)簽: FPGA 混沌 加密芯片 技術(shù)研究

    上傳時(shí)間: 2013-04-24

    上傳用戶:yx007699

  • 加密卡的研制與加密算法的FPGA實(shí)現(xiàn)

    隨著安全通信數(shù)據(jù)速率的提高,關(guān)鍵數(shù)據(jù)加密算法的軟件實(shí)施成為重要的系統(tǒng)瓶頸.基于FPGA的高度優(yōu)化的可編程的硬件安全性解決方案提供了并行處理能力,并且可以達(dá)到所要求的加密處理性能(每秒的SSL或RSA運(yùn)算次數(shù))基準(zhǔn).網(wǎng)絡(luò)的迅速發(fā)展,對安全性的需要變得越來越重要.然而,盡管網(wǎng)絡(luò)技術(shù)進(jìn)步很快,安全性問題仍然相對落后.由于FPGA所提供的設(shè)計(jì)優(yōu)勢,特別是新的高速版本,網(wǎng)絡(luò)系統(tǒng)設(shè)計(jì)人員可以在這些網(wǎng)絡(luò)設(shè)備中經(jīng)濟(jì)地實(shí)現(xiàn)安全性支持.FPGA是實(shí)現(xiàn)設(shè)計(jì)靈活性和功能升級(jí)的關(guān)鍵,對于容錯(cuò)、IPSec協(xié)議和系統(tǒng)接口問題而言這兩點(diǎn)非常重要.而且,FPGA還為網(wǎng)絡(luò)系統(tǒng)設(shè)計(jì)人員提供了適應(yīng)不同安全處理功能以及隨著安全技術(shù)的發(fā)展方便地增加對新技術(shù)支持的能力.標(biāo)準(zhǔn)加密/解決以及認(rèn)證算法,如RC-4、DES、三次DES、MD-5以及安全哈希算法-1(SHA-1)被廣泛用于全球網(wǎng)絡(luò)安全系統(tǒng)中.本文介紹了基于PCI總線的加密卡的研制,硬件板卡的結(jié)構(gòu),著重論述了加密卡上加密模塊的實(shí)現(xiàn),即用FPGA實(shí)現(xiàn)3DES及IDEA、MD5算法的過程,加密卡的工作原理,加密卡中多種密碼算法的配置原理,最后對3DES算法及IDEA、MD5算法的實(shí)現(xiàn)進(jìn)行仿真,并繪制了板卡的原理圖,對PCI接口原理進(jìn)行了闡述.在論文中,首先闡述了數(shù)據(jù)加密原理.介紹了數(shù)據(jù)加密的算法和數(shù)據(jù)加密的技術(shù)發(fā)展趨勢,并重點(diǎn)說明了3DES的算法.由于加密卡的生存空間在于其高速的加密性能與便捷的使用方式,所以,我們的加密卡采用的是基于PCI插槽的結(jié)構(gòu),遵從的是PCI2.2規(guī)范,理解并掌握PCI總線的規(guī)范是了解整個(gè)系統(tǒng)的重要一環(huán),本文講述了PCI總線的特點(diǎn)和性能,以及總線的信號(hào).由于遵從高速性的要求,我們在硬件選型的時(shí)候,選用的是TI公司高速DSP T M S 3 2 0 C 5 4 x:T I公司新推出的T M S 3 2 0 C 6 x系列D S P功能強(qiáng),速度也非常快,但目前價(jià)格仍然太高,不適合一般加解密使用.而TMS3 2 0 C 5 4 x系列具有性能適中,價(jià)格低廉,產(chǎn)品成熟等特點(diǎn),是較好的選擇.FPGA選用的XILINX公司的XC2V3000,在隨后的文章中,我們將會(huì)對這些器件特性做相應(yīng)說明.并由此得出電路原理圖的繪制.文章的重點(diǎn)之一在于3DES算法及IDEA、MD5算法的FPGA實(shí)現(xiàn),以Xilinx公司VIRTEXII結(jié)構(gòu)的VXC2V3000為例,闡述用FPGA高速實(shí)現(xiàn)3DES算法及IDEA、MD5算法的設(shè)計(jì)要點(diǎn)及關(guān)鍵部分的設(shè)計(jì).

    標(biāo)簽: FPGA 加密卡 加密算法

    上傳時(shí)間: 2013-04-24

    上傳用戶:qazwsc

  • 基于ARM與FPGA的機(jī)械手自動(dòng)控制系統(tǒng)的研究

    機(jī)械手是自動(dòng)裝配生產(chǎn)線上必不可少的設(shè)備,它可以模擬人手臂的部分動(dòng)作,按預(yù)定的程序、軌跡和要求,實(shí)現(xiàn)抓取、搬運(yùn)和裝配等工作。在減輕人的勞動(dòng)強(qiáng)度、提高裝配質(zhì)量和提高裝配效率等方面,起到了積極的作用。本文基于ARM和FPGA嵌入式系統(tǒng),開展了機(jī)械手控制系統(tǒng)的研發(fā)工作,實(shí)現(xiàn)了機(jī)械手的自動(dòng)控制。 嵌入式ARM處理器,具有運(yùn)行速度快、功耗低、程序設(shè)計(jì)靈活、外圍硬件資源豐富等優(yōu)點(diǎn),但其普通輸入輸出口的高低電平變化周期最快只能到1微妙左右,不適合高速輸入輸出;FPGA芯片高速輸入輸出數(shù)據(jù),時(shí)間可縮短至幾十納秒。通過ARM處理器和FPGA技術(shù)的有機(jī)結(jié)合,發(fā)揮各自的優(yōu)勢,使系統(tǒng)具有程序設(shè)計(jì)靈活、以太網(wǎng)通信、大容量存儲(chǔ)、高速數(shù)據(jù)輸山、低成本等特點(diǎn),滿足高速機(jī)械手自動(dòng)控制的要求。 本文分析了ARM和FPGA系統(tǒng),以及機(jī)械手控制系統(tǒng)的功能要求;設(shè)計(jì)硬件模塊、接口電路;闡述了系統(tǒng)軟件的設(shè)計(jì)過程,包括啟動(dòng)代碼U—BOOT、操作系統(tǒng)μCLinux的移植;并介紹了如何利用便件描述語言VHDL來實(shí)現(xiàn)機(jī)械手邏輯控制。

    標(biāo)簽: FPGA ARM 機(jī)械手 自動(dòng)控制系統(tǒng)

    上傳時(shí)間: 2013-04-24

    上傳用戶:luyanping

  • 數(shù)字時(shí)鐘

    通過設(shè)計(jì)實(shí)現(xiàn)以下功能:顯示小時(shí)、分鐘、秒

    標(biāo)簽: 數(shù)字時(shí)鐘

    上傳時(shí)間: 2013-07-18

    上傳用戶:william345

  • 單片機(jī)電子鐘

    設(shè)計(jì)一個(gè)數(shù)字鐘,要求開機(jī)時(shí),顯示00:00:00的時(shí)間開始計(jì)時(shí),并且用3個(gè)按鍵分別控制控制“秒”“分”“時(shí)”的調(diào)整,每按一次加1秒、1分;和1個(gè)小時(shí)。

    標(biāo)簽: 單片機(jī) 電子鐘

    上傳時(shí)間: 2013-04-24

    上傳用戶:851197153

  • PIC單片機(jī)C語言應(yīng)用例程

    AD程序?qū)崿F(xiàn)模擬量到數(shù)字量的轉(zhuǎn)換功能; CAN程序?qū)崿F(xiàn)CAN總線通訊功能; keyboard_check程序?qū)崿F(xiàn)鍵盤的掃描查詢方式輸入; keyboard_disturb程序?qū)崿F(xiàn)PORTB的"電平變化中斷"進(jìn)行鍵盤的輸入; led0-8程序?qū)崿F(xiàn)在8個(gè)LED上依次顯示1~8數(shù)字; PWM程序用于使CCP1模塊產(chǎn)生分辨率為10位的PWM波形,占空比為50%; RS-232程序通過RS-232接口來完成PC計(jì)算機(jī)與單片機(jī)之間的通信; simple_POARD程序?yàn)橥鈬δ苣K簡單應(yīng)用實(shí)例,點(diǎn)亮與PORTD口相連的八個(gè)發(fā)光二極管; stopwatch程序?qū)崿F(xiàn)計(jì)時(shí)秒表功能,時(shí)鐘顯示范圍00.00~99.99秒,分辨度為0.01秒; switchinput程序用于開關(guān)量的輸入(采用SPI總線),并顯示在與D口相連的LED上; wakeup程序?qū)崿F(xiàn)PIC18F458的休眠工作方式,并由實(shí)驗(yàn)板上的按鍵產(chǎn)生"電平變化中斷"將其從休眠狀態(tài)中激活; WDT程序?qū)崿F(xiàn)"看門狗"WDT的功能; Yejing程序?qū)崿F(xiàn)液晶顯示器的接口和顯示功能。

    標(biāo)簽: PIC C語言 單片機(jī)

    上傳時(shí)間: 2013-06-04

    上傳用戶:GHF

  • 基于FPGA的MJPEG編碼器

    在視頻傳輸系統(tǒng)中,最大障礙是視頻數(shù)據(jù)的大數(shù)據(jù)量傳輸。故壓縮就顯得尤為必要。MJPEG是以25幀每秒傳輸?shù)腏PEG圖像。本文根據(jù)JPEG基本壓縮模式,通過前端圖像采集芯片輸出標(biāo)準(zhǔn)的4:2:2格式的圖像流,在XILINX公司的SPARTAN IIE芯片下壓縮,獲得了良好效果,壓縮比達(dá)到10:1。中間的各個(gè)環(huán)節(jié)同MATLAB下同等壓縮相比,除了精度上有點(diǎn)差別外,基本一致。同專用芯片相比,比專用芯片靈活得多,F(xiàn)PGA內(nèi)部全部是可編程,燒寫不同的程序便可實(shí)現(xiàn)不同的壓縮。同DSP相比,壓縮時(shí)間極大的提高,同周霖的“基于DSP技術(shù)的靜態(tài)圖像壓縮編碼”一文中編碼所需的時(shí)間進(jìn)行比較(DCT變換消耗4224個(gè)指令,量化Z排序耗960指令,huffman編碼至少耗1400指令),假設(shè)令其采用6000系列DSP,指令周期為6ns,運(yùn)算速度為1336MIPS。壓縮一個(gè)8*8DCT塊,采用高檔的DSP,消耗39tJs,而采用27M的FPGA只需6us,若采用FPGA內(nèi)部自帶的DLL將時(shí)鐘倍頻到54M,則只需要3us.本設(shè)計(jì)同傳統(tǒng)的壓縮實(shí)現(xiàn)方式相比,在速度和靈活性上有了極大的提高。

    標(biāo)簽: MJPEG FPGA 編碼器

    上傳時(shí)間: 2013-04-24

    上傳用戶:TI初學(xué)者

  • 基于FPGA的H264視頻編碼器設(shè)計(jì)

    隨著多媒體編碼技術(shù)的發(fā)展,視頻壓縮標(biāo)準(zhǔn)在很多領(lǐng)域都得到了成功應(yīng)用,如視頻會(huì)議(H.263)、DVD(MPEG-2)、機(jī)頂盒(MPEG-2)等等,而網(wǎng)絡(luò)帶寬的不斷提升和高效視頻壓縮技術(shù)的發(fā)展使人們逐漸把關(guān)注的焦點(diǎn)轉(zhuǎn)移到了寬帶網(wǎng)絡(luò)數(shù)字電視(IPTV)、流媒體等基于傳輸?shù)臉I(yè)務(wù)上來。帶寬的增加為流式媒體的發(fā)展鋪平了道路,而高效的視頻壓縮標(biāo)準(zhǔn)的出臺(tái)則是流媒體技術(shù)發(fā)展的關(guān)鍵。H.264/AVC是由國際電信聯(lián)合會(huì)和國際標(biāo)準(zhǔn)化組織共同發(fā)展的下一代視頻壓縮標(biāo)準(zhǔn)之一。新標(biāo)準(zhǔn)中采用了新的視頻壓縮技術(shù),如多模式幀間預(yù)測、1/4像素精度預(yù)測、整數(shù)DCT變換、變塊尺寸運(yùn)動(dòng)補(bǔ)償、基于上下文的二元算術(shù)編碼(CABAC)、基于上下文的變長編碼(CAVLC)等等,這些技術(shù)的采用大大提高了視頻壓縮的效率,更有利于寬帶網(wǎng)絡(luò)數(shù)字電視(IPTV)、流媒體等基于傳輸?shù)臉I(yè)務(wù)的實(shí)現(xiàn)。 本文主要根據(jù)視頻會(huì)議應(yīng)用的需要對JM8.6代碼進(jìn)行優(yōu)化,目標(biāo)是實(shí)現(xiàn)基于Baseline的低復(fù)雜度的CIF編碼器,并對部分功能模塊進(jìn)行電路設(shè)計(jì)。在設(shè)計(jì)方法上采用自頂向下的設(shè)計(jì)方法,首先對H.264編碼器的C代碼和算法進(jìn)行優(yōu)化,并對優(yōu)化后的結(jié)果進(jìn)行測試比較,結(jié)果顯示在圖像質(zhì)量沒有明顯降低的情況下,H.264編碼器編碼CIF格式視頻每秒達(dá)到15幀以上,滿足了視頻會(huì)議應(yīng)用的實(shí)時(shí)性要求。然后,以C模型為參考對H.264編碼器的部分功能模塊電路進(jìn)行設(shè)計(jì)。采用Verilog HDL實(shí)現(xiàn)了這些模塊,并在Quartus Ⅱ中進(jìn)行了綜合、仿真、驗(yàn)證。主要完成了Zig-zag掃描和CAVLC模塊的設(shè)計(jì),詳細(xì)說明模塊的工作原理和過程,然后進(jìn)行多組的仿真測試,結(jié)果與C模型相應(yīng)部分的結(jié)果一致,證明了設(shè)計(jì)的正確性。

    標(biāo)簽: FPGA H264 視頻編碼器

    上傳時(shí)間: 2013-06-11

    上傳用戶:kjgkadjg

  • 精密延時(shí)電路在UWB雷達(dá)發(fā)射機(jī)

    超寬帶沖激雷達(dá)是一種新體制雷達(dá),其發(fā)射信號(hào)是無高頻載頻,寬度僅為納秒級(jí)的沖激脈沖。得益于這種特殊的發(fā)射信號(hào),超寬帶沖激雷達(dá)具有優(yōu)異的探測性能和廣泛的應(yīng)用前景。自然地,對于發(fā)射機(jī)的研究,在超寬帶沖激雷達(dá)研究領(lǐng)域有著極其重要的地位。本文在超寬帶沖激雷達(dá)實(shí)驗(yàn)系統(tǒng)的基礎(chǔ)上,對其發(fā)射機(jī)進(jìn)行了深入研究,主要內(nèi)容如下: 1、介紹了超寬帶沖激雷達(dá)發(fā)射機(jī),尤其是脈沖源的原理及設(shè)計(jì)。 2、分析了決定超寬帶沖激雷達(dá)探測距離的因素。在此基礎(chǔ)上尋求通過提高發(fā)射信號(hào)脈沖重復(fù)頻率來增大發(fā)射機(jī)的能量輸出;提出了一種提高脈沖重復(fù)頻率的方法。設(shè)計(jì)了基于現(xiàn)場可編程門陣列的延時(shí)控制電路,對提高脈沖重復(fù)頻率予以工程實(shí)現(xiàn)。 3、提出了超寬帶沖激雷達(dá)波束掃描的實(shí)現(xiàn)方法:通過精密控制各發(fā)射機(jī)脈沖源觸發(fā)時(shí)間,在各路發(fā)射信號(hào)之間產(chǎn)生一定的延時(shí)。設(shè)計(jì)了運(yùn)用現(xiàn)場可編程門陣列實(shí)現(xiàn)這種控制的精密延時(shí)電路。

    標(biāo)簽: UWB 精密 延時(shí)電路 雷達(dá)發(fā)射機(jī)

    上傳時(shí)間: 2013-08-05

    上傳用戶:564708051@qq.com

  • 獨(dú)立蜂鳴煤氣報(bào)警

    HT45F43 特性特性特性特性 MCU 特性:內(nèi)建 2x OPAs & 2x Comparators, EEPROM, HIRC 4MHz + 32K LIRC,節(jié)省外部器件 傳感器:電化學(xué) Sensor(ME2-CO) 電源電壓:9V 堿性電池 高音量蜂鳴器輸出:(>85DB) 待機(jī)電流:Typ.21uA, Max.27uA 低電壓檢測:7.5V 自測 / 校準(zhǔn)功能 LED 顯示:紅、黃、綠三顆 LED 指示 使用 HT45F43 內(nèi)建 OSC & Reset 電路,節(jié)省外部器件 使用 HT45F43 內(nèi)建 OPA 進(jìn)行 CO Sensor 信號(hào)放大,節(jié) 省外部器件 WATCHDOG 每 32 秒喚醒一次進(jìn)行 CO 濃度偵測和電池電壓偵測

    標(biāo)簽: 獨(dú)立 煤氣 報(bào)警 蜂鳴

    上傳時(shí)間: 2013-06-16

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