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移位寄存

循環冗余校驗CRC (Cyclic Redundancy Check)碼是由分組線性碼的分支而來

循環冗余校驗CRC (Cyclic Redundancy Check)碼是由分組線性碼的分支而來，其主要應用是二元碼字。編碼簡單且誤判概率很低，在通信系統中得到了廣泛的應用。循環冗余校驗碼是屬于分組碼中的一類重要的線性碼，它不僅在理論上具有很好的代數結構，而且其編碼和譯碼可以通過線性移位寄存器很容易地實現。通過對CRC的分析和基于MATLAB工具的仿真，充分證明了CRC的檢錯能力很強，編碼簡單。

標簽： Redundancy Cyclic Check CRC

上傳時間： 2016-04-13

上傳用戶：watch100
ＳＰＩ總線與ＣＰＬＤ之間的通信程序

ＳＰＩ總線與ＣＰＬＤ之間的通信程序，可實現ＳＰＩ串行輸入，通過移位寄存器后并行輸出

標簽： 總線通信程序

上傳時間： 2013-12-16

上傳用戶：1583060504
時鐘程序

時鐘程序，spi送數，顯示是8個數碼管，接8的移位寄存器。時間從00 00 00 到 23 59 59

標簽： 時鐘程序

上傳時間： 2014-01-13

上傳用戶：tb_6877751
時鐘程序

時鐘程序，spi送數，顯示是8個數碼管，接8的移位寄存器。時間從00 00 00 到 23 59 59

標簽： 時鐘程序

上傳時間： 2016-06-17

上傳用戶：tonyshao
EDA實驗--UART串口實驗：UART 主要有由數據總線接口、控制邏輯、波特率發生器、發送部分和接收部分等組成。UART 發送器 --- 發送器每隔16 個CLK16 時鐘周期輸出1 位

EDA實驗--UART串口實驗：UART 主要有由數據總線接口、控制邏輯、波特率發生器、發送部分和接收部分等組成。UART 發送器 --- 發送器每隔16 個CLK16 時鐘周期輸出1 位，次序遵循1位起始位、8位數據位（假定數據位為8位）、1位校驗位（可選）、1位停止位。 UART 接收器 --- 串行數據幀和接收時鐘是異步的，發送來的數據由邏輯1 變為邏輯0 可以視為一個數據幀的開始。接收器先要捕捉起始位，確定rxd 輸入由1 到0，邏輯0 要8 個CLK16 時鐘周期，才是正常的起始位，然后在每隔16 個CLK16 時鐘周期采樣接收數據，移位輸入接收移位寄存器rsr，最后輸出數據dout。還要輸出一個數據接收標志信號標志數據接收完。波特率發生器 --- UART 的接收和發送是按照相同的波特率進行收發的。波特率發生器產生的時鐘頻率不是波特率時鐘頻率，而是波特率時鐘頻率的16 倍，目的是為在接收時進行精確地采樣，以提出異步的串行數據。 --- 根據給定的晶振時鐘和要求的波特率算出波特率分頻數。

標簽： UART EDA CLK 實驗

上傳時間： 2014-01-25

上傳用戶：xsnjzljj
將雙字節16進制數轉換為可用于數碼管顯示用的7段碼

將雙字節16進制數轉換為可用于數碼管顯示用的7段碼，直接輸入移位寄存器即可正常顯示。附帶注釋，經驗證完全可用。

標簽： 雙字進制數轉換數碼管顯示

上傳時間： 2013-12-03

上傳用戶：asdkin
SPI是一個環形總線結構

SPI是一個環形總線結構，由ss（cs）、sck、sdi、sdo構成，其時序其實很簡單，主要是在sck的控制下，兩個雙向移位寄存器進行數據交換。假設下面的8位寄存器裝的是待發送的數據10101010，上升沿發送、下降沿接收、高位先發送。那么第一個上升沿來的時候數據將會是sdo=1；寄存器=0101010x。下降沿到來的時候，sdi上的電平將所存到寄存器中去，那么這時寄存器=0101010sdi，這樣在8個時鐘脈沖以后，兩個寄存器的內容互相交換一次。這樣就完成里一個spi時序。

標簽： SPI 環形總線結構

上傳時間： 2013-12-22

上傳用戶：lijinchuan
本程序為加密芯片內部加密運算單元部分

本程序為加密芯片內部加密運算單元部分，包括32位減法器、移位寄存器、加/減法器、寄存器等，對密碼芯片運算部分設計具有一定指導意義

標簽： 程序加密芯片加密分

上傳時間： 2014-11-03

上傳用戶：ynwbosss
16*64點陣程序

16*64點陣程序，運用串行傳輸數據，移位寄存器接收數據，硬件電路連接簡單

標簽： 16 64 點陣程序

上傳時間： 2016-12-31

上傳用戶：xyipie
VHDL語言編寫

VHDL語言編寫，實現雙向移位寄存器功能，在MAX+plus軟件下實現

標簽： VHDL 語言編寫

上傳時間： 2014-07-13

上傳用戶：宋桃子