雙人搶答器的程序,可以加分減分等,還可以用指示燈表示開(kāi)始搶答和搶答結(jié)束
上傳時(shí)間： 2016-06-11
上傳用戶：zhangliming420
分頻器是FPGA設(shè)計(jì)中使用頻率非常高的基本單元之一。盡管目前在大部分設(shè)計(jì)中還廣泛使用集成鎖相環(huán)(如altera的PLL，Xilinx的DLL)來(lái)進(jìn)行時(shí)鐘的分頻、倍頻以及相移設(shè)計(jì)，但是，對(duì)于時(shí)鐘要求不太嚴(yán)格的設(shè)計(jì)，通過(guò)自主設(shè)計(jì)進(jìn)行時(shí)鐘分頻的實(shí)現(xiàn)方法仍然非常流行。首先這種方法可以節(jié)省鎖相環(huán)資源，再者，這種方式只消耗不多的邏輯單元就可以達(dá)到對(duì)時(shí)鐘操作的目的。 偶數(shù)倍分頻：偶數(shù)倍分頻應(yīng)該是大家都比較熟悉的分頻，通過(guò)計(jì)數(shù)器計(jì)數(shù)是完全可以實(shí)現(xiàn)的。如進(jìn)行N倍偶數(shù)分頻，那么可以通過(guò)由待分頻的時(shí)鐘觸發(fā)計(jì)數(shù)器計(jì)數(shù)，當(dāng)計(jì)數(shù)器從0計(jì)數(shù)到N/2-1時(shí)，輸出時(shí)鐘進(jìn)行翻轉(zhuǎn)，并給計(jì)數(shù)器一個(gè)復(fù)位信號(hào)，使得下一個(gè)時(shí)鐘從零開(kāi)始計(jì)數(shù)。以此循環(huán)下去。這種方法可以實(shí)現(xiàn)任意的偶數(shù)分頻。
上傳時(shí)間： 2016-06-14
上傳用戶：wpwpwlxwlx
一個(gè)可實(shí)現(xiàn)多倍（次）分頻器VHDL源代碼設(shè)計(jì)
上傳時(shí)間： 2014-01-27
上傳用戶：2467478207
一個(gè)基于CPLD/FPGA的半整數(shù)分頻器的設(shè)計(jì)的文檔資料
標(biāo)簽： CPLD FPGA 整數(shù) 分頻器
上傳時(shí)間： 2016-07-13
上傳用戶：CHENKAI
好的分頻器設(shè)計(jì)程序，有三個(gè)，二分頻，八分頻隨便改，比較實(shí)用
標(biāo)簽： 分頻器 設(shè)計(jì)程序
上傳時(shí)間： 2016-07-15
上傳用戶：songyue1991
（1）利用單片機(jī)定時(shí)器中斷和定時(shí)器計(jì)數(shù)方式實(shí)現(xiàn)秒、分定時(shí)。 （2）通過(guò)LED顯示程序的調(diào)整，熟悉8155與8051，8155與LED的接口技術(shù)
標(biāo)簽： LED 用單片機(jī) 定時(shí)器中斷 定時(shí)器
上傳時(shí)間： 2013-11-29
上傳用戶：yd19890720
Classifier4J是一個(gè)很好的基于java的分類(lèi)器,里面有Native bayes和KNN等方法的文本分類(lèi).另外還 提供了分詞和自動(dòng)摘要等功能
標(biāo)簽： Classifier4J Native bayes java
上傳時(shí)間： 2016-08-14
上傳用戶：lwwhust
在做2維度樣本分類(lèi)的過(guò)程中,若我們能事先畫(huà)出訓(xùn)練樣本在空間中的分散情形,這將有助於我們?cè)谠O(shè)定SVM分類(lèi)器的參數(shù)C的取值範(fàn)圍. 例如:若畫(huà)出的訓(xùn)練樣本的散佈較分散,我們可以得知此時(shí)採(cǎi)用的參數(shù)值可以取在較大的範(fàn)圍. 所以本程式也是讓想要畫(huà)出資料樣本在平面的散佈情形者之一各可行工具.
上傳時(shí)間： 2016-08-19
上傳用戶：sy_jiadeyi
多工器ｖｅｒｉｌｏｇ設(shè)計(jì)1對(duì)多快速解碼提供控制功能
標(biāo)簽： 控制功能
上傳時(shí)間： 2014-01-16
上傳用戶：GavinNeko
verilog除頻器可用於編碼段運(yùn)用可以穩(wěn)定電路設(shè)計(jì)
標(biāo)簽： verilog
上傳時(shí)間： 2013-12-26
上傳用戶：372825274
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