摘 要:本 文 介 紹 了 一 種 以 LPC2210微 處 理 器 為 主 控 制 器 ,以 ~C/OS—I1為 嵌 入 式 操 作 系 統 的 嵌 入 式 信 息 家 電遠 程 控 制 系 統 .通 過 互 聯 網 實現 對 家 用 電 器 的遠 程 智 能 控 制 。 該 系統 實 用,功 能 靈 活 多 樣 ,可 以 對 被 遙 控 對 象 的 狀 態進 行 查 詢 以 及 控 制 ,可 以 廣 泛 地 應 用 于 家 用 電 器 或 者 其 他 場 所 的 各 種 控 制 設 備
上傳時間: 2017-08-06
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摘要慣性制導系統初始對準的主要任務是精確確定載體坐標系和制導坐標 系之間的初始方向余弦矩陣和載體的初始速度。慣性制導的精度在很大程度上 取決于系統初始對準的精度。本文基于初始對準誤差引起的慣性導航誤差模 型,針時近程戰術武器系統,在一定精度范圍內,忽略引力變化和發射時載體的 初始速度,推導出初始對準誤差對慣性制導誤差影響的簡化算法。該算法具有 模型清晰,計算簡便,易于使用的特點,避免了繁瑣的運動學建模和編程計算過 程,并且為在項目論證階段不具備完備的總體數據支持的條件下,進行初始對準 精度指標分配提供了理論依據。并經仿真驗證,簡化算法具有一定的精度。
上傳時間: 2017-08-07
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:樸素貝葉斯分類器是一種簡單而高效的分類器,但是它的屬性獨立性假設使其無法表示現實世界屬性之間的依賴關 系,以及它的被動學習策略,影響了它的分類性能。本文從不同的角度出發,討論并分析了三種改進樸素貝葉斯分類 性能的方法。為進一步的研究打下堅實的基礎。
上傳時間: 2017-08-18
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Turbo碼編碼器的刪除模塊,此模塊是CCSDS標準系的碼率為1/2和1/3的刪除模塊
上傳時間: 2013-12-11
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Turbo碼編碼器的兩個分量編碼器RSC,主要由四個移位寄存器和兩個模2加法器組成
上傳時間: 2014-01-21
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電感器設計工具集相關專輯 27種 46.0M德國VAC 超微晶材料磁芯用于共模濾波電感的幾大優異性.pdf
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上傳時間: 2014-05-05
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模電 波形轉換 設計制作一個正弦波方波三角波函數轉換器
上傳時間: 2016-06-12
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淋浴器溫度控制調節采用MAT LAB 的附加組件Simulink, 仿真系 統的框圖如圖1 所示。圖中的虛線為模糊控制器, 作為二維模糊控制器機構以水的溫度偏差temp 和 流量偏差f low 為輸入量, 采用模糊推理方法對水 的溫度偏差和流量偏差進行整定, 用來確定冷水閥 門和熱水閥門的開口大小cold 和hot 以便控制冷 熱水的流量, 構成2 輸入2 輸出的一階模糊控制系 統; 模糊推理與去模糊化采用MIN - MAX 法及重 心法, 并用MA TLAB 模糊推理工具箱來編輯模糊 控制器。 圖1
上傳時間: 2018-10-12
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具有執行器故障的馬爾可夫跳躍非線性系統的自適應滑??刂?/p>
標簽: 上傳時間: 2019-07-24
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lm75A溫度數字轉換器 FPGA讀寫實驗Verilog邏輯源碼Quartus工程文件+文檔資料,FPGA為CYCLONE4系列中的EP4CE6E22C8. 完整的工程文件,可以做為你的學習設計參考。LM75A 是一個使用了內置帶隙溫度傳感器和模數轉換技術的溫度數字轉換器。它也是一個溫度檢測器,可提供一個過熱檢測輸出。LM75A 包含許多數據寄存器:配置寄存器用來存儲器件的某些配置,如器件的工作模式、OS 工作模式、OS 極性和OS 故障隊列等(在功能描述一節中有詳細描述);溫度寄存器(Temp),用來存儲讀取的數字溫度;設定點寄存器(Tos & Thyst),用來存儲可編程的過熱關斷和滯后限制,器件通過2 線的串行I2C 總線接口與控制器通信。LM75A 還包含一個開漏輸出(OS),當溫度超過編程限制的值時該輸出有效。LM75A 有3 個可選的邏輯地址管腳,使得同一總線上可同時連接8個器件而不發生地址沖突。LM75A 可配置成不同的工作條件。它可設置成在正常工作模式下周期性地對環境溫度進行監控或進入關斷模式來將器件功耗降至最低。OS 輸出有2 種可選的工作模式:OS 比較器模式和OS 中斷模式。OS 輸出可選擇高電平或低電平有效。故障隊列和設定點限制可編程,為了激活OS 輸出,故障隊列定義了許多連續的故障。溫度寄存器通常存放著一個11 位的二進制數的補碼,用來實現0.125℃的精度。這個高精度在需要精確地測量溫度偏移或超出限制范圍的應用中非常有用。正常工作模式下,當器件上電時,OS 工作在比較器模式,溫度閾值為80℃,滯后75℃,這時,LM75A就可用作一個具有以上預定義溫度設定點的獨立的溫度控制器。module LM75_SEG_LED ( //input input sys_clk ,input sys_rst_n ,inout sda_port ,//output output wire seg_c1 ,output wire seg_c2 ,output wire seg_c3 ,output wire seg_c4 ,output reg seg_a ,output reg seg_b ,output reg seg_c ,output reg seg_e ,output reg seg_d ,output reg seg_f ,output reg seg_g ,output reg seg_h , output reg clk_sclk );//parameter define parameter WIDTH = 8;parameter SIZE = 8;//reg define reg [WIDTH-1:0] counter ;reg [9:0] counter_div ;reg clk_50k ;reg clk_200k ;reg sda ;reg enable ;
上傳時間: 2021-10-27
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