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網(wǎng)(wǎng)絡(luò)(luò)IP攝象機(jī)(jī)

S8JX開關(guān)電源(35/50/100/150-W型)

符合全球標(biāo)準(zhǔn)的小巧電源•35～150 W容量支持5 V, 12 V和24 V輸出電壓(100 W, 150 W: 僅24 V型)• 支持DIN導(dǎo)軌安裝• 安全標(biāo)準(zhǔn) ： UL 508/60950-1, EN 60950-1CSA C22.2 No. 60950-1

標(biāo)簽： S8JX 100 150 35

上傳時(shí)間： 2014-04-17

上傳用戶：fklinran
基于單片機(jī)的嵌入式TCP/IP協(xié)議棧的設(shè)計(jì)與實(shí)現(xiàn)

摘要:隨著網(wǎng)絡(luò)技術(shù)和單片機(jī)技術(shù)的發(fā)展，嵌入式網(wǎng)絡(luò)在遠(yuǎn)程控制領(lǐng)域擁有廣泛的應(yīng)用前景。文中以Atmega16單片機(jī)和CP2200網(wǎng)絡(luò)芯片為硬件平臺(tái)，設(shè)計(jì)和實(shí)現(xiàn)了一個(gè)面向遠(yuǎn)程工業(yè)控制領(lǐng)域的精簡(jiǎn)TCP／IP協(xié)議棧，包括ARP，IP，UDP及TCP等協(xié)議模塊。文中給出了系統(tǒng)的硬件設(shè)計(jì)，詳細(xì)論述了精簡(jiǎn)TCP／IP協(xié)議棧的實(shí)現(xiàn)方法，并給出了一個(gè)遠(yuǎn)程控制的應(yīng)用實(shí)例。該系統(tǒng)具有低成本、易使用的特點(diǎn)。關(guān)鍵詞:單片機(jī) 以太網(wǎng) CP2200 TCP/IP

標(biāo)簽： TCP IP 單片機(jī) 協(xié)議棧

上傳時(shí)間： 2013-11-13

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基于Avalon總線的8051MCU IP核的設(shè)計(jì)

設(shè)計(jì)了一款基于Avalon總線的8051MCU IP核。它支持MCS-51指令集，優(yōu)化內(nèi)部的結(jié)構(gòu)，通過采用流水線技術(shù)、指令映射技術(shù)、指令預(yù)取技術(shù)、微代碼技術(shù)等極大的提高了IP核的工作速度，使IP核在100MHz時(shí)鐘下，能夠單周期執(zhí)行一條指令。本設(shè)計(jì)使用Modelsim軟件完成了功能仿真和時(shí)序仿真，并在以Altera 公司的Cyclone II FPGA芯片為核心的DE2開發(fā)板上完成了硬件驗(yàn)證。

標(biāo)簽： Avalon 8051 MCU 總線

上傳時(shí)間： 2013-11-02

上傳用戶：gundan
基于EDA技術(shù)的單片機(jī)IP核設(shè)計(jì)

本文介紹了利用EDA技術(shù)設(shè)計(jì)出與MCS-51系列微處理器指令集完全兼容的8位嵌入式微處理器芯片的IP核,并經(jīng)過驗(yàn)證獲得了滿意的效果。

標(biāo)簽： EDA 單片機(jī) IP核

上傳時(shí)間： 2013-10-28

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基于EDA技術(shù)的單片機(jī)IP核設(shè)計(jì)

本文介紹了利用EDA技術(shù)設(shè)計(jì)出與MCS-51系列微處理器指令集完全兼容的8位嵌入式微處理器芯片的IP核,并經(jīng)過驗(yàn)證獲得了滿意的效果。

標(biāo)簽： EDA 單片機(jī) IP核

上傳時(shí)間： 2013-11-14

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用VHDL語(yǔ)言進(jìn)行MCS－51兼容單片機(jī)ip核開發(fā)

用VHDL語(yǔ)言進(jìn)行MCS－51兼容單片機(jī)ip核開發(fā)

標(biāo)簽： VHDL MCS 51兼容語(yǔ)言

上傳時(shí)間： 2013-10-28

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基于TMS20C6416T的IP視頻電話加密

采用DSP處理器TMS320C6416T,基于AES分組密碼算法和SPI總線實(shí)現(xiàn)IP視頻電話加密通信。設(shè)計(jì)了系統(tǒng)硬件結(jié)構(gòu)，選擇了合理的加密算法和加密方式，提出了高效的通信機(jī)制和數(shù)據(jù)格式，分析了軟硬件設(shè)計(jì)關(guān)鍵環(huán)節(jié)。

標(biāo)簽： C6416 6416T 6416 TMS

上傳時(shí)間： 2013-10-11

上傳用戶：yuzhou229843982
使用LabVIEW FPGA模塊設(shè)計(jì)IP核

對(duì)于利用LabVIEW FPGA實(shí)現(xiàn)RIO目標(biāo)平臺(tái)上的定制硬件的工程師與開發(fā)人員，他們可以很容易地利用所推薦的組件設(shè)計(jì)構(gòu)建適合其應(yīng)用的、可復(fù)用且可擴(kuò)展的代碼模塊。基于已經(jīng)驗(yàn)證的設(shè)計(jì)進(jìn)行代碼模塊開發(fā)，將使現(xiàn)有IP在未來(lái)應(yīng)用中得到更好的復(fù)用，也可以使在不同開發(fā)人員和內(nèi)部組織之間進(jìn)行共享和交換的代碼更好服用

標(biāo)簽： LabVIEW FPGA IP核模塊設(shè)計(jì)

上傳時(shí)間： 2013-11-20

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基于Quartus II免費(fèi)IP核的雙端口RAM設(shè)計(jì)實(shí)例

　　QuartusII中利用免費(fèi)IP核的設(shè)計(jì) 　　作者：雷達(dá)室　　以設(shè)計(jì)雙端口RAM為例說明。　　Step1：打開QuartusII，選擇File—New Project Wizard，創(chuàng)建新工程，出現(xiàn)圖示對(duì)話框，點(diǎn)擊Next；

標(biāo)簽： Quartus RAM IP核雙端口

上傳時(shí)間： 2014-12-28

上傳用戶：fghygef
基于FPGA的GPIB接口IP核的研究與設(shè)計(jì)

基于FPGA的GPIB接口IP核的研究與設(shè)計(jì)

標(biāo)簽： FPGA GPIB 接口 IP核

上傳時(shí)間： 2013-11-04

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