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自動(dòng)跟隨小車

  • 雙信號快速測頻技術及FPGA實現

    建立在數據率轉換技術之上的寬帶數字偵察接收機要求能夠實現高截獲概率、高靈敏度、近乎實時的信號處理能力。雙信號數據率轉換技術是寬帶數字偵察接收機關鍵技術之一,是解決寬帶數字接收機中前端高速ADC采樣的高速數據流與后端DSP處理速度之間瓶頸問題的可行方案。測頻技術以及帶通濾波,即寬帶數字下變頻技術,是實現數據率轉換系統的關鍵技術。本文首先介紹了寬帶數字偵察接收關鍵技術之一的數據率轉換技術,著重研究了快速、高精度雙信號測頻算法以及實驗系統硬件實現。論文主要工作如下: (1)分析了現代電子偵察環境下的信號特征,指出寬帶數字接收機必須滿足寬監視帶寬、流水作業以及近實時的響應時間。給出了一種頻率引導式的數字接收機方案,簡要介紹這種接收機的關鍵技術——快速、高精度頻率估計以及高效的數據率轉換。 (2)介紹了FFT技術在測頻算法中的應用,比較了FFT專用芯片及其優點和缺點,指出為了滿足實時處理要求,必須選用FPGA設計FFT模塊。 (3)在分析常規的插值算法基礎上,提出了一種單信號的快速插值頻率估計方法,只需三個FFT變換系數的實部構造頻率修正項,計算量低。該方法具有精度高、測頻速率快的特點。 (4)基于DFT理論和自相關理論,提出了結合FFT和自相關的雙信號頻率估計算法。該方法先用DFT估計其中一個信號的頻率和幅度,以此頻率對信號解調并對消該頻率成分,最后利用自相關理論估計出另一個信號的頻率。 (5)基于DFT理論和FFT技術,研究了信號平方與FFT結合的雙信號頻率估計算法。根據信號中兩頻率分量的幅度比,只需一次一維平方信號譜峰搜索,就可以得到雙信號的和頻與差頻分量的估計值,并利用插值技術提高測頻精度。該算法能夠精確地估計頻率間隔小的雙信號頻率,且容易地擴展到復信號,FPGA硬件實現容易。 (6)基于現代譜分析理論,研究了基于AR(2)模型的雙信號頻率估計算法。方法在利用AR(2)模型系數估計雙正弦信號頻率之和的同時,利用FFT快速測頻算法估計其中強信號分量的頻率值。算法仿真驗證和性能分析表明了提出的算法能快速高精度地估計雙信號頻率。 (7)給出了基于頻譜重心算法的雷達雙信號頻率估計的FPGA硬件實現架構,并進行了時序仿真。 (8)討論了雙信號帶寬匹配接收系統的硬件設計方案,給出了快速測頻及帶寬估計模塊設計。

    標簽: FPGA 信號 測頻

    上傳時間: 2013-06-02

    上傳用戶:youke111

  • 基于FPGA的高速采樣自適應濾波系統的研究

    自適應濾波器的硬件實現一直是自適應信號處理領域研究的熱點。隨著電子技術的發展,數字系統功能越來越強大,對器件的響應速度也提出更高的要求。 本文針對用通用DSP 芯片實現的自適應濾波器處理速度低和用HDL語言編寫底層代碼用FPGA實現的自適應濾波器開發效率低的缺點,提出了一種基于DSP Builder系統建模的設計方法。以隨機2FSK信號作為研究對象,首先在matlab上編寫了LMS去噪自適應濾波器的點M文件,改變自適應參數,進行了一系列的仿真,對算法迭代步長、濾波器的階數與收斂速度和濾波精度進行了研究,得出了最佳自適應參數,即迭代步長μ=0.0057,濾波器階數m=8,為硬件實現提供了參考。 然后,利用最新DSP Builder工具建立了基于LMS算法的8階2FSK信號去噪自適應濾波器的模型,結合多種EDA工具,在EPFlOKl00EQC208-1器件上設計出了最高數據處理速度為36.63MHz的8階LMS自適應濾波器,其速度是文獻[3]通過編寫底層VHDL代碼設計的8階自適應濾波器數據處理速度7倍多,是文獻[50]采用DSP通用處理器TMS320C54X設計的8階自適應濾波器處理速度25倍多,開發效率和器件性能都得到了大大地提高,這種全新的設計理念與設計方法是EDA技術的前沿與發展方向。 最后,采用異步FIFO技術,設計了高速采樣自適應濾波系統,完成了對雙通道AD器件AD9238與自適應濾波器的高速匹配控制,在QuartusⅡ上進行了仿真,給出了系統硬件實現的原理框圖,并將采樣濾波控制器與異步FIF0集成到同一芯片上,既能有效降低高頻可能引起的干擾又降低了系統的成本。

    標簽: FPGA 高速采樣 自適應濾波

    上傳時間: 2013-06-01

    上傳用戶:ynwbosss

  • 基于FPGA組的ASIC邏輯驗證技術研究

    隨著ASIC設計規模的增長,功能驗證已成為整個開發周期的瓶頸。傳統的基于軟件模擬和硬件仿真的邏輯驗證方法已難以滿足應用的要求,基于FPGA組的原型驗證方法能有效縮短系統的開發周期,可提供更快更全面的驗證。由于FPGA芯片容量的增加跟不上ASIC設計規模的增長,單芯片已無法容納整個設計,所以常常需要對設計進行邏輯分割,將子邏輯塊映射到FPGA陣列中。 本文對邏輯驗證系統的可配置互連結構和ASIC邏輯分割算法進行了深入的研究,提出了FPGA陣列的非對稱可配置互連結構。與現有的對稱互連結構相比,該結構能提供更多的互連通道,可實現對I/O數量、電平類型和互連路徑的靈活配置。 本文對邏輯分割算法進行了較深入的研究。針對現有的兩類分割算法存在的不足,提出并實現了基于設計模塊的邏輯分割算法,該算法有三個重要特征:1)基于設計代碼;2)以模塊作為邏輯分割的最小單位;3)使用模塊資源信息指導邏輯分割過程,避免了設計分割過程的盲目性,簡化了邏輯分割過程。 本文還對并行邏輯分割方法進行了研究,提出了兩種基于不同任務分配策略的并行分割算法,并對其進行了模擬和性能分析;驗證了采用并行方案對ASIC邏輯進行分割和映射的可行性。 最后基于改進的芯片互連結構,使用原型系統驗證方法對某一大規模ASIC設計進行了邏輯分割和功能驗證。實驗結果表明,使用改進后的FPGA陣列互連結構可以更方便和快捷地實現ASIC設計的分割和驗證,不但能顯著提高芯片間互連路徑的利用率,而且能給邏輯分割乃至整個驗證過程提供更好的支持,滿足現在和將來大規模ASIC邏輯驗證的需求。

    標簽: FPGA ASIC 邏輯 驗證技術

    上傳時間: 2013-06-12

    上傳用戶:極客

  • JPEG2000二維離散小波變換快速算法研究和FPGA實現

    相對于JPEG中二維離散余弦變換(2DDCT)來說,在JPEG2000標準中,二維離散小波變換(2DDWT)是其圖像壓縮系統的核心變換。在很多需要進行實時處理圖像的系統中,如數碼相機、遙感遙測、衛星通信、多媒體通信、便攜式攝像機、移動通信等系統,需要用芯片實現圖像的編解碼壓縮過程。雖然有許多研究工作者對圖像處理的小波變換進行了研究,但大都只偏重算法研究,對算法硬件實現時的復雜性考慮較少,對圖像處理的小波變換硬件實現的研究也較少。  本文針對圖像處理的小波變換算法及其硬件實現進行了研究。對文獻[13]提出的“內嵌延拓提升小波變換”(Combiningthedata-extensionprocedureintothelifting-basedDWTcore)快速算法進行仔細分析,提出一種基于提升方式的5/3小波變換適合硬件實現的算法,在MATLAB中仿真驗證了該算法,證明其是正確的。并設計了該算法的硬件結構,在MATLAT的Simulink中進行仿真,對該結構進行VHDL語言的寄存器傳輸級(RTL)描述與仿真,成功綜合到Altera公司的FPGA器件中進行驗證通過。本算法與傳統的小波變換的邊界處理方法比較:由于將其邊界延拓過程內嵌于小波變換模塊中,使該硬件結構無需額外的邊界延拓過程,減少小波變換過程中對內存的讀寫量,從而達到減少內存使用量,降低功耗,提高硬件利用率和運算速度的特點。本算法與文獻[13]提出的算法相比較:無需增加額外的硬件計算模塊,又具有在硬件實現時不改變原來的提升小波算法的規則性結構的特點。這種小波變換硬件芯片的實現不僅適用于JPEG2000的5/3無損小波變換,當然也可用于其它各種實時圖像壓縮處理硬件系統。

    標簽: JPEG 2000 FPGA 二維

    上傳時間: 2013-06-13

    上傳用戶:jhksyghr

  • 基于提升機構的二維離散小波的FPGA設計

    在衛星遙感設備中,隨著遙感技術的發展和對傳輸式觀測衛星遙感圖像質量要求的不斷提高,航天遙感圖像的分辨率和采樣率也越來越高,由此引起高分辨率遙感圖像數據存儲量和傳輸數據量的急劇增長,然而衛星信道帶寬有限。為了盡量保持高分辨率遙感圖像所具有的信息,必須解決輸入數據碼率和傳輸信道帶寬之間的矛盾。所以星載高分辨率遙感圖像數據的高保真、實時、大壓縮比壓縮技術就成了解決這一矛盾的關鍵技術。FPGA器件為實現數據壓縮提供了一種壓縮算法的硬件實現的一個理想的平臺。FPGA器件集成度高,體積小,通過用戶編程實現專門應用的功能。它允許電路設計者利用基于計算機的開發平臺,經過設計輸入,仿真,測試和校驗,直到達到預期的結果,減少了開發周期。小波變換能夠適應現代圖像壓縮所需要的如多分辨率、多層質量控制等要求,在較大壓縮比下,小波圖像壓縮質量明顯好于DCT變換,因此小波變換成為新一代壓縮標準JPEG2000的核心算法。同時,小波變換的提升算法結構簡單,能夠實現快速算法,有利于硬件實現,因此提升小波變換對于采用FPGA或ASIC來實現圖像變換來說是很好的選擇。本文針對衛星遙感圖像的數據流,主要研究可以對衛星圖像進行實時二維小波變換的方案。針對提升小波變換的VLSI結構和FPGA設計中的關鍵技術,從邊界延拓、濾波器結構、整數小波、定點運算、原位運算等方面進行了研究和討論,并且完成了針對衛星遙感圖像的分塊二維9/7提升小波變換的FPGA實現。采用VerIlog語言對設計進行了仿真驗證,并將仿真結果同matlab仿真結果進行了比較,比較結果表明該方案能實現對衛星遙感圖像數據流的二維提升小波變換的功能。同時QuartusII綜合結果也表明,系統時鐘能夠工作在很高的頻率,可以滿足高速實時對衛星圖像的小波變換處理。

    標簽: FPGA 提升機 二維 離散小波

    上傳時間: 2013-06-15

    上傳用戶:00.00

  • 基于FPGA的雙自觸發脈沖激光測距關鍵技術研究

    激光測距技術被廣泛應用于現代工業測量、航空與大地的測量、國防及通信等諸多領域。本文從已獲得廣泛應用的脈沖激光測距技術入手,重點分析了近年提出的自觸發脈沖激光測距技術(STPLR)特別是其中的雙自觸發脈沖激光測距技術(BSTPLR),通過分析發現其核心部件之一就是用于測量激光脈沖飛行時間(周期)的高精度高速計數器,而目前一般的方式是采用昂貴的進口高速計數器或專用集成電路(ASIC)來完成,這使得激光測距儀在研發、系統的改造升級和自主知識產權保護等諸多方面受到制約,同時在其整體性能上特別是在集成化、小型化和高可靠性方面帶來阻礙。為此,本文研究了采用現場可編程門陣列(FPGA)來實現脈沖激光測距中的高精度高速計數及其他相關功能,基本解決了以上存在的問題。 論文通過對雙自觸發脈沖激光測距的主要技術要求和技術指標進行分析,對其中的信號處理單元采用了FPGA+單片機的設計形式。由FPGA主控芯片(EPF10K20TC144-4)作為周期測量模塊,在整個測距系統中是信號處理的核心部件,借助其用戶可編程特性及很高的內部時鐘頻率,設計了專用于BSTPLR的高速高精度計數芯片,負責對測距信號產生電路中的時刻鑒別電路輸出信號進行計數。數據處理模塊則主要由單片機(AT89C51)來實現。系統可以通過鍵盤預置門控信號的寬度以均衡測量的精度和速度,測量結果采用7位LED數碼管顯示。本設計在近距離(大尺寸)范圍內實驗測試時基本滿足設計要求。

    標簽: FPGA 自觸發脈沖 激光測距 關鍵技術

    上傳時間: 2013-06-02

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  • 指紋識別算法的研究及基于FPGA的硬件實現

    隨著圖像處理和模式識別技術的進步,基于生物特征的識別技術成為蓬勃發展的高技術之一,根據IBG(InternationalBiometricGroup)組織對生物特征市場的統計和預測,該領域的收入的年增長率30-50%,到2008年,全球總收入將達到46.39億美元。而基于指紋特征的識別技術由于其獨特的可靠性,穩定性,方便快捷的特點,恰好符合了市場的需求。目前指紋識別技術是生物識別領域中應用最廣泛的識別技術,也是研究與應用的一個熱點。 SOPC片上可編程系統和嵌入式系統是當前電子設計領域中最熱門的概念。NiosⅡ是Altera公司開發的一種采用流水線技術、單指令流的RISC嵌入式處理器軟核,可以將它嵌入FPGA內部,與用戶自定義邏輯結合構成一個基于FPGA的片上系統。與嵌入式硬核相比較,嵌入式軟核具有更大的靈活性。而FPGA的高速性、恰恰滿足了指紋識別系統對速度的要求。 本文對指紋識別技術中各個環節的算法進行了較為深入的研究,結合NiosⅡ嵌入式處理器的特點,對算法進行了合理的選擇與優化,形成了一套完整的指紋識別算法,并提出了一種基于FPGA的指紋識別系統硬件設計方案。 論文的內容主要包括以下幾個方面: 1、對指紋圖像預處理、后處理和匹配算法進行了改進,提高了算法的性能;設計了一種適用于快速匹配的指紋特征數據結構;提出了一套基于特征點匹配的指紋識別算法。實驗結果表明該算法速度快、誤識率較低、可靠性較高,可以滿足實用的要求。 2、本著增加系統集成度、減小系統體積、提高便攜性、降低功耗和成本,同時提升系統的性能的原則,使用Altera公司提供的外圍設備IP核配合NiosⅡ處理器軟核搭建了一個單片嵌入式系統,然后以內嵌NiosⅡ軟核的FPGA和FPS200指紋采集器為核心芯片,外配片外RAM和Flash存儲器以及小鍵盤和LCD顯示屏等器件,設計了一個便攜式指紋識別系統,提出了一套基于FPGA的硬件設計方案。 3、利用NiosⅡ開發板對硬件設計方案進行了初步的驗證,實現了指紋采集芯片FPS200與FPGA的接口,并進行了算法的移植。 實驗結果表明本文所提出的系統設計方案是可行的。基于FPGA的自動指紋識別系統在速度、功耗、體積、擴展性方面有著獨特的優勢,具有廣闊的發展空間。最后提出了對這一設計繼續改進的思路和下一步研究的內容。

    標簽: FPGA 指紋識別 法的研究 硬件實現

    上傳時間: 2013-06-07

    上傳用戶:kikye

  • 大型汽輪發電機端部物理場的研究及其進相運行分析

    本論文圍繞大容量汽輪發電機的進相運行展開了研究工作。全文共分七章。第一章首先闡述了發電機進相運行的重要性和迫切性,對國內外相關方面的研究概況作了較為系統全面的綜述,并對本論文的研究內容作了簡單介紹。第二章給出了低頻三維渦流電磁場的復邊值問題,并介紹了復矢量場的一些理論基礎。然后分別利用伴隨算子和伴隨場函數(廣義相互作用原理)、最小作用原理和拉格朗日乘子法(廣義變分原理),建立了低頻三維渦流電磁場中非自伴算子問題的變分描述。上述三種方法所得的結果與Galerkin法的結果完全一致。第三章介紹了圓柱坐標系下基于拱形體單元的三維穩態溫度場有限元計算模型,并將變分法的結果與Galerkin法的結果進行了對比。第四章建立了汽輪發電機端部三維行波渦流電磁場的數學模型,在渦流控制方程中引入了罰函數項以使庫倫規范自動滿足,并應用廣義相互作用原理導出了對應的泛函變分及其有限元計算格式。然后對多臺大容量汽輪發電機端部的渦流電磁場進行了實例計算,并分析了罰函數項對數值解穩定性的影響以及影響端部電磁場的各種因素。第五章建立了大型汽輪發電機端部三維溫度場的有限元計算模型,并應用傳熱學理論研究了散熱系數、等效熱傳導系數等問題。然后求解了QFSS-300-2型汽輪發電機端部大壓圈上的三維溫度場分布,并與兩臺機組多種工況下的實測數據進行了對比。第六章介紹了二維穩態溫度場的邊值問題及其等價變分,導出了其有限元計算格式。然后求解了QFQS-200-2型汽輪發電機端部壓圈上的溫度分布,并與實測數據進行了對比。第七章首先定性研究了汽輪發電機從遲相運行到進相運行過程中不同區域上磁場強度的變化規律。然后介紹了發電機變參數數學模型,結合實測數據以及最小二乘回歸分析計算了發電機穩態運行時的相關電氣參數,并分析了發電機各物理量之間的相互關系。隨后分析了不同工況下發電機端部結構件上的渦流損耗及溫升的變化趨勢。最后,利用發電機變參數模型給出了發電機的飽和功角特性、靜穩極限以及運行極限圖。

    標簽: 大型 汽輪發電機 物理

    上傳時間: 2013-07-10

    上傳用戶:stampede

  • 單相交流串勵電動機溫升計算和振動分析

    單相交流串勵電動機由于啟動轉矩大、轉速高、體積小等一系列的特點,在電動工具、家用電器,尤其是小家電和吸塵器上獲得了十分廣泛的應用。論文對單相交流串勵電動機的發熱和振動特性進行研究。 在第二章,通過討論電機的發熱理論及其影響因素,結合實際建立了數學模型,推導得出一個工程上比較實用的公式,用來計算馬達堵轉時的溫升,還編寫了一個電腦程序來仿真計算馬達堵轉時的溫升。 在第三章,討論了電機轉子和支撐組成的振動系統在多自由度和各種情況下的振動。應用杜哈梅積分式和傅立葉分析法將機械振動和電磁干擾聯系起來,將機械振動問題轉化為二階電路的問題來進行處理。并且提出觀點:1.先測量出機械振動的頻譜圖或電磁噪音的Db-Freq頻譜圖,再用反傅立葉分解的方法將它們合成,得到周期性的激勵的形狀。2.由激勵(力信號或電信號)所產生的波在弦內進行傳播,信號經過衰減,輻射,在邊界處反射,然后跟下一列波迭加,直到成為穩定的干擾信號。 在第四章,對樣機進行測試,并和電腦仿真結果進行了比較。結果表明二者的偏差在2.5%以內。

    標簽: 單相交流 電動機 溫升計算

    上傳時間: 2013-07-31

    上傳用戶:csgcd001

  • 基于小波分解和模糊聚類的MRI圖像去噪以及分割算法研究

    磁共振成像(MRI)由于自身獨特的成像特點,使得其處理方法不同于一般圖像.根據不同的應用目的,該文分別提出了MRI圖像去噪和分割兩個算法.首先,該文針對MRI重建后圖像噪聲分布的實際特點,提出了基于小波變換的MRI圖像去噪算法.該算法詳細闡明了MRI圖像Rician噪聲的特點,首先對與噪聲和邊緣相關的小波系數進行建模,然后利用最大似然估計來進行參數估計,同時利用連續尺度間的尺度相關性特點來進行函數升級,以便獲得最佳萎縮函數,進一步提高圖像的質量,最終取得了一定的效果.與此同時,該文對MRI圖像的進一步的分析與應用展開了一定研究,提出了一種改進的快速模糊C均值聚類魯棒分割算法.該算法先用K均值聚類方法得到初始聚類中心點,同時考慮鄰域對分割結果的影響,對目標函數加以改進,用來克服噪聲和非均勻場對MRI圖像分割的影響,達到魯棒分割的目的,為進一步圖像處理和分析打下基礎.通過實驗,我們發現,無論是針對模擬圖像還是實際圖像,該文所提出的兩個算法都取得了較好的效果,達到了預期的目的.

    標簽: MRI 小波分解 圖像去噪 分割

    上傳時間: 2013-04-24

    上傳用戶:zhichenglu

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