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解壓覆蓋當源文件

  • kalman濾波器詳解

    卡爾曼濾波器教程,中文詳解,通俗易懂,18頁-Kalman Filter Directory

    標簽: kalman 濾波器

    上傳時間: 2013-04-24

    上傳用戶:牛布牛

  • C、C++語言版教程

    N個源碼,都是C文件或C++源文件。 此文件高壓縮。解壓時間可能長一些。 申請加下載限額。 主頁:http://www.programsalon.com/developer.asp?id=

    標簽: 語言 教程

    上傳時間: 2013-07-01

    上傳用戶:牛布牛

  • 電路實例詳解

    49個電路實例詳解 三位數字顯示電容測試表電路圖 市電電壓雙向越限報警保護器等

    標簽: 電路實例

    上傳時間: 2013-06-19

    上傳用戶:shenglei_353

  • 開關電源設計詳解

    開關電源設計詳解 開關電源設計詳解 開關電源設計詳解 開關電源設計詳解

    標簽: 開關電源設計

    上傳時間: 2013-04-24

    上傳用戶:stewart·

  • 嵌入式Linux系統開發技術詳解--基于ARM(完整版)

    嵌入式Linux系統開發技術詳解--基于ARM(完整版) 詳細解讀~!

    標簽: Linux ARM 嵌入式

    上傳時間: 2013-07-11

    上傳用戶:咔樂塢

  • IEEE 802.11信道編解碼及交織解交織的FPGA實現

    隨著糾錯編碼理論研究的不斷深入,糾錯碼的實際應用越來越廣泛。卷積碼作為其中重要的一種,已被大多數通信系統所采用。(2,1,7)卷積碼是一種短約束長度最佳碼,編、譯碼器易于實現,且具有較強的糾錯能力。 本文研究了IEEE 802.11協議中(2,1,7)卷積碼編碼、交織解交織及其軟判決高速Viterbi譯碼的實現問題。 首先介紹了IEEE 802.11無線局域網標準及規范,然后介紹了信道編解碼中卷積碼編碼及Viterbi譯碼算法和FPGA 設計方法,接著通過對(2,1,7)卷積碼特點的具體分析,吸取目前Viterbi譯碼算法和交織解交織算法的優點,采取一系列的改進措施,基于FPGA實現了IEEE 802.11信道編解碼及交織和解交織系統。這些改進措施包括采用并行FIFO、改進的ACS 單元、流水式塊處理結構、改進的SMDO方法、雙重交織策略,使得在同樣時鐘速率下,系統的性能大幅度提高。最后將程序下載到Altera公司的Cyclone 系列的FPGA(型號EP1C6Q240C8)器件上進測試,并對測試結果作了簡單分析。

    標簽: 802.11 IEEE FPGA 信道

    上傳時間: 2013-05-25

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  • WCDMA多用戶檢測算法的研究和下行鏈路解復用技術的FPGA實現

    本文首先在介紹多用戶檢測技術的原理以及系統模型的基礎上,對比分析了幾種多用戶檢測算法的性能,給出了算法選擇的依據。為了同時克服多址干擾和多徑干擾,給出了融合多用戶檢測與分集合并技術的接收機結構。 接著,針對WCDMA反向鏈路信道結構,介紹了擴頻使用的OVSF碼和擾碼,分析了擾碼的延時自相關特性和互相關特性,指出了存在多址干擾和多徑干擾的根源。在此基礎上,給出了解相關檢測器的數學公式推導和結構框圖,并仿真研究了用戶數、擴頻比、信道估計精度等參數對系統性能的影響。 常規的干擾抵消是基于chip級上的抵消,需要對用戶信號重構,因此具有較高的復雜度。在解相關檢測器的基礎上,衍生出符號級上的干擾抵消。通過仿真,給出了算法中涉及的干擾抑制控制權值、干擾抵消級數等參數的最佳取值,并進行了算法性能比較。仿真結果驗證了該算法的有效性。 最后,介紹了WCDMA系統移動臺解復用技術的硬件實現,在FPGA平臺上分別實現了與基站和安捷倫8960儀表的互聯互通。

    標簽: WCDMA FPGA 多用戶檢測 下行鏈路

    上傳時間: 2013-07-29

    上傳用戶:jiangxin1234

  • PCB板的線寬、覆銅厚度與通過的電流對應的關系

    PCB板的線寬、覆銅厚度與通過的電流對應的關系 寬度(mm) 電流(A) 寬度(mm) 電流(A) 寬度(mm) 電流(A)0.15 0.2 0.15 0.5 0.15

    標簽: PCB 覆銅 電流

    上傳時間: 2013-06-28

    上傳用戶:gzming

  • PCB板的線寬、覆銅厚度對應的關系

    PCB板的線寬、覆銅厚度與通過的電流對應的關系,可作為PCB設計時的參考資料。

    標簽: PCB 覆銅

    上傳時間: 2013-06-16

    上傳用戶:liansi

  • 交織與解交織的算法研究及FPGA實現

    本文主要研究了數字聲音廣播系統(DAB)內交織器與解交織器的算法及硬件實現方法。時間交織器與解交織器的硬件實現可以有幾種實現方案,本文對其性能進行了分析比較,選擇了一種工程中實用的設計方案進行設計,并將設計結果以FPGA設計驗證。時間解交織器的交織速度、電路面積、占用內存、是設計中主要因素,文中采用了單口SRAM實現,減少了對存儲器的使用,利用lC設計的優化設計方法來改善電路的面積。硬件實現是采用工業EDA標準Top-to-Down設計思想來設計時間解交織,使用verilogHDL硬件描述語言來描述解交織器,用Cadence Nc-verilog進行仿真,Debussy進行debug,在Altera公司的FPGA開發板上進行測試,然后用ASIC實現。測試結果證明:時間解交織器的輸出正確,實現速度較快,占用面積較小。

    標簽: FPGA 算法研究

    上傳時間: 2013-04-24

    上傳用戶:梧桐

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