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解調(diào)器

DSP2812寄存器詳解

DSP,DSP2812寄存器詳解

標簽： DSP

上傳時間： 2019-04-25

上傳用戶：eep123
編碼器的詳解課件

編碼器的詳解ppt

標簽： 編碼器

上傳時間： 2022-07-24

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單片機定時器中斷原理和C語言代碼詳解

該文檔為單片機定時器中斷原理和C語言代碼詳解總結文檔，是一份不錯的參考資料，感興趣的可以下載看看，，，，，，，，，，，，，，，，，

標簽： 單片機

上傳時間： 2022-08-10

上傳用戶：d1997wayne
SVPWM逆變器過調制策略對交流電機動態性能影響的研究.rar

隨著電力電子技術、微處理器技術以及控制技術的發展，基于轉子磁鏈定向的交流電機矢量控制系統以其優良的性能受到了廣泛應用。采用SVPWM逆變器的異步電動機矢量控制系統在轉速參考值變化或者負載轉矩參考值變化的動態情況下，參考電壓矢量可能會超出基本空間矢量構成的正六邊形，此時便出現動態過調制，需要用過調制策略將超出的電壓矢量重新限定在正六邊形邊界內。不同的過調制策略會給整個系統帶來不同的動態性能，本文在對過調制策略進行完善的基礎上，針對三種過調制策略對交流電動機動態性能的影響進行了研究，并對其機理進行了理論分析與探討。 @@ 本文首先以三相異步電動機在兩相靜止坐標系下的動態方程為基礎，按照轉子磁鏈定向，設計了轉子磁鏈觀測器，完成了勵磁電流分量和轉矩電流分量的解耦，并構建了基于SVPWM的異步電動機矢量控制系統的MATLAB仿真模型。在矢量控制中，電流控制對系統性能具有重要影響。為了改善系統性能，所設計的矢量控制系統采用了同步電流控制，并對反電勢進行了前饋補償。 @@ 在分析了現有的三種過調制策略之后，對過調制策略進行了完善，并構建了異步電動機矢量控制系統的過調制仿真模型。過調制中，當原參考電壓矢量位于正六邊形中任意兩個扇區交界附近時，過調制策略2和3所得到的新電壓矢量仍會超出正六邊形邊界，過調制算法不再適用于此區域。針對以上不足，本文對過調制策略2和3進行了完善，使過調制算法適用于所有區域。采用完善后的過調制策略對轉速參考值變化和負載轉矩參考值變化的異步電動機矢量控制系統進行仿真，發現在加速與加載的條件下，過調制策略2的動態性能好于過調制策略1，而過調制策略3的動態性能最佳，具有最小的動態響應時間，暫態性能優良；在減載的條件下，過調制策略1和2能夠很快的進入穩定狀態，但是過調制策略3卻出現問題，動態響應時間很長，說明此策略具有一定的局限性。 @@ 本文深入探討了三種過調制策略導致不同動態性能的內在機理，通過對三種過調制策略中電壓矢量的幅值和相位進行分析，理論上解釋了出現不同動態響應時間的原因。出現過調制時，過調制策略2中新電壓矢量的幅值總是大于過調制策略1中新電壓矢量的幅值，所以動態性能更好。在加速和加載條件下，過調制策略3中新電壓矢量的相位總是超前于過調制策略1和2中新電壓矢量的相位，因此可以獲得更快的動態響應，暫態性能更佳。但是在減載條件下，過調制策略3中新電壓矢量與原電壓矢量間的相位關系處于無規律的超前滯后狀態，導致過調制策略3出現問題，動態響應時間很長，說明此過調制策略有其不足之處，有待于改進。@@關鍵詞：SVPWM；矢量控制；過調制；動態性能

標簽： SVPWM 逆變器過調制

上傳時間： 2013-06-27

上傳用戶：nunnzhy
3kW光伏并網逆變器最大功率點跟蹤控制的研究.rar

光伏發電是集開發可再生能源、改善生態環境于一體的重大課題，有巨大的經濟、社會效益和學術研究價值。本文首先介紹了3kW光伏并網逆變器系統的組成和結構。3kW光伏并網逆變器采用兩級式結構，主電路由前級Boost變換器和后級的單相逆變橋組成。控制部分以DSP(DSP56F803)為核心，實現了光伏陣列最大功率點的跟蹤控制，以及產生與電網壓同頻同相的正弦電流，實現并網的功能。本文重點對逆變器系統的最大功率點跟蹤(MPPT)控制進行研究。針對基于外特性建立的光伏陣列模型雖然簡單、參數易解，但精度低的問題，本文建立了基于物理特性的光伏陣列模型，并考慮光照強度、環境溫度對光伏陣列的影響，模型參數與實際參數嚴格對應。將幾種最大功率點跟蹤算法應用于所建立的光伏陣列模型使用MATLAB進行仿真，分析仿真結果，比較各種算法的優缺點，總結出每種算法所適用的環境，并給出了最大功率點跟蹤控制在并網逆變器系統的實現策略。設計了適用于額定功率為100W的光伏陣列最大功率點跟蹤的Boost電路，分別給出了利用PIC單片機16F873實現擾動觀察法和增量電導法的程序流程圖，實現了這兩種算法控制下光伏陣列的最大功率點跟蹤，并分析了兩種算法的跟蹤性能。

標簽： 3kW 光伏并網逆變器

上傳時間： 2013-04-24

上傳用戶：fudong911
基于FPGA的GSM解擴解調的設計與實現.rar

擴頻通信系統與常規的通信系統相比，具有很強的抗窄帶干擾，抗多徑干擾，抗人為干擾的能力，并具有信息隱蔽、多址保密通信等優點，在近年來得到了迅速的發展。論文針對直擴通信系統中偽碼和載波同步問題而展開，研究了直擴系統的結構、性能及完成了相關參數的計算，改進了包絡算法，設計了解擴和解調器，最后用ISE9.1實現了解擴和解調器的仿真波形，驗證了設計的正確性。論文研究了擴頻通信系統的特點、國內外發展現狀及理論基礎，完成了DS-QPSK接收機的解擴器和解調器的設計與實現。解擴器主要圍繞著偽碼的捕獲與跟蹤這一核心，分析了解擴器的結構、性能及其完成了相關參數的計算，完成了數字下變頻器、偽碼發生電路、偽碼相關積分提取電路、多通道快碼捕獲電路、偽碼跟蹤鑒相電路、偽碼時鐘調整電路的設計，并在ISE9.1編程綜合得到仿真結果，驗證了設計的正確性。由于相關積分包絡算法是整個系統的基礎和核心，為了減少時延和系統所占硬件資源，改進了包絡算法并得到了仿真驗證。結果表明，它不但減少了硬件資源的占用、縮短了延時，而且對整個系統的優化起著決定性的作用。論文給出了偽碼同步的仿真結果及資源占用情況，有力地說明了解擴器占用資源少、時延短等特點。解調器研究了頻偏及載波相位誤差對信號的影響及同步方案，完成了數控振蕩器、反正切鑒頻器、環路濾波器的設計并得到了相關的仿真波形，實現了載波的跟蹤，給出了仿真結果及資源占用情況，對系統實現過程中的一些經驗進行了總結。最后是對論文工作的一些總結和對今后工作的展望。

標簽： FPGA GSM 解調

上傳時間： 2013-06-13

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基于FPGA的直擴調制解調器的設計與實現.rar

擴頻通信系統與常規的通信系統相比，具有很強的抗窄帶干擾，抗多徑干擾，抗人為干擾的能力，并具有信息隱蔽、多址保密通信等優點。在近年來得到了迅速的發展。本論文主要討論和實現了基于FPGA的直接序列擴頻信號的解擴解調處理。論文對該直擴通信系統和FPGA設計方法進行了相關研究，最后用Altera公司的最新的FPGA開發平臺Quarus Ⅱ5.0實現了相關設計。整個系統分為兩個部分，發送部分和接收部分。發送部分主要有串并轉換、差分卷積編碼、PN碼擴頻、QPSK調制、成型濾波等模塊。接收部分主要有前端抗干擾、數字下變頻、解擴解調等模塊。論文首先介紹了擴頻通信系統的特點以及相關技術的國內外發展現狀，并介紹了本論文的研究思路和內容。然后，論文分析了幾種常用的窄帶干擾抑制、載波同步及PN碼同步算法，結合實際需要，設計了一種零中頻DSSS解調解擴方案。給出了抗窄帶干擾、PN碼捕獲及跟蹤以及載波同步的算法分析，采用了基于數字外差調制的自適應陷波器來進行前端窄帶干擾抑制處理，用基于自適應門限技術的滑動相關捕獲和分時復用單相關器跟蹤來改善PN碼同步的性能，用基于硬判決的COSTAS(科斯塔斯)環來減少載波提取的算法復雜度，用改進型CORDIC算法實現NCO來方便的進行擴展。接著，論文給出了系統總體設計和發送及接受子系統的各個功能模塊的實現分析以及在Quartus Ⅱ5.0上的實現細節，給出了仿真結果。然后論文介紹了整個系統的硬件電路設計和它在真實系統中連機調試所得到的測試結果，結果表明該系統具有性能穩定，靈活性好，生產調試容易，體積小，便于升級等特點并且達到課題各項指標的要求。最后是對論文工作的一些總結和對今后工作的展望。

標簽： FPGA 調制解調器

上傳時間： 2013-05-23

上傳用戶：磊子226
適用于H.264視頻解碼器的VLD設計

設計了一種適合于H.264 的變字長解碼器根據碼流特點進行模塊劃分減少硬件開銷采用并行結構解NAL 包解碼效率高采用了桶形移位器進行并行解碼每個時鐘解一個碼字采用Verilog 語言進行設計仿真并通過

標簽： 264 VLD 視頻解碼器

上傳時間： 2013-07-15

上傳用戶：shen007yue
IEEE 802.11信道編解碼及交織解交織的FPGA實現

隨著糾錯編碼理論研究的不斷深入，糾錯碼的實際應用越來越廣泛。卷積碼作為其中重要的一種，已被大多數通信系統所采用。(2,1,7)卷積碼是一種短約束長度最佳碼，編、譯碼器易于實現，且具有較強的糾錯能力。本文研究了IEEE 802.11協議中(2,1,7)卷積碼編碼、交織解交織及其軟判決高速Viterbi譯碼的實現問題。首先介紹了IEEE 802.11無線局域網標準及規范，然后介紹了信道編解碼中卷積碼編碼及Viterbi譯碼算法和FPGA 設計方法，接著通過對(2,1,7)卷積碼特點的具體分析，吸取目前Viterbi譯碼算法和交織解交織算法的優點，采取一系列的改進措施，基于FPGA實現了IEEE 802.11信道編解碼及交織和解交織系統。這些改進措施包括采用并行FIFO、改進的ACS 單元、流水式塊處理結構、改進的SMDO方法、雙重交織策略，使得在同樣時鐘速率下，系統的性能大幅度提高。最后將程序下載到Altera公司的Cyclone 系列的FPGA(型號EP1C6Q240C8)器件上進測試，并對測試結果作了簡單分析。

標簽： 802.11 IEEE FPGA 信道

上傳時間： 2013-05-25

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交織與解交織的算法研究及FPGA實現

本文主要研究了數字聲音廣播系統(DAB)內交織器與解交織器的算法及硬件實現方法。時間交織器與解交織器的硬件實現可以有幾種實現方案，本文對其性能進行了分析比較，選擇了一種工程中實用的設計方案進行設計，并將設計結果以FPGA設計驗證。時間解交織器的交織速度、電路面積、占用內存、是設計中主要因素，文中采用了單口SRAM實現，減少了對存儲器的使用，利用lC設計的優化設計方法來改善電路的面積。硬件實現是采用工業EDA標準Top-to-Down設計思想來設計時間解交織，使用verilogHDL硬件描述語言來描述解交織器，用Cadence Nc-verilog進行仿真，Debussy進行debug，在Altera公司的FPGA開發板上進行測試，然后用ASIC實現。測試結果證明：時間解交織器的輸出正確，實現速度較快，占用面積較小。

標簽： FPGA 算法研究

上傳時間： 2013-04-24

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