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  • FPGA可促進嵌入式系統設計改善即時應用性能

    FPGA可促進嵌入式系統設計改善即時應用性能,臺灣人寫的,關于FPGA應用的技術文章

    標簽: FPGA 嵌入式 系統 性能

    上傳時間: 2013-08-20

    上傳用戶:liuwei6419

  • pcb layout design(臺灣硬件工程師15年經驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或導通孔。11. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

  • pcb layout design(臺灣硬件工程師15年經驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或導通孔。11. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-11-17

    上傳用戶:cjf0304

  • 王森 Java手機程式設計入門

    王森 Java手機程式設計入門

    標簽: Java 程式

    上傳時間: 2015-01-23

    上傳用戶:maizezhen

  • Win32多線程程序設計

    Win32多線程程序設計,很不錯得到

    標簽: Win 32 程序

    上傳時間: 2015-01-31

    上傳用戶:15736969615

  • 基於GSM公網的PLC遠端通信的設計與實現.rar

    基於GSM公網的PLC遠端通信的設計與實現.rar

    標簽: GSM PLC 通信

    上傳時間: 2014-11-26

    上傳用戶:wcl168881111111

  • Windows 95 系統程式設計大奧秘書籍源碼

    Windows 95 系統程式設計大奧秘書籍源碼

    標簽: Windows 95 系統 程式

    上傳時間: 2014-01-06

    上傳用戶:yt1993410

  • Matt Pietrek 著的《Windows 95 System Programming SECRETS》(中文譯名:《Windows 95 系統程式設計大奧秘》)中的第8章

    Matt Pietrek 著的《Windows 95 System Programming SECRETS》(中文譯名:《Windows 95 系統程式設計大奧秘》)中的第8章,專門介紹WINDOWS的PE文件格式,非常有價值,這個是由這章單獨整理出來的。

    標簽: Windows Programming Pietrek SECRETS

    上傳時間: 2015-03-17

    上傳用戶:日光微瀾

  • Programming Windows程式開發設計指南

    Programming Windows程式開發設計指南

    標簽: Programming Windows 程式

    上傳時間: 2015-03-18

    上傳用戶:agent

  • 這個程式可以用來觀察其他程式的VCL組態、記憶體內容。幫助設計時的runtime debug。 當然也可以用來看別人程式中用了什麼元件、設計了什麼property

    這個程式可以用來觀察其他程式的VCL組態、記憶體內容。幫助設計時的runtime debug。 當然也可以用來看別人程式中用了什麼元件、設計了什麼property

    標簽: property runtime debug 程式

    上傳時間: 2015-04-11

    上傳用戶:ynzfm

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