本原碼是基于Verilog HDL語言的FPGA原程序，主要用于測頻率，特點主要是可以更快地測頻。實時性更高。
標簽： Verilog FPGA HDL 語言
上傳時間： 2013-09-01
上傳用戶：1417818867
采用Verilog語言,實現了FPGA控制視頻芯片的數據采集,并將數據按幀存儲起來
標簽： Verilog FPGA 語言 控制
上傳用戶：喵米米米
這是我用vhdl語言，在fpga內部做了一個雙口ram的程序。我的郵箱：wleechina@163.com
標簽： vhdl 語言
上傳時間： 2013-09-02
上傳用戶：jhksyghr
VHDL語言編寫的FIR濾波器源碼\r\n對于嵌入式設計者有很好的指導作用\r\n
標簽： VHDL FIR 語言 編寫
上傳時間： 2013-09-03
上傳用戶：kaje
利用VHDL語言編寫的一個crc功能模塊，可下載到FPGA實現功能
標簽： VHDL crc 語言 編寫
上傳用戶：王慶才
這是一個用MAX+PLUSII開發FPGA（1K30器件）開發的李沙育圖形發生器（硬件描述語言部分）。
標簽： PLUSII FPGA 1K30 MAX
上傳用戶：zhyfjj
這是一個用C語言寫的SPI讀寫FPGA的典型代碼，具有一定的參照開發價值
標簽： FPGA SPI C語言 讀寫
上傳用戶：hzy5825468
lua腳本語言調用allegro游戲程序庫的接口。跨平臺
標簽： allegro lua 腳本 游戲程序
上傳時間： 2013-09-04
上傳用戶：松毓336
用CADENCE做VHDL語言實驗的教程
標簽： CADENCE VHDL 語言實驗 教程
上傳用戶：wangchong
數控振蕩器的頻率控制字寄存器、相位控制字寄存器、累加器和加法器可以用VHDL語言描述，集成在一個模塊中，提供VHDL源程序供大家學習和討論。\r\n
標簽： VHDL 寄存器 數控振蕩器 加法器
上傳用戶：a471778
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