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跨層設(shè)(shè)計(jì)

基于ARM的PCI北橋設(shè)計(jì)與驗(yàn)證

PCI(Peripheral Component Interconnect)總線以其高性能、低成本、開(kāi)放性、獨(dú)立于處理器、軟件透明等眾多優(yōu)點(diǎn)成為當(dāng)今最流行的計(jì)算機(jī)局部總線。在嵌入式系統(tǒng)領(lǐng)域中，許多IP都是基于PCI總線設(shè)計(jì)的。本文闡述一種以ARM9作為CPU的嵌入式系統(tǒng)的PCI北橋設(shè)計(jì)與驗(yàn)證。首先介紹基于ARM的嵌入式系統(tǒng)結(jié)構(gòu)，并深入研究PCI2.2總線行為規(guī)范。在此基礎(chǔ)上提出一種基于ARM處理器的PCI總線北橋的設(shè)計(jì)方案，整個(gè)設(shè)計(jì)主要分為主設(shè)備接口模塊，目標(biāo)設(shè)備接口模塊，配置寄存器模塊和集成總線仲裁器三大部分。對(duì)于主設(shè)備接口模塊和目標(biāo)設(shè)備接口模塊，論文主要從數(shù)據(jù)通路和控制路徑的實(shí)現(xiàn)兩方面進(jìn)行闡述。對(duì)于集成的總線仲裁器，設(shè)計(jì)采用兩優(yōu)先級(jí)的循環(huán)優(yōu)先算法，通過(guò)一組設(shè)備編號(hào)寄存器實(shí)現(xiàn)了PCI總線上的仲裁，此外，論文對(duì)跨時(shí)鐘域的信號(hào)同步和PCI配置寄存器也作了較為詳細(xì)的描述，最終采用自頂向下的方法實(shí)現(xiàn)了整個(gè)設(shè)計(jì)。在驗(yàn)證部分，引入了基于平臺(tái)的驗(yàn)證思路，通過(guò)搭建驗(yàn)證平臺(tái)，可以高效地實(shí)現(xiàn)驗(yàn)證。論文重點(diǎn)討論了驗(yàn)證平臺(tái)的搭建和行為模型的建立，并介紹了一種命令總線，通過(guò)打包各個(gè)驗(yàn)證點(diǎn)控制驗(yàn)證流程。此外，為提高驗(yàn)證的自動(dòng)化程度，論文對(duì)驗(yàn)證所使用的腳本也進(jìn)行了描述。通過(guò)此驗(yàn)證平臺(tái)和腳本，提高了整個(gè)驗(yàn)證系統(tǒng)的可移植性和可重用性。論文最終完成了PCI北橋的RTL級(jí)的功能描述，并使用仿真軟件完成對(duì)設(shè)計(jì)的仿真驗(yàn)證。設(shè)計(jì)通過(guò)驗(yàn)證并成功實(shí)現(xiàn)在基于ARM的集成處理器，達(dá)到預(yù)定的功能設(shè)計(jì)要求，并具有良好的性能，最后對(duì)后續(xù)開(kāi)發(fā)進(jìn)行了探討。

標(biāo)簽： ARM PCI 北橋

上傳時(shí)間： 2013-05-22

上傳用戶：uuuuuuu
基于ARM的嵌入式遠(yuǎn)程控制平臺(tái)系統(tǒng)軟件設(shè)計(jì)

遠(yuǎn)程控制的目的旨在突破地域和環(huán)境上的限制，對(duì)現(xiàn)場(chǎng)設(shè)備的運(yùn)行狀態(tài)及各種參數(shù)進(jìn)行遠(yuǎn)程監(jiān)控。尤其是在現(xiàn)場(chǎng)設(shè)備分布離散、工作環(huán)境惡劣等情況下，遠(yuǎn)程控制技術(shù)的采用實(shí)現(xiàn)了跨地域的集中控制，節(jié)省了人力物力，降低了生產(chǎn)成本，提高了生產(chǎn)率和經(jīng)濟(jì)效益。本文采用ARM7TDMI系列S3C44BOX嵌入式微處理器和μC/OS—Ⅱ作為系統(tǒng)開(kāi)發(fā)平臺(tái)，研究并完成了操作系統(tǒng)的移植、應(yīng)用程序的編寫和系統(tǒng)的集成測(cè)試。在充分理解μC/OS—Ⅱ文件體系結(jié)構(gòu)和移植條件的基礎(chǔ)上，移植了OS_CPU.H、OS_CPU_AASM和OS_CPU_C.C三個(gè)文件。自定義了手機(jī)短信的通信格式。應(yīng)用程序的編寫完成了對(duì)串口信息的監(jiān)測(cè)、讀寫、分析與執(zhí)行。根據(jù)系統(tǒng)功能制定需要被操作系統(tǒng)調(diào)度的任務(wù)及任務(wù)優(yōu)先級(jí)。系統(tǒng)調(diào)試主要分為兩個(gè)步驟，先于宿主機(jī)上脫機(jī)調(diào)試程序代碼，成功后通過(guò)JTAG端口下載到目標(biāo)機(jī)上進(jìn)行在線調(diào)試。本文將移動(dòng)通信技術(shù)和嵌入式技術(shù)結(jié)合起來(lái)應(yīng)用到遠(yuǎn)程控制系統(tǒng)中。憑借SMS短消息業(yè)務(wù)所具有的操作簡(jiǎn)便、收費(fèi)低廉、可靠性高等特點(diǎn)來(lái)發(fā)送對(duì)遠(yuǎn)程設(shè)備的監(jiān)控指令；嵌入式實(shí)時(shí)操作系統(tǒng)的移植則更好地實(shí)現(xiàn)了對(duì)監(jiān)控指令的分析與執(zhí)行，提高了系統(tǒng)的執(zhí)行效率。

標(biāo)簽： ARM 嵌入式遠(yuǎn)程控制平臺(tái)系統(tǒng)

上傳時(shí)間： 2013-06-25

上傳用戶：Poppy
基于ARM核的AHBUSB20接口ASIC設(shè)計(jì)

USB2．0接口和基于ARM核的SOC系統(tǒng)的應(yīng)用已經(jīng)非常廣泛，特別在電子消費(fèi)類領(lǐng)域。包含USB2,0接口的ARM系統(tǒng)則更是市場(chǎng)的需求。本文介紹一種基于ARM核的USB2,0接口IP(AHB_USB2.0)的設(shè)計(jì)，主要對(duì)其中的串行接口引擎(SIE)的設(shè)計(jì)進(jìn)行討論。該 AHB_USB2.0 IP核支持USB2.0協(xié)議，并兼容USB1.1協(xié)議；支持AMBA2.0協(xié)議和UTMI 1.05協(xié)議。該IP核一側(cè)通過(guò)UTMI接口或ULPI接口的PHY與USB2.0主機(jī)端進(jìn)行通信；另一側(cè)則通過(guò)AHB總線與ARM相連。 AHB_USB2.0 IP核在硬件上分為三個(gè)大模塊：ULPI模塊(ULPI)、串行接口引擎(SIE)模塊和AHB總線接口模塊(AHB)。ULPI模塊實(shí)現(xiàn)了UTMI接口轉(zhuǎn)ULPI接口。串行接口引擎(SIE)模塊為USB2.0的數(shù)據(jù)鏈路層協(xié)議處理模塊，為整個(gè)IP核的核心部分，進(jìn)一步分為四個(gè)子模塊——GLC(全局控制模塊)，PIE(PHY接口處理引擎)，SIF(系統(tǒng)接口邏輯)和EPB(端點(diǎn)緩沖模塊)。GLC模塊負(fù)責(zé)整個(gè)IP的復(fù)位控制，IP時(shí)鐘的開(kāi)關(guān)提示等；PIE模塊負(fù)責(zé)處理USB的事務(wù)級(jí)傳輸，包括組包解包等；SIF模塊負(fù)責(zé)協(xié)議相關(guān)寄存器組和端點(diǎn)緩沖區(qū)的讀寫，跨時(shí)鐘域信號(hào)的處理和PIE所需的控制信號(hào)的產(chǎn)生；AHB模塊負(fù)責(zé)IP核與ARM通信和DMA功能的實(shí)現(xiàn)。該IP核的軟件設(shè)計(jì)遵循USB協(xié)議，Bulk Only協(xié)議和UFI協(xié)議，由外掛ARM實(shí)現(xiàn)USB設(shè)備命令和UFI命令的解析，并執(zhí)行相應(yīng)的操作。設(shè)計(jì)了IP核與ARM之間的多種數(shù)據(jù)傳輸方法，通過(guò)軟件實(shí)現(xiàn)常規(guī)數(shù)據(jù)讀寫訪問(wèn)、內(nèi)部DMA或外部DMA等多種方式的切換。本IP已經(jīng)通過(guò)EDA驗(yàn)證和FPGA測(cè)試，并且已經(jīng)在內(nèi)嵌ARM核的FPGA系統(tǒng)上實(shí)現(xiàn)了多個(gè)U盤。這個(gè)FPGA系統(tǒng)的正確工作，證明了AHB_USB2.01P核設(shè)計(jì)是正確的。

標(biāo)簽： AHBUSB ASIC ARM 20

上傳時(shí)間： 2013-05-17

上傳用戶：qqoqoqo
高吞吐量LDPC碼編碼構(gòu)造及其FPGA實(shí)現(xiàn)

低密度校驗(yàn)碼（LDPC，Low Density Parity Check Code）是一種性能接近香農(nóng)極限的信道編碼，已被廣泛地采用到各種無(wú)線通信領(lǐng)域標(biāo)準(zhǔn)中，包括我國(guó)的數(shù)字電視地面?zhèn)鬏敇?biāo)準(zhǔn)、歐洲第二代衛(wèi)星數(shù)字視頻廣播標(biāo)準(zhǔn)（DVB-S2，Digital Video Broadcasting-Satellite 2）、IEEE 802.11n、IEEE 802.16e等。它是3G乃至將來(lái)4G通信系統(tǒng)中的核心技術(shù)之一。當(dāng)今LDPC碼構(gòu)造的主流方向有兩個(gè)，分別是結(jié)合準(zhǔn)循環(huán)（QC，Quasi Cyclic）移位結(jié)構(gòu)的單次擴(kuò)展構(gòu)造和類似重復(fù)累積（RA，Repeat Accumulate）碼構(gòu)造。相應(yīng)地，主要的LDPC碼編碼算法有基于生成矩陣的算法和基于迭代譯碼的算法。基于生成矩陣的編碼算法吞吐量高，但是需要較多的寄存器和ROM資源；基于迭代譯碼的編碼算法實(shí)現(xiàn)簡(jiǎn)單，但是吞吐量不高，且不容易構(gòu)造高性能的好碼。本文在研究了上述幾種碼構(gòu)造和編碼算法之后，結(jié)合編譯碼器綜合實(shí)現(xiàn)的復(fù)雜度考慮，提出了一種切實(shí)可行的基于二次擴(kuò)展（Dex，Duplex Expansion）的QC-LDPC碼構(gòu)造方法，以實(shí)現(xiàn)高吞吐量的LDPC碼收發(fā)端；并且充分利用該類碼校驗(yàn)矩陣準(zhǔn)循環(huán)移位結(jié)構(gòu)的特點(diǎn)，結(jié)合RU算法，提出了一種新編碼器的設(shè)計(jì)方案。基于二次擴(kuò)展的QC-LDPC碼構(gòu)造方法，是通過(guò)對(duì)母矩陣先后進(jìn)行亂序擴(kuò)展（Pex，Permutation Expansion）和循環(huán)移位擴(kuò)展（CSEx，Cyclic Shift Expansion）實(shí)現(xiàn)的。在此基礎(chǔ)上，為了實(shí)現(xiàn)可變碼長(zhǎng)、可變碼率，一般編譯碼器需同時(shí)支持多個(gè)亂序擴(kuò)展和循環(huán)移位擴(kuò)展的擴(kuò)展因子。本文所述二次擴(kuò)展構(gòu)造方法的特點(diǎn)在于，固定循環(huán)移位擴(kuò)展的擴(kuò)展因子大小不變，支持多個(gè)亂序擴(kuò)展的擴(kuò)展因子，使得譯碼器結(jié)構(gòu)得以精簡(jiǎn)；構(gòu)造得到的碼字具有近似規(guī)則碼的結(jié)構(gòu)，便于硬件實(shí)現(xiàn)；（偽）隨機(jī)生成的循環(huán)移位系數(shù)能夠提高碼字的誤碼性能，是對(duì)硬件實(shí)現(xiàn)和誤碼性能的一種折中。新編碼器在很大程度上考慮了資源的復(fù)用，使得實(shí)現(xiàn)復(fù)雜度近似與碼長(zhǎng)成正比。考慮到吞吐量的要求，新編碼器結(jié)構(gòu)完全拋棄了RU算法中串行的前向替換（FS，F(xiàn)orward Substitution）模塊，同時(shí)簡(jiǎn)化了流水線結(jié)構(gòu)，由原先RU算法的6級(jí)降低為4級(jí)；為了縮短編碼延時(shí)，設(shè)計(jì)時(shí)安排每一級(jí)流水線計(jì)算所需的時(shí)鐘數(shù)大致相同。這種碼字構(gòu)造和編碼聯(lián)合設(shè)計(jì)方案具有以下優(yōu)勢(shì)：相比RU算法，新方案對(duì)可變碼長(zhǎng)、可變碼率的支持更靈活，吞吐量也更大；相比基于生成矩陣的編碼算法，新方案節(jié)省了50％以上的寄存器和ROM資源，單位資源下的吞吐量更大；相比類似重復(fù)累積碼結(jié)構(gòu)的基于迭代譯碼的編碼算法，新方案使高性能LDPC碼的構(gòu)造更為方便。以上結(jié)果都在Xilinx Virtex II pro 70 FPGA上得到驗(yàn)證。通過(guò)在實(shí)驗(yàn)板上實(shí)測(cè)表明，上述基于二次擴(kuò)展的QC-LDPC碼構(gòu)造和相應(yīng)的編碼方案能夠?qū)崿F(xiàn)高吞吐量LDPC碼收發(fā)端，在實(shí)際應(yīng)用中具有很高的價(jià)值。目前，LDPC碼正向著非規(guī)則、自適應(yīng)、信源信道及調(diào)制聯(lián)合編碼方向發(fā)展。跨層聯(lián)合編碼的構(gòu)造方法，及其對(duì)應(yīng)的編碼算法，也必將成為信道編碼理論未來(lái)的研究重點(diǎn)。

標(biāo)簽： LDPC FPGA 吞吐量編碼

上傳時(shí)間： 2013-07-26

上傳用戶：qoovoop
Android應(yīng)用架構(gòu)原理與程式設(shè)計(jì)36計(jì)

·目錄第一篇良弓之子，必學(xué)為箕(框架) ~禮記.學(xué)記~第 1 章認(rèn)識應(yīng)用框架, 141.1 何謂應(yīng)用框架1.2 框架的起源1.3 框架的分層1.4 框架的「無(wú)用之用」效果1.5 框架與OS 之關(guān)係：常見的迷思第 2 章應(yīng)用框架魅力的泉源：反向溝通, 312.1 前言2.2 認(rèn)識反向溝通2.3 主

標(biāo)簽： Android 架構(gòu) 程式設(shè)計(jì)

上傳時(shí)間： 2013-05-23

上傳用戶：181992417
WinCE平臺(tái)上的語(yǔ)音識(shí)別程序

·詳細(xì)說(shuō)明：wince平臺(tái)上的語(yǔ)音識(shí)別程序，基于evc++ 4.0。文件列表: pocketsphinx-0.3 ................\aclocal.m4 ................\autogen.sh ................\ChangeLog ................\config.gu

標(biāo)簽： WinCE 語(yǔ)音識(shí)別程序

上傳時(shí)間： 2013-07-06

上傳用戶：小草123
用PROTEL DXP電路板設(shè)計(jì)的一般原則

新手指導(dǎo)\r\n--用PROTEL DXP電路板設(shè)計(jì)的一般原則\r\n電路板設(shè)計(jì)的一般原則包括：電路板的選用、電路板尺寸、元件布局、布線、焊盤、填充、跨接線等。\r\n

標(biāo)簽： PROTEL DXP 電路板設(shè)計(jì)

上傳時(shí)間： 2013-09-11

上傳用戶：jyycc
Allegro SPB V15.2 版新增功能

15.2 已經(jīng)加入了有關(guān)貫孔及銲點(diǎn)的Z軸延遲計(jì)算功能. 先開(kāi)啟 Setup - Constraints - Electrical constraint sets 下的 DRC 選項(xiàng). 點(diǎn)選 Electrical Constraints dialog box 下 Options 頁(yè)面勾選 Z-Axis delay欄.

標(biāo)簽： Allegro 15.2 SPB

上傳時(shí)間： 2013-10-08

上傳用戶：王慶才
機(jī)翼極限環(huán)振蕩仿真與計(jì)算

機(jī)翼極限環(huán)振蕩（LCO）是典型的非線性氣動(dòng)彈性問(wèn)題，嚴(yán)重的會(huì)造成機(jī)翼的結(jié)構(gòu)破壞。為了精確捕捉極限環(huán)振蕩初始臨界點(diǎn)，準(zhǔn)確預(yù)測(cè)極限環(huán)的幅值，為機(jī)翼的設(shè)計(jì)提供準(zhǔn)確的數(shù)據(jù)參考，本文綜合考慮了氣動(dòng)與結(jié)構(gòu)非線性的影響，提出了一種松耦合氣動(dòng)彈性仿真方法。在子迭代過(guò)程中分別采用LUSGS雙時(shí)間推進(jìn)和多步推進(jìn)法交替求解氣動(dòng)和結(jié)構(gòu)動(dòng)力學(xué)方程；一種高效的插值技術(shù)應(yīng)用于耦合界面數(shù)據(jù)的映射與傳遞；采用精確動(dòng)網(wǎng)格技術(shù)模擬氣體的非定常流動(dòng)。對(duì)標(biāo)準(zhǔn)模型切尖三角翼的跨音速極限環(huán)振蕩的計(jì)算與分析，表明相比同類仿真方法，通過(guò)此方法得到結(jié)果與實(shí)驗(yàn)值吻合更好；證明了結(jié)構(gòu)幾何非線性與氣動(dòng)非線性是誘發(fā)LCO的重要原因。耦合仿真方法保真度高，能為強(qiáng)非線性結(jié)構(gòu)的強(qiáng)度設(shè)計(jì)提供重要依據(jù)。

標(biāo)簽： 極限環(huán) 振蕩仿真計(jì)算

上傳時(shí)間： 2013-10-22

上傳用戶：m62383408
基于新型CCCII的電流模式積分電路

介紹了廣泛應(yīng)用于各種電流模式電路的第二代電流控制電流傳輸器原件的跨導(dǎo)線性環(huán)特性和端口特性，以及其基本組成共源共柵電流鏡，并提出了基于共源共柵電流鏡的新型COMS電流傳輸器。在此基礎(chǔ)上，設(shè)計(jì)了基于電流控制電流傳輸器的電流模式積分電路，并利用Hspice軟件進(jìn)行輸入為正弦波和方波時(shí)的輸出波形的仿真驗(yàn)證。

標(biāo)簽： CCCII 電流模式積分電路

上傳時(shí)間： 2013-10-22

上傳用戶：wtrl