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路徑尋優(yōu)(yōu)

  • U盤IC1114的電路圖和C語言源程序

    U盤IC1114的電路圖和C語言源程序

    標簽: 1114 IC U盤 C語言

    上傳時間: 2013-12-17

    上傳用戶:hanli8870

  • 基于Proteus的單片機出租車計價器的設計

    隨著單片機性能不斷提高而價格卻不斷下降, 單片機控制在越來越多的領域得以應用。按照傳統(tǒng)的模式, 在整個項目開發(fā)過程中, 先根據控制系統(tǒng)要求設計原理圖, PCB 電路圖繪制, 電路板制作, 元器件的焊接, 然后進行軟件編程, 通過仿真器對系統(tǒng)硬件和軟件調試, 最后將調試成功的程序固化到單片機中。這一過程中的主要問題是, 應用程序需要在硬件完成的情況下才能進行調試。雖然有的軟件可以進行模擬調試, 但是對于一些復雜的程序如人機交互程序, 在沒有硬件的時候, 沒有界面的真實感, 給調試帶來困難。在軟硬件的配合中如需要修改硬件, 要重新制板, 在時間和投入上帶來很大的麻煩。縱觀整個過程, 無論是從硬件成本上, 還是從調試周期上, 傳統(tǒng)開發(fā)模式的效率有待提高。能否只使用一種開發(fā)工具兼顧仿真, 調試, 制板, 以及最大限度的軟件模擬來作為單片機的開發(fā)平臺, 用它取代編程器、仿真器、成品前的硬件測試等工作是廣大單片機開發(fā)者的夢想。 PROTEUS 軟件介紹為了更加直觀具體地說明Proteus 軟件的實用價值, 本文以一具體的TAXI 的計價器和計時器電路板的設計過程為例。其電路板要實現的功能是:㈠計時功能(相當于時鐘);㈡里程計價功能:兩公里以內價格為4 元, 以后每一公里加0.7 元, 不足一公里取整(如10.3 公里取11 公里);㈢通過鍵盤輸入里程, 模擬計算里程費, 實現Y= (X- 2)*0.7+4 的簡單計算。基于上述功能, 選用ATMEL 公司生產的通用芯片AT89C51 單片機構成應用系統(tǒng)。AT89C51 是內含8 位4K 程序存儲器, 128B 數據存儲器, 2 個定時器/計數器的通用芯片。系統(tǒng)開發(fā)環(huán)境采用ProteusISIS 6。2.1 計價器模擬系統(tǒng)硬件構成系統(tǒng)主要由一個AT89C51 單片機、74LS373、74LS240、矩陣鍵盤、4 位7 段數碼管等組成。通用AT89C51 單片機芯片作為整個電路的核心部分、74LS373 作為LED 段選控制、74LS240四路反相器則為4 位共陰極7 段數碼管提供位選通信號、矩陣鍵盤輸入控制信號。

    標簽: Proteus 單片機 出租車計價器

    上傳時間: 2013-11-09

    上傳用戶:木子葉1

  • 51單片機讀寫u盤(含源程序和原理圖)

    附件有51單片機加上sl811讀寫U盤的源程序和原理圖 /*--------------------------------------------------------------------------AT89X52.H Header file for the low voltage Flash Atmel AT89C52 and AT89LV52.Copyright (c) 1995-1996 Keil Software, Inc.  All rights reserved.--------------------------------------------------------------------------*/ #ifndef AT89X52_HEADER_FILE#define AT89X52_HEADER_FILE 1 /*------------------------------------------------Byte Registers------------------------------------------------*/sfr P0      = 0x80;sfr SP      = 0x81;sfr DPL     = 0x82;sfr DPH     = 0x83;sfr PCON    = 0x87;sfr TCON    = 0x88;sfr TMOD    = 0x89;sfr TL0     = 0x8A;sfr TL1     = 0x8B;sfr TH0     = 0x8C;sfr TH1     = 0x8D;sfr P1      = 0x90;sfr SCON    = 0x98;sfr SBUF    = 0x99;sfr P2      = 0xA0;sfr IE      = 0xA8;sfr P3      = 0xB0;sfr IP      = 0xB8;sfr T2CON   = 0xC8;sfr T2MOD   = 0xC9;sfr RCAP2L  = 0xCA;sfr RCAP2H  = 0xCB;sfr TL2     = 0xCC;sfr TH2     = 0xCD;sfr PSW     = 0xD0;sfr ACC     = 0xE0;sfr B       = 0xF0;

    標簽: 51單片機 讀寫 源程序 原理圖

    上傳時間: 2014-01-05

    上傳用戶:lnnn30

  • FPGA與ARM EPI通信,控制16路步進電機和12路DC馬達 VHDL編寫的

    FPGA與ARM EPI通信,控制16路步進電機和12路DC馬達 VHDL編寫的,,,,,

    標簽: FPGA VHDL ARM EPI

    上傳時間: 2013-10-21

    上傳用戶:zhyfjj

  • 基于FPGA的無人機多路視頻監(jiān)控系統(tǒng)設計

    為了能實時監(jiān)控無人機的狀態(tài)和提高無人機的安全可靠性,本設計利用FPGA高速率、豐富的片上資源和靈活的設計接口,設計了一套無人機多路監(jiān)控系統(tǒng)。該監(jiān)控系統(tǒng)具備了將處于無人機不同位置的攝像機所采集的視頻信息,傳送給地面站控制設備,并在同一臺顯示器上實現同步顯示的功能。仿真結果表明,該系統(tǒng)可以很好的保證監(jiān)控視頻的實時性、和高清度,確保無人機完成偵查任務。

    標簽: FPGA 無人機 多路 視頻監(jiān)控

    上傳時間: 2013-10-22

    上傳用戶:cxl274287265

  • 基于FPGA的多路視頻合成系統(tǒng)的設計

      摘 要:研究一種基于FPGA的多路視頻合成系統(tǒng)。系統(tǒng)接收16路ITU656格式的視頻數據,按照畫面分割的要求對視頻數據流進行有效抽取和幀合成處理,經過視頻編碼芯片轉換成模擬信號輸出到顯示器,以全屏或多窗口模式顯示多路視頻畫面。系統(tǒng)利用FPGA的高速并行處理能力的優(yōu)勢,應用靈活的的多路視頻信號的合成技術和數字圖像處理算法,實現實時處理多路視頻數據。

    標簽: FPGA 多路 視頻合成

    上傳時間: 2014-12-05

    上傳用戶:jiangfire

  • 基于FPGA的多功能多路舵機控制器的實現

    伺服舵機作為基本的輸出執(zhí)行機構廣泛應用于 遙控航模以及人形機器人的控制中。舵機是一種位 置伺服的驅動器,其控制信號是PWM信號.,利 用占空比的變化改變舵機的位置,也可使用FPGA、 模擬電路、單片機來產生舵機的控制信號舊。應 用模擬電路產生PWM信號,應用的元器件較多, 會增加電路的復雜程度;若用單片機產生PWM信 號,當信號路數較少時單片機能滿足要求,但當 PWM信號多于4路時,由于單片機指令是順序執(zhí) 行的,會產生較大的延遲,從而使PWM信號波形 不穩(wěn),導致舵機發(fā)生顫振。

    標簽: FPGA 多功能 多路 舵機

    上傳時間: 2014-12-28

    上傳用戶:ainimao

  • 七天玩轉Altera:學習FPGA必經之路

             七天玩轉Altera:學習FPGA必經之路包括基礎篇、時序篇和驗證篇三個部分。

    標簽: Altera FPGA

    上傳時間: 2013-10-11

    上傳用戶:woshinimiaoye

  • 采用FPGA的多路高壓IGBT驅動觸發(fā)器研制

    為有效控制固態(tài)功率調制設備,提高系統(tǒng)的可調性和穩(wěn)定性,介紹了一種基于現場可編程門陣列( FPGA)和微控制器(MCU) 的多路高壓IGBT 驅動觸發(fā)器的設計方法和實現電路。該觸發(fā)器可選擇內或外觸發(fā)信號,可遙控或本控,能產生多路頻率、寬度和延時獨立可調的脈沖信號,信號的輸入輸出和傳輸都使用光纖。將該觸發(fā)器用于高壓IGBT(3300 V/ 800 A) 感應疊加脈沖發(fā)生器中進行實驗測試,給出了實驗波形。結果表明,該多路高壓IGBT驅動觸發(fā)器輸出脈沖信號達到了較高的調整精度,頻寬’脈寬及延時可分別以步進1 Hz、0. 1μs、0. 1μs 進行調整,滿足了脈沖發(fā)生器的要求,提高了脈沖功率調制系統(tǒng)的性能。

    標簽: FPGA IGBT 多路 驅動

    上傳時間: 2013-10-22

    上傳用戶:zhulei420

  • 基于FPGA的多路高速串并轉換器設計

    高速串并轉換器的設計是FPGA 設計的一個重要方面,傳統(tǒng)設計方法由于采用FPGA 的內部邏輯資源來實現,從而限制了串并轉換的速度。該研究以網絡交換調度系統(tǒng)的FGPA 驗證平臺中多路高速串并轉換器的設計為例,詳細闡述了1 :8DDR 模式下高速串并轉換器的設計方法和16 路1 :8 串并轉換器的實現。結果表明,采用Xilinx Virtex24 的ISERDES 設計的多路串并轉換器可以實現800 Mbit/ s 輸入信號的串并轉換,并且減少了設計復雜度,縮短了開發(fā)周期,能滿足設計要求。關鍵詞:串并轉換;現場可編程邏輯陣列;Xilinx ; ISERDES

    標簽: FPGA 多路 串并轉換

    上傳時間: 2013-11-03

    上傳用戶:王小奇

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