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通用串行總線

串行外設接口SPI的應用

串行外設接口SPI的應用，及通過SPI方式連接外設的通用方式!

標簽： SPI 串行外設接口

上傳時間： 2016-04-20

上傳用戶：zhichenglu
DSP2407 I2C接口的串行EEPROM操作程序代碼。c語言

DSP2407 I2C接口的串行EEPROM操作程序代碼。c語言，可以通用

標簽： EEPROM 2407 DSP I2C

上傳時間： 2013-12-24

上傳用戶：watch100
TLC548和TLC549是以8位開關電容逐次逼近A/D轉換器為基礎而構造的CMOS A/D轉換器。它們設計成能通過3態數據輸出和模擬輸入與微處理器或外圍設備串行接口。TLC548和TLC549僅

TLC548和TLC549是以8位開關電容逐次逼近A/D轉換器為基礎而構造的CMOS A/D轉換器。它們設計成能通過3態數據輸出和模擬輸入與微處理器或外圍設備串行接口。TLC548和TLC549僅用輸入/輸出時鐘（I/O CLOCK）和芯片選擇（CS）輸入作數據控制。TLC548的最高I/O CLOCK輸入頻率為2.048MHz，而TLC549的I/O CLOCK輸入頻率最高可達1.1MHz。有關與大多數通用微處理器接口的詳細資料已由工廠準備好，可供使用。

標簽： TLC 548 549 CMOS

上傳時間： 2013-11-28

上傳用戶：aig85
c8051f系列單片機的SPI 并行/串行通信源程序 Cygnal出的一種混合信號系統級單片機。片內含CIP－51的CPU內核

c8051f系列單片機的SPI 并行/串行通信源程序 Cygnal出的一種混合信號系統級單片機。片內含CIP－51的CPU內核，它的指令系統與MCS－51完全兼容。其中的C8051F020單片機含有64kB片內Flash程序存儲器，4352B的RAM、8個I／O端口共64根I／O口線、一個12位A／D轉換器和一個8位A／D轉換器以及一個雙12位D／A轉換器、2個比較器、5個16位通用定時器、5個捕捉／比較模塊的可編程計數／定時器陣列、看門狗定時器、VDD監視器和溫度傳感器等部分。C8051F020單片機支持雙時鐘，其工作電壓范圍為2．7～3．6V（端口I/O,RST和JTAG引腳的耐壓為5V）。與以前的51系列單片機相比，C8051F020增添了許多功能，同時其可靠性和速度也有了很大提高。

標簽： c8051f Cygnal SPI CIP

上傳時間： 2013-12-24

上傳用戶：Thuan
用VB實現上位機與OMRONPLC串行通訊

摘要：隨著工業自動化的發展，PLC與計算機在工業中的應用越來越廣泛，為了充分發揮它們的各自優越性，PIC與個人計算機間的通訊越來越頻繁。本文以QMRON小型PLC CPIH為例，介紹了如何用vB編程軟件實現上位機和PLC的串行通訊。該方案具有硬件簡單，使用靈活的特點。對中小型控制系統實現人機界面有一定的參考價值。關健詞：Visual Basic 6.0；可編程控制器；串行通訊隨著工業控制要求的不斷發展，上位機監控已基本成為集散控制系統所不可缺少的部分。一般情況下，在大型的集散控制系統中都是用專業工控組態軟件制作上位機的監控界面，而以PLC廠家所推薦的DDE SERVER作為聯系上位機和PLC的橋梁。操作員站采用工控組態軟件實現畫面監控。由于這種方案成本較高，所以在很多小型的集散控制系統中，趨向于采用通用工程軟件，如DELPHI，VISUAL BASIC，VISUAL C++等編制上位機監控界面。同時，在一些實時性要求較高的監控應用中，用VISUALBASIC等工具可實現更底層的控制，在硬件配置相同時系統響應比工控組態軟件要快。

標簽： vb 上位機 omronplc 通訊

上傳時間： 2022-06-26

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基于USB的串行通信軟硬件設計

基于USB的串行通信軟硬件設計

標簽： USB 串行通信軟硬件設計

上傳時間： 2013-08-04

上傳用戶：eeworm
基于USB的串行通信軟硬件設計-41頁-0.8M.pdf

專輯類-數字處理及顯示技術專輯-106冊-9138M 基于USB的串行通信軟硬件設計-41頁-0.8M.pdf

標簽： USB 0.8 41

上傳時間： 2013-07-19

上傳用戶：yatouzi118
基于FPGA的高速串行接口模塊仿真設計.rar

現代社會信息量爆炸式增長，由于網絡、多媒體等新技術的發展，用戶對帶寬和速度的需求快速增加。并行傳輸技術由于時鐘抖動和偏移，以及PCB布線的困難，使得傳輸速率的進一步提升面臨設計的極限；而高速串行通信技術憑借其帶寬大、抗干擾性強和接口簡單等優勢，正迅速取代傳統的并行技術，成為業界的主流。本論文針對目前比較流行并且有很大發展潛力的兩種高速串行接口電路——高速鏈路口和Rocket I/O進行研究，并以Xilinx公司最新款的Virtex-5 FPGA為研究平臺進行仿真設計。本論文的主要工作是以某低成本相控陣雷達信號處理機為設計平臺，在其中的一塊信號處理板上，進行了基于LVDS(Low VoltageDifferential Signal)技術的高速LinkPort(鏈路口)設計和基于CML(Current ModeLogic)技術的Rocket I/O高速串行接口設計。首先在FPGA的軟件中進行程序設計和功能、時序的仿真，當仿真驗證通過之后，重點是在硬件平臺上進行調試。硬件調試驗證的方法是將DSP TS201的鏈路口功能與在FPGA中的模擬高速鏈路口相連接，進行數據的互相傳送，接收和發送的數據相同，證明了高速鏈路口設計的正確性。并且在硬件調試時對Rocket IO GTP收發器進行回環設計，經過回環之后接收到的數據與發送的數據相同，證明了Rocket I/O高速串行接口設計的正確性。

標簽： FPGA 高速串行接口模塊

上傳時間： 2013-04-24

上傳用戶：戀天使569
基于FPGA的SCI串行通信接口的研究與實現.rar

國家863項目“飛行控制計算機系統FC通信卡研制”的任務是研究設計符合CPCI總線標準的FC通信卡。本課題是這個項目的進一步引伸，用于設計SCI串行通信接口，以實現環上多計算機系統間的高速串行通信。本文以此項目為背景，對基于FPGA的SCI串行通信接口進行研究與實現。論文先概述SCI協議，接著對SCI串行通信接口的兩個模塊：SCI節點模型模塊和CPCI總線接口模塊的功能和實現進行了詳細的論述。 SCI節模型包含Aurora收發模塊、中斷進程、旁路FIFO、接受和發送存儲器、地址解碼、MUX。在SCI節點模型的實現上，利用FPGA內嵌的RocketIO高速串行收發器實現主機之間的高速串行通信，并利用Aurora IP核實現了Aurora鏈路層協議；設計一個同步FIFO實現旁路FIFO；利用FPGA上的塊RAM實現發送和接收存儲器；中斷進程、地址解碼和多路復合分別在控制邏輯中實現。 CPCI總線接口包括PCI核、PCI核的配置模塊以及用戶邏輯三個部分。本課題中，采用FPGA+PCI軟核的方法來實現CPCI總線接口。PCI核作為PCI總線與用戶邏輯之間的橋梁：PCI核的配置模塊負責對PCI核進行配置，得到用戶需要的PCI核；用戶邏輯模塊負責實現整個通信接口具體的內部邏輯功能；并引入中斷機制來提高SCI通信接口與主機之間數據交換的速率。設計選用硬件描述語言VerilogHDL和VHDL，在開發工具Xilinx ISE7.1中完成整個系統的設計、綜合、布局布線，利用Modelsim進行功能及時序仿真，使用DriverWorks為SCI串行通信接口編寫WinXP下的驅動程序，用VC++6.0編寫相應的測試應用程序。最后，將FPGA設計下載到FC通信卡中運行，并利用ISE內嵌的ChipScope Pro虛擬邏輯分析儀對設計進行驗證，運行結果正常。文章最后分析傳輸性能上的原因，指出工作中的不足之處和需要進一步完善的地方。

標簽： FPGA SCI 串行通信接口

上傳時間： 2013-04-24

上傳用戶：竺羽翎2222
基于FPGAHDL的隨機讀寫I2C串行總線接口電路設計.rar

I2C(Inter Integrated Circuits)是Philips公司開發的用于芯片之間連接的串行總線，以其嚴格的規范、卓越的性能、簡便的操作和眾多帶I2C接口的外圍器件而得到廣泛的應用并受到普遍的歡迎。現場可編程門陣列(FPGA)設計靈活、速度快，在數字專用集成電路的設計中得到了廣泛的應用。本論文主要討論了如何利用Verilog/FPGA來實現一個隨機讀/寫的I2C接口電路，實現與外圍I2C接口器件E2PROM進行數據通信，實現讀、寫等功能，傳輸速率實現為100KBps。在Modelsim6.0仿真軟件環境中進行仿真，在Xilinx公司的ISE9.li開發平臺上進行了下載，搭建外圍電路，用Agilem邏輯分析儀進行數據采集，分析測試結果。首先，介紹了微電子設計的發展概況以及設計流程，重點介紹了HDL/FPGA的設計流程。其次，對I2C串行總線進行了介紹，重點說明了總線上的數據傳輸格式并對所使用的AT24C02 E2PROM存儲器的讀／寫時序作了介紹。第三，基于Verilog _HDL設計了隨機讀/寫的I2C接口電路、測試模塊和顯示電路；接口電路由同步有限狀態機(FSM)來實現；測試模塊首先將數據寫入到AT24C02的指定地址，接著將寫入的數據讀出，并將兩個數據顯示在外圍LED數碼管和發光二極管上，從而直觀地比較寫入和輸出的數據的正確性。FPGA下載芯片為Xilinx SPARTAN Ⅲ XC3S200。第四，用Agilent邏輯分析儀進行傳輸數據的采集，分析數據傳輸的時序，從而驗證電路設計的正確性。最后，論文對所取得的研究成果進行了總結，并展望了下一步的工作。

標簽： FPGAHDL I2C 隨機

上傳時間： 2013-06-27

上傳用戶：liuchee