多數大小排列 可輸入多組數字 進行大小排序 為初學者迴圈應用的進階題
標簽： 排序
上傳時間： 2013-12-26
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使用DM642 來進行scaling 有說明檔
上傳時間： 2014-01-24
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bsxfun, 一個matlab中十分常用的函數. 可以快速地對matrix進行接位複合運算~~
上傳時間： 2013-12-20
上傳用戶：ywqaxiwang
這個章節將詳細介紹Windows CE 系統中的處理程序 (process) 和執行緒 (thread)，並對Windows CE作業系統所使用的排程策略進行分析。處理程序是資源分配的基本單位，而執行緒是排程的基本單位。
上傳時間： 2015-07-01
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步進馬達控制器的編程方法，可控制步進馬達進行正轉反轉等操作
標簽： 控制器
上傳時間： 2013-12-26
上傳用戶：lingzhichao
基于USB的串行通信軟硬件設計
上傳時間： 2013-08-04
上傳用戶：eeworm
《三百六十行大觀》(名家繪圖本·中國傳統行業圖集)[沈寂主編][上海畫報版.1997][PDF]
上傳時間： 2013-08-04
上傳用戶：eeworm
專輯類-數字處理及顯示技術專輯-106冊-9138M 基于USB的串行通信軟硬件設計-41頁-0.8M.pdf
上傳時間： 2013-07-19
上傳用戶：yatouzi118
超聲波電機(Ultrasonic Motor簡稱USM)是八十年代發展起來的新型微電機。本文針對超聲波電機及其控制技術的研究現狀和發展趨勢,以我國研究技術相對比較成熟并有產業化前景的行波超聲波電機(Traveling-wave Ultrasonic Motor簡稱TUSM)的伺服控制技術為研究對象,以直徑60mm的行波超聲波電機TUSM60為研究實例,在特性測試、動穩態性能分析,辨識模型建立、控制策略與控制算法的選擇與實現等方面展開研究。本論具體的研究內容為： 在分析超聲波電機研究歷史和現狀的基礎上,結合國內外超聲波電機特別是行波超聲波電機控制技術的發展趨勢,重點論述了行波超聲波電機及其驅動控制技術的研究進展。 介紹行波超聲波電機的基本結構,并從該電機的主要理論基礎--壓電原理、行波合成、接觸模型出發,分析了行波超聲波電機定子質點的運動方程.并結合定轉子摩擦接觸特點,分析了行波超聲波電機的運行機理。 根據對行波超聲波電機測試和高精度控制的要求,研制出基于雙DSP和FPGA的超聲波電機高性能測試控制平臺。其中控制核心采用了雙DSP結構,可以在對行波超聲波電機進行控制的同時,將必要的參數讀取出來進行分析和研究。為行波超聲波電機瞬態特性分析以及控制策略、控制算法的深入研究打下了基礎。 對電機的瞬態、穩態特性進行的測試,可以分析驅動頻率、電壓以及相位差等調節量對電機輸出的影響。在此基礎上進一步對行波超聲波電機的調節方式、控制算法選擇方面進行分析,并得到相應結論。 通過對實驗數據的總結和歸納,利用系統辨識中的非參數方法,建立在特定頻率條件下的近似線性模型。在行波超聲波電機工作范圍內,辨識若干組不同頻率條件下的近似線性模型,將這些模型的參數進行二維或三維擬合,可以得到一個關于行波超聲波電機傳遞函數的模型。辨識模型的建立為合理的選擇和優化控制參數,控制效果的驗證等提供了行之有效的手段。 在對行波超聲波電機的速度控制、位置控制展開的研究中.首先利用遺傳算法對常規PI恒轉速控制的控制參數整定及修正方法進行了研究；利用神經元的在線自學習能力,研究和設計單神經元PID-PI轉速控制器,提高控制系統對電機非線性和時變性的適應能力；為了消除在伺服控制中,單一調節量(驅動頻率)情況下,低轉速的跳躍問題,研究和討論了多調節量分段控制方法,并利用模糊控制對控制方法的有效性進行了驗證；在位置控制中,利用轉速控制研究的結果,研究和設計了位置--速度雙環(串級)控制器,實現了電機高精度位置伺服控制。 通過對已有控制系統的改進和簡化,設計和研制了具有實用化價值行波超聲波電機控制器：并將研究成果應用于針對核磁成像設備而設計的行波超聲波電機隨動控制系統中,同時嘗試了將該控制器用于高精度X-Y兩維定位平臺。
上傳時間： 2013-07-13
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現代社會信息量爆炸式增長，由于網絡、多媒體等新技術的發展，用戶對帶寬和速度的需求快速增加。并行傳輸技術由于時鐘抖動和偏移，以及PCB布線的困難，使得傳輸速率的進一步提升面臨設計的極限；而高速串行通信技術憑借其帶寬大、抗干擾性強和接口簡單等優勢，正迅速取代傳統的并行技術，成為業界的主流。 本論文針對目前比較流行并且有很大發展潛力的兩種高速串行接口電路——高速鏈路口和Rocket I/O進行研究，并以Xilinx公司最新款的Virtex-5 FPGA為研究平臺進行仿真設計。本論文的主要工作是以某低成本相控陣雷達信號處理機為設計平臺，在其中的一塊信號處理板上，進行了基于LVDS(Low VoltageDifferential Signal)技術的高速LinkPort(鏈路口)設計和基于CML(Current ModeLogic)技術的Rocket I/O高速串行接口設計。首先在FPGA的軟件中進行程序設計和功能、時序的仿真，當仿真驗證通過之后，重點是在硬件平臺上進行調試。硬件調試驗證的方法是將DSP TS201的鏈路口功能與在FPGA中的模擬高速鏈路口相連接，進行數據的互相傳送，接收和發送的數據相同，證明了高速鏈路口設計的正確性。并且在硬件調試時對Rocket IO GTP收發器進行回環設計，經過回環之后接收到的數據與發送的數據相同，證明了Rocket I/O高速串行接口設計的正確性。
上傳時間： 2013-04-24
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