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鎖相環(huán)(huán)

  • 單相,三相逆變器工作原理及控制

    直流變單相交流,三相三線制交流,三相四線制交流,很給力

    標(biāo)簽: 單相 三相逆變器 工作原理 控制

    上傳時間: 2013-11-03

    上傳用戶:qijian11056

  • 新型四相SR電機功率變換器的分析與設(shè)計

    功率變換器是開關(guān)磁阻電動機調(diào)速系統(tǒng)(SRD)中的重要組成部分,現(xiàn)有的各種功率變換器大都有這樣或那樣的問題與不足,關(guān)鍵是不能保證較好的性能價格比。本文通過對兩種常用的四相開關(guān)磁阻電動機(SR)功率變換器主電路進行分析,優(yōu)化、綜合常用的主電路,給出了目前最優(yōu)的四相SR電機功率變換器主電路型式——最少主開關(guān)型,提高了經(jīng)濟性和實用性。結(jié)合作者的研制實踐,又給出了5.5KW 的SR電機新型功率變換器的實際電路、主要器件及其定額的選擇。通過實驗成功地應(yīng)用此方案,基于降低SR電機轉(zhuǎn)矩波動的有效手段,同時實現(xiàn)電機實時雙相繞組通電穩(wěn)定運行。關(guān)鍵詞:開關(guān)磁阻電動機;功率變換器;最少主開關(guān);繞組雙相運行

    標(biāo)簽: 電機功率 變換器

    上傳時間: 2013-10-08

    上傳用戶:jdm439922924

  • K60_Flash_Noika5110_超聲波測距_AB相正交解碼測速

    K60_Flash_Noika5110_超聲波測距_AB相正交解碼測速

    標(biāo)簽: Flash_Noika 5110 60 AB

    上傳時間: 2014-12-29

    上傳用戶:windwolf2000

  • 一種陣列天線幅相誤差校正方法設(shè)計

    陣列信號處理是當(dāng)前信號處理的熱門方向,為信號處理帶來極大的方便,陣列信號處理中的各通道不一致問題將會給陣列信號處理帶來影響,很多文獻中介紹過關(guān)于自適應(yīng)幅相誤差校正的理論及方法,但實現(xiàn)起來都比較耗費資源和時間,且效果有待實踐驗證。提出一種工程上可實現(xiàn)且計算量較小的通道校正方法-查表法。通過仿真,結(jié)果表明此方法可以對特定來向的有用信號進行較為準(zhǔn)確的校正。

    標(biāo)簽: 陣列天線 幅相誤差 校正

    上傳時間: 2014-01-12

    上傳用戶:fxf126@126.com

  • 一種新型高功率微波相移器

    !!研究了一種新型高功率微波相移器%%%同軸插板式相移器!其設(shè)計思想為&在同軸波導(dǎo)內(nèi)插入金屬導(dǎo)體板!將同軸波導(dǎo)分為幾個扇形截面波導(dǎo)!由于扇形截面波導(dǎo)中傳輸?shù)?2!!模相速度與同軸82; 模的相速度不同!通過改變插入金屬板的長度就可以實現(xiàn)相移的調(diào)節(jié).

    標(biāo)簽: 高功率 相移器

    上傳時間: 2013-10-29

    上傳用戶:banlangen

  • 單相逆變器光伏仿真程序--原文資料

    單相逆變器光伏仿真程序

    標(biāo)簽: 單相逆變器 光伏 仿真程序

    上傳時間: 2013-11-20

    上傳用戶:362279997

  • 編碼器倍頻、鑒相電路在FPGA中的實現(xiàn)

    編碼器倍頻、鑒相電路在FPGA中的實現(xiàn)

    標(biāo)簽: FPGA 編碼器 倍頻 中的實現(xiàn)

    上傳時間: 2013-10-27

    上傳用戶:royzhangsz

  • CPLD器件在兩相混合式步進電動機驅(qū)動器中的應(yīng)用

    文章詳細(xì)介紹了一種以Xilinx 公司生產(chǎn)的CPLD 器件XC9536 為核心來產(chǎn)生電機繞組參考電流, 進而實現(xiàn)具有繞組電流補償功能的兩相混合式步進電動機10 細(xì)分和50 細(xì)分運行方式的方法。實踐證明, 該方法可以有效地提高兩相混合式步進電動機系統(tǒng)的運行效果。

    標(biāo)簽: CPLD 器件 中的應(yīng)用 步進電動

    上傳時間: 2013-11-16

    上傳用戶:trepb001

  • 基于FPGA的數(shù)字三相鎖相環(huán)的優(yōu)化設(shè)計

    數(shù)字三相鎖相環(huán)中含有大量乘法運算和三角函數(shù)運算,占用大量的硬件邏輯資源。為此,提出一種數(shù)字三相鎖相環(huán)的優(yōu)化實現(xiàn)方案,利用乘法模塊復(fù)用和CORDIC算法實現(xiàn)三角函數(shù)運算,并用Verilog HDL硬件描述語言對優(yōu)化前后的算法進行了編碼實現(xiàn)。仿真和實驗結(jié)果表明,優(yōu)化后的數(shù)字三相鎖相環(huán)大大節(jié)省了FPGA的資源,并能快速、準(zhǔn)確地鎖定相位,具有良好的性能。

    標(biāo)簽: FPGA 數(shù)字 三相 優(yōu)化設(shè)計

    上傳時間: 2013-10-22

    上傳用戶:emhx1990

  • 基于FPGA的全數(shù)字鎖相環(huán)路的設(shè)計

    介紹了應(yīng)用VHDL技術(shù)設(shè)計嵌入式全數(shù)字鎖相環(huán)路的方法。詳細(xì)描述了其工作原理和設(shè)計思想,并用可編程邏輯器件FPGA加以實面。

    標(biāo)簽: FPGA 全數(shù)字 鎖相環(huán)路

    上傳時間: 2013-10-20

    上傳用戶:yl8908

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