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鎖相環(huán)

基于AT89C2051單片機的無環流靜止進相器

介紹一種以AT89C51單片機為核心器件，采用晶閘管實現交一交變頻的無環流靜止進相器。論述了這種靜止進相器的硬件結構，I：作原理，補償方法。這種進相器進相補償效果明顯，具有很好的實用價值。

標簽： C2051 2051 89C AT

上傳時間： 2013-11-23

上傳用戶：leixinzhuo
基于DSP的單相Boost型數字PFC控制技術

為了減少電力電子裝置對電網引起的諧波污染,在變頻器接入電網之前加入PFC電路是一種趨勢。討論了基于TMS320LF2407的全數字控制的單相PFC電路的工作原理,并由此得到了主電路參數的選取原則;建立了單相Boost型數字PFC的小信號動態模型,并分析了基于該模型的數字控制設計方法,給出了設計軟件流程;最后搭建了一臺樣機,在實際電路中實現了數字控制的單相PFC,并得到了較好的實驗結果。

標簽： Boost DSP PFC 單相

上傳時間： 2014-12-28

上傳用戶：zhangyi99104144
編碼器倍頻、鑒相電路在FPGA中的實現

編碼器倍頻、鑒相電路在FPGA中的實現

標簽： FPGA 編碼器倍頻中的實現

上傳時間： 2013-11-08

上傳用戶：38553903210
CPLD器件在兩相混合式步進電動機驅動器中的應用

文章詳細介紹了一種以Xilinx 公司生產的CPLD 器件XC9536 為核心來產生電機繞組參考電流, 進而實現具有繞組電流補償功能的兩相混合式步進電動機10 細分和50 細分運行方式的方法。實踐證明, 該方法可以有效地提高兩相混合式步進電動機系統的運行效果。

標簽： CPLD 器件中的應用步進電動

上傳時間： 2013-11-15

上傳用戶：lnnn30
基于FPGA的數字三相鎖相環的優化設計

數字三相鎖相環中含有大量乘法運算和三角函數運算，占用大量的硬件邏輯資源。為此，提出一種數字三相鎖相環的優化實現方案，利用乘法模塊復用和CORDIC算法實現三角函數運算，并用Verilog HDL硬件描述語言對優化前后的算法進行了編碼實現。仿真和實驗結果表明，優化后的數字三相鎖相環大大節省了FPGA的資源，并能快速、準確地鎖定相位，具有良好的性能。

標簽： FPGA 數字三相優化設計

上傳時間： 2013-11-15

上傳用戶：yjj631
基于FPGA的全數字鎖相環路的設計

介紹了應用VHDL技術設計嵌入式全數字鎖相環路的方法。詳細描述了其工作原理和設計思想，并用可編程邏輯器件FPGA加以實面。

標簽： FPGA 全數字鎖相環路

上傳時間： 2014-12-28

上傳用戶：ruixue198909
毫米波低相噪捷變頻高分辨率雷達頻率源設計

設計了一種由直接數字頻率合成(DDS)、倍頻鏈構成的三次變頻直接頻率合成方案，實現了低相噪捷變頻高分辨率毫米波雷達頻率合成器設計。利用直接頻率合成器的倍頻輸出取代傳統三次變頻毫米波頻率源的鎖相環(PLL),同時提供線性調頻(LFM)信號，優化DDS和變頻方案的頻率配置關系。利用FPGA電路進行高速控制，較好地解決了毫米波頻率合成器各技術指標之間的矛盾。實測結果表明，采用該方案的毫米波頻率合成器在本振跳頻帶寬為160 MHz時，線性調頻頻率分辨率可達0.931 Hz，最大頻率轉換時間小于2 ?滋s，最大雜散低于-60 dBc，相位噪聲優于-90 dBc/Hz。

標簽： 毫米波捷變高分辨率雷達

上傳時間： 2014-01-06

上傳用戶：brain kung
ADF4159--ADI鎖相環原文資料

ADI鎖相環

標簽： 4159 ADF ADI 鎖相環

上傳時間： 2013-10-27

上傳用戶：zaizaibang
可編程FM鎖相發射機的實現

文中設計了一種可編程的FM鎖相發射機。利用Atmega8實現與計算機的串口通信，實現對鎖相環芯片和數字電位器的配置，達到改變輸出頻率和調制頻偏的目的。發射機輸出頻率覆蓋2 200~2 300 MHz，調制響應100 Hz~3.5 MHz，能夠滿足大部分FM體制遙測系統的需要。

標簽： 可編程發射機鎖相

上傳時間： 2013-10-23

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人工神經網絡在金相圖像分割中的應用研究

摘要：利用多層感知器神經網絡和自組織映射神經網絡對球墨鑄鐵、可鍛鑄鐵和灰鑄鐵的金相圖像進行了分割提取。通過對比以上兩種方法分割后的圖像質量和定量分析樣本圖像中的石墨結構、珍珠巖/鐵氧體結構所占的百分含量后發現，多層感知器網絡分割提取的結果與樣本實際的結果更加接近，而自組織映射神經網絡分割提取的結果則不夠理想。據此，可以推斷多層感知器網絡是實現金屬圖像分割自動化提取和精確性分析的有效工具。

標簽： 人工神經網絡中的應用圖像分割

上傳時間： 2014-12-29

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