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可重構FPGA通訊糾錯進化電路及其實現

ASIC對產品成本和靈活性有一定的要求.基于MCU方式的ASIC具有較高的靈活性和較低的成本,然而抗干擾性和可靠性相對較低,運算速度也受到限制.常規ASIC的硬件具有速度優勢和較高的可靠性及抗干擾能力,然而不是靈活性較差,就是成本較高.與傳統硬件(CHW)相比,具有一定可配置特性的場可編程門陣列(FPGA)的出現,使建立在可再配置硬件基礎上的進化硬件(EHW)成為智能硬件電路設計的一種新方法.作為進化算法和可編程器件技術相結合的產物,可重構FPGA的研究屬于EHW的研究范疇,是研究EHW的一種具體的實現方法.論文認為面向分類的專用類可重構FPGA(ASR-FPGA)的研究,可使可重構電路粒度劃分的針對性更強、設計更易實現.論文研究的可重構FPGA的BCH通訊糾錯碼進化電路是一類ASR-FPGA電路的具體方法,具有一定的實用價值.論文所做的工作主要包括:(1)BCH編譯碼電路的設計——求取實驗用BCH碼的生成多項式和校驗多項式及其相應的矩陣并構造實驗用BCH碼;(2)建立基于可重構FPGA的基核——構造具有可重構特性的硬件功能單元,以此作為可重構BCH碼電路的設計基礎;(3)構造實現可重構BCH糾錯碼電路的方法——建立可重構糾錯碼硬件電路算法并進行實驗驗證;(4)在可重構糾錯碼電路基礎上,構造進化硬件控制功能塊的結構,完成各進化RLA控制模塊的驗證和實現.課題是將可重構BCH碼的編譯碼電路的實現作為一類ASR-FPGA的研究目標,主要成果是根據可編程邏輯電路的特點,選擇一種可編程樹的電路模型,并將它作為可重構FPGA電路的基核T;通過對循環BCH糾錯碼的構造原理和電路結構的研究,將基核模型擴展為能滿足糾錯碼電路需要的糾錯碼基本功能單元T;以T作為再劃分的基本單元,對FPGA進行"格式化",使T規則排列在FPGA上,通過對T的控制端的不同配置來實現糾錯碼的各個功能單元;在可重構基核的基礎上提出了糾錯碼重構電路的嵌套式GA理論模型,將嵌套式GA的染色體串作為進化硬件描述語言,通過轉換為相應的VHDL語言描述以實現硬件電路;采用RLA模型的有限狀態機FSM方式實現了可重構糾錯碼電路的EHW的各個控制功能塊.在實驗方面,利用Xilinx FPGA開發系統中的VHDL語言和電路圖相結合的設計方法建立了循環糾錯碼基核單元的可重構模型,進行循環糾錯BCH碼的電路和功能仿真,在Xilinx公司的Virtex600E芯片進行了FPGA實現.課題在研究模型上選取的是比較基本的BCH糾錯碼電路,立足于解決基于可重構FPGA核的設計的基本問題.課題的研究成果及其總結的一套ASR-FPGA進化硬件電路的設計方法對實際的進化硬件設計具有一定的實際指導意義,提出的基于專用類基核FPGA電路結構的研究方法為新型進化硬件的器件結構的設計也可提供一種借鑒.

標簽： FPGA 可重構通訊糾錯

上傳時間： 2013-07-01

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四相升壓型轉換器提供348W功率而無需采用散熱器

在汽車、工業和電信行業的設計師當中，使用高功率升壓型轉換器的現像正變得越來越普遍。當需要 300W 或更高的功率時，必須在功率器件中實現高效率 (低功率損耗)，以免除增設龐大散熱器和采用強迫通風冷卻的需要

標簽： 348W 升壓型轉換器功率散熱器

上傳時間： 2014-12-01

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MSP430系列flash型超低功耗16位單片機

MSP430系列flash型超低功耗16位單片機MSP430系列單片機在超低功耗和功能集成等方面有明顯的特點。該系列單片機自問世以來，頗受用戶關注。在2000年該系列單片機又出現了幾個FLASH型的成員，它們除了仍然具備適合應用在自動信號采集系統、電池供電便攜式裝置、超長時間連續工作的設備等領域的特點外，更具有開發方便、可以現場編程等優點。這些技術特點正是應用工程師特別感興趣的。《MSP430系列FLASH型超低功耗16位單片機》對該系列單片機的FLASH型成員的原理、結構、內部各功能模塊及開發方法與工具作詳細介紹。MSP430系列FLASH型超低功耗16位單片機目錄第1章引論1.1 MSP430系列單片機1.2 MSP430F11x系列1.3 MSP430F11x1系列1.4 MSP430F13x系列1.5 MSP430F14x系列第2章結構概述2.1 引言2.2 CPU2.3 程序存儲器2.4 數據存儲器2.5 運行控制2.6 外圍模塊2.7 振蕩器與時鐘發生器第3章系統復位、中斷及工作模式3.1 系統復位和初始化3.1.1 引言3.1.2 系統復位后的設備初始化3.2 中斷系統結構3.3 MSP430 中斷優先級3.3.1 中斷操作--復位/NMI3.3.2 中斷操作--振蕩器失效控制3.4 中斷處理 3.4.1 SFR中的中斷控制位3.4.2 中斷向量地址3.4.3 外部中斷3.5 工作模式3.5.1 低功耗模式0、1（LPM0和LPM1）3.5.2 低功耗模式2、3（LPM2和LPM3）3.5.3 低功耗模式4（LPM4）22 3.6 低功耗應用的要點23第4章存儲空間4.1 引言4.2 存儲器中的數據4.3 片內ROM組織4.3.1 ROM 表的處理4.3.2 計算分支跳轉和子程序調用4.4 RAM 和外圍模塊組織4.4.1 RAM4.4.2 外圍模塊--地址定位4.4.3 外圍模塊--SFR4.5 FLASH存儲器4.5.1 FLASH存儲器的組織4.5.2 FALSH存儲器的數據結構4.5.3 FLASH存儲器的控制寄存器4.5.4 FLASH存儲器的安全鍵值與中斷4.5.5 經JTAG接口訪問FLASH存儲器39第5章 16位CPU5.1 CPU寄存器5.1.1 程序計數器PC5.1.2 系統堆棧指針SP5.1.3 狀態寄存器SR5.1.4 常數發生寄存器CG1和CG25.2 尋址模式5.2.1 寄存器模式5.2.2 變址模式5.2.3 符號模式5.2.4 絕對模式5.2.5 間接模式5.2.6 間接增量模式5.2.7 立即模式5.2.8 指令的時鐘周期與長度5.3 指令組概述5.3.1 雙操作數指令5.3.2 單操作數指令5.3.3 條件跳轉5.3.4 模擬指令的簡短格式5.3.5 其他指令第6章硬件乘法器6.1 硬件乘法器6.2 硬件乘法器操作6.2.1 無符號數相乘(16位×16位、16位×8位、8位×16位、8位×8位)6.2.2 有符號數相乘(16位×16位、16位×8位、8位×16位、8位×8位)6.2.3 無符號數乘加(16位×16位、16位×8位、8位×16位、8位×8位)6.2.4 有符號數乘加(16位×16位、16位×8位、8位×16位、8位×8位)6.3 硬件乘法器寄存器6.4 硬件乘法器的軟件限制6.4.1 尋址模式6.4.2 中斷程序6.4.3 MACS第7章基礎時鐘模塊7.1 基礎時鐘模塊7.2 LFXT1與XT27.2.1 LFXT1振蕩器7.2.2 XT2振蕩器7.2.3 振蕩器失效檢測7.2.4 XT振蕩器失效時的DCO7.3 DCO振蕩器7.3.1 DCO振蕩器的特性7.3.2 DCO調整器7.4 時鐘與運行模式7.4.1 由PUC啟動7.4.2 基礎時鐘調整7.4.3 用于低功耗的基礎時鐘特性7.4.4 選擇晶振產生MCLK7.4.5 時鐘信號的同步7.5 基礎時鐘模塊控制寄存器7.5.1 DCO時鐘頻率控制7.5.2 振蕩器與時鐘控制寄存器7.5.3 SFR控制位第8章輸入輸出端口8.1 引言8.2 端口P1、P28.2.1 P1、P2的控制寄存器8.2.2 P1、P2的原理8.2.3 P1、P2的中斷控制功能8.3 端口P3、P4、P5和P68.3.1 端口P3、P4、P5和P6的控制寄存器8.3.2 端口P3、P4、P5和P6的端口邏輯第9章看門狗定時器WDT9.1 看門狗定時器9.2 WDT寄存器9.3 WDT中斷控制功能9.4 WDT操作第10章 16位定時器Timer_A10.1 引言10.2 Timer_A的操作10.2.1 定時器模式控制10.2.2 時鐘源選擇和分頻10.2.3 定時器啟動10.3 定時器模式10.3.1 停止模式10.3.2 增計數模式10.3.3 連續模式10.3.4 增/減計數模式10.4 捕獲/比較模塊10.4.1 捕獲模式10.4.2 比較模式10.5 輸出單元10.5.1 輸出模式10.5.2 輸出控制模塊10.5.3 輸出舉例10.6 Timer_A的寄存器10.6.1 Timer_A控制寄存器TACTL10.6.2 Timer_A寄存器TAR10.6.3 捕獲/比較控制寄存器CCTLx10.6.4 Timer_A中斷向量寄存器10.7 Timer_A的UART應用第11章 16位定時器Timer_B11.1 引言11.2 Timer_B的操作11.2.1 定時器長度11.2.2 定時器模式控制11.2.3 時鐘源選擇和分頻11.2.4 定時器啟動11.3 定時器模式11.3.1 停止模式11.3.2 增計數模式11.3.3 連續模式11.3.4 增/減計數模式11.4 捕獲/比較模塊11.4.1 捕獲模式11.4.2 比較模式11.5 輸出單元11.5.1 輸出模式11.5.2 輸出控制模塊11.5.3 輸出舉例11.6 Timer_B的寄存器11.6.1 Timer_B控制寄存器TBCTL11.6.2 Timer_B寄存器TBR11.6.3 捕獲/比較控制寄存器CCTLx11.6.4 Timer_B中斷向量寄存器第12章 USART通信模塊的UART功能12.1 異步模式12.1.1 異步幀格式12.1.2 異步通信的波特率發生器12.1.3 異步通信格式12.1.4 線路空閑多機模式12.1.5 地址位多機通信格式12.2 中斷和中斷允許12.2.1 USART接收允許12.2.2 USART發送允許12.2.3 USART接收中斷操作12.2.4 USART發送中斷操作12.3 控制和狀態寄存器12.3.1 USART控制寄存器UCTL12.3.2 發送控制寄存器UTCTL12.3.3 接收控制寄存器URCTL12.3.4 波特率選擇和調整控制寄存器12.3.5 USART接收數據緩存URXBUF12.3.6 USART發送數據緩存UTXBUF12.4 UART模式，低功耗模式應用特性12.4.1 由UART幀啟動接收操作12.4.2 時鐘頻率的充分利用與UART的波特率12.4.3 多處理機模式對節約MSP430資源的支持12.5 波特率計算第13章 USART通信模塊的SPI功能13.1 USART同步操作13.1.1 SPI模式中的主模式13.1.2 SPI模式中的從模式13.2 中斷與控制功能 13.2.1 USART接收/發送允許位及接收操作13.2.2 USART接收/發送允許位及發送操作13.2.3 USART接收中斷操作13.2.4 USART發送中斷操作13.3 控制與狀態寄存器13.3.1 USART控制寄存器13.3.2 發送控制寄存器UTCTL13.3.3 接收控制寄存器URCTL13.3.4 波特率選擇和調制控制寄存器13.3.5 USART接收數據緩存URXBUF13.3.6 USART發送數據緩存UTXBUF第14章比較器Comparator_A14.1 概述14.2 比較器A原理14.2.1 輸入模擬開關14.2.2 輸入多路切換14.2.3 比較器14.2.4 輸出濾波器14.2.5 參考電平發生器14.2.6 比較器A中斷電路14.3 比較器A控制寄存器14.3.1 控制寄存器CACTL114.3.2 控制寄存器CACTL214.3.3 端口禁止寄存器CAPD14.4 比較器A應用14.4.1 模擬信號在數字端口的輸入14.4.2 比較器A測量電阻元件14.4.3 兩個獨立電阻元件的測量系統14.4.4 比較器A檢測電流或電壓14.4.5 比較器A測量電流或電壓14.4.6 測量比較器A的偏壓14.4.7 比較器A的偏壓補償14.4.8 增加比較器A的回差第15章模數轉換器ADC1215.1 概述15.2 ADC12的工作原理及操作15.2.1 ADC內核15.2.2 參考電平15.3 模擬輸入與多路切換15.3.1 模擬多路切換15.3.2 輸入信號15.3.3 熱敏二極管的使用15.4 轉換存儲15.5 轉換模式15.5.1 單通道單次轉換模式15.5.2 序列通道單次轉換模式15.5.3 單通道重復轉換模式15.5.4 序列通道重復轉換模式15.5.5 轉換模式之間的切換15.5.6 低功耗15.6 轉換時鐘與轉換速度15.7 采樣15.7.1 采樣操作15.7.2 采樣信號輸入選擇15.7.3 采樣模式15.7.4 MSC位的使用15.7.5 采樣時序15.8 ADC12控制寄存器15.8.1 控制寄存器ADC12CTL0和ADC12CTL115.8.2 轉換存儲寄存器ADC12MEMx15.8.3 控制寄存器ADC12MCTLx15.8.4 中斷標志寄存器ADC12IFG.x和中斷允許寄存器ADC12IEN.x15.8.5 中斷向量寄存器ADC12IV15.9 ADC12接地與降噪第16章 FLASH型芯片的開發16.1 開發系統概述16.1.1 開發技術16.1.2 MSP430系列的開發16.1.3 MSP430F系列的開發16.2 FLASH型的FET開發方法16.2.1 MSP430芯片的JTAG接口16.2.2 FLASH型仿真工具16.3 FLASH型的BOOT ROM16.3.1 標準復位過程和進入BSL過程16.3.2 BSL的UART協議16.3.3 數據格式16.3.4 退出BSL16.3.5 保護口令16.3.6 BSL的內部設置和資源附錄A 尋址空間附錄B 指令說明B.1 指令匯總B.2 指令格式B.3 不增加ROM開銷的模擬指令B.4 指令說明（字母順序）B.5 用幾條指令模擬的宏指令附錄C MSP430系列單片機參數表附錄D MSP430系列單片機封裝形式附錄E MSP430系列器件命名

標簽： flash MSP 430 超低功耗

上傳時間： 2014-04-28

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高效率E類射頻功率振蕩器的設計

主要介紹了高效率E類射頻功率振蕩器的原理和設計方法，通過電路等效變換，E類射頻功率振蕩器最終轉換成與E類放大器相同的結構，MOS管工作在軟開關狀態，漏極高電壓、大電流不會同時交疊，大大降低了功率損耗，在同等工作條件下，能夠獲得與E類放大器相似的高效率。文中以ARF461型LDMOS做為功率器件，結合E類射頻振蕩器在等離子體源中的應用，給出了的設計實例。ADS仿真結果表明，在13.56MHz的工作頻率下，振蕩器輸出功率46W，效率為92%，符合設計預期。

標簽： 高效率 E類射頻功率振蕩器

上傳時間： 2014-02-10

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先進的高壓大功率器件——原理特性和應用

本書共11章。第1章簡要介紹了高電壓功率器件的可能應用，定義了理想功率開關的電特性，并與典型器件的電特性進行了比較。第2章和第3章分析了硅基功率晶閘管和碳化硅基功率晶閘管。第4章討論了硅門極關斷（GTO）晶閘管結構。第5章致力于分析硅基IGBT結構，以提供對比分析的標準。第6章和第7章分析了碳化硅MOSFET和碳化硅IGBT的結構。碳化硅MOSFET 和IGBT的結構設計重點在于保護柵氧化層，以防止其提前擊穿。另外，必須屏蔽基區，以避免擴展擊穿。這些器件的導通電壓降由溝道電阻和緩沖層設計所決定。第8章和第9章討論了金屬氧化物半導體控制晶閘（MCT）結構和基極電阻控制晶閘管（BRT）結構，后者利用MOS柵控制晶閘管的導通和關斷。第10章介紹了發射極開關晶閘（EST），該種結構也利用一種MOS柵結構來控制晶閘管的導通與關斷，并可利用IGBT加工工藝來制造。這種器件具有良好的安全工作區。本書最后一章比較了書中討論的所有高壓功率器件結構。本書的讀者對象包括在校學生、功率器件設計制造和電力電子應用領域的工程技術人員及其他相關專業人員。本書適合高等院校有關專業用作教材或專業參考書，亦可被電力電子學界和廣大的功率器件和裝置生產企業的工程技術人員作為參考書之用。

標簽： 大功率器件

上傳時間： 2021-11-02

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SiC 功率器件?模塊應用筆記

本應用筆記詳細記載了關于羅姆的SiC 器件的特性及使用方法。從分立器件到模塊，面向各種應用，SiC器件的優勢和使用上的注意點，從初次接觸SiC器件到熟知產品的各位，都可以得到應用和幫助

標簽： sic 功率器件

上傳時間： 2022-02-08

上傳用戶：shjgzh
半導體器件 sentaurus TCAD設計與應用[韓雁,丁扣寶][電子教案(PPT版本)]

Sentaurus TCAD全面繼承了Tsuprem4，Medici和ISE-TCAD的特點和優勢，它可以用來模擬集成器件的工藝制程，器件物理特性和互連線特性等。Sentaurus TCAD提供全面的產品套件，其中包括Sentaurus Workbench, Ligament, Sentaurus Process, Sentaurus Structure Editor, Mesh Noffset3D, Sentaurus Device, Tecplot SV Inspect, Advanced Calibration等等。Sentaurus Process和Sentaurus Device可以支持的仿真器件類型非常廣泛，包括CMOS，功率器件，存儲器，圖像傳感器，太陽能電池，和模擬/射頻器件。sentaurus TCAD還提供互連建模和參數提取工具，為優化芯片性能提供關鍵的寄生參數信息。

標簽： 半導體器件 tcad

上傳時間： 2022-06-30

上傳用戶：shjgzh
基于ST7FMC的電動摩托車控制系統的研究.rar

本文論述了基于ST7FMC的電動摩托車控制系統的研究。近年來,由于燃油交通工具尾氣排放對城市空氣造成的嚴重污染，以及人們生活水平、環保意識的逐漸提高，綠色交通工具己成為時代發展的重要課題。考慮到我國目前的國情，發展電動車具有重要的環保意義。隨著電機技術及功率器件性能的不斷提高,電動車的控制器發展迅速。但是目前市場上大多數的電動車產品均采用低集成度元件控制裝置，功能過于簡單，不能充分發揮系統潛力及處理一些特殊的控制問題。提出了基于意法半導體芯片ST7FMC的永磁無刷直流電動機的控制系統設計方案，進行了低成本、高智能的無刷直流電機控制系統設計，能滿足更多應用場合的需要。主要從以下幾個方面進行了分析與研究: 首先，建立無刷直流電機的數學模型，并分析其電機運行特性。其次，根據ST專用單片機的特點詳細設計了系統的控制策略：將調速系統設計為電流、速度雙閉環的PI算法控制，以保證調速性能和電流控制精度；采用ST芯片固有的寄存器進行速度的檢測，比較精確；將相電流檢測設計成母線電流PWM On中點檢測；采用了高性能的驅動集成電路IR2136來驅動MOSFET組成的全橋逆變電路；驅動方式采用新型的凸形波驅動控制方法。最后，組裝了試驗樣車，通過實驗室觀測及實地運行，驗證了系統運行的可靠性。由此得出結論：本課題設計的基于ST7FMC的電動摩托車控制系統具有運行性能良好、可靠性高的特點，為后續的研究工作提供了一定的基礎。

標簽： ST7FMC 電動摩托車控制系統

上傳時間： 2013-05-17

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基于DSP的IGBT勵磁系統研究與仿真.rar

勵磁調節系統是同步發電機的重要組成部分，對同步發電機乃至電力系統的安全穩定運行有著重要影響。隨著電力系統規模的不斷增大，系統結構和運行方式日趨復雜，對同步發電機勵磁控制系統運行的可靠性、穩定性、經濟性和靈活性提出了更高的要求。本文根據勵磁調節器的國內外發展趨勢，研究開發了以TMS320F2812芯片為控制核心的同步發電機DSP勵磁調節器。本文首先介紹了數字勵磁的發展歷程、特點及應用范圍，然后介紹了同步發電機勵磁控制系統的國內外發展狀況及趨勢，提出了基于數字信號處理器 TMS320F2812 控制的絕緣柵雙極晶體管(IGBT)微機勵磁系統的結構和設計方案。在詳細解釋功率器件 IGBT 和控制器件TMS320F2812芯片基礎上，提出了勵磁系統的主要硬件設計及軟件實現方法；完成了IGBT勵磁裝置主回路和 IGBT 保護及驅動單元的設計；進行調節器硬件設計，給出了硬件原理圖和軟件流程圖；利用TMS320F2812芯片強大的數據處理能力和豐富的片內外設和高速的實時處理能力，用單片系統結構實現了交流采樣、變速積分 PID控制算法、PWM功率調節和系統保護等功能。TMS320F2812芯片的引入，大大簡化了勵磁控制器的硬件結構，提高了勵磁系統的抗干擾能力和可靠性。最后，為驗證所設計的勵磁調節器的有效性和控制效果，采用 MATLAB 中 SIMULINK 仿真平臺，設計了勵磁控制系統各環節的仿真模型。仿真結果表明，采用 TMS320F2812的同步發電機IGBT勵磁系統具有響應快速、調節靈敏、控制性能優良等特點。

標簽： IGBT DSP 勵磁

上傳時間： 2013-07-29

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多相感應電機的設計研究.rar

自上世紀初以來，電力發電、輸配電系統都是三相系統。因此，大多數電機調速系統都是由三相電機與三相變頻器構成的。但是目前三相電機的地位已經受到一定的挑戰，一是在低壓大功率的傳動場合，二是在對系統可靠性要求很高的場合。而多相電機調速系統除了可以用低壓功率器件實現大功率等級外，具有多相冗余結構使調速系統的可靠性得以改善。因此，多相電機調速系統的研究受到日益廣泛的關注。和常規的三相感應電機相比多相感應電機有著許多優點，例如多相感應電機在一相或多相定子繞組開路和短路時仍然可以起動或繼續運行，轉矩脈動小，轉子損耗小，運行性能好，可以在不提高相電壓的情況下增加電機的容量，比較適合應用于艦艇推進系統等方面。本文在傳統的三相電機調速系統的基礎上，致力于研究多相電機調速系統，以多相感應電機為主要研究對象，進行了深入的研究，主要包括以下幾個方面： 1、對多相電機調速系統作了較為全面的綜述，介紹了多相電機調速系統的特點和國內外研究現狀。 2、研究了多相感應電機的基本結構。從電機的繞組連接方式入手，對多相感應電機進行了諧波分析，從理論上證明了多相電機相對于三相電機在減小諧波含量方面的優越性，同時探討了多相感應電機的數學模型。 3、在三相感應電機電磁設計程序的基礎上整理推導了多相感應電機的電磁設計程序，并用Visual C＋＋編程語言開發了多相感應電機的電磁設計軟件。 4、對多相感應電機的電磁場進行了詳細的分析，運用電磁場有限元分析軟件Maxwell 2D對本論文中的樣機的瞬態磁場進行分析，分析結果同用VC所編寫的電磁設計程序的計算結果進行比較，驗證了所設計樣機數據的合理性。

標簽： 多相感應電機

上傳時間： 2013-07-30

上傳用戶：是王洪文