統一潮流控制器(UPFC)作為一種典型的FACTS裝置，綜合了FACTS元件的多種靈活控制手段，能同時或選擇地控制線路的基本參數(電壓、阻抗、相角)，也可交替地控制線路上的有功和無功潮流，還可獨立地提供可控的并聯無功補償。因此UPFC被認為是最有創造性，功能最強大的FACTS元件。 首先，本文詳細分析了統一潮流控制器的基本結構和工作原理。采用開關函數法建立了電壓源型變流器的數學模型，并推導了統一潮流控制器在abc三相坐標系和dq旋轉坐標系下的數學模型，該模型考慮到直流環節電容儲能的動態變化過程，從而使其更適合于系統的動態特性分析。本文討論的UPFC控制采用基于兩相旋轉坐標系下的非線性解耦控制方案，在UPFC的精確模型下具有可快速跟蹤給定值的優點，且在dq坐標系下可以實現有功和無功功率的獨立控制；在電容電壓PI調節中加入電流反饋，使其更接近真實值。 其次，本論文在分析UPFC數學模型的基礎上建立了UPFC在MATLAB平臺上的仿真模型；然后利用MATLAB建立了三相環形電力系統，將UPFC模型應用到該系統中，著重研究了UPFC對電網電能質量的影響。首先研究了UPFC對故障系統中電網功率的影響以及UPFC對提高故障系統功率穩定性的作用；同時，對UPFC能夠抑制無故障系統中系統接入電網時的功率沖擊進行了研究。最后，通過仿真波形研究了UPFC對電網故障中電壓跌落的補償作用以及UPFC對正常系統電壓的影響，結果發現，UPFC可以保持故障中的系統電壓為正弦波。
上傳時間： 2013-04-24
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隨著對電能應用高效率的要求，基于電力電子技術的非線性負載等開關設備的應用越來越普遍，這些開關設備造成的諧波成分對電網的污染也越來越嚴重。這些諧波會影響其它電氣設備的正常工作，危及電網安全。電力有源濾波器由于能對頻率和幅值都變化的諧波進行跟蹤補償，得到了廣泛的研究。 本文是在課題組380V、260kVA純有源電力濾波器項目方案的論證階段，為提高大容量單臺純有源濾波器的效率和動、穩態性能而做的分析、設計和仿真驗證工作。論文首先介紹了通過LCL濾波器與電網相連的并聯電力有源濾波器的主電路結構，進而分析了這種主電路結構在大容量和低開關頻率場合對開關紋波衰減的優勢。通過比較PI控制和狀態反饋控制，選取全狀態反饋來達到對系統的穩定控制。 將電網處理為擾動輸入，對LCL主電路在靜止abc坐標系中進行了建模，然后選取系統閉環期望極點設計了控制系統。為消除電網這個外部輸入對指令電流跟蹤的影響，引入了電壓前饋，并從理論上推導了前饋的具體關系式。之后引入了觀測器，并把對電網輸入的建模考慮進了觀測器，消除了電網輸入對狀態估計和補償輸出造成的偏差。在電力有源濾波器實際安裝時，電網進線和變壓器的電感是不確定的，其會加在LCL的網側電感上，從而使對系統基于狀態空間的建模產生偏差，因此文章研究了所設計的控制器對LCL網側電感變化的適應性。為保證電力有源濾波器的穩態指標，對狀態反饋后的系統設計了重復控制器。 最后，基于設計的控制器在MATLAB/Simulink環境下建立了對1MW不控整流負載進行補償的電力有源濾波器系統模型，進行了仿真；并對動靜態性能進行了分析，驗證了設計和理論分析的正確性。
上傳時間： 2013-06-20
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近幾十年來,由于大功率電力電子裝置的廣泛應用,使公用電網受到諧波電流和諧波電壓的污染日益嚴重,功率因數低,電能利用率低。為了抑制電網的諧波,提高功率因數,人們通常采用無功補償、有源、無源濾波器等對電網環境進行改善。近年來,功率因數校正技術作為抑制諧波電流,提高功率因數的行之有效的方法,備受人們的關注。 本文在參閱國內外大量文獻的基礎上,綜述了近年來國內外功率因數校正的發展狀況,簡要分析了無源功率因數與有源功率因數的優、缺點,并詳細分析了有源功率因數校正的基本原理和控制方法。在通過對主電路拓撲與控制方法的優、缺點比較后,選擇BOOST變換器作為主電路拓撲,采用基于平均電流控制的UC3854控制器,設計了容量為300W的兩級有源功率因數校正電路的前一級電路,計算了主電路與控制電路的元件參數。根據此參數,基于MATLAB環境下對功率因數校正前、后的電路進行了仿真,通過仿真波形的分析。最后搭建實驗電路進行實驗,采集實驗波形,對實驗結果進行分析,進-步驗證了本設計參數的正確性與準確性。 本文功率因數校正電路的設計,使電路的功率因數得到了明顯的改善,達到了設計要求,同時電路的總諧波畸變因數控制在了一定的范圍,減少了對電網的污染。并且電路的輸出電壓穩定,為后一級的電路設計奠定了基礎。
上傳時間： 2013-05-22
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隨著以太網技術的不斷發展，網絡的傳輸速度已經由最初的10M發展到現在的10,000M。用可編程邏輯器件(FPGA)實現以太網控制器與其它SOC系統的互連成為當前的研究熱點。本文闡述了MAC層的FPGA設計、仿真及測試；介紹了整個系統的內部結構、模塊劃分，并對各個模塊的設計過程進行了詳細闡述，接著介紹了開發環境和驗證工具，同時給出測試方案、驗證數據、實現結果及時序仿真波形圖。 對MAC層的主要功能模塊如:發送模塊、接收模塊、MAC流程控制模塊、寄存器模塊、MⅡ接口模塊和主機接口模塊以及CRC，CSMA/CD，HASH表等算法給出了基于FPGA及硬件描述語言的解決方法。 本課題針對以下三個方面進行了研究并取得一定的成果: 1)FPGA開發平臺的硬件實現。選用Xilinx公司的XC3S1000-FT256-4-C和ATMEL公司的ARM9200作為測試的核心器件，采用LXT971芯片作為物理層芯片，AT91RM9200作為數據輸入源和雙blockram作為幀緩存搭建FPGA硬件驗證開發平臺。 2)基于FPGA實現以太網控制器。用VerilogHDL語言構建以太網控制器，實現CSMA/CD協議、10M/100M自適應以及與物理層MⅡ接口等。 3)采用片上系統通用的WS接口。目的是便于與具有通用接口的片上系統互連，也為構建SOC上處理器提供條件。 本論文實現了一個基于WS總線接口可裁減的以太網MAC控制器IP軟核，為設計具有自主知識產權的以太網MAC控制器積累了經驗。同時，為與其它WS接口的控制器實現直接互連創造了條件，對高層次設計這一先進ASIC設計方法也有了較為深入的認識。
上傳時間： 2013-07-17
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系統采用ATME189S52 為微控制器(MCE)核心，實現了可控的恒定直流電流源設計。核心恒流模塊采用自反饋電路連接大功率場效應管IRFZ44NL，使得電流輸出范圍達到20~2000
上傳時間： 2013-07-05
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隨著計算機技術和互聯網技術的發展，嵌入式系統已成為近年來新興的研究熱點。嵌入式系統的硬件核心是嵌入式微處理器，ARM處理器以其高性能、低功耗、低成本等優點占領了嵌入式系統處理器的大部分市場，基于ARM的嵌入式系統的應用已深入到工業控制、網絡通訊設備等領域。Linux作為功能強大、源碼公開的操作系統，在嵌入式領域中被廣泛應用。 本文針對自動售貨機控制系統在校園一卡通系統中的應用要求，以開發具有射頻卡結帳功能的新型自動售貨機控制系統，并與校園一卡通信息管理系統相連為目標，提出了基于ARM-Linux的自動售貨機控制器總體設計方案。根據方案對自動售貨機控制系統進行總體設計，在分析嵌入式軟硬件可實現模塊化設計的基礎上，采用數據處理能力強和能夠實現數據網絡傳輸的HMS30C7202微處理器，對ARM處理器最小系統和關鍵的接口電路進行了硬件結構設計，系統擴展有FLASH、EPROM、以太網接口、RS232接口、GPIO接口、USB接口等外圍電路。利用Protel軟件完成了開發板的原理圖設計、繪制以及印刷電路板布局布線工作，PCB設計以高速電路設計為準則，集成了多種接口電路，完成了硬件系統的設計。研究了嵌入式Linux操作系統下的自動售貨機控制系統軟件環境建立方法，論述了移植Linux到ARM控制板的過程，分析了嵌入式軟件的應用程序架構與各部分設備驅動程序的設計方法，設計了硬件驅動程序。在嵌入式軟、硬件開發的基礎上，對基于ARM的嵌入式自動售貨機控制系統進行實例研究和系統功能調試，完成了自動售貨機控制系統的基本功能，并使系統能夠基于以太網進行數據通信，為進一步的開發和應用提供了良好的基礎。
上傳時間： 2013-07-05
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現代家庭中單相供電的用電設備如電腦、電視機、冰箱等都具有非線性特性，都會產生諧波污染電網。本文針對這一現象研究了單相并聯電壓型有源電力濾波器（APF），設計了一個APF控制系統來產生與諧波電流大小相等方向相反的補償電流，并使補償電流實時地跟蹤諧波電流，從而消除諧波電流達到凈化電網。 本文對提出的APF控制系統從模擬和數字兩個方面進行了深入的研究。 首先，設計了APF的主電路結構，確定了系統中電感電容等元件參數，并根據仿真結果系統地分析了參數變化對系統補償效果的影響，然后根據補償效果選擇最佳的參數值。 其次，針對控制系統要求，選用適合系統的電流電壓PI雙環控制系統，通過參數優化后得到了控制器的最優參數，使控制效果達到最優。并從理論上詳細分析了無差拍控制算法。 最后，利用滯環比較原理制作了10KHz的三角波發生器，用于PWM調制電路。在對硬件描述語言以及FPGA設計流程深入理解的基礎上，利用Verilog語言實現了雙環PI控制器和PWM發生電路的數字化，使得有源電力濾波器補償精度提高，有更好的可修改性，可使用于很多不同的非線性負載。
上傳時間： 2013-07-27
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·摘要： DDB SDRAM使用雙倍數據速率結構,它能獲得比SDRAM更高的性能.DDR SDRAM需要特定的DDB控制器才能完成與DSP、FPGA之間的通信.由于Xilinx VirtexTM-4系列FPGA具備ChipSync源同步技術等優勢,本設計采用它來實現DDRSDRAM控制器.該DDR SDRAM控制器采用直接時鐘數據捕獲技術,本文將重點闡述該技術.
標簽： Xilinx_FPGA DDR_SDRAM 控制器
上傳時間： 2013-05-24
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目前市面上比較流行的can協議vhdl控制器，提供源碼參考設計，同仁可自行下載
上傳時間： 2013-08-12
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文中介紹一種基于DDFS（直接頻率合成）技術的可編程音頻儀器測試信號源設計。該系統采用單片機作為控制器，以FPGA（現場可編程門陣列）作為信號源的主要平臺，利用DDFS技術產生一個按指數衰減的頻率可調正弦衰減信號。測試結果表明，該系統產生的信號其幅度可以按指數規律衰減；其頻率可以在1～4 KHz頻率范圍內按1 Hz步長步進。可以方便的用于測試音頻儀器設備的放大和濾波性能。
上傳時間： 2013-11-20
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