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集成電路型號

  • 基于FPGA的DDS雙通道波形發生器.rar

    直接數字頻率合成(DDS)是七十年代初提出的一種新的頻率合成技術,其數字結構滿足了現代電子系統的許多要求,因而得到了迅速的發展。現場可編程門陣列器件(FPGA)的出現,改變了現代電子數字系統的設計方法,提供了一種全新的設計模式。本論文結合這兩項技術,并利用單片機控制靈活的特點,開發了一種雙通道波形發生器。在實現過程中,選用了Altera公司的EP1C6Q240C8芯片作為產生波形數據的主芯片,充分利用了該芯片的超大集成性和快速性。在控制芯片上選用ATMAL的AT89C51單片機作為控制芯片。本設計中,FPGA芯片的設計和與控制芯片的接口設計是一個難點,本文利用Altera的設計工具Quartus Ⅱ并結合Verilog-HDL語言,采用硬件編程的方法很好地解決了這一問題。 本文首先介紹了波形發生器的研究背景和DDS的理論。然后詳盡地敘述了用EP1C6Q240C8完成DDS模塊的設計過程,這是設計的基礎。接著分析了整個設計中應處理的問題,根據設計原理就功能上進行了劃分,將整個儀器功能劃分為控制模塊、外圍硬件、FPGA器件三個部分來實現。然后就這三個部分分別詳細地進行了闡述。并且通過系列實驗,詳細地分析了該波形發生器的功能、性能、實現和實驗結果。最后,結合在設計中的一些心得體會,提出了本設計中的一些不足和改進意見。通過實驗說明,本設計達到了預定的要求,并證明了采用軟硬件結合,利用FPGA實現基于DDS架構的雙路波形發生器是可行的。

    標簽: FPGA DDS 雙通道

    上傳時間: 2013-06-09

    上傳用戶:wxhwjf

  • 基于FPGA的視頻圖像畫面分割器的設計.rar

    視頻監控一直是人們關注的應用技術熱點之一,它以其直觀、方便、信息內容豐富而被廣泛用于在電視臺、銀行、商場等場合。在視頻圖像監控系統中,經常需要對多路視頻信號進行實時監控,如果每一路視頻信號都占用一個監視器屏幕,則會大大增加系統成本。視頻圖像畫面分割器主要功能是完成多路視頻信號合成一路在監視器顯示,是視頻監控系統的核心部分。 傳統的基于分立數字邏輯電路甚至DSP芯片設計的畫面分割器的體積較大且成本較高。為此,本文介紹了一種基于FPGA技術的視頻圖像畫面分割器的設計與實現。 本文對視頻圖像畫面分割技術進行了分析,完成了基于ITU-RBT.656視頻數據格式的畫面分割方法設計;系統采用Xilinx公司的FPGA作為核心控制器,設計了視頻圖像畫面分割器的硬件電路,該電路在FPGA中,將數字電路集成在一起,電路結構簡潔,具有較好的穩定性和靈活性;在硬件電路平臺基礎上,以四路視頻圖像分割為例,完成了I2C總線接口模塊,異步FIFO模塊,有效視頻圖像數據提取模塊,圖像存儲控制模塊和圖像合成模塊的設計,首先,由攝像頭采集四路模擬視頻信號,經視頻解碼芯片轉換為數字視頻圖像信號后送入異步FIFO緩沖。然后,根據畫面分割需要進行視頻圖像數據抽取,并將抽取的視頻圖像數據按照一定的規則存儲到圖像存儲器。最后,按照數字視頻圖像的數據格式,將四路視頻圖像合成一路編碼輸出,實現了四路視頻圖像分割的功能。從而驗證了電路設計和分割方法的正確性。 本文通過由FPGA實現多路視頻圖像的采集、存儲和合成等邏輯控制功能,I2C總線對兩片視頻解碼器進行動態配置等方法,實現四路視頻圖像的輪流采集、存儲和圖像的合成,提高了系統集成度,并可根據系統需要修改設計和進一步擴展功能,同時提高了系統的靈活性。

    標簽: FPGA 視頻圖像 畫面分割器

    上傳時間: 2013-04-24

    上傳用戶:gundan

  • 基于FPGA的變頻調速控制系統設計與實現.rar

    如今電力電子電路的控制旨在實現高頻開關的計算機控制,并向著更高頻率、更低損耗和全數字化的方向發展。現場可編程門陣列器件(Field Programmable Gate Arrays)是近年來嶄露頭角的一類新型集成電路,它具有簡潔、經濟、高速度、低功耗等優勢,又具有全集成化、適用性強,便于開發和維護(升級)等顯著優點。與單片機和DSP相比,FPGA的頻率更高、速度更快,這些特點順應了電力電子電路的日趨高頻化和復雜化發展的需要。因此,在越來越多的領域中FPGA得到了日益廣泛的發展和應用。 本文提出了一種采用現場可編程門陣列(FPGA)器件實現數字化變頻調速控制系統的設計方案。該系統能產生三相六路正弦脈寬調制(SPWM)波形;調制頻率范圍為0~4KHZ,分7級控制;16位的速度控制分辨率;載波頻率分8級控制,最高可達24KHZ;系統接口兼容Intel系列和Motorola系列單片機;該系統控制簡單、精確,易修改,可現場編程;同時具有脈沖延時小、最小脈沖刪除、過壓和過流保護功能等特點,可應用于PWM變頻調速系統的全數字化控制。文中對方案的實現進行了詳細的論述,主要包括系統設計的理論分析,系統結構設計及在FPGA硬件上的實現,最終驗證了該控制系統的可行性和有效性。 數字化設計是本系統的特點,系統最終生成的三相SPWM脈沖是基于三相正弦調制波和三角載波比較得到的。設計時,充分結合FPGA器件的結構特點,利用一種改進結構的數字控制振蕩器(NCO)來產生正弦波樣本,在一定程度上解決了傳統NCO產生正弦波的精度和頻率相互制約的問題;把分時復用數字通信原理結合到系統的設計中,設計出分時運算電路,使得系統在同步時鐘下,生成三相正弦調制波而不影響系統的速度,同三角載波邏輯比較后,最終得到三相SPWM脈沖序列。

    標簽: FPGA 變頻調速控制 系統設計

    上傳時間: 2013-07-05

    上傳用戶:duoshen1989

  • 西門子3508型手機工作原理

    西門子3508型手機工作原理1,電源部分電路,開關機控制電路主要由電源IC D200及主微處理器D103組成,其主要作用是在話機加電池或外接充電器情況下,按下開關機鍵時產生一系列復位信號。

    標簽: 3508 西門子 手機 工作原理

    上傳時間: 2013-07-28

    上傳用戶:asdfasdfd

  • 基于FPGA的多路脈沖時序控制電路設計與實現.rar

    在團簇與激光相互作用的研究中和在團簇與加速器離子束的碰撞研究中,需要對加速器束流或者激光束進行脈沖化與時序同步,同時用于測量作用產物的探測系統如飛行時間譜儀(TOF)等要求各加速電場的控制具有一定的時序匹配。在整個實驗中,需要用到符合要求的多路脈沖時序信號控制器,而且要求各脈沖序列的周期、占空比、重復頻率等方便可調。為此,本論文基于FPGA設計完成了一款多路脈沖時序控制電路。 本文基于Altera公司的Cyclone系列FPGA芯片EPlC3T100C8,設計出了一款可以同時輸出8路脈沖序列、各脈沖序列之間具有可調高精度延遲、可調脈沖寬度及占空比等。論文討論了FPGA芯片結構及開發流程,著重討論了較高頻率脈沖電路的可編程實現方法,以及如何利用VHDL語言實現硬件電路軟件化設計的技巧與方法,給出了整個系統設計的原理與實現。討論了高精密電源的PWM技術原理及實現,并由此設計了FPGA所需電源系統。給出了配置電路設計、數據通信及接口電路的實現。開發了上層控制軟件來控制各路脈沖時序及屬性。 該電路工作頻率200MHz,輸出脈沖最小寬度可達到10ns,最大寬度可達到us甚至ms量級。可以同時提供l路同步脈沖和7路脈沖,并且7路脈沖相對于同步脈沖的延遲時間可調,調節步長為5ns。

    標簽: FPGA 多路 脈沖

    上傳時間: 2013-06-15

    上傳用戶:ZJX5201314

  • 集成運放線性應用電路分析方法的研究.rar

    集成運放線性應用電路分析方法的研究 集成運放線性應用電路分析方法的研究

    標簽: 集成運放 線性應用 電路分析

    上傳時間: 2013-06-06

    上傳用戶:gxf2016

  • 高噪聲率下極值型中值濾波算法的改進

    極值型中值濾波算法在高噪聲率下的濾波效果不是很好,主要原因有以下兩個:首先,濾波窗口中過多的噪聲點會使窗口中的點在排序時產生中值偏移;其次是高噪聲率環境下,可能序列中值本身就是是噪聲點。對此,本文提出

    標簽: 高噪聲率 中值濾波 法的改進

    上傳時間: 2013-06-26

    上傳用戶:小小小熊

  • 開關型單兩節鋰離子鋰聚合物充電管理芯片

    HT6298A 為開關型單節或兩節鋰離子/鋰聚合物電池充電管理芯片,非常適合于便攜式設備的充電管理應用。HT6298A 集內置功率MOSFET、高精度電壓和電流調節器、預充、充電狀態指示和充電截止等功

    標簽: 開關 充電管理芯片 鋰離子 鋰聚合物

    上傳時間: 2013-06-22

    上傳用戶:417313137

  • 集成運放應用

    集成運放應用:一、實訓任務1 學會組裝集成運放應用電路;2 學會測試集成運放應用電路。二、實訓目標1 學會集成運放典型電路應用,理解集成運放應用電路的工作原理;

    標簽: 集成運放

    上傳時間: 2013-06-11

    上傳用戶:busterman

  • 采用FPGA實現基于ATCA架構的2.5Gbps串行背板接口

    當前,在系統級互連設計中高速串行I/O技術迅速取代傳統的并行I/O技術正成為業界趨勢。人們已經意識到串行I/O“潮流”是不可避免的,因為在高于1Gbps的速度下,并行I/O方案已經達到了物理極限,不能再提供可靠和經濟的信號同步方法。基于串行I/O的設計帶來許多傳統并行方法所無法提供的優點,包括:更少的器件引腳、更低的電路板空間要求、減少印刷電路板(PCB)層數、PCB布局布線更容易、接頭更小、EMI更少,而且抵抗噪聲的能力也更好。高速串行I/O技術正被越來越廣泛地應用于各種系統設計中,包括PC、消費電子、海量存儲、服務器、通信網絡、工業計算和控制、測試設備等。迄今業界已經發展出了多種串行系統接口標準,如PCI Express、串行RapidIO、InfiniBand、千兆以太網、10G以太網XAUI、串行ATA等等。 Aurora協議是為私有上層協議或標準上層協議提供透明接口的串行互連協議,它允許任何數據分組通過Aurora協議封裝并在芯片間、電路板間甚至機箱間傳輸。Aurora鏈路層協議在物理層采用千兆位串行技術,每物理通道的傳輸波特率可從622Mbps擴展到3.125Gbps。Aurora還可將1至16個物理通道綁定在一起形成一個虛擬鏈路。16個通道綁定而成的虛擬鏈路可提供50Gbps的傳輸波特率和最大40Gbps的全雙工數據傳輸速率。Aurora可優化支持范圍廣泛的應用,如太位級路由器和交換機、遠程接入交換機、HDTV廣播系統、分布式服務器和存儲子系統等需要極高數據傳輸速率的應用。 傳統的標準背板如VME總線和CompactPCI總線都是采用并行總線方式。然而對帶寬需求的不斷增加使新興的高速串行總線背板正在逐漸取代傳統的并行總線背板。現在,高速串行背板速率普遍從622Mbps到3.125Gbps,甚至超過10Gbps。AdvancedTCA(先進電信計算架構)正是在這種背景下作為新一代的標準背板平臺被提出并得到快速的發展。它由PCI工業計算機制造商協會(PICMG)開發,其主要目的是定義一種開放的通信和計算架構,使它們能被方便而迅速地集成,滿足高性能系統業務的要求。ATCA作為標準串行總線結構,支持高速互聯、不同背板拓撲、高信號密度、標準機械與電氣特性、足夠步線長度等特性,滿足當前和未來高系統帶寬的要求。 采用FPGA設計高速串行接口將為設計帶來巨大的靈活性和可擴展能力。Xilinx Virtex-IIPro系列FPGA芯片內置了最多24個RocketIO收發器,提供從622Mbps到3.125Gbps的數據速率并支持所有新興的高速串行I/O接口標準。結合其強大的邏輯處理能力、豐富的IP核心支持和內置PowerPC處理器,為企業從并行連接向串行連接的過渡提供了一個理想的連接平臺。 本文論述了采用Xilinx Virtex-IIPro FPGA設計傳輸速率為2.5Gbps的高速串行背板接口,該背板接口完全符合PICMG3.0規范。本文對串行高速通道技術的發展背景、現狀及應用進行了簡要的介紹和分析,詳細分析了所涉及到的主要技術包括線路編解碼、控制字符、逗點檢測、擾碼、時鐘校正、通道綁定、預加重等。同時對AdvancedTCA規范以及Aurora鏈路層協議進行了分析, 并在此基礎上給出了FPGA的設計方法。最后介紹了基于Virtex-IIPro FPGA的ATCA接口板和MultiBERT設計工具,可在標準ATCA機框內完成單通道速率為2.5Gbps的全網格互聯。

    標簽: FPGA ATCA Gbps 2.5

    上傳時間: 2013-05-29

    上傳用戶:frank1234

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