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零件設(shè)(shè)計(jì)

  • MATLAB 程式設(shè)計與應(yīng)用 張智星.rar

    多媒體相關(guān)專輯 48個 11.7GMATLAB 程式設(shè)計與應(yīng)用 張智星.rar

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    上傳時間: 2014-05-05

    上傳用戶:時代將軍

  • 滑塊設(shè)計 15個 10.2M.rar

    機械五金類專輯 84冊 3.02G滑塊設(shè)計 15個 10.2M.rar

    標簽:

    上傳時間: 2014-05-05

    上傳用戶:時代將軍

  • 包裝工程設(shè)計手冊 590頁 10.7M.pdf

    機械五金類專輯 84冊 3.02G包裝工程設(shè)計手冊 590頁 10.7M.pdf

    標簽:

    上傳時間: 2014-05-05

    上傳用戶:時代將軍

  • 電子連接器設(shè)計基礎(chǔ) 35頁 1.3M.ppt

    實用電子技術(shù)專輯 385冊 3.609G電子連接器設(shè)計基礎(chǔ) 35頁 1.3M.ppt

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    上傳時間: 2014-05-05

    上傳用戶:時代將軍

  • 開關(guān)電源基本原理與設(shè)計介紹 62頁 2.3M ppt.ppt

    開關(guān)電源相關(guān)專輯 119冊 749M開關(guān)電源基本原理與設(shè)計介紹 62頁 2.3M ppt.ppt

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    上傳時間: 2014-05-05

    上傳用戶:時代將軍

  • MP3 PCB布局設(shè)計指南.pdf

    MP3 PCB布局設(shè)計指南.pdf 只供學習之用

    標簽: MP3 PCB pdf 布局

    上傳時間: 2018-04-17

    上傳用戶:yulin3192

  • MP3 PCB布局設(shè)計指南

    印刷電路板(PCB )設(shè)計佈局指南,主要應(yīng)用註釋

    標簽: mp3 pcb

    上傳時間: 2021-11-30

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  • 58.8V7A.設(shè)計筆記

    58.8V7A.設(shè)計筆記 UCC38051D(SOIC-8) PFC 功率拓撲設(shè)計

    標簽: 58 8v7a

    上傳時間: 2021-12-04

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  • 開關(guān)電源的PCB設(shè)計規(guī)范.PDF

    開關(guān)電源的PCB設(shè)計規(guī)范.PDF

    標簽: pcb 開關(guān)電源

    上傳時間: 2021-12-12

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  • pcb layout design(臺灣硬件工程師15年經(jīng)驗

    PCB LAYOUT 術(shù)語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數(shù)零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設(shè)計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設(shè)計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內(nèi)層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內(nèi)層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內(nèi)NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或?qū)住?1. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應(yīng)相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設(shè)置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

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