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電力電子器件

  • 有機(jī)電致發(fā)光顯示器件新型封裝技術(shù)及材料的研究.rar

    有機(jī)發(fā)光顯示器件(OrganicLight-EmittingDiodes,OLEDs)作為下一代顯示器倍受關(guān)注,它具有輕、薄、高亮度、快速響應(yīng)、高清晰度、低電壓、高效率和低成本等優(yōu)點(diǎn),完全可以媲美CRT、LCD、LED等顯示器件。作為全固化顯示器件,OLED的最大優(yōu)越性是能夠與塑料晶體管技術(shù)相結(jié)合實(shí)現(xiàn)柔性顯示,應(yīng)用前景非常誘人。OLED如此眾多的優(yōu)點(diǎn)和廣闊的商業(yè)前景,吸引了全球眾多研究機(jī)構(gòu)和企業(yè)參與其研發(fā)和產(chǎn)業(yè)化。然而,OLED也存在一些問(wèn)題,特別是在發(fā)光機(jī)理、穩(wěn)定性和壽命等方面還需要進(jìn)一步的研究。要達(dá)到這些目標(biāo),除了器件的材料,結(jié)構(gòu)設(shè)計(jì)外,封裝也十分重要。 本論文的主要工作是利用現(xiàn)有的材料,從綠光OLED器件制作工藝、發(fā)光機(jī)理,結(jié)構(gòu)和封裝入手,首先,探討了作為陽(yáng)極的ITO玻璃表面處理工藝和ITO玻璃的光刻工藝。ITO表面的清潔程度嚴(yán)重影響著光刻質(zhì)量和器件的最終性能;ITO表面經(jīng)過(guò)氧等離子處理后其表面功函數(shù)增大,明顯提高了器件的發(fā)光亮度和發(fā)光效率。 其次,針對(duì)光刻、曝光工藝技術(shù)進(jìn)行了一系列相關(guān)實(shí)驗(yàn),在光刻工藝中,光刻膠的厚度是影響光刻質(zhì)量的一個(gè)重要因素,其厚度在1.2μm左右時(shí),光刻效果理想。研究了OLED器件陰極隔離柱成像過(guò)程中的曝光工藝,摸索出了最佳工藝參數(shù)。 然后采用以C545T作為綠光摻雜材料制作器件結(jié)構(gòu)為ITO/CuPc(20nm)/NPB(100nm)/Alq3(80nm):C545T(2.1%摻雜比例)/Alq3(70nm)/LiF(0.5nm)/Al(1,00nm)的綠光OLED器件。最后基于以上器件采用了兩種封裝工藝,實(shí)驗(yàn)一中,在封裝玻璃的四周涂上UV膠,放入手套箱,在氮?dú)獗Wo(hù)氣氛下用紫外冷光源照射1min進(jìn)行一次封裝,然后取出OLED片,在ITO玻璃和封裝玻璃接口處涂上UV膠,真空下用紫外冷光源照射1min,固化進(jìn)行二次封裝。實(shí)驗(yàn)二中,在各功能層蒸鍍完成后,又在陰極的外面蒸鍍了一層薄膜封裝層,然后再按實(shí)驗(yàn)一的方法進(jìn)行封裝。薄膜封裝層的材料分別為硒(Se)、碲(Te)、銻(Sb)。分別對(duì)兩種封裝工藝器件的電流-電壓特性、亮度-電壓特性、發(fā)光光譜及壽命等特性進(jìn)行了測(cè)試與討論。通過(guò)對(duì)比,研究發(fā)現(xiàn)增加薄膜封裝層器件的壽命比未加薄膜封裝層器件壽命都有所延長(zhǎng),其中,Se薄膜封裝層的增加將器件的壽命延長(zhǎng)了1.4倍,Te薄膜封裝層的增加將器件的壽命延長(zhǎng)了兩倍多,Sb薄膜封裝層的增加將器件的壽命延長(zhǎng)了1.3倍,研究還發(fā)現(xiàn)薄膜封裝層基本不影響器件的電流-電壓特性、色坐標(biāo)等光電性能。最后,分別對(duì)三種薄膜封裝層材料硒(Se)、碲(Te)、銻(Sb)進(jìn)行了研究。

    標(biāo)簽: 機(jī)電 發(fā)光 顯示器件

    上傳時(shí)間: 2013-07-11

    上傳用戶(hù):liuwei6419

  • 基于FPGA的IDE固態(tài)硬盤(pán)控制器的設(shè)計(jì)與實(shí)現(xiàn).rar

    固態(tài)硬盤(pán)是一種以FLASH為存儲(chǔ)介質(zhì)的新型硬盤(pán)。由于它不像傳統(tǒng)硬盤(pán)一樣以高速旋轉(zhuǎn)的磁盤(pán)為存儲(chǔ)介質(zhì),不需要浪費(fèi)大量的尋道時(shí)間,因此它有著傳統(tǒng)硬盤(pán)不可比擬的順序和隨機(jī)存儲(chǔ)速度。同時(shí)由于固態(tài)硬盤(pán)不存在機(jī)械存儲(chǔ)結(jié)構(gòu),因此還具有高抗震性、無(wú)工作噪音、可適應(yīng)惡劣工作環(huán)境等優(yōu)點(diǎn)。隨著計(jì)算機(jī)技術(shù)的高速發(fā)展,固態(tài)硬盤(pán)技術(shù)已經(jīng)成為未來(lái)存儲(chǔ)介質(zhì)技術(shù)發(fā)展的必然趨勢(shì)。 本文以設(shè)計(jì)固態(tài)硬盤(pán)控制芯片IDE接口部分為項(xiàng)目背景,通過(guò)可編程邏輯器件FPGA,基于ATA協(xié)議并使用硬件編程語(yǔ)言verilog,設(shè)計(jì)了一個(gè)位于設(shè)備端的IDE控制器。該IDE控制器的主要作用在于解析主機(jī)所發(fā)送的IDE指令并控制硬盤(pán)設(shè)備進(jìn)行相應(yīng)的狀態(tài)遷移和指令操作,從而完成硬盤(pán)設(shè)備端與主機(jī)端之間基本的狀態(tài)通信以及數(shù)據(jù)通信。論文主要完成了幾個(gè)方面的內(nèi)容。第一:論文從固態(tài)硬盤(pán)的基本結(jié)構(gòu)出發(fā),分析了固態(tài)硬盤(pán)IDE控制器的功能性需求以及寄存器傳輸、PIO傳輸和UDMA傳輸三種ATA協(xié)議主要傳輸模式所必須遵循的時(shí)序要求,并概括了IDE控制器設(shè)計(jì)的要點(diǎn)和難點(diǎn);第二:論文設(shè)計(jì)了IDE控制器的總體功能框架,將IDE控制器從功能上分為寄存器部分、頂層控制模塊、異步FIFO模塊、PIO控制模塊、UDMA控制模塊以及CRC校驗(yàn)?zāi)K六大子功能模塊,并分析了各個(gè)子功能模塊的基本工作原理和具體功能設(shè)計(jì);第三:論文以設(shè)計(jì)狀態(tài)機(jī)流程和主要控制信號(hào)的方式實(shí)現(xiàn)了各個(gè)具體子功能模塊并列舉了部分關(guān)鍵代碼,同時(shí)給出了主要子功能模塊的時(shí)序仿真圖;最后,論文給出了基于PIO傳輸模式和基于UDMA傳輸模式的具體指令操作流程實(shí)現(xiàn),并通過(guò)SAS邏輯分析儀和QuartusⅡ?qū)DE控制器進(jìn)行了功能測(cè)試和分析,驗(yàn)證了本論文設(shè)計(jì)的正確性。

    標(biāo)簽: FPGA IDE 固態(tài)硬盤(pán)

    上傳時(shí)間: 2013-07-31

    上傳用戶(hù):liangrb

  • MP3音頻解碼器的FPGA原型芯片設(shè)計(jì)與實(shí)現(xiàn).rar

    MP3音樂(lè)是目前最為流行的音樂(lè)格式,因其音質(zhì)、復(fù)雜度與壓縮比的完美折中,占據(jù)著廣闊的市場(chǎng),不僅在互聯(lián)網(wǎng)上廣為流傳,而且在便攜式設(shè)備領(lǐng)域深受人們喜愛(ài)。本文以MPEG-1的MP3音頻解碼器為研究對(duì)象,在實(shí)時(shí)性、面積等約束條件下,研究MP3解碼電路的設(shè)計(jì)方法,實(shí)現(xiàn)FPGA原型芯片,研究MP3原型芯片的驗(yàn)證方法。 論文的主要貢獻(xiàn)如下: (1)使用算法融合方法合并MP3解碼過(guò)程的相關(guān)步驟,以減少緩沖區(qū)存儲(chǔ)單元的容量和訪存次數(shù)。如把重排序步驟融合到反量化模塊,可以減少一半的讀寫(xiě)RAM操作;把IMDCT模塊內(nèi)部的三個(gè)算法步驟融合在一起進(jìn)行設(shè)計(jì),可以省去存儲(chǔ)中間計(jì)算結(jié)果的緩存區(qū)單元。 (2)反量化、立體聲處理等模塊中,采用流水線設(shè)計(jì)技術(shù),設(shè)置寄存器把較長(zhǎng)的組合邏輯路徑隔開(kāi),提高了電路的性能和可靠性;使用連續(xù)訪問(wèn)公共緩存技術(shù),合理規(guī)劃各計(jì)算子模塊的工作時(shí)序,將數(shù)據(jù)計(jì)算的時(shí)間隱藏在訪存過(guò)程中;充分利用頻率線的零值區(qū)特性,有效地減少數(shù)據(jù)計(jì)算量,加快了數(shù)據(jù)處理的速度。 (3)設(shè)計(jì)了MP3硬件解碼器的FPGA原型芯片。采用Verilog HDL硬件描述語(yǔ)言設(shè)計(jì)RTL級(jí)電路,完成功能仿真,以Altera公司Stratix II系列的EP2S180 FPGA開(kāi)發(fā)板為平臺(tái),實(shí)現(xiàn)MP3解碼器的FPGA原型芯片。MP3硬件解碼器在Stratix II EP2S180器件內(nèi)的資源利用率約為5%,其中組合邏輯查找表ALUT為7189個(gè),寄存器共有4024個(gè),系統(tǒng)頻率可達(dá)69.6MHz,充分滿足了MP3解碼過(guò)程的實(shí)時(shí)性要求。實(shí)驗(yàn)結(jié)果表明,MP3音頻解碼FPGA原型芯片可正常播放聲音,解碼音質(zhì)良好。

    標(biāo)簽: FPGA MP3 音頻解碼器

    上傳時(shí)間: 2013-07-01

    上傳用戶(hù):xymbian

  • 基于FPGA的HDMI顯示系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn).rar

    伴隨著多媒體顯示和傳輸技術(shù)的發(fā)展,人們獲得了越來(lái)越高的視聽(tīng)享受。從傳統(tǒng)的模擬電視,到標(biāo)清、高清、全高清。與顯示技術(shù)發(fā)展結(jié)伴而行的是顯示接口技術(shù)的發(fā)展,從模擬的AV端子,S-Video和VGA接口,到數(shù)字顯示的DVI接口,技術(shù)上經(jīng)歷了一個(gè)從模擬到數(shù)字,從并行到串行,從低速到高速的發(fā)展過(guò)程。 HDMI是最新的高清晰度多媒體接口,它的規(guī)范由Silicon Image等七家公司提出,具有帶寬大,尺寸小,傳輸距離長(zhǎng)和支持正版保護(hù)等功能,符合當(dāng)今技術(shù)的發(fā)展潮流,一經(jīng)推出,就獲得了巨大的成功。成為平板顯示器、高清電視等設(shè)備的標(biāo)準(zhǔn)接口之一,并獲得了越來(lái)越廣泛的應(yīng)用。 從上世紀(jì)80年代XILINX發(fā)明第一款FPGA芯片以來(lái),FPGA就以其體系結(jié)構(gòu)和邏輯單元靈活,運(yùn)算速度快,編程方便等優(yōu)點(diǎn)廣泛應(yīng)用與IC設(shè)計(jì)、系統(tǒng)控制、視頻處理、通信系統(tǒng)、航空航天等諸多方面。 本文利用ALTERA的一款高端FPGA芯片EP2S180F1508C3為核心,配合Silicon Image的專(zhuān)用HDMI接收芯片搭建了一個(gè)HDMI的接收顯示平臺(tái)。針對(duì)HDMI帶寬寬,數(shù)據(jù)量大的特點(diǎn),使用了新型的DDR2 SDRAM作為視頻信號(hào)的輸入和輸出緩沖。在硬件板級(jí)設(shè)計(jì)上,針對(duì)HDMI和DDR2的相關(guān)高速電路,采用了一系列的高速電路設(shè)計(jì)方法,有效的避免了信號(hào)的反射,串?dāng)_等不良現(xiàn)象。同時(shí)在對(duì)HDMI規(guī)范和DDR2 SDRAM時(shí)序規(guī)范的深入研究的基礎(chǔ)上,在ALTERA的開(kāi)發(fā)平臺(tái)QUARTUSII上編寫(xiě)了系統(tǒng)的頂層模塊和相關(guān)各功能子模塊,并仿真通過(guò)。 論文的主要工作和創(chuàng)新點(diǎn)表現(xiàn)在以下幾個(gè)方面: 1、論文研究了最新的HDMI接口規(guī)范和新型存儲(chǔ)器件DDR2的時(shí)序規(guī)范。 2、論文搭建的整個(gè)系統(tǒng)相當(dāng)龐大,涉及到相關(guān)的規(guī)范、多種芯片的資料、各種工具軟件的使用、原理圖的繪制和PCB板的布局布線,直至后期的編程仿真,花費(fèi)了作者大量的時(shí)間和精力。 3、論文首次使用FPGA來(lái)處理HDMI信號(hào)且直接驅(qū)動(dòng)顯示器件,區(qū)別于-般的ASIC方案。 4、論文對(duì)高速電路特別是的DDR2布局布線,采用了一系列的專(zhuān)門(mén)措施,具有一定的借鑒價(jià)值。

    標(biāo)簽: FPGA HDMI 顯示系統(tǒng)

    上傳時(shí)間: 2013-07-28

    上傳用戶(hù):xiaoxiang

  • 基于FPGA的圖像處理算法研究及硬件設(shè)計(jì).rar

    隨著圖像分辨率的越來(lái)越高,軟件實(shí)現(xiàn)的圖像處理無(wú)法滿足實(shí)時(shí)性的需求;同時(shí)FPGA等可編程器件的快速發(fā)展使得硬件實(shí)現(xiàn)圖像處理變得可行。如今基于FPGA的圖像處理研究成為了國(guó)內(nèi)外的一個(gè)熱門(mén)領(lǐng)域。 本文在FPGA平臺(tái)上,用Verilog HDL實(shí)現(xiàn)了一個(gè)研究圖像處理算法的可重復(fù)配置的硬件模塊架構(gòu),架構(gòu)包括PC機(jī)預(yù)處理和通信軟件,控制模塊,計(jì)算單元,存儲(chǔ)器模塊和通信適配模塊五個(gè)部分。其中的計(jì)算模塊負(fù)責(zé)具體算法的實(shí)現(xiàn),根據(jù)不同的圖像處理算法可以獨(dú)立實(shí)現(xiàn)。架構(gòu)為計(jì)算模塊實(shí)現(xiàn)了一個(gè)可添加、移出接口,不同的算法設(shè)計(jì)只要符合該接口就可以方便的加入到模塊架構(gòu)中來(lái)進(jìn)行調(diào)試和運(yùn)行。 在硬件架構(gòu)的基礎(chǔ)上本文實(shí)現(xiàn)了排序?yàn)V波,中值濾波,卷積運(yùn)算及高斯濾波,形態(tài)學(xué)算子運(yùn)算等經(jīng)典的圖像處理算法。討論了FPGA的圖像處理算法的設(shè)計(jì)方法及優(yōu)化策略,通過(guò)性能分析,F(xiàn)PGA實(shí)現(xiàn)圖像處理在時(shí)間上比軟件處理有了很大的提高;通過(guò)結(jié)果的比較,發(fā)現(xiàn)FPGA的處理結(jié)果達(dá)到了軟件處理幾乎同等的效果水平。最后本文在實(shí)現(xiàn)較大圖片處理和圖像處理窗口的大小可配置性方面做了一定程度的討論和改進(jìn),提高了算法的可用性,同時(shí)為進(jìn)一步的研究提供了更加便利的平臺(tái)。 整個(gè)設(shè)計(jì)都是在ISE8.2和ModelSim第三方仿真軟件環(huán)境下開(kāi)發(fā)的,在xilinx的Spartan-3E XC3S500E硬件平臺(tái)上實(shí)現(xiàn)。在軟件仿真過(guò)程中利用了ISE8.2自帶仿真工具和ModelSim結(jié)合使用。 本課題為制造FPGA的專(zhuān)用圖像處理芯片做了有益的探索性研究,為實(shí)現(xiàn)FPGA為核心處理芯片的實(shí)時(shí)圖像處理系統(tǒng)有著積極的作用。

    標(biāo)簽: FPGA 圖像處理 算法研究

    上傳時(shí)間: 2013-07-29

    上傳用戶(hù):愛(ài)順不順

  • GAL器件的開(kāi)發(fā)與應(yīng)用.rar

    GAL器件的開(kāi)發(fā)與應(yīng)用.rar GAL器件的開(kāi)發(fā)與應(yīng)用.rar

    標(biāo)簽: GAL 器件

    上傳時(shí)間: 2013-07-14

    上傳用戶(hù):feichengweoayauya

  • LED電源驅(qū)動(dòng)器測(cè)試解決方案

    發(fā)光二極體(Light Emitting Diode, LED)為半導(dǎo)體發(fā)光之固態(tài)光源。它成為具省電、輕巧、壽命長(zhǎng)、環(huán)保(不含汞)等優(yōu)點(diǎn)之新世代照明光源。目前LED已開(kāi)始應(yīng)用於液晶顯示

    標(biāo)簽: LED 電源 方案 驅(qū)動(dòng)器

    上傳時(shí)間: 2013-04-24

    上傳用戶(hù):王慶才

  • 一種基于SIFT描述子的特征匹配新算法

    為了克服傳統(tǒng)的局部特征匹配算法對(duì)噪聲和圖像灰度非線性變換敏感的不足,提出了基于SIFT(Scale Invariant Feature Transform)描述算子的特征匹配算法。該算法首先

    標(biāo)簽: SIFT 特征匹配 新算法

    上傳時(shí)間: 2013-04-24

    上傳用戶(hù):hphh

  • FPGA的測(cè)試

    隨著FPGA(FieldProgrammableGateArray)器件的應(yīng)用越來(lái)越廣泛且重要,F(xiàn)PGA的測(cè)試技術(shù)也得到了廣泛重視和研究。基于FPGA可編程的特性,應(yīng)用獨(dú)立的測(cè)試(工廠測(cè)試)需要設(shè)計(jì)數(shù)個(gè)測(cè)試編程和測(cè)試向量來(lái)完成FPGA的測(cè)試,確保芯片在任何用戶(hù)可能的編程下都可靠工作。 本論文正是針對(duì)上述問(wèn)題,以XilinxXC4000E系列FPGA為主要的研究對(duì)象,在詳細(xì)研究FPGA內(nèi)部結(jié)構(gòu)的基礎(chǔ)上,基于“分治法”的基本思路對(duì)FPGA的測(cè)試?yán)碚摵头椒ㄗ隽颂剿餍匝芯俊?研究完成了對(duì)可編程邏輯模塊(ConfigrableLogicBlock)及其子模塊的測(cè)試。主要基于“分治法”對(duì)CLB及其子模塊進(jìn)位邏輯(CLM)、查找表(LUT)的RAM工作模式等進(jìn)行了測(cè)試劃分,分別實(shí)現(xiàn)了以“一維陣列”為基礎(chǔ)的測(cè)試配置和測(cè)試向量,以較少了測(cè)試編程次數(shù)完成了所有CLB資源的測(cè)試。 研究完成了對(duì)互連資源(ConfigrableInterconnectResource)的測(cè)試。基于普通數(shù)據(jù)總線的測(cè)試方法,針對(duì)互連資源主要由線段和NMOS開(kāi)關(guān)管組成的特點(diǎn)及其自身的故障模型,通過(guò)手工連線實(shí)現(xiàn)測(cè)試配置,僅通過(guò)4次編程就實(shí)現(xiàn)了對(duì)其完全測(cè)試。 在測(cè)試?yán)碚撗芯康幕A(chǔ)上,我們開(kāi)發(fā)了能對(duì)FPGA器件進(jìn)行實(shí)際測(cè)試的測(cè)試平臺(tái)。基于硬件仿真器的測(cè)試平臺(tái)通過(guò)高速光纖連接工作站上的EDA仿真軟件,把軟件語(yǔ)言描述的測(cè)試波形通過(guò)硬件仿真器轉(zhuǎn)化為真實(shí)測(cè)試激勵(lì),測(cè)試響應(yīng)再讀回到仿真軟件進(jìn)行觀察,能夠靈活、快速的完成FPGA器件的配置和測(cè)試。該平臺(tái)在國(guó)內(nèi)首次實(shí)現(xiàn)了軟硬件協(xié)同在線測(cè)試FPGA。在該平臺(tái)支持下,我們成功完成了對(duì)各軍、民用型號(hào)FPGA的測(cè)試任務(wù)。 本研究成果為國(guó)內(nèi)自主研發(fā)FPGA器件提供了有力保障,具有重大科研與實(shí)踐價(jià)值,成功解決了國(guó)外公司在FPGA測(cè)試技術(shù)上的壟斷問(wèn)題,幫助國(guó)產(chǎn)FPGA器件實(shí)現(xiàn)完全國(guó)產(chǎn)化。

    標(biāo)簽: FPGA 測(cè)試

    上傳時(shí)間: 2013-05-17

    上傳用戶(hù):wangyi39

  • 嵌入式USB總線器件端處理器的FPGA實(shí)現(xiàn)研究

      本文提出了一種適合于嵌入式SoC的USB器件端處理器的硬件實(shí)現(xiàn)結(jié)構(gòu)。并主要研究了USB器件端處理器的RTL級(jí)實(shí)現(xiàn)及FPGA原型驗(yàn)證、和ASIC實(shí)現(xiàn)研究,包括從模型建立、算法仿真、各個(gè)模塊的RTL級(jí)設(shè)計(jì)及仿真、FPGA的下載測(cè)試和ASIC的綜合分析。它的速度滿足預(yù)定的48MHz,等效門(mén)面積不超過(guò)1萬(wàn)門(mén),完全可應(yīng)用于SOC設(shè)計(jì)中。  本文重點(diǎn)對(duì)嵌入式USB器件端處理器的FPGA實(shí)現(xiàn)作了研究。為了準(zhǔn)確測(cè)試本處理器的運(yùn)行情況,本文應(yīng)用串口傳遞測(cè)試數(shù)據(jù)入FPGA開(kāi)發(fā)板,測(cè)試模塊讀入測(cè)試數(shù)據(jù),發(fā)送入PC機(jī)的主機(jī)端。通過(guò)NI-VISA充當(dāng)軟件端,檢驗(yàn)測(cè)試數(shù)據(jù)的正確。     

    標(biāo)簽: FPGA USB 嵌入式 器件

    上傳時(shí)間: 2013-07-24

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