DSP芯片SCI模塊在電力電子控制裝置中的應用
上傳時間： 2013-11-23
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海爾芯片程序模塊
上傳時間： 2014-12-28
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介紹了16bit立體聲數(shù)字音頻信號編解碼器CS4218與DSP56F826芯片組成的音頻信號數(shù)字處理接口，給出了相應的應用電路接口設計和部分軟件框圖。
上傳時間： 2013-11-16
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設計一種應用于某全地形ATV車載武器裝置中的中控系統(tǒng)，該系統(tǒng)設計是以TMS320F2812型DSP為核心，采用模塊化設計思想，對其硬件部分進行系統(tǒng)設計，能夠完成對武器裝置高低、回轉(zhuǎn)方向的運動控制，實現(xiàn)靜止或行進狀態(tài)中對目標物的測距，自動瞄準以及按既定發(fā)射模式發(fā)射彈丸和各項安全性能檢測等功能。通過編制相應的軟件，對其進行系統(tǒng)調(diào)試，驗證了該設計運行穩(wěn)定。 Abstract: A central control system applied to an ATV vehicle weapons is designed. The system design is based on TMS320F2812 DSP as the core， uses modular design for its hardware parts. The central control system can complete the motion control of the level of weapons and equipment， rotation direction， to achieve a state of static or moving objects on the target ranging， auto-targeting and according to the established target and the projectile and the launch of the security performance testing and other functions. Through the development of appropriate software and to carry out system testing to verify the stability of this design and operation.
標簽： ATV-ATT DSP 中控系統(tǒng)
上傳時間： 2013-11-02
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FPGA-CPLD芯片設置方法
上傳時間： 2013-10-28
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電子發(fā)燒友網(wǎng)訊： Altera公司 28nm FPGA系列芯片共包括三大系列：Stratix V、Arria V與Cyclone V系列芯片。近日，Altera公司也正式宣布該三大系列芯片已全部開始量產(chǎn)出貨。Altera公司憑借著其28nm FPGA芯片在性能和成本上的優(yōu)勢，未來的前景勢必無法估量。通過本文對Altera公司 28nm FPGA系列芯片的基本性能、市場優(yōu)勢、型號差異以及典型應用等介紹，電子發(fā)燒友網(wǎng)小編將帶領大家一起來感受Altera公司28nm FPGA系列芯片的“雄韜偉略”，深入闡述如何更好地為你未來的設計選擇相應的Altera 28nm FPGA 芯片。
上傳時間： 2013-11-21
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Arria V系列 FPGA芯片基本描述 （1）28nm FPGA，在成本、功耗和性能上達到均衡； （2）包括低功耗6G和10G串行收發(fā)器； （3）總功耗比6G Arria II FPGA低40%； （4）豐富的硬核IP模塊，提高了集成度 （5）目前市場上支持10.3125Gbps收發(fā)器技術、功耗最低的中端FPGA。
上傳時間： 2013-10-26
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賽靈思FPGA芯片論文，值得一看。
上傳時間： 2014-12-28
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在點對多點主從通信系統(tǒng)中,需要合適的接口形式和通信協(xié)議實現(xiàn)主站與各從站的信息交換。RS -485 接口是適合這種需求的一種標準接口形式。當選擇主從多點同步通信方式時,工作過程與幀格式符合HDLC/SDLC協(xié)議。介紹了采用VHDL 語言在FPGA 上實現(xiàn)的以HDLC/ SDLC 協(xié)議控制為基礎的RS - 485 通信接口芯片。實驗表明,這種接口芯片操作簡單、體積小、功耗低、可靠性高,極具實用價值。
上傳時間： 2013-11-02
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賽靈思推出業(yè)界首款自動化精細粒度時鐘門控解決方案，該解決方案可將 Virtex®-6 和 Spartan®-6 FPGA 設計方案的動態(tài)功耗降低高達 30%。賽靈思智能時鐘門控優(yōu)化可自動應用于整個設計，既無需在設計流程中添加更多新的工具或步驟，又不會改變現(xiàn)有邏輯或時鐘，從而避免設計修改。此外，在大多數(shù)情況下，該解決方案都能保留時序結(jié)果。
上傳時間： 2013-11-16
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