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電磁發(fā)射器的原理

分級變頻調壓軟起動器的設計與仿真研究.rar

異步電動機的軟起動研究，是一項重要的研究課題。本文以分級變頻理論為基礎，利用數(shù)學分析的方法對分級變頻的子頻率系統(tǒng)進行了深入的研究，總結了各級子頻率系統(tǒng)的電壓相序情況以及最優(yōu)的觸發(fā)角度。并且對傳統(tǒng)異步電動機軟起動器的主電路結構進行了改進，提出了從較低頻率開始分五級起動的分級變頻調壓軟起動形式，而且各級子頻率的起動都能實現(xiàn)最優(yōu)的正序電壓組合，保證了起動轉矩的最大化。通過對分級變頻調壓軟起動形式的建模和仿真試驗，證明了此方法可以在降低起動電流的同時實現(xiàn)異步電機的高轉矩起動，驗證了此方法的有效性和可行性?；谝陨涎芯康某晒?，本文介紹了以TMS320LF2407ADSP芯片為核心的軟起動軟硬件設計方法。最后對本課題的進一步研究提出了展望。

標簽： 分級仿真研究頻調

上傳時間： 2013-04-24

上傳用戶：assss
一種新穎的隔離型軟開關Boost變換器的研究.rar

交錯并聯(lián)反激變換器具有電路結構簡單，控制方便等優(yōu)點，并且可以實現(xiàn)電氣隔離。但是其升壓比不高，變換器中主開關管電壓應力較大，且工作中開關管處于硬開關狀態(tài)，限制了變換器的效率。針對交錯并聯(lián)反激變換器所存在的問題，本文提出了一種新穎的基于耦合電感第三繞組實現(xiàn)的原邊并聯(lián)、副邊并聯(lián)隔離型軟開關Boost變換器。該變換器繼承了交錯并聯(lián)反激變換器的優(yōu)點，兩個并聯(lián)單元互補工作，分擔功率損耗，輸出電壓的脈動頻率為主開關管的兩倍。不同的是，該變換器具有較高的升壓比，變換器中主開關管的電壓應力較小，克服了交錯并聯(lián)反激變換器的問題。在軟開關方面，變換器使用有源箝位軟開關電路，使主開關管與箝位開關管都實現(xiàn)了零電壓軟開關動作，提高了變換器的效率與使用壽命。因此，它與交錯并聯(lián)反激變換器相比，更適合于低電壓輸入、高電壓輸出的應用變換場合。在該變換器的基礎上，針對變換器中輸出二極管電壓電流振蕩較大，本文還提出了經(jīng)過改進的引入輸出箝位電容的變換器。輸出箝位電容抑制了二極管兩端電壓的振蕩，減小了二極管的電壓應力，提高了變換器的效率。最后，本文通過仿真與實驗驗證了基于耦合電感第三繞組實現(xiàn)的原邊并聯(lián)、副邊并聯(lián)隔離型軟開關Boost變換器及其改進型變換器方案的可行性與合理性。

標簽： Boost 隔離型軟開關

上傳時間： 2013-05-20

上傳用戶：chenlong
單相光伏并網(wǎng)逆變器的研究.rar

逆變器作為光伏陣列和電網(wǎng)接口的主要設備，它的性能決定著整個光伏發(fā)電系統(tǒng)的性能。為了將光伏陣列產(chǎn)生的電能最大限度地饋入電網(wǎng)，并提高其運行的穩(wěn)定度、可靠性和精確度，必須對并網(wǎng)逆變器的主電路拓撲選擇、濾波器參數(shù)設計及其控制策略選取等進行深入研究。論文首先分析了光伏發(fā)電的國內(nèi)外發(fā)展現(xiàn)狀和應用前景，對光伏并網(wǎng)發(fā)電系統(tǒng)的種類、結構和并網(wǎng)標準進行了綜述。針對眾多適用于光伏并網(wǎng)的逆變器拓撲進行了詳細的比較分析，最終確定了一臺單相滿載功率1kW、并網(wǎng)電壓220V的逆變器拓撲及其主電路參數(shù)，對其輸出濾波器參數(shù)進行設計，并對其進行了幅頻特性分析。其次，詳細分析和研究逆變器的并網(wǎng)控制策略，確定了在獨立工作模式下的瞬時電壓控制策略和在并網(wǎng)工作模式下的瞬時電流控制策略。根據(jù)選定的控制策略分別對其控制系統(tǒng)進行了建模和閉環(huán)參數(shù)設計，并利用Sabet軟件進行系統(tǒng)仿真，驗證了系統(tǒng)建模和設計的正確性。接著，在分析光伏陣列特性的基礎上，總結和比較了常用的幾種MPPT（Maximum Power Point Tracking）控制方法，通過擾動觀測法對并網(wǎng)逆變器輸出電流的控制，實現(xiàn)了光伏陣列的MPPT，并給出了設計方案和實驗驗證。最后，根據(jù)以上分析結果，研制了一臺基于DSP控制的光伏并網(wǎng)逆變器的試驗樣機，并詳述了其軟硬件的設計方案，給出了相關實驗結果。

標簽： 單相光伏并網(wǎng) 逆變器

上傳時間： 2013-04-24

上傳用戶：天天天天
一種單相交流斬波變換器的研究.rar

本文致力于可并聯(lián)運行的斬控式單相交流斬波變換器的研究。交交變換技術作為電力電子技術一個重要的領域一直得到人們的關注，但大都將目光投向AC-DC-AC兩級變換上面。AC/AC直接變換具有單級變換、功率密度高、拓撲緊湊簡單、并聯(lián)容易等優(yōu)勢，并且具有較強擴展性，故而在工業(yè)加熱、調光電源、異步電機啟動、調速等領域具有重要應用。斬控式AC/AC 電壓變換是一種基于自關斷半導體開關器件及脈寬調制控制方式的新型交流調壓技術。本文對全數(shù)字化的斬控式AC/AC 變換做了系統(tǒng)研究，工作內(nèi)容主要有：對交流斬波電路的拓撲及其PWM方式做了詳細的推導，著重對不同拓撲的死區(qū)效應進行了分析，并且推導了不同負載情況對電壓控制的影響。重點推導了單相Buck型變換器和Buck-Boost 變換器的拓撲模型，并將單相系統(tǒng)的拓撲開關模式推導到三相的情況，然后分別對單相、三相的情況進行了Matlab仿真。建立了單相Buck 型拓撲的開關周期平均意義下的大信號模型和小信號模型，指導控制器的設計。建立了適合電路工作的基于占空比前饋的電壓瞬時值環(huán)、電壓平均值環(huán)控制策略。在理論分析和仿真驗證的基礎上，建立了一臺基于TMS320F2808數(shù)字信號處理器的實驗樣機，完成樣機調試，并完成各項性能指標的測試工作。

標簽： 單相交流斬波變換器

上傳時間： 2013-04-24

上傳用戶：visit8888
MSP430定時器的使用.rar

MSP430定時器的使用，有詳細的例子程序和講解，是新手學習的好資料哦

標簽： MSP 430 定時器

上傳時間： 2013-07-08

上傳用戶：西伯利亞狼
本質安全型單端反激變換器的分析與設計.rar

應用于煤礦、石化等易燃易爆環(huán)境的電子設備必須滿足防爆的要求，本質安全型是最佳的防爆形式。本質安全型開關電源具有重量輕、體積小、制造工藝簡單、成本低、安全性能高等優(yōu)點，因而具有廣闊的發(fā)展前景。單端反激變換器是開關變換器的一種基本的拓撲結構，在實際中應用比較廣泛，因此對單端反激變換器進行本質安全特性分析是本質安全開關電源設計的重要基礎。本質安全型開關變換器的設計，主要是對變換器中的儲能元件進行設計，即變換器中的電感和輸出濾波電容進行設計。本文對變換器的靜態(tài)特性進行了深入分析，指出反激變換器存在三種工作模式：CISM-CCM、IISM-CCM和DCM：得出了變換器工作在整個動態(tài)范圍內(nèi)的最大輸出紋波電壓、最大電感電流和最大輸出短路釋放能量。對單端反激變換器的本質安全特性進行了分析，得出輸出本質安全型單端反激變換器的非爆炸判斷方法，并通過安全火花試驗裝置對變換器進行爆炸性試驗，驗證了輸出本安判據(jù)的正確性。得出輸出本質安全型單端反激變換器的設計方法，以同時滿足輸出紋波電壓和輸出本安要求作為約束條件，得到了本質安全型單端反激變換器電感、電容參數(shù)的設計范圍。給出了具體實例，并進行仿真和試驗研究，仿真和實驗結果驗證了理論分析的正確性和設計方法的可行性。

標簽： 本質安全單端反激分

上傳時間： 2013-06-25

上傳用戶：水中浮云
基于DSP控制的三電平逆變器的研究.rar

高壓變頻調速技術節(jié)能效果顯著，多電平逆變器是其常用的一種電路拓撲形式。三電平逆變器能降低功率器件耐壓要求、降低諧波含量，普遍地采用電壓空間矢量脈寬調制的控制策略。將DSP數(shù)字控制技術應用于三電平逆變器不僅簡化了系統(tǒng)的硬件結構，提高系統(tǒng)性能，還可以實現(xiàn)系統(tǒng)的優(yōu)化控制。本文首先簡要介紹了三電平逆變器的拓撲結構和控制策略，并闡述了二極管箝位式三電平逆變器電路結構和電壓空間矢量脈寬調制控制策略的實現(xiàn)方法。在此基礎上，通過對逆變器的工作過程分析，建立了逆變器的數(shù)學模型。并提出了一種能控制逆變器直流側電容中點電位平衡并且能降低開關損耗的電壓空間矢量脈寬調制方法。本文在綜述人工神經(jīng)網(wǎng)絡技術的基礎上，提出一種基于復合人工神經(jīng)網(wǎng)絡的電壓空間矢量脈寬調制算法，充分利用人工神經(jīng)網(wǎng)絡的快速并行處理能力、學習能力，縮短了計算時間，降低了由控制延時引起的諧波成分。最后在MATIAB/Simulink環(huán)境下，結合ANN工具箱建立了仿真模型。仿真結果證明了基于復合人工神經(jīng)網(wǎng)絡算法的可行性。本文進行了三電平逆變器的主電路、開關器件驅動電路、電流電壓檢測電路和保護電路等的設計。根據(jù)三電平逆變器主電路功率開關多，驅動信號不能共地的特點，本文設計一種利用光耦隔離驅動功率開關器件的驅動保護電路，降低電磁干擾，并在過流等異常情況下實時保護功率開關器件。最后以TMS320LF2407DSP為數(shù)字控制平臺，實現(xiàn)了三電平逆變器的電壓空間矢量脈寬調制控制策略。

標簽： DSP 控制三電平逆變器

上傳時間： 2013-07-07

上傳用戶：natopsi
基于FPGA的RS255，223編解碼器的高速并行實現(xiàn).rar

隨著信息時代的到來，用戶對數(shù)據(jù)保護和傳輸可靠性的要求也在不斷提高。由于信道衰落，信號經(jīng)信道傳輸后，到達接收端不可避免地會受到干擾而出現(xiàn)信號失真。因此需要采用差錯控制技術來檢測和糾正由信道失真引起的信息傳輸錯誤。RS（Reed—Solomon）碼是差錯控制領域中一類重要的線性分組碼，由于它編解碼結構相對固定，性能強，不但可以糾正隨機差錯，而且對突發(fā)錯誤的糾錯能力也很強，被廣泛應用在數(shù)字通信、數(shù)據(jù)存儲系統(tǒng)中，以滿足對數(shù)據(jù)傳輸通道可靠性的要求。因此設計一款高性能的RS編解碼器不但具有很大的應用意義，而且具有相當大的經(jīng)濟價值。本文首先介紹了線形分組碼及其子碼循環(huán)碼、BCH碼的基礎理論知識，重點介紹了BCH碼的重要分支RS碼的常用編解碼算法。由于其算法在有限域上進行，接著介紹了有限域的有關理論?；赗S碼傳統(tǒng)的單倍結構，本文提出了一種八倍并行編碼及九倍并行解碼方案，并用Verilog HDL語言實現(xiàn)。其中編碼器基于傳統(tǒng)的線性反饋移位寄存器除法電路并進行八倍并行擴展，譯碼器關鍵方程求解模塊基于修正的歐幾里德算法設計了一種便于硬件實現(xiàn)的脈動關鍵方程求解結構，其他模塊均采用九倍并行實現(xiàn)。由于進行了超前運算、流水線及并行處理，使編解碼的數(shù)據(jù)吞吐量大為提高，同時延時更小。本論文設計了C++仿真平臺，并與HDL代碼結果進行了對比驗證。Verilog HDL代碼經(jīng)過modelsim仿真驗證，并在ALTERA STRATIX3 EP3SL15OF1152C2 FPGA上進行綜合驗證以及靜態(tài)時序分析，綜合軟件為QUATURSⅡ V8．0。驗證及測試表明，本設計在滿足編解碼基本功能的基礎上，能夠實現(xiàn)數(shù)據(jù)的高吞吐量和低延時傳輸，達到性能指標要求。本論文在基于FPGA的RS（255，223）編解碼器的高速并行實現(xiàn)方面的研究成果，具有通用性、可移植性，有一定的理論及經(jīng)濟價值。

標簽： FPGA 255 223

上傳時間： 2013-04-24

上傳用戶：思琦琦
MPEG2視頻解碼器的FPGA設計.rar

MPEG-2是MPEG組織在1994年為了高級工業(yè)標準的圖象質量以及更高的傳輸率所提出的視頻編碼標準，其優(yōu)秀性使之成為過去十年應用最為廣泛的標準，也是未來十年影響力最為廣泛的標準之一。本文以MPEG-2視頻標準為研究內(nèi)容，建立系統(tǒng)級設計方案，設計FPGA原型芯片，并在FPGA系統(tǒng)中驗證視頻解碼芯片的功能。最后在0.18微米工藝下實現(xiàn)ASIC的前端設計。完成的主要工作包括以下幾個方面： 1.完成解碼系統(tǒng)的體系結構的設計，采用了自頂而下的設計方法，實現(xiàn)系統(tǒng)的功能單元的劃分；根據(jù)其視頻解碼的特點，確定解碼器的控制方式；把視頻數(shù)據(jù)分文幀內(nèi)數(shù)據(jù)和幀間數(shù)據(jù)，實現(xiàn)兩種數(shù)據(jù)的并行解碼。 2.實現(xiàn)了具體模塊的設計：根據(jù)本文研究的要求，在比特流格式器模塊設計中提出了特有的解碼方式；在可變長模塊中的變長數(shù)據(jù)解碼采用組合邏輯外加查找表的方式實現(xiàn)，大大減少了變長數(shù)據(jù)解碼的時間；IQ、IDCT模塊采用流水的設計方法，減少數(shù)據(jù)計算的時間：運動補償模塊，針對模塊數(shù)據(jù)運算量大和訪問幀存儲器頻繁的特點，采用四個插值單元同時處理，增加像素緩沖器，充分利用并行性結構等方法來加快運動補償速度。 3.根據(jù)視頻解碼的參考軟件，通過解碼系統(tǒng)的仿真結果和軟件結果的比較來驗證模塊的功能正確性。最后用FPGA開發(fā)板實現(xiàn)了解碼系統(tǒng)的原型芯片驗證，取得了良好的解碼效果。整個設計采用Verilog HDL語言描述，通過了現(xiàn)場可編程門陣列(FPGA)的原型驗證，并采用SIMC0.18μm工藝單元庫完成了該電路的邏輯綜合。經(jīng)過實際視頻碼流測試，本文設計可以達到MPEG-2視頻主類主級的實時解碼的技術要求。

標簽： MPEG2 FPGA 視頻解碼器

上傳時間： 2013-07-27

上傳用戶：ice_qi
MP3音頻解碼器的FPGA原型芯片設計與實現(xiàn).rar

MP3音樂是目前最為流行的音樂格式，因其音質、復雜度與壓縮比的完美折中，占據(jù)著廣闊的市場，不僅在互聯(lián)網(wǎng)上廣為流傳，而且在便攜式設備領域深受人們喜愛。本文以MPEG-1的MP3音頻解碼器為研究對象，在實時性、面積等約束條件下，研究MP3解碼電路的設計方法，實現(xiàn)FPGA原型芯片，研究MP3原型芯片的驗證方法。論文的主要貢獻如下： (1)使用算法融合方法合并MP3解碼過程的相關步驟，以減少緩沖區(qū)存儲單元的容量和訪存次數(shù)。如把重排序步驟融合到反量化模塊，可以減少一半的讀寫RAM操作；把IMDCT模塊內(nèi)部的三個算法步驟融合在一起進行設計，可以省去存儲中間計算結果的緩存區(qū)單元。 (2)反量化、立體聲處理等模塊中，采用流水線設計技術，設置寄存器把較長的組合邏輯路徑隔開，提高了電路的性能和可靠性；使用連續(xù)訪問公共緩存技術，合理規(guī)劃各計算子模塊的工作時序，將數(shù)據(jù)計算的時間隱藏在訪存過程中；充分利用頻率線的零值區(qū)特性，有效地減少數(shù)據(jù)計算量，加快了數(shù)據(jù)處理的速度。 (3)設計了MP3硬件解碼器的FPGA原型芯片。采用Verilog HDL硬件描述語言設計RTL級電路，完成功能仿真，以Altera公司Stratix II系列的EP2S180 FPGA開發(fā)板為平臺，實現(xiàn)MP3解碼器的FPGA原型芯片。MP3硬件解碼器在Stratix II EP2S180器件內(nèi)的資源利用率約為5％，其中組合邏輯查找表ALUT為7189個，寄存器共有4024個，系統(tǒng)頻率可達69.6MHz，充分滿足了MP3解碼過程的實時性要求。實驗結果表明，MP3音頻解碼FPGA原型芯片可正常播放聲音，解碼音質良好。

標簽： FPGA MP3 音頻解碼器

上傳時間： 2013-07-01

上傳用戶：xymbian

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