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電能監(jiān)控器

  • 基于ARM控制的新型零電壓零電流全橋DCDC變換器的研制

    軟開關(guān)技術(shù)是電力電子裝置向高頻化、高功率密度化發(fā)展的關(guān)鍵技術(shù),已成為現(xiàn)代電力電子技術(shù)研究的熱點之一。微處理器的出現(xiàn)促進了電力電子變換器的控制技術(shù)從傳統(tǒng)的模擬控制轉(zhuǎn)向數(shù)字控制,數(shù)字控制技術(shù)可使控制電路大為簡化,并能提高系統(tǒng)的抗干擾能力、控制靈活性、通用性以及智能化程度。本文提出了一種利用耦合輸出電感的新型次級箝位ZVZCS PWM DC/DC變換器,其反饋控制采用數(shù)字化方式。 論文分析了該新型變換器的工作原理,推導了變換器各種狀態(tài)時的參數(shù)計算方程;設(shè)計了以ARW芯片LPC2210為核心的數(shù)字化反饋控制系統(tǒng),通過軟件設(shè)計實現(xiàn)了PWM移相控制信號的輸出;運用Pspice9.2軟件成功地對變換器進行了仿真,分析了各參數(shù)對變換器性能的影響,并得出了變換器的優(yōu)化設(shè)計參數(shù);最后研制出基于該新型拓撲和數(shù)字化控制策略的1千瓦移相控制零電壓零電流軟開關(guān)電源,給出了其主電路、控制電路、驅(qū)動電路、保護電路及高頻變壓器等的設(shè)計過程,并在實驗樣機上測量出了實際運行時的波形。 理論分析與實驗結(jié)果表明:該變換器拓撲能實現(xiàn)超前橋臂的零電壓開關(guān),滯后橋臂的零電流開關(guān);采用ARM微控制器進行數(shù)字控制,較傳統(tǒng)的純模擬控制實時反應(yīng)速度更快、電源穩(wěn)壓性能更好、外圍電路更簡單、設(shè)計更靈活等,為實現(xiàn)智能化數(shù)字電源創(chuàng)造了基礎(chǔ),具有廣泛的應(yīng)用前景和巨大的經(jīng)濟價值。

    標簽: DCDC ARM 控制 全橋

    上傳時間: 2013-08-03

    上傳用戶:cc1

  • ARM體系的嵌入式工控一體機

    隨著嵌入式控制在工業(yè)領(lǐng)域的不斷滲入,進入21世紀之后,基于ARM體系Linux操作系統(tǒng)的嵌入式一體化工業(yè)控制系統(tǒng)成為了工業(yè)控制的主要發(fā)展方向,ARM芯片不僅體積小,功耗低,而且功能強;Linux由于其開源,穩(wěn)定以及成本低的優(yōu)點,在嵌入式系統(tǒng)中得到了廣泛的應(yīng)用。 本文研究的主要內(nèi)容是基于Linux操作系統(tǒng)ARM體系的嵌入式工控一體機設(shè)計與實現(xiàn)。該嵌入式工控一體機是基于Motorola公司研發(fā)的ARM9嵌入式系統(tǒng)和Linux操作系統(tǒng)的設(shè)備,整個系統(tǒng)體積小,結(jié)構(gòu)精簡,并有很高的執(zhí)行效率。它根據(jù)特定的工業(yè)控制對象定制特定的模型與控制算法。另外,該設(shè)備自身還具備各種數(shù)字PID控制算法,實現(xiàn)PID閉環(huán)控制。可以應(yīng)用于工業(yè)控制領(lǐng)域中的各類被控設(shè)備,以及為高校自動化控制實驗和工業(yè)應(yīng)用研究提供解決方案。它的軟件編程由Qt集成開發(fā)環(huán)境實現(xiàn),Qt是基于C++的針對構(gòu)造圖形用戶界面(程序)所使用的GUI工具包,它速度塊,易于使用,并具有很好的可移植性。 本文首先對嵌入式系統(tǒng)進行選型,然后提出了系統(tǒng)的軟硬件整體架構(gòu)和系統(tǒng)的啟動流程。接著介紹了系統(tǒng)開發(fā)環(huán)境的搭建,包括啟動加載器的設(shè)計和實現(xiàn),Linux內(nèi)核的移植,設(shè)備驅(qū)動程序的編寫以及圖形用戶界面的實現(xiàn)。最后,詳細介紹了一個具有創(chuàng)新性的案例作為該嵌入式Linux工控一體機作為通訊和控制終端的典型應(yīng)用。 該嵌入式Linux工控一體機具有極好的實用性和應(yīng)用前景,并且其設(shè)計和實現(xiàn)過程對于其它嵌入式平臺也具有很好的參考價值。

    標簽: ARM 嵌入式 工控

    上傳時間: 2013-07-27

    上傳用戶:zhaiyanzhong

  • 高效的CABAC解碼器設(shè)計及FPGA實現(xiàn)

    H.264/AVC是ITU與ISO/IEC(International Standard Organization/Intemational Electrotechnical Commission國際標準化組織/國際電工委員會)聯(lián)合推出的活動圖像編碼標準。作為最新的國際視頻編碼標準,H.264/AVC與MPEG-4、H.263等視頻編碼標準相比,性能有了很大提高,并已在流媒體、數(shù)字電視、電話會議、視頻存儲等諸多領(lǐng)域得到廣泛的應(yīng)用。基于上下文的自適應(yīng)二進制算術(shù)編碼(Conrext-based Adaptive Binary Arithmetic Coding,CABAC)是H.264/AVC的兩個熵編碼方案之一,相對于另一熵編碼方案-CAVLC(基于上下文的自適應(yīng)可變長編碼),CABAC具有更高的數(shù)據(jù)壓縮率:在同等編碼質(zhì)量下要比CAVLC提高10%~15%的壓縮率。CABAC能實現(xiàn)很高的數(shù)據(jù)壓縮率,但這是以增加實現(xiàn)的復雜性為代價的。在已有的硬件實現(xiàn)方法上,CABAC的解碼效率并不高。 論文在深入研究CABAC解碼算法及其實現(xiàn)流程,并在仔細分析了H.264/AVC碼流結(jié)構(gòu)的基礎(chǔ)上,總結(jié)出了影響CABAC解碼效率的各個環(huán)節(jié),并以此為出發(fā)點,對CABAC解碼所需中的各個功能模塊進行了優(yōu)化設(shè)計,設(shè)計出一種新的CABAC解碼器結(jié)構(gòu),相對于一般的CABAC解碼器,它的解碼效率得到了顯著提高。論文針對影響CABAC解碼過程的"瓶頸"問題一多次訪問存儲部件影響解碼速率,提出了新的存儲組織方式,并根據(jù)CABAC的碼流結(jié)構(gòu)特性,采用4個子解碼器級聯(lián)的方式來進一步提高解碼速率。 最后,用Verilog語言對所設(shè)計的CABAC解碼器進行了描述,用EDA軟件對其進行了仿真,并在FPGA上驗證了其功能,結(jié)果顯示,該CABAC解碼器結(jié)構(gòu)顯著提高了解碼效率,能夠滿足高檔次實時通訊的要求。

    標簽: CABAC FPGA 解碼器

    上傳時間: 2013-07-03

    上傳用戶:huazi

  • 基于DVD應(yīng)用的RS編譯碼器的研究

    糾錯碼技術(shù)是一種通過增加一定冗余信息來提高信息傳輸可靠性的有效方法。RS碼是一種典型的糾錯碼,在線性分組碼中,它具有最強的糾錯能力,既能糾正隨機錯誤,也能糾正突發(fā)錯誤,在深空通信、移動通信、磁盤陣列、光存儲及數(shù)字視頻廣播(DVB)等系統(tǒng)中具有廣泛的應(yīng)用。 DVD是一種高容量的存儲媒質(zhì)。DVD技術(shù)的應(yīng)用很廣泛,在數(shù)字技術(shù)中占有重要地位。DVD系統(tǒng)中采用里德-所羅門乘積碼(RS-PC:Reed-Solomon ProductCode)進行糾錯,RS碼譯碼器在伺服芯片中具有重要作用。 FPGA在開發(fā)階段具有安全、方便、可隨時修改設(shè)計等不可替代的優(yōu)點,在電子系統(tǒng)中采用FPGA可以極大的提升硬件系統(tǒng)設(shè)計的靈活性,可靠性,同時提高硬件開發(fā)的速度和降低系統(tǒng)的成本。FPGA的固有優(yōu)點使其得到越來越廣泛的應(yīng)用,F(xiàn)PGA設(shè)計技術(shù)也被越來越多的設(shè)計人員所掌握。 本文首先介紹了編碼理論和常用的RS編譯碼算法,提出RS編碼器實現(xiàn)方案,詳細分析了譯碼器的ME算法和改進BM算法的實現(xiàn),針對ME算法提出了一種流水線結(jié)構(gòu)的糾刪糾錯RS譯碼器實現(xiàn)方案,在譯碼器復雜度和延時上作了折衷,降低了譯碼器的復雜度并提高了最高工作頻率,利用有限域乘法器的特性對編譯碼電路進行優(yōu)化。這些技術(shù)的采用大大的提高了RS編譯碼器的效率,節(jié)省了RS編譯碼器占用的資源。在Xilinx公司的Virtex-II系列FPGA上設(shè)計并成功實現(xiàn)了RS(208,192)編譯碼器。

    標簽: DVD RS編譯碼

    上傳時間: 2013-07-20

    上傳用戶:xinshou123456

  • 基于DSP和FPGA的數(shù)字化開關(guān)電源

    文章開篇提出了開發(fā)背景。認為現(xiàn)在所廣泛應(yīng)用的開關(guān)電源都是基于傳統(tǒng)的分立元件組成的。它的特點是頻率范圍窄、電力小、功能少、器件多、成本較高、精度低,對不同的客戶要求來“量身定做”不同的產(chǎn)品,同時幾乎沒有通用性和可移植性。在電子技術(shù)飛速發(fā)展的今天,這種傳統(tǒng)的模擬開關(guān)電源已經(jīng)很難跟上時代的發(fā)展步伐。 隨著DSP、ASIC等電子器件的小型化、高速化,開關(guān)電源的控制部分正在向數(shù)字化方向發(fā)展。由于數(shù)字化,使開關(guān)電源的控制部分的智能化、零件的共通化、電源的動作狀態(tài)的遠距離監(jiān)測成為了可能,同時由于它的智能化、零件的共通化使得它能夠靈活地應(yīng)對不同客戶的需求,這就降低了開發(fā)周期和成本。依靠現(xiàn)代數(shù)字化控制和數(shù)字信號處理新技術(shù),數(shù)字化開關(guān)電源有著廣闊的發(fā)展空間。 在數(shù)字化領(lǐng)域的今天,最后一個沒有數(shù)字化的堡壘就是電源領(lǐng)域。近年來,數(shù)字電源的研究勢頭與日俱增,成果也越來越多。雖然目前中國制造的開關(guān)電源占了世界市場的80%以上,但都是傳統(tǒng)的比較低端的模擬電源。高端市場上幾乎沒有我們份額。 本論文研究的主要內(nèi)容是在傳統(tǒng)開關(guān)電源模擬調(diào)節(jié)器的基礎(chǔ)上,提出了一種新的數(shù)字化調(diào)節(jié)器方案,即基于DSP和FPGA的數(shù)字化PID調(diào)節(jié)器。論文對系統(tǒng)方案和電路進行了較為具體的設(shè)計,并通過測試取得了預期結(jié)果。測試證明該方案能夠適合本行業(yè)時代發(fā)展的步伐,使系統(tǒng)電路更簡單,精度更高,通用性更強。同時該方案也可用于相關(guān)領(lǐng)域。 本文首先分析了國內(nèi)外開關(guān)電源發(fā)展的現(xiàn)狀,以及研究數(shù)字化開關(guān)電源的意義。然后提出了數(shù)字化開關(guān)電源的總體設(shè)計框圖和實現(xiàn)方案,并與傳統(tǒng)的開關(guān)電源做了較為詳細的比較。本論文的設(shè)計方案是采用DSP技術(shù)和FPGA技術(shù)來做數(shù)字化PID調(diào)節(jié),通過數(shù)字化PID算法產(chǎn)生PWM波來控制斬波器,控制主回路。從而取代傳統(tǒng)的模擬PID調(diào)節(jié)器,使電路更簡單,精度更高,通用性更強。傳統(tǒng)的模擬開關(guān)電源是將電流電壓反饋信號做PID調(diào)節(jié)后--分立元器件構(gòu)成,采用專用脈寬調(diào)制芯片實現(xiàn)PWM控制。電流反饋信號來自主回路的電流取樣,電壓反饋信號來自主回路的電壓采樣。再將這兩個信號分別送至電流調(diào)節(jié)器和電壓調(diào)節(jié)器的反相輸入端,用來實現(xiàn)閉環(huán)控制。同時用來保證系統(tǒng)的穩(wěn)定性及實現(xiàn)系統(tǒng)的過流過壓保護、電流和電壓值的顯示。電壓、電流的給定信號則由單片機或電位器提供。再次,文章對各個模塊從理論和實際的上都做了仔細的分析和設(shè)計,并給出了具體的電路圖,同時寫出了軟件流程圖以及設(shè)計中應(yīng)該注意的地方。整個系統(tǒng)由DSP板和ADC板組成。DSP板完成PWM生成、PID運算、環(huán)境開關(guān)量檢測、環(huán)境開關(guān)量生成以及本地控制。ADC板主要完成前饋電壓信號采集、負載電壓信號采集、負載電流信號采集、以及對信號的一階數(shù)字低通濾波。由于整個系統(tǒng)是閉環(huán)控制系統(tǒng),要求采樣速率相當高。本系統(tǒng)采用FPGA來控制ADC,這樣就避免了高速采樣占用系統(tǒng)資源的問題,減輕了DSP的負擔。DSP可以將讀到的ADC信號做PID調(diào)節(jié),從而產(chǎn)生PWM波來控制逆變橋的開關(guān)速率,從而達到閉環(huán)控制的目的。 最后,對數(shù)字化開關(guān)電源和模擬開關(guān)電源做了對比測試,得出了預期結(jié)論。同時也提出了一些需要改進的地方,認為該方案在其他相關(guān)行業(yè)中可以廣泛地應(yīng)用。模擬控制電路因為使用許多零件而需要很大空間,這些零件的參數(shù)值還會隨著使用時間、溫度和其它環(huán)境條件的改變而變動并對系統(tǒng)穩(wěn)定性和響應(yīng)能力造成負面影響。數(shù)字電源則剛好相反,同時數(shù)字控制還能讓硬件頻繁重復使用、加快上市時間以及減少開發(fā)成本與風險。在當前對產(chǎn)品要求體積小、智能化、共通化、精度高和穩(wěn)定度好等前提條件下,數(shù)字化開關(guān)電源有著廣闊的發(fā)展空間。本系統(tǒng)來基本上達到了設(shè)計要求。能夠滿足較高精度的設(shè)計要求。但對于高精度數(shù)字化電源,系統(tǒng)還有值得改進的地方,比如改進主控器,提高參考電壓的精度,提高采樣器件的精度等,都可以提高系統(tǒng)的精度。 本系統(tǒng)涉及電子、通信和測控等技術(shù)領(lǐng)域,將數(shù)字PID算法與電力電子技術(shù)、通信技術(shù)等有機地結(jié)合了起來。本系統(tǒng)的設(shè)計方案不僅可以用在電源控制器上,只要是相關(guān)的領(lǐng)域都可以采用。

    標簽: FPGA DSP 數(shù)字化 開關(guān)電源

    上傳時間: 2013-06-21

    上傳用戶:498732662

  • 基于FPGA的OQPSK調(diào)制解調(diào)器

    偏移正交相移鍵控(OQPSK:Offset Quadrature Phase Shift Keying)調(diào)制技術(shù)是一種恒包絡(luò)調(diào)制技術(shù),具有頻譜利用率高、頻譜特性好等特點,廣泛應(yīng)用于衛(wèi)星通信和移動通信領(lǐng)域。 論文以某型偵收設(shè)備中OQPSK解調(diào)器的全數(shù)字化為研究背景,設(shè)計并實現(xiàn)了基于FPGA的全數(shù)字OQPSK調(diào)制解調(diào)器,其中調(diào)制器主要用于仿真未知信號,作為測試信號源。論文研究了全數(shù)字OQPSK調(diào)制解調(diào)的基本算法,包括成形濾波器、NCO模型、載波恢復、定時恢復等;完成了整個調(diào)制解調(diào)算法的MATLAB仿真。在此基礎(chǔ)上,采用VHDL硬件描述語言在Xilinx公司ISE7.1開發(fā)環(huán)境下設(shè)計并實現(xiàn)了各個算法模塊,并在硬件平臺上加以實現(xiàn)。通過實際現(xiàn)場測試,實現(xiàn)了對所偵收信號的正確解調(diào)。論文還實現(xiàn)了解調(diào)器的百兆以太網(wǎng)接口,使得系統(tǒng)可以方便地將解調(diào)數(shù)據(jù)發(fā)送給計算機進行后續(xù)處理。

    標簽: OQPSK FPGA 調(diào)制解調(diào)器

    上傳時間: 2013-05-19

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  • 基于FPGA的Turbo碼編譯碼器研究與實現(xiàn)

    本文以Turbo碼編譯碼器的FPGA實現(xiàn)為目標,對Turbo碼的編譯碼算法和用硬件語言將其實現(xiàn)進行了深入的研究。 首先,在理論上對Turbo碼的編譯碼原理進行了介紹,確定了Max-log-MAF算法的譯碼算法,結(jié)合CCSDS標準,在實現(xiàn)編碼器時,針對標準中給定的幀長、碼率與交織算法,以及偽隨機序列模塊與幀同步模塊,提出了相應(yīng)解決方案;而在相應(yīng)的譯碼器設(shè)計中,采用了FPGA設(shè)計中“自上而下”的設(shè)計方法,權(quán)衡硬件實現(xiàn)復雜度與處理時延等因素,優(yōu)先考慮面積因素,提高元件的重復利用率和降低電路復雜度,來實現(xiàn)Turbo碼的Max-log-MAP算法譯碼。把整個系統(tǒng)分割成不同的功能模塊,分別闡述了實現(xiàn)過程。 然后,基于Verilog HDL 設(shè)計出12位固點數(shù)據(jù)的Turbo編譯碼器以及仿真驗證平臺,與用Matlab語言設(shè)計的相同指標的浮點數(shù)據(jù)譯碼器進行性能比較,得到該設(shè)計的功能驗證。 最后,研究了Tuxbo碼譯碼器幾項最新技術(shù),如滑動窗譯碼,歸一化處理,停止迭代技術(shù)結(jié)合流水線電路設(shè)計,將改進后的譯碼器與先前設(shè)計的譯碼器分別在ISE開發(fā)環(huán)境中針對目標器件xilinx Virtex-Ⅱ500進行電路綜合,證實了這些改進技術(shù)能有效地提高譯碼器的吞吐量,減少譯碼時延和存儲器面積從而降低功耗。

    標簽: Turbo FPGA 編譯碼器

    上傳時間: 2013-04-24

    上傳用戶:haohaoxuexi

  • 基于FPGA的RS碼編譯碼器的設(shè)計與實現(xiàn)

    研制發(fā)射微小衛(wèi)星,是我國利用空間技術(shù)服務(wù)經(jīng)濟建設(shè)、造福人類的重要途徑。現(xiàn)代微小衛(wèi)星在短短20年里能取得長足的發(fā)展,主要取決于微小衛(wèi)星自身的一系列特點:重量輕,體積小,成本低,性能高,安全可靠,發(fā)射方便、快捷靈活等。在衛(wèi)星通信系統(tǒng)中,由于傳輸信道的多徑和各種噪聲的影響,信號在接收端會引起差錯,通過信道編碼環(huán)節(jié),可對這些不可避免的差錯進行檢測和糾正。 在微小衛(wèi)星通信鏈路中,信道編碼器的任務(wù)是差錯控制。本文采用符合空間數(shù)據(jù)系統(tǒng)咨詢委員會CCSDS標準的鏈接碼進行信道編碼,即內(nèi)碼為(2,1,6)的卷積碼,外碼為(255,223)的RS碼,中間進行交織操作。其中,里德-索羅蒙碼(簡稱RS碼)是一種重要的非二進制BCH碼,是分組碼中糾錯能力最強的糾錯碼,一次可以糾正多個突發(fā)錯誤,廣泛地用于空間通信中。 本文針對南京航空航天大學自行研制的微小衛(wèi)星通信分系統(tǒng)的技術(shù)要求,在用SystemView和C語言仿真的基礎(chǔ)上,用硬件描述語言Verilog設(shè)計了RS(255,223)編碼器和譯碼器,使用Modelsim軟件進行了功能仿真,并通過Xilinx公司的軟件ISE對設(shè)計進行綜合、布局布線,最后生成可下載的比特流文件下載到Xilinx公司的型號為XC3S2000的FPGA芯片中,完成了電路的設(shè)計并實現(xiàn)了編碼譯碼的功能,表明本文設(shè)計的信道編解碼器的正確性和實用性,滿足了微小衛(wèi)星通信分系統(tǒng)的技術(shù)要求。

    標簽: FPGA RS碼 編譯碼器

    上傳時間: 2013-08-01

    上傳用戶:lili123

  • 基于FPGA的回波抵消器設(shè)計與實現(xiàn)

    回波抵消器在免提電話、無線產(chǎn)品、IP電話、ATM語音服務(wù)和電話會議等系統(tǒng)中,都有著重要的應(yīng)用。在不同應(yīng)用場合對回波抵消器的要求并不完全相同,本文主要研究應(yīng)用于電話系統(tǒng)中的電回波抵消器。電回波是由于語音信號在電話網(wǎng)中傳輸時由于阻抗不匹配而產(chǎn)生的。 傳統(tǒng)回波抵消器主要是基于通用DSP處理器實現(xiàn)的,這種回波抵消器在系統(tǒng)實時性要求不高的場合能很好的滿足回波抵消的性能要求,但是在實時性要求較高的場合,其處理速度等性能方面已經(jīng)不能滿足系統(tǒng)高速、實時的需要。現(xiàn)代大容量、高速度的FPGA的出現(xiàn),克服了上訴方案的諸多不足。用FPGA來實現(xiàn)數(shù)字信號處理可以很好地解決并行性和速度問題,且其靈活的可配置特性使得FPGA構(gòu)成的DSP系統(tǒng)非常易于修改、測試和硬件升級。 本文研究目標是如何在FPGA芯片上實現(xiàn)回波抵消器,完成的主要工作有: (1)深入研究了回波抵消器各模塊算法,包括自適應(yīng)濾波算法、遠端檢測算法、雙講檢測算法、NLP算法、舒適噪聲產(chǎn)生算法,并實現(xiàn)了這些算法的C程序。 (2)深入研究了回波抵消器基于FPGA的設(shè)計流程與實現(xiàn)方法,并利用硬件描述語言Verilog HDL實現(xiàn)了各部分算法。 (3)在OuartusⅡ和ModelSim仿真環(huán)境下對該系統(tǒng)進行模塊級和系統(tǒng)級的功能仿真、時序仿真和驗證。并在FPGA硬件平臺上實現(xiàn)了該系統(tǒng)。 (4)根據(jù)ITU-T G.168的標準和建議,對設(shè)計進行了大量的主、客測試,各項測試結(jié)果均達到或優(yōu)于G.168的要求。

    標簽: FPGA 回波抵消器

    上傳時間: 2013-06-23

    上傳用戶:123啊

  • 全數(shù)字化超聲診斷儀中的應(yīng)用研究

    數(shù)字超聲診斷設(shè)備在臨床診斷中應(yīng)用十分廣泛,研制全數(shù)字化的醫(yī)療儀器已成為趨勢。盡管很多超聲成像儀器設(shè)計制造中使用了數(shù)字化技術(shù),但是我們可以說現(xiàn)代VLSI 和EDA 技術(shù)在其中并沒有得到充分有效的應(yīng)用。隨著現(xiàn)代電子信息技術(shù)的發(fā)展,PLD 在很多與B 型超聲成像或多普勒超聲成像有關(guān)的領(lǐng)域都得到了較好的應(yīng)用,例如數(shù)字通信和相控雷達領(lǐng)域。 在研究現(xiàn)代超聲成像原理的基礎(chǔ)上,我們首先介紹了常見的數(shù)字超聲成像儀器的基本結(jié)構(gòu)和模塊功能,同時也介紹了現(xiàn)代FPGA 和EDA 技術(shù)。隨后我們詳細分析討論了B 超中,全數(shù)字化波束合成器的關(guān)鍵技術(shù)和實現(xiàn)手段。我們設(shè)計實現(xiàn)了片內(nèi)高速異步FIFO 以降低采樣率,仿真結(jié)果表明資源使用合理且訪問時間很小。正交檢波方法既能給出灰度超聲成像所需要的回波的幅值信息,也能給出多普勒超聲成像所需要的回波的相移信息。我們設(shè)計實現(xiàn)了基于直接數(shù)字頻率合成原理的數(shù)控振蕩器,能夠給出一對幅值和相位較平衡的正交信號,且在FPGA 片內(nèi)實現(xiàn)方案簡單廉價。數(shù)控振蕩器輸出波形的頻率可動態(tài)控制且精度較高,對于隨著超聲在人體組織深度上的穿透衰減,導致回波中心頻率下移的聲學物理現(xiàn)象,可視作將回波接收機的中心頻率同步動態(tài)變化進行補償。 還設(shè)計實現(xiàn)了B 型數(shù)字超聲診斷儀前端發(fā)射波束聚焦和掃描控制子系統(tǒng)。在單片F(xiàn)PGA 芯片內(nèi)部設(shè)計實現(xiàn)了聚焦延時、脈寬和重復頻率可動態(tài)控制的發(fā)射驅(qū)動脈沖產(chǎn)生器、線掃控制、探頭激勵控制、功能碼存儲等功能模塊,功能仿真和時序分析結(jié)果表明該子系統(tǒng)為設(shè)計實現(xiàn)高速度、高精度、高集成度的全數(shù)字化超聲診斷設(shè)備打下了良好的基礎(chǔ),將加快其研發(fā)和制造進程,為生物醫(yī)學電子、醫(yī)療設(shè)備和超聲診斷等方面帶來新思路。

    標簽: 全數(shù)字 中的應(yīng)用 超聲診斷儀

    上傳時間: 2013-05-30

    上傳用戶:tonyshao

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