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高效的CABAC解碼器設計及FPGA實現

  • 資源大?。?/b>1843 K
  • 上傳時間: 2013-07-03
  • 上傳用戶:ookok56
  • 資源積分:2 下載積分
  • 標      簽: CABAC FPGA 解碼器

資 源 簡 介

H.264/AVC是ITU與ISO/IEC(International Standard Organization/Intemational Electrotechnical Commission國際標準化組織/國際電工委員會)聯合推出的活動圖像編碼標準。作為最新的國際視頻編碼標準,H.264/AVC與MPEG-4、H.263等視頻編碼標準相比,性能有了很大提高,并已在流媒體、數字電視、電話會議、視頻存儲等諸多領域得到廣泛的應用?;谏舷挛牡淖赃m應二進制算術編碼(Conrext-based Adaptive Binary Arithmetic Coding,CABAC)是H.264/AVC的兩個熵編碼方案之一,相對于另一熵編碼方案-CAVLC(基于上下文的自適應可變長編碼),CABAC具有更高的數據壓縮率:在同等編碼質量下要比CAVLC提高10%~15%的壓縮率。CABAC能實現很高的數據壓縮率,但這是以增加實現的復雜性為代價的。在已有的硬件實現方法上,CABAC的解碼效率并不高。 論文在深入研究CABAC解碼算法及其實現流程,并在仔細分析了H.264/AVC碼流結構的基礎上,總結出了影響CABAC解碼效率的各個環節,并以此為出發點,對CABAC解碼所需中的各個功能模塊進行了優化設計,設計出一種新的CABAC解碼器結構,相對于一般的CABAC解碼器,它的解碼效率得到了顯著提高。論文針對影響CABAC解碼過程的"瓶頸"問題一多次訪問存儲部件影響解碼速率,提出了新的存儲組織方式,并根據CABAC的碼流結構特性,采用4個子解碼器級聯的方式來進一步提高解碼速率。 最后,用Verilog語言對所設計的CABAC解碼器進行了描述,用EDA軟件對其進行了仿真,并在FPGA上驗證了其功能,結果顯示,該CABAC解碼器結構顯著提高了解碼效率,能夠滿足高檔次實時通訊的要求。

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