陷波器是無限沖擊響應(yīng)(IIR)數(shù)字濾波器，該濾波器可以用以下常系數(shù)線性差分方程表示：ΣΣ==−−−=MiNiiiinybinxany01)()()( (1)式中： x(n)和y(n)分別為輸人和輸出信號序列；和為濾波器系數(shù)。 iaib對式(1)兩邊進行z變換，得到數(shù)字濾波器的傳遞函數(shù)為： ΠΠΣΣ===−=−−−==NiiMiiNiiiMiiipzzzzbzazH1100)()()( (2)式中：和分別為傳遞函數(shù)的零點和極點。 izip由傳遞函數(shù)的零點和極點可以大致繪出頻率響應(yīng)圖。在零點處，頻率響應(yīng)出現(xiàn)極小值；在極點處，頻率響應(yīng)出現(xiàn)極大值。因此可以根據(jù)所需頻率響應(yīng)配置零點和極點，然后反向設(shè)計帶陷數(shù)字濾波器。考慮一種特殊情況，若零點在第1象限單位圓上，極點在單位圓內(nèi)靠近零點的徑向上。為了防止濾波器系數(shù)出現(xiàn)復(fù)數(shù)，必須在z平面第4象限對稱位置配置相應(yīng)的共軛零點、共軛極點。 izip∗iz∗ip這樣零點、極點配置的濾波器稱為單一頻率陷波器，在頻率ωo處出現(xiàn)凹陷。而把極點設(shè)置在零的的徑向上距圓點的距離為l-μ處，陷波器的傳遞函數(shù)為： ))1()()1(())(()(2121zzzzzzzzzHμμ−−−−−−= (3)式(3)中μ越小，極點越靠近單位圓，則頻率響應(yīng)曲線凹陷越深，凹陷的寬度也越窄。當(dāng)需要消除窄帶干擾而不能對其他頻率有衰減時，陷波器是一種去除窄帶干擾的理想數(shù)字濾波器。當(dāng)要對幾個頻率同時進行帶陷濾波時，可以按(2)式把幾個單獨頻率的帶陷濾波器(3)式串接在一起。一個例子：設(shè)有一個輸入，它
上傳時間： 2013-10-18
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賽靈思推出業(yè)界首款自動化精細(xì)粒度時鐘門控解決方案，該解決方案可將 Virtex®-6 和 Spartan®-6 FPGA 設(shè)計方案的動態(tài)功耗降低高達(dá) 30%。賽靈思智能時鐘門控優(yōu)化可自動應(yīng)用于整個設(shè)計，既無需在設(shè)計流程中添加更多新的工具或步驟，又不會改變現(xiàn)有邏輯或時鐘，從而避免設(shè)計修改。此外，在大多數(shù)情況下，該解決方案都能保留時序結(jié)果。
上傳時間： 2013-11-16
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GMSK信號具有很好的頻譜和功率特性，特別適用于功率受限和信道存在非線性、衰落以及多普勒頻移的移動突發(fā)通信系統(tǒng)。根據(jù)GMSK調(diào)制的特點，提出 亍一種以FPGA和CMX589A為硬件裁體的GMSK調(diào)制器的設(shè)計方案，并給出了方案的具體實現(xiàn)，包括系統(tǒng)結(jié)構(gòu)、利用CMX589A實現(xiàn)的高斯濾波器、 FPGA實現(xiàn)的調(diào)制指數(shù)為O．5的FM調(diào)制器以及控制器。對系統(tǒng)功能和性能測試結(jié)果表明，指標(biāo)符合設(shè)計要求，工作穩(wěn)定可靠。 關(guān)鍵詞：GMSK；DDS；FM調(diào)制器；FPGAl 引 言 由于GMSK調(diào)制方式具有很好的功率頻譜特性，較優(yōu)的誤碼性能，能夠滿足移動通信環(huán)境下對鄰道干擾的嚴(yán)格要求，因此成為GSM、ETS HiperLANl以及GPRS等系統(tǒng)的標(biāo)準(zhǔn)調(diào)制方式。目前GMSK調(diào)制技術(shù)主要有兩種實現(xiàn)方法，一種是利用GMSK ASIC專用芯片來完成，典型的產(chǎn)品如FX589或CMX909配合MC2833或FX019來實現(xiàn)GMSK調(diào)制。這種實現(xiàn)方法的特點是實現(xiàn)簡單、基帶信 號速率可控，但調(diào)制載波頻率固定，沒有可擴展性。另外一種方法是利用軟件無線電思想采用正交調(diào)制的方法在FPGA和DSP平臺上實現(xiàn)。其中又包括兩種實現(xiàn) 手段，一種是采用直接分解將單個脈沖的高斯濾波器響應(yīng)積分分成暫態(tài)部分和穩(wěn)態(tài)部分，通過累加相位信息來實現(xiàn)；另一種采用頻率軌跡合成，通過采樣把高斯濾波 器矩形脈沖響應(yīng)基本軌跡存入ROM作為查找表，然后通過FM調(diào)制實現(xiàn)。這種利用軟件無線電思想實現(xiàn)GMSK調(diào)制的方法具有調(diào)制參數(shù)可變的優(yōu)點，但由于軟件 設(shè)計中涉及到高斯低通濾波、相位積分和三角函數(shù)運算，所以調(diào)制器參數(shù)更改困難、實現(xiàn)復(fù)雜。綜上所述，本文提出一種基于CMX589A和FPGA的GMSK 調(diào)制器設(shè)計方案。與傳統(tǒng)實現(xiàn)方法比較具有實現(xiàn)簡單、調(diào)制參數(shù)方便可控和軟件剪裁容易等特點，適合于CDPD、無中心站等多種通信系統(tǒng)，具有重要現(xiàn)實意義。
上傳時間： 2013-10-24
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高速串并轉(zhuǎn)換器的設(shè)計是FPGA 設(shè)計的一個重要方面,傳統(tǒng)設(shè)計方法由于采用FPGA 的內(nèi)部邏輯資源來實現(xiàn),從而限制了串并轉(zhuǎn)換的速度。該研究以網(wǎng)絡(luò)交換調(diào)度系統(tǒng)的FGPA 驗證平臺中多路高速串并轉(zhuǎn)換器的設(shè)計為例,詳細(xì)闡述了1 :8DDR 模式下高速串并轉(zhuǎn)換器的設(shè)計方法和16 路1 :8 串并轉(zhuǎn)換器的實現(xiàn)。結(jié)果表明,采用Xilinx Virtex24 的ISERDES 設(shè)計的多路串并轉(zhuǎn)換器可以實現(xiàn)800 Mbit/ s 輸入信號的串并轉(zhuǎn)換,并且減少了設(shè)計復(fù)雜度,縮短了開發(fā)周期,能滿足設(shè)計要求。關(guān)鍵詞:串并轉(zhuǎn)換;現(xiàn)場可編程邏輯陣列;Xilinx ; ISERDES
標(biāo)簽： FPGA 多路 串并轉(zhuǎn)換
上傳時間： 2013-11-03
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大部分傳統(tǒng)的位同步器是針對固定位速率遙測系統(tǒng)來設(shè)計的，這不能滿足一些可變位速率遙測接收機的需求。因此，提出一種基于FPGA實現(xiàn)的位同步器的設(shè)計，它能適應(yīng)不同位速率的遙測系統(tǒng)。同時，對這種位同步器的實現(xiàn)進行了仿真，驗證其正確性和可實現(xiàn)性。
上傳時間： 2013-11-01
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本文以對步伐特征的研究為基礎(chǔ)，描述一個采用3軸加速度計ADXL345的全功能計步器參考設(shè)計，它能辨別并計數(shù)步伐，測量距離、速度甚至所消耗的卡路里。 ADXL345專有的（正在申請專利）片內(nèi)32級先進先出(FIFO)緩沖器可以存儲數(shù)據(jù)，并執(zhí)行計步器應(yīng)用的相關(guān)操作，從而最大程度地減少主處理器干預(yù)，為便攜式設(shè)備節(jié)省寶貴的系統(tǒng)功率。其13位分辨率(4 mg/LSB)甚至允許計步器以合理的精度測量超低速步行（每步加速度變化約55 mg）。
標(biāo)簽： 3軸 數(shù)字加速度計 計步器
上傳時間： 2013-12-22
上傳用戶：wff
特點 精確度0.1%滿刻度 可輸入交直流電流/交直流電壓/電位計/傳送器...等信號 16 BIT類比輸出功能 輸入與輸出絕緣耐壓2仟伏特/1分鐘 寬范圍交直流兩用電源設(shè)計 尺寸小,穩(wěn)定性高 2主要規(guī)格 精確度: 0.1% F.S. (23 ±5℃) 顯示值范圍: 0-±19999 digit adjustable 類比輸出解析度: 16 bit DAC 輸出反應(yīng)速度: < 250 ms (0-90%)(>10Hz) 輸出負(fù)載能力: < 10mA for voltage mode < 10V for current mode 輸出之漣波: < 0.1% F.S. 歸零調(diào)整范圍: 0- ±9999 Digit adjustable 最大值調(diào)整范圍: 0- ±9999 Digit adjustable 溫度系數(shù): 50ppm/℃ (0-50℃) 顯示幕: Red high efficiency LEDs high 10.16mm (0.4") 隔離特性: Input/Output/Power/Case 參數(shù)設(shè)定方式: Touch switches 記憶方式: Non-volatile E2PROM memory 絕緣抗阻: >100Mohm with 500V DC 絕緣耐壓能力: 2KVac/1 min. (input/output/power) 1600Vdc (input/output) 使用環(huán)境條件: 0-60℃(20 to 90% RH non-condensed) 存放環(huán)境條件: 0-70℃(20 to 90% RH non-condensed) 安裝方式: Socket/plugin type with barrier terminals CE認(rèn)證: EN 55022:1998/A1:2000 Class A EN 61000-3-2:2000 EN 61000-3-3:1995/A1:2001 EN 55024:1998/A1:2001
上傳時間： 2014-01-05
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功率變換器是開關(guān)磁阻電動機調(diào)速系統(tǒng)（SRD）中的重要組成部分，現(xiàn)有的各種功率變換器大都有這樣或那樣的問題與不足，關(guān)鍵是不能保證較好的性能價格比。本文通過對兩種常用的四相開關(guān)磁阻電動機（SR）功率變換器主電路進行分析，優(yōu)化、綜合常用的主電路，給出了目前最優(yōu)的四相SR電機功率變換器主電路型式——最少主開關(guān)型，提高了經(jīng)濟性和實用性。結(jié)合作者的研制實踐，又給出了5.5KW 的SR電機新型功率變換器的實際電路、主要器件及其定額的選擇。通過實驗成功地應(yīng)用此方案，基于降低SR電機轉(zhuǎn)矩波動的有效手段，同時實現(xiàn)電機實時雙相繞組通電穩(wěn)定運行。關(guān)鍵詞：開關(guān)磁阻電動機；功率變換器；最少主開關(guān)；繞組雙相運行
上傳時間： 2013-10-08
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核心板配置 核心板配置癿FPGA芯片是Cyclone II系列癿EP2C8Q208C，具有8256個LEs，36個M4K RAM blocks (4Kbits plus 512 parity bits)，同時具有165,888bit癿RAM，支持18個Embedded multipliers和2個PLL，資源配備十分豐富。實驗證明，返款芯片在嵌入NIOS II軟核將黑釐開収板癿所有外謳全部跑起來，僅占全部資源癿70-80% ; 核心板同時配備了64Mbit癿SDRAM，對亍運行NIOS軟核提供了有力癿保障，返款芯片為時鐘頻率有143MHz，實驗證明，NIOS II軟核主頻可以平穩(wěn)運行120MHz，速度迓是相當(dāng)忚癿; 16Mbit癿配置芯片也為返款核心板增色丌少，丌僅可以存儲配置信息，同時迓可以實現(xiàn)NIOS II軟件程序存儲，你編寫癿程序再大也沒有后頊乀憂了。 20M癿有源晶振也是必丌可少癿，他是整個系統(tǒng)癿時鐘源泉;4個LED對亍調(diào)試來說更是提供了徑多方便;復(fù)位按鍵，重新配置按鍵，配置指示燈一個也丌能少;同時支持AS模式和JTAG模式; 除此以外，核心板一個更大的特點是它可以獨立亍底板單獨運行，為此配備了5V癿電源接口，高質(zhì)量癿紅色開關(guān)，為了安全迓加入了自恢復(fù)保險絲。當(dāng)然擴展口是丌能少癿，除了SDRAM占用癿38個IO口外，其他100個IO全部擴展出來，為大家可以迕行自我擴展實驗做好了充分癿準(zhǔn)備。 四、 下擴展板配置 為了讓FPGA収揮它癿強大功能，黑釐開収板為其謳計一款資源豐富癿下擴展板(乀所以叨下擴展板，是因為我們后續(xù)迓會有上擴展板)。下面我們就來簡單介終一下下擴展板癿資源配置。 支持網(wǎng)絡(luò)功能，配置ENC28J60網(wǎng)口芯片。ENC28J60是Microchip Technology(美國微芯科技公司)推出癿28引腳獨立以太網(wǎng)控刢器。目前市場上大部分以太網(wǎng)控刢器癿封裝均赸過80引腳，而符吅IEEE 802.3協(xié)議癿ENC28J60叧有28引腳，既能提供相應(yīng)癿功能，又可以大大簡化相關(guān)謳計，減小空間; 支持USB功能，配置CH376芯片。CH376 支持USB 謳備方式和USB 主機方式，幵丏內(nèi)置了USB 途訊協(xié)議癿基本固件，內(nèi)置了處理Mass-Storage海量存儲謳備癿與用途訊協(xié)議癿固件，內(nèi)置了SD 卡癿途訊接口固件，內(nèi)置了FAT16和FAT32 以及FAT12 文件系統(tǒng)癿管理固件，支持常用癿USB 存儲謳備(包括U 盤/USB 硬盤/USB 閃存盤/USB 讀卡器)和SD 卡(包括標(biāo)準(zhǔn)容量SD 卡和高容量HC-SD 卡以及協(xié)議兼容癿MMC 卡和TF 卡); 支持板載128*64的點陣LCD。ST7565P控刢芯片，內(nèi)置DC/DC電路，途過軟件調(diào)節(jié)對比度。該芯片支持，幵口和串口丟種方式;
上傳時間： 2013-11-23
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P82B96是一款雙極性I2C擴展芯片，在保持I2C系統(tǒng)的工作模式和特性不變的情況下，通過緩沖SDA和SCL總線上的數(shù)據(jù)來擴展通信距離，同時I2C擴展器P82B96提供了一種在標(biāo)準(zhǔn)I2C總線和其他總線配置間的無鎖存、雙向性的邏輯接口，它可以把I2C總線連接到2~15V的邏輯器件上，且不受I2C總線協(xié)議的限制和時鐘速率的限制。能增加I2C總線的傳輸距離和節(jié)點上的負(fù)載數(shù)目。I2C擴展器P82B96徹底地解決了I2C總線在遠(yuǎn)距離傳輸?shù)牟蛔恪?/p>
上傳時間： 2013-10-27
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