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電能質(zhì)量監(jiān)(jiān)測

  • 高速FPGA系統(tǒng)的信號完整性測試和分析,能幫助學(xué)習(xí)FPGA

    高速FPGA系統(tǒng)的信號完整性測試和分析,能幫助學(xué)習(xí)FPGA

    標(biāo)簽： FPGA 信號完整性 測試

    上傳時間： 2013-08-05

    上傳用戶：妄想演繹師

  • 用于FPGA的N+0.5分頻代碼

    用于FPGA的N+0.5分頻代碼，可以用來進行非整數(shù)分頻！

    標(biāo)簽： FPGA 0.5 分頻 代碼

    上傳時間： 2013-08-06

    上傳用戶：weixiao99

  • 用FPGA 實現(xiàn)基- 4FFT 算法

    針對高速數(shù)字信號處理的要求,提出用FPGA 實現(xiàn)基- 4FFT 算法,并對其整體結(jié)構(gòu)、蝶形單\\\\\\\\r\\\\\\\\n元進行了分析. 采用蝶算單元輸入并行結(jié)構(gòu)和同址運算,能同時提供蝶形運算所需的4 個操作\\\\\\\\r\\\\\\\\n數(shù),具有最大的數(shù)據(jù)并行性,能提高處理速度 按照旋轉(zhuǎn)因子存放規(guī)則,蝶形運算所需的3 個旋轉(zhuǎn)\\\\\\\\r\\\\\\\\n因子地址相同,且尋址方式簡單 輸出采取與輸入相似的存儲器 運算單元同時采用3 個乘法的\\\\\\\\r\\\\\\\\n復(fù)數(shù)運算算法來

    標(biāo)簽： FPGA 4FFT 算法

    上傳時間： 2013-08-08

    上傳用戶：gxrui1991

  • 能完全模擬DDS芯片的工作

    能完全模擬DDS芯片的工作，在CPLD的輸出引腳后接上相應(yīng)的D/A轉(zhuǎn)換芯片并接上低通濾波器，將得到非常好的正旋波

    標(biāo)簽： DDS 模擬 芯片

    上傳時間： 2013-08-09

    上傳用戶：3294322651

  • 在FPGA上實現(xiàn)的出租車計價器VHDL源代碼

    在FPGA上實現(xiàn)的出租車計價器VHDL源代碼\r\n能實現(xiàn)里程計價、誤時計價等功能

    標(biāo)簽： FPGA VHDL 出租車計價器 源代碼

    上傳時間： 2013-08-13

    上傳用戶：18888888888

  • 針對嵌入式系統(tǒng)的底層網(wǎng)絡(luò)接口給出了一種由FPGA實現(xiàn)的以太網(wǎng)控制器的設(shè)計方法

    針對嵌入式系統(tǒng)的底層網(wǎng)絡(luò)接口給出了一種由FPGA實現(xiàn)的以太網(wǎng)控制器的設(shè)計方法．該控制器能支持10Mbps和100Mbps的傳輸速率以及半雙工和全雙工模式，同時可提供MII接口，可并通過外接以太網(wǎng)物理層（PHY）芯片來實現(xiàn)網(wǎng)絡(luò)接入\r\n

    標(biāo)簽： FPGA 嵌入式系統(tǒng) 以太網(wǎng)控制器 底層

    上傳時間： 2013-08-18

    上傳用戶：青春給了作業(yè)95

  • 多路18b20測溫顯示系統(tǒng),可同時測量n個第三18b20

    多路18b20測溫顯示系統(tǒng),可同時測量n個第三18b20

    標(biāo)簽： 18b20 多路 測溫 顯示系統(tǒng)

    上傳時間： 2013-08-21

    上傳用戶：zhangchu0807

  • FPGA實現(xiàn)頻率合成的技術(shù)，含軟硬件設(shè)計

    盡管頻率合成技術(shù)已經(jīng)經(jīng)歷了大半個世紀(jì)的發(fā)展史，但直到今天，人們對\\r\\n它的研究仍然在繼續(xù)。現(xiàn)在，我們可以開發(fā)出輸出頻率高達IG的DDS系統(tǒng)，\\r\\n武漢理工大學(xué)碩士學(xué)位論文\\r\\n已能滿足絕大多數(shù)頻率源的要求，集成DDS產(chǎn)品的信噪比也可達到75dB以上，\\r\\n已達到鎖相頻率合成的一般水平。電子技術(shù)的發(fā)展己進入數(shù)字時代，模擬信號\\r\\n數(shù)字化的方法也是目前一個熱門研究課題，高速AD、DA器件在通信、廣播電\\r\\n視等領(lǐng)域的應(yīng)用越來越廣泛。本次設(shè)計完成了軟件仿真和硬件實現(xiàn)，對設(shè)計原

    標(biāo)簽： FPGA 頻率合成 軟硬件設(shè)計

    上傳時間： 2013-08-21

    上傳用戶：asdkin

  • 16QAM接收機解調(diào)芯片的FPGA實現(xiàn)

    描述了一個用于微波傳輸設(shè)備的16QAM接收機解調(diào)芯片的FPGA實現(xiàn),芯片集成了定時恢復(fù)、載波恢復(fù)和自適應(yīng)盲判決反饋均衡器(DFE),采用恒模算法(CMA)作為均衡算法。芯片支持高達25M波特的符號速率,在一片EP1C12Q240C8(ALTERA)上實現(xiàn),即將用于量產(chǎn)的微波傳輸設(shè)備中。\\r\\n

    標(biāo)簽： FPGA QAM 16 接收機

    上傳時間： 2013-08-22

    上傳用戶：23333

  • 針對超聲波應(yīng)用系統(tǒng)易受噪聲干擾以及超聲波信號的空間衰減現(xiàn)象影響

    針對超聲波應(yīng)用系統(tǒng)易受噪聲干擾以及超聲波信號的空間衰減現(xiàn)象影響, 從而要求\r\n超聲波傳感器工作在其最佳特性的特點, 論證了驅(qū)動脈沖信號的控制精度對傳感器工作特\r\n性的影響, 給出了傳感器驅(qū)動信號脈沖寬度與傳感器頻率之間的最佳關(guān)系式, 提出了采用復(fù)\r\n雜可編程邏輯器件(CPLD) 產(chǎn)生傳感器驅(qū)動控制信號的方法, 將該方法應(yīng)用于一超聲波流\r\n量計測量系統(tǒng)中, 得到了比傳統(tǒng)型單片機控制電路更好的控制精度和控制效果。

    標(biāo)簽： 超聲波 應(yīng)用系統(tǒng) 干擾 信號

    上傳時間： 2013-08-23

    上傳用戶：ippler8

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