利用免疫演算法的特性去模擬tsp的問題加以求解路徑的最佳化
標簽： tsp 免疫 算法 模
上傳時間： 2014-01-07
上傳用戶：gxrui1991
是一個用verilog寫成的加法器電路,可把七個元件加起來
標簽： verilog 加法器 元件
上傳用戶：zhangzhenyu
使用硬體描述語言HDL 設計硬體電路，臺灣人寫的PPT講義，非常不錯。VHDL硬件設計入門學習。VHDL基本語法架構，VHDL的零件庫(Library)及包裝(Package)等內容。
標簽： HDL
上傳時間： 2014-01-22
上傳用戶：cxl274287265
用匯編語言來使鍵盤成為一個演奏音樂的電子琴。高音依次1,2,3,4,5,6,7 。中音依次為q,w,e,r,t,y,u 。低音依次為a,s,d,f,g,h,j
標簽： 匯編語言 低音 鍵盤 電子琴
上傳時間： 2013-12-17
上傳用戶：wangdean1101
5 bits 的加法器與減法器合併電路之原始程式製作
標簽： bits 加法器 法器 程式
上傳時間： 2016-05-18
上傳用戶：ippler8
verilog除頻器可用於編碼段運用可以穩定電路設計
標簽： verilog
上傳時間： 2013-12-26
上傳用戶：372825274
內含fulladder結構檔,電路檔,測試檔(testbench)以及執行檔(.do)
標簽： fulladder testbench do
上傳時間： 2016-11-25
上傳用戶：wxhwjf
S3C44B0-ARM應用板(電路+PCB+程序).rar
標簽： ARM PCB 44
上傳時間： 2013-12-27
上傳用戶：cuiyashuo
電子琴 高音依次為1,2,3,4,5,6,7 中音依次為q,w,e,r,t,y,u 低音依次為a,s,d,f,g,h,j
標簽： 電子琴 低音
上傳時間： 2017-01-14
上傳用戶：fnhhs
SONET 教學V1.0_方便使用者在學習射頻電路模擬上遇到的問題解決方式
標簽： SONET 1.0 模 方式
上傳時間： 2017-01-17
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