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音頻輸出

  • 針對嵌入式系統(tǒng)的底層網(wǎng)絡接口給出了一種由FPGA實現(xiàn)的以太網(wǎng)控制器的設計方法

    針對嵌入式系統(tǒng)的底層網(wǎng)絡接口給出了一種由FPGA實現(xiàn)的以太網(wǎng)控制器的設計方法.該控制器能支持10Mbps和100Mbps的傳輸速率以及半雙工和全雙工模式,同時可提供MII接口,可并通過外接以太網(wǎng)物理層(PHY)芯片來實現(xiàn)網(wǎng)絡接入\r\n

    標簽: FPGA 嵌入式系統(tǒng) 以太網(wǎng)控制器 底層

    上傳時間: 2013-08-18

    上傳用戶:青春給了作業(yè)95

  • 設計出優(yōu)秀fpga程序的十條戒律

    設計出優(yōu)秀fpga程序的十條戒律,設計指導

    標簽: fpga 程序

    上傳時間: 2013-09-04

    上傳用戶:yjj631

  • 一種改進的基于時間戳的空間音視頻同步方法

    空間多媒體通信過程中存在的不可預測的分組數(shù)據(jù)丟失、亂序,可變的鏈路傳輸及處理時延抖動以及收發(fā)端時鐘不同步與漂移等問題,這可能導致接收端在對音視頻數(shù)據(jù)進行顯示播放時產生音視頻不同步現(xiàn)象。為了解決此問題,提出了一種改進的基于時間戳的空間音視頻同步方法,該方法采用一種相對時間戳映射模型,結合接收端同步檢測和緩沖設計,能夠在無需全網(wǎng)時鐘和反饋通道的情況下,實現(xiàn)空間通信中的音視頻同步傳輸,并在接收端進行同步播放顯示。對該方法進行了仿真,結果表明了設計的可行性。同步前的均方根誤差SPD值平均在150 ms左右,最大能達到176.1 ms。文中方法能將SPD值控制在60 ms左右,不僅能實現(xiàn)音視頻同步傳輸,并且開銷很小,可應用在空間多媒體通信中。

    標簽: 音視頻

    上傳時間: 2013-11-21

    上傳用戶:comer1123

  • 傳輸線與電路觀點詳解

      •1-1 傳輸線方程式 •1-2 傳輸線問題的時域分析 •1-3 正弦狀的行進波 •1-4 傳輸線問題的頻域分析 •1-5 駐波和駐波比 •1-6 Smith圖 •1-7 多段傳輸線問題的解法 •1-8 傳輸線的阻抗匹配

    標簽: 傳輸線 電路

    上傳時間: 2013-11-21

    上傳用戶:laomv123

  • IC封裝製程簡介(IC封裝制程簡介)

    半導體的產品很多,應用的場合非常廣泛,圖一是常見的幾種半導體元件外型。半導體元件一般是以接腳形式或外型來劃分類別,圖一中不同類別的英文縮寫名稱原文為   PDID:Plastic Dual Inline Package SOP:Small Outline Package SOJ:Small Outline J-Lead Package PLCC:Plastic Leaded Chip Carrier QFP:Quad Flat Package PGA:Pin Grid Array BGA:Ball Grid Array         雖然半導體元件的外型種類很多,在電路板上常用的組裝方式有二種,一種是插入電路板的銲孔或腳座,如PDIP、PGA,另一種是貼附在電路板表面的銲墊上,如SOP、SOJ、PLCC、QFP、BGA。    從半導體元件的外觀,只看到從包覆的膠體或陶瓷中伸出的接腳,而半導體元件真正的的核心,是包覆在膠體或陶瓷內一片非常小的晶片,透過伸出的接腳與外部做資訊傳輸。圖二是一片EPROM元件,從上方的玻璃窗可看到內部的晶片,圖三是以顯微鏡將內部的晶片放大,可以看到晶片以多條銲線連接四周的接腳,這些接腳向外延伸並穿出膠體,成為晶片與外界通訊的道路。請注意圖三中有一條銲線從中斷裂,那是使用不當引發(fā)過電流而燒毀,致使晶片失去功能,這也是一般晶片遭到損毀而失效的原因之一。   圖四是常見的LED,也就是發(fā)光二極體,其內部也是一顆晶片,圖五是以顯微鏡正視LED的頂端,可從透明的膠體中隱約的看到一片方型的晶片及一條金色的銲線,若以LED二支接腳的極性來做分別,晶片是貼附在負極的腳上,經(jīng)由銲線連接正極的腳。當LED通過正向電流時,晶片會發(fā)光而使LED發(fā)亮,如圖六所示。     半導體元件的製作分成兩段的製造程序,前一段是先製造元件的核心─晶片,稱為晶圓製造;後一段是將晶中片加以封裝成最後產品,稱為IC封裝製程,又可細分成晶圓切割、黏晶、銲線、封膠、印字、剪切成型等加工步驟,在本章節(jié)中將簡介這兩段的製造程序。

    標簽: 封裝 IC封裝 制程

    上傳時間: 2014-01-20

    上傳用戶:蒼山觀海

  • 低成本單進三出逆變器設計經(jīng)驗總結

    介紹了一款低成本單進三出逆變器的設計經(jīng)驗,硬件成本控制在60元人民幣以內時,可驅動1 kW以下的三相籠式異步電機。總結了經(jīng)過近百多次的修改后得到的較為成熟的電路的設計要點,包括微處理器,功率器件,半橋驅動,過流保護,控制方法,試驗結果等方面的內容。用該電路實現(xiàn)的變頻調速可以因低成本而大大擴展其應用范圍,稍加修改后可用于直流無刷電機的驅動。

    標簽: 逆變器 設計經(jīng)驗

    上傳時間: 2013-11-11

    上傳用戶:Jesse_嘉偉

  • 低成本單進三出逆變器設計經(jīng)驗總結

    介紹了一款低成本單進三出逆變器的設計經(jīng)驗,硬件成本控制在60元人民幣以內時,可驅動1 kW以下的三相籠式異步電機。總結了經(jīng)過近百多次的修改后得到的較為成熟的電路的設計要點,包括微處理器,功率器件,半橋驅動,過流保護,控制方法,試驗結果等方面的內容。用該電路實現(xiàn)的變頻調速可以因低成本而大大擴展其應用范圍,稍加修改后可用于直流無刷電機的驅動。

    標簽: 逆變器 設計經(jīng)驗

    上傳時間: 2013-11-04

    上傳用戶:alibabamama

  • 采用4mmX4mm QFN封裝的通用型TFT LCD偏置電源和白光LED驅動器

    LTC3524 的 2.5V 至 6V 輸入電源範圍非常適合於那些從鋰離子電池或者多節(jié)堿性或鎳電池供電的便攜式設備。LCD 和 LED 驅動器的工作頻率均為 1.5MHz,因而允許使用纖巧、低成本的電感器和電容器。

    標簽: 4mmX4mm QFN LCD LED

    上傳時間: 2013-11-22

    上傳用戶:zzbbqq99n

  • DDR記憶體電源

    CMOS 邏輯系統(tǒng)的功耗主要與時脈頻率、系統(tǒng)內各閘極輸入電容及電源電壓有關,裝置尺寸縮小後,電源電壓也隨之降低,使得閘極大幅降低功耗。這種低電壓裝置擁有更低的功耗和更高的運作速度,因此系統(tǒng)時脈頻率可升高至 Ghz 範圍。

    標簽: DDR 記憶體 電源

    上傳時間: 2013-10-14

    上傳用戶:immanuel2006

  • 從PCB中畫出原理圖

    從PCB中畫出原理圖的方法

    標簽: PCB 原理圖

    上傳時間: 2013-11-21

    上傳用戶:南國時代

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