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飛行模擬

  • 開關電源共模EMI抑制技術研究.rar

    隨著電力電子技術的發展,開關電源的小型化、高頻化成為趨勢,其中各個部分工作時的電磁干擾問題也越來越嚴重,因此開關電源的電磁兼容性也越來越引起人們的重視。目前,軟開關技術因其能減少開關損耗和提高效率,在開關電源中應用越來越廣泛。本文的主要目的是針對開關電源中的電磁干擾進行分析,研究軟開關技術對電磁干擾的影響,并且提出一種抑制共模干擾的濾波方法。 本文首先介紹了電磁兼容的定義、開關電源EMI的特點,論述了開關電源中EMI的研究現狀。從電磁干擾的三要素出發,介紹了開關電源中電磁干擾的干擾源和干擾的耦合通路。分析了電感、電容、高頻變壓器等器件的高頻特性,并介紹了線性阻抗穩定系統(LISN)的定義和作用。在了解了軟開關基本概念的基礎上,本文以全橋變換器為對象,介紹了移相全橋ZVS的工作原理,分析了它在實現過程中對共模干擾的影響,并在考慮IGBT寄生電容的情況下,對其共模干擾通道進行了分析。然后以UC3875為核心,設計了移相全橋ZVS的控制電路和主電路,實現了軟開關。為了對共模干擾進行抑制,本文提出了一種新型的有源和無源相結合的EMI濾波器,即無源部分采用匹配網絡法,將阻抗失配的影響降到最低;有源部分采用前饋控制,對共模電流進行補償。 針對以上提出的問題,本文通過Saber軟件對移相全橋ZVS進行了仿真,并和硬開關條件下的傳導干擾進行了比較,得出了在高頻段,ZVS的共模干擾小于硬開關,在較低頻段改善不大,甚至更加嚴重,而差模干擾有較大衰減的結論。通過對混合濾波器進行仿真,取得了良好的濾波效果,和傳統的無源EMI濾波器相比,在體積和重量上都有一定優勢。

    標簽: EMI 開關電源

    上傳時間: 2013-05-28

    上傳用戶:iswlkje

  • 滑模變結構控制MATLAB仿真.rar

    滑模控制理論的基本原理,各種滑模控制器的MATLAB仿真源程序,程序代碼詳細,正確,能直接運行。

    標簽: MATLAB 滑模變結構 控制

    上傳時間: 2013-04-24

    上傳用戶:253189838

  • 基于FPGA的電壓電流溫度監測系統設計與實現.rar

    對一些信號的監測尤其是對電壓、電流、溫度等模擬量的監測有著很廣泛的應用,通過監測到的數據,可以對系統相關設置進行及時調整,為人們的生產生活帶來便利與保證。 系統采用Actel公司先進的模數混合FPGA以及Actel公司的SOPC設計解決方案,單芯片實現以CortexMI處理器為核心的片上監測系統。它可以完成對電壓、電流、溫度等模擬量的監測,系統模擬模塊將采集到的數據ADC后送給處理器Cortex-MI進行處理,通過串行口,以太網口和OLED,實現與PC主機交互,板上實時顯示以及遠程主機檢測功能。借助于Actel的先進的新型fusion模數混合FPGA器件,單芯片實現可直接對外部模擬信號進行處理的數模混合系統,簡化了設計;對電壓,電流,溫度等模擬量的測控在日常生活中有很重要的意義,該系統在智能家電,電源監控以及微控制器等領域有廣泛的應用前景。 本文研究的主要內容包括: 1.對現有嵌入式設計方法進行比較,確定系統設計目標并選擇SOPC方案設計系統; 2.系統硬件平臺設計; 3.系統軟件設計。

    標簽: FPGA 電壓電流 溫度監測

    上傳時間: 2013-06-14

    上傳用戶:tuilp1a

  • 基于FPGA的分布式采集系統時鐘同步控制技術研究與實現.rar

    隨著電子技術的快速發展,各種電子設備對時間精度的要求日益提升。在衛星發射、導航、導彈控制、潛艇定位、各種觀測、通信等方面,時鐘同步技術都發揮著極其重要的作用,得到了廣泛的推廣。對于分布式采集系統來說,中心主站需要對來自于不同采集設備的采集數據進行匯總和分析,得到各個采集點對同一事件的采集時間差異,通過對該時間差異的分析,最終做出對事件的準確判斷。如果分布式采集系統中的各個采集設備不具有統一的時鐘基準,那么得到的各個采集時間差異就不能反映出實際情況,中心主站也無法準確地對事件進行分析和判斷,甚至得出錯誤的結論。因此,時鐘同步是分布式采集系統正常運作的必要前提。 目前國內外時鐘同步領域常用的技術有GPS授時技術,鎖相環技術和IRIG-B 碼等。GPS授時技術雖然精度高,抗干擾性強,但是由于需要專用的GPS接收機,若單純使用GPS 授時技術做時鐘同步,就需要在每個采集點安裝接收機,成本較高。鎖相環是一種讓輸出信號在頻率和相位上與輸入參考信號同步的技術,輸出信號的時鐘準確度和穩定性直接依賴于輸入參考信號。IRIG-B 碼是一種信息量大,適合傳輸的時間碼,但是由于其時間精度低,不適合應用于高精度時鐘同步的系統。基于上述分析,本文結合這三種常用技術,提出了一種基于FPGA的分布式采集系統時鐘同步控制技術。該技術既保留了GPS 授時的高精確度和高穩定性,又具備IRIG-B時間碼易傳輸和低成本的特性,為分布式采集系統中的時鐘同步提供了一種新的解決方案。 本文中的設計采用了Ublox公司的精確授時GPS芯片LEA-5T,通過對GPS芯片串行時間信息解碼,獲得準確的UTC時間,并實現了分布式采集系統中各個采集設備的精確時間打碼。為了能夠使整個分布式采集系統具有統一的高精度數據采集時鐘,本論文采用了數模混合的鎖相環技術,將GPS 接收芯片輸出的高精度秒信號作為參考基準,生成了與秒信號高精度同步的100MHZ 高頻時鐘。本文在FPGA 中完成了IRIG-B 碼的編碼部分,將B 碼的準時標志與GPS 秒信號同步,提高了IRIG-B 碼的時間精度。在分布式采集系統中,IRIG-B時間碼能直接通過串口或光纖將各個采集點時間與UTC時間統一,節約了各點布設GPS 接收機的高昂成本。最后,通過PC104總線對時鐘同步控制卡進行了數據讀取和測試,通過實驗結果的分析,提出了改進方案。實驗表明,改進后的時鐘同步控制方案具有很高的時鐘同步精度,對時鐘同步技術有著重大的推進意義!

    標簽: FPGA 分布式 采集

    上傳時間: 2013-08-05

    上傳用戶:lz4v4

  • 基于FPGA的高速串行接口模塊仿真設計.rar

    現代社會信息量爆炸式增長,由于網絡、多媒體等新技術的發展,用戶對帶寬和速度的需求快速增加。并行傳輸技術由于時鐘抖動和偏移,以及PCB布線的困難,使得傳輸速率的進一步提升面臨設計的極限;而高速串行通信技術憑借其帶寬大、抗干擾性強和接口簡單等優勢,正迅速取代傳統的并行技術,成為業界的主流。 本論文針對目前比較流行并且有很大發展潛力的兩種高速串行接口電路——高速鏈路口和Rocket I/O進行研究,并以Xilinx公司最新款的Virtex-5 FPGA為研究平臺進行仿真設計。本論文的主要工作是以某低成本相控陣雷達信號處理機為設計平臺,在其中的一塊信號處理板上,進行了基于LVDS(Low VoltageDifferential Signal)技術的高速LinkPort(鏈路口)設計和基于CML(Current ModeLogic)技術的Rocket I/O高速串行接口設計。首先在FPGA的軟件中進行程序設計和功能、時序的仿真,當仿真驗證通過之后,重點是在硬件平臺上進行調試。硬件調試驗證的方法是將DSP TS201的鏈路口功能與在FPGA中的模擬高速鏈路口相連接,進行數據的互相傳送,接收和發送的數據相同,證明了高速鏈路口設計的正確性。并且在硬件調試時對Rocket IO GTP收發器進行回環設計,經過回環之后接收到的數據與發送的數據相同,證明了Rocket I/O高速串行接口設計的正確性。

    標簽: FPGA 高速串行 接口模塊

    上傳時間: 2013-04-24

    上傳用戶:戀天使569

  • 基于FPGA的SCI串行通信接口的研究與實現.rar

    國家863項目“飛行控制計算機系統FC通信卡研制”的任務是研究設計符合CPCI總線標準的FC通信卡。本課題是這個項目的進一步引伸,用于設計SCI串行通信接口,以實現環上多計算機系統間的高速串行通信。 本文以此項目為背景,對基于FPGA的SCI串行通信接口進行研究與實現。論文先概述SCI協議,接著對SCI串行通信接口的兩個模塊:SCI節點模型模塊和CPCI總線接口模塊的功能和實現進行了詳細的論述。 SCI節模型包含Aurora收發模塊、中斷進程、旁路FIFO、接受和發送存儲器、地址解碼、MUX。在SCI節點模型的實現上,利用FPGA內嵌的RocketIO高速串行收發器實現主機之間的高速串行通信,并利用Aurora IP核實現了Aurora鏈路層協議;設計一個同步FIFO實現旁路FIFO;利用FPGA上的塊RAM實現發送和接收存儲器;中斷進程、地址解碼和多路復合分別在控制邏輯中實現。 CPCI總線接口包括PCI核、PCI核的配置模塊以及用戶邏輯三個部分。本課題中,采用FPGA+PCI軟核的方法來實現CPCI總線接口。PCI核作為PCI總線與用戶邏輯之間的橋梁:PCI核的配置模塊負責對PCI核進行配置,得到用戶需要的PCI核;用戶邏輯模塊負責實現整個通信接口具體的內部邏輯功能;并引入中斷機制來提高SCI通信接口與主機之間數據交換的速率。 設計選用硬件描述語言VerilogHDL和VHDL,在開發工具Xilinx ISE7.1中完成整個系統的設計、綜合、布局布線,利用Modelsim進行功能及時序仿真,使用DriverWorks為SCI串行通信接口編寫WinXP下的驅動程序,用VC++6.0編寫相應的測試應用程序。最后,將FPGA設計下載到FC通信卡中運行,并利用ISE內嵌的ChipScope Pro虛擬邏輯分析儀對設計進行驗證,運行結果正常。 文章最后分析傳輸性能上的原因,指出工作中的不足之處和需要進一步完善的地方。

    標簽: FPGA SCI 串行通信接口

    上傳時間: 2013-04-24

    上傳用戶:竺羽翎2222

  • 基于FPGAHDL的隨機讀寫I2C串行總線接口電路設計.rar

    I2C(Inter Integrated Circuits)是Philips公司開發的用于芯片之間連接的串行總線,以其嚴格的規范、卓越的性能、簡便的操作和眾多帶I2C接口的外圍器件而得到廣泛的應用并受到普遍的歡迎。 現場可編程門陣列(FPGA)設計靈活、速度快,在數字專用集成電路的設計中得到了廣泛的應用。本論文主要討論了如何利用Verilog/FPGA來實現一個隨機讀/寫的I2C接口電路,實現與外圍I2C接口器件E2PROM進行數據通信,實現讀、寫等功能,傳輸速率實現為100KBps。在Modelsim6.0仿真軟件環境中進行仿真,在Xilinx公司的ISE9.li開發平臺上進行了下載,搭建外圍電路,用Agilem邏輯分析儀進行數據采集,分析測試結果。 首先,介紹了微電子設計的發展概況以及設計流程,重點介紹了HDL/FPGA的設計流程。其次,對I2C串行總線進行了介紹,重點說明了總線上的數據傳輸格式并對所使用的AT24C02 E2PROM存儲器的讀/寫時序作了介紹。第三,基于Verilog _HDL設計了隨機讀/寫的I2C接口電路、測試模塊和顯示電路;接口電路由同步有限狀態機(FSM)來實現;測試模塊首先將數據寫入到AT24C02的指定地址,接著將寫入的數據讀出,并將兩個數據顯示在外圍LED數碼管和發光二極管上,從而直觀地比較寫入和輸出的數據的正確性。FPGA下載芯片為Xilinx SPARTAN Ⅲ XC3S200。第四,用Agilent邏輯分析儀進行傳輸數據的采集,分析數據傳輸的時序,從而驗證電路設計的正確性。最后,論文對所取得的研究成果進行了總結,并展望了下一步的工作。

    標簽: FPGAHDL I2C 隨機

    上傳時間: 2013-06-27

    上傳用戶:liuchee

  • 視頻圖像采集和預處理系統的FPGA實現.rar

    本文研究的視頻處理系統是上海市科委技術攻關基金項目“計算機視覺及其芯片化實現”的一部分,主要完成計算機視覺系統的一些基本工作,即視頻圖像的采集、預處理和顯示等。 視頻圖像采集和預處理系統以Xilinx公司Virtex-ⅡPro系列的FPGA為核心控制器件,結合視頻模數轉換芯片和VGA顯示器,完成視頻圖像的實時采集、預處理和顯示。采集和顯示部分作為同外界交流信息的渠道,是構成計算機視覺系統必不可少的一部分;圖像預處理則是計算機視覺系統進行高層處理的基礎,優秀的預處理算法能有效改善圖像質量,提高系統分析判斷的準確性。 本文在介紹基于FPGA的視頻采集、預處理系統整體架構的基礎上,圍繞以下四個方面展開了工作: 1.研究并給出了兩種基于FPGA的設計方案用于實現YCrCb色度空間到RGB色度空間的轉換; 2.針對采集的視頻圖像,根據VGA顯示的要求,給出了一種實現圖像去隔行的方案; 3.分析了一系列圖像濾波的預處理算法,如均值濾波、中值濾波和自適應濾波等,在比較和總結各算法特點的基礎上,提出了一種新的適用于處理混合噪聲的濾波算法:混合自適應濾波法; 4.根據算法特點設計了多種采用FPGA實現的圖像濾波算法,并對硬件算法進行RTL級的功能仿真和驗證,還給出了各種濾波算法的實驗結果,在此基礎上對各種算法的效果進行直觀的比較。 文中,預處理算法的實現充分利用了FPGA的片內資源,體現了FPGA在圖像處理方面的特點及優勢。同時,視頻采集和顯示的控制模塊也由同一FPGA芯片實現,從而簡化了系統整體結構。視頻采集和預處理系統在FPGA上的成功實現為“計算機視覺及其芯片化實現”奠定了必要的基礎、提供了一定理論依據。

    標簽: FPGA 視頻圖像

    上傳時間: 2013-07-26

    上傳用戶:alia

  • 點陣取模軟件.rar

    點陣取模軟件,取字模和數字以及符號,LED點陣大小8*8,16*16.

    標簽: 點陣取模 軟件

    上傳時間: 2013-08-06

    上傳用戶:jacking

  • 視頻格式轉換算法研究及FPGA實現——去隔行、幀頻轉換、分辨率變換.rar

    在當今的廣播系統中,絕大部分的視頻信號是隔行采樣的。采用這種掃描格式,能夠大幅度地減少視頻的帶寬,但也會引起彩色爬行、畫面閃爍、邊緣模糊及鋸齒等現象。這種缺陷經人尺寸屏幕放大后就更加明顯。為改善畫面的視覺效果,去隔行技術應運而生。同時,視頻信號本身的低幀頻也會導致行抖動、線爬行以及大面積閃爍等視覺效果上的缺陷。增加掃描頻率會把這些視覺缺陷搬移到人眼不敏感的高頻區域上去從而產生較好的主觀圖象質量。而為了適應不同顯示終端以及對圖像大小變化的要求就必須對原始信號分辨率即每幀行數和每行像素數進行變換。因此去隔行、幀頻轉換、分辨率變換成為視頻格式轉換的基本內容。 FPGA 的出現是VLSI技術和EDA技術發展的結果。FPGA器件集成度高、體積小,具有通過用戶編程實現專門應用的功能。它允許電路設計者利用基于計算機的開發平臺,經過設計輸入、仿真、測試和校驗,直到達到預期的結果。使用FPGA器件可以大大縮短系統的研制周期,減少資金投入。另外采用FPGA器件可以將原來的電路板級產品集成芯片級產品,從而降低了功耗,提高了可靠性,同時還可以很方便的對設計進行在線修改。 該文在介紹了視頻格式轉換中的主要算法后,重點對去隔行、幀頻轉換、分辨率變換的FPGA綜合實現方案進行了由簡單到復雜的深入研究,分別給出了最簡解決方案、基于非線性算法的解決方案和基于運動補償的解決方案。最簡解決方案利用線性算法將去隔行,幀頻轉換,分辨率變換三項處理同時實現,達到FPGA內部資源和外部RAM耗用量都為最小的要求,是后續復雜方案的基礎。其中去隔行采用場合并方式,幀頻轉換采用幀重復方式,分辨率變換采用均勻插值方式。基于非線性算法的解決方案中加入了對靜止區域的判斷,靜止區域的輸出像素值直接選用相應位置的已存輸入數據,非靜止區域的輸出像素值通過對已存輸入數據進行非線性運算得出。基于運動補償的解決方案在對靜止區域進行判斷和處理的基礎上,對欲生成的變頻后的場間插值幀進行運動估計,根據運動矢量得出非靜止區域的輸出像素值。其中為求得輸入場間相應時間位置上的插值幀輸出數據,該方案采用了自定義的前后向塊匹配運動估計方式,通過對三步搜索算法的高效實現,將SAD 值進行比較得出運動矢量。

    標簽: FPGA 視頻格式轉換 算法研究

    上傳時間: 2013-07-19

    上傳用戶:米卡

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