設計高速電路必須考慮高速訊 號所引發的電磁干擾、阻抗匹配及串音等效應,所以訊號完整性 (signal integrity)將是考量設計電路優劣的一項重要指標,電路日異複雜必須仰賴可 靠的軟體來幫忙分析這些複雜的效應,才比較可能獲得高品質且可靠的設計, 因此熟悉軟體的使用也將是重要的研究項目之一。另外了解高速訊號所引發之 各種效應(反射、振鈴、干擾、地彈及串音等)及其克服方法也是研究高速電路 設計的重點之一。目前高速示波器的功能越來越多,使用上很複雜,必須事先 進修學習,否則無法全盤了解儀器之功能,因而無法有效發揮儀器的量測功能。 其次就是高速訊號量測與介面的一些測試規範也必須熟悉,像眼圖分析,探針 效應,抖動(jitter)測量規範及高速串列介面量測規範等實務技術,必須充分 了解研究學習,進而才可設計出優良之教學教材及教具。
標簽: 高速電路
上傳時間: 2021-11-02
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Windows下方便簡單的免費MD5驗證工具WMD5
標簽: Windows WMD5 MD5
上傳時間: 2014-01-13
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本程式為並列flash ROM之控制程式, 可將flash rom的資料讀出後, 經過CPLD controller將圖檔轉成VESA影像訊號, 輸出至螢幕, 本程式已經過硬體驗證
標簽: flash controller CPLD VESA
上傳時間: 2013-11-28
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本程式為使用Verilog語言寫控制DRAM的控制模塊, 可以簡易的控制DRAM IC, 本程式已經過系統驗證.
標簽: DRAM Verilog 控制 程式
上傳時間: 2014-01-14
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利用C++ Builder程式撰寫出可以驗證臺灣人身分證件是否為合法證件的 C 源碼
標簽: Builder 程式 分
上傳時間: 2014-06-25
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模擬無線通訊論文的模擬程式, 可用此程式驗證論文方法是否正確
標簽: 模 程式 無線 正
上傳時間: 2016-03-30
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身分證驗證器(這是我入門的第一個程式~~~~)
標簽: 分 程式
上傳時間: 2013-12-31
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2對4解多工可以用來擴充至4對8解多工經硬體驗證過可用
標簽:
上傳時間: 2016-08-20
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鍵盤掃描verilog硬體驗證可以將開發版鍵盤功能使用
標簽: 鍵盤
上傳時間: 2013-12-24
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演算法關於JAVA的, 驗證過的, 無誤好用
標簽: JAVA 算法
上傳時間: 2016-08-21
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