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高性能開(kāi)(kāi)關(guān)(guān)

  • 一種高性能的步進(jìn)電機(jī)運(yùn)動(dòng)控制系統(tǒng)設(shè)計(jì)

    文中介紹了一種應(yīng)用于舞臺(tái)電腦燈控制系統(tǒng)的高性能步進(jìn)電機(jī)運(yùn)動(dòng)控制系統(tǒng),以及步進(jìn)電機(jī)的細(xì)分驅(qū)動(dòng)原理和自適應(yīng)調(diào)速算法。使用細(xì)分驅(qū)動(dòng)可以顯著地減小步進(jìn)電機(jī)的低頻振動(dòng);使用自適應(yīng)調(diào)速法,可以在保證系統(tǒng)的

    標(biāo)簽: 性能 步進(jìn)電機(jī) 運(yùn)動(dòng)控制 系統(tǒng)設(shè)計(jì)

    上傳時(shí)間: 2013-04-24

    上傳用戶:zhang97080564

  • 幾種用于FPGA的新型有效混合布線算法

    采用現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)可以快速實(shí)現(xiàn)數(shù)字電路,但是用于生成FPGA編程的比特流文件的CAD工具在編制大規(guī)模電路時(shí)常常需要數(shù)小時(shí)的時(shí)間,以至于許多設(shè)計(jì)者甚至通過(guò)在給定FPGA上采用更多的資源,或者以犧牲電路速度為代價(jià)來(lái)提高編制速度。電路編制過(guò)程中大部分時(shí)間花費(fèi)在布線階段,因此有效的布線算法能極大地減少布線時(shí)間。 許多布線算法已經(jīng)被開(kāi)發(fā)并獲得應(yīng)用,其中布爾可滿足性(SAT)布線算法及幾何查找布線算法是當(dāng)前最為流行的兩種。然而它們各有缺點(diǎn):基于SAT的布線算法在可擴(kuò)展性上有很大缺陷;幾何查找布線算法雖然具有廣泛的拆線重布線能力,但當(dāng)實(shí)際問(wèn)題具有嚴(yán)格的布線約束條件時(shí),它在布線方案的收斂方面存在很大困難。基于此,本文致力于探索一種能有效解決以上問(wèn)題的新型算法,具體研究工作和結(jié)果可歸納如下。 1、在全面調(diào)查FPGA結(jié)構(gòu)的最新研究動(dòng)態(tài)的基礎(chǔ)上,確定了一種FPGA布線結(jié)構(gòu)模型,即一個(gè)基于SRAM的對(duì)稱陣列(島狀)FPGA結(jié)構(gòu)作為研究對(duì)象,該模型僅需3個(gè)適合的參數(shù)即能表示布線結(jié)構(gòu)。為使所有布線算法可在相同平臺(tái)上運(yùn)行,選擇了美國(guó)北卡羅來(lái)納州微電子中心的20個(gè)大規(guī)模電路作為基準(zhǔn),并在布線前采用VPR399對(duì)每個(gè)電路都生成30個(gè)布局,從而使所有的布線算法都能夠直接在這些預(yù)制電路上運(yùn)行。 2、詳細(xì)研究了四種幾何查找布線算法,即一種基本迷宮布線算法Lee,一種基于協(xié)商的性能驅(qū)動(dòng)的布線算法PathFinder,一種快速的時(shí)延驅(qū)動(dòng)的布線算法VPR430和一種協(xié)商A

    標(biāo)簽: FPGA 布線算法

    上傳時(shí)間: 2013-05-18

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  • 基于DSPFPGA的捷聯(lián)慣性導(dǎo)航系統(tǒng)設(shè)計(jì)

    在慣性導(dǎo)航系統(tǒng)中,捷聯(lián)式慣性導(dǎo)航系統(tǒng)以其體積小、成本低和可靠性高等優(yōu)點(diǎn)正逐步取代平臺(tái)式慣性導(dǎo)航系統(tǒng),成為慣性導(dǎo)航系統(tǒng)的發(fā)展趨勢(shì)。    為了適應(yīng)捷聯(lián)慣性導(dǎo)航系統(tǒng)小型化、低成本和高性能的發(fā)展方向,本文設(shè)計(jì)了DSP與FPGA相結(jié)合的系統(tǒng)方案:系統(tǒng)采用MEMS器件和高性能A/D轉(zhuǎn)換器構(gòu)成慣性信號(hào)檢測(cè)單元,F(xiàn)PGA進(jìn)行I/O控制,DSP完成導(dǎo)航計(jì)算。方案綜合考慮了系統(tǒng)成本、計(jì)算速度、精度、體積等各方面的因素,并通過(guò)GPS、磁航向計(jì)等信息融合進(jìn)一步提高導(dǎo)航精度。    數(shù)據(jù)采集是捷聯(lián)慣導(dǎo)系統(tǒng)設(shè)計(jì)的關(guān)鍵,本文數(shù)據(jù)采集由信號(hào)調(diào)理、A/D轉(zhuǎn)換和。FPGA等幾部分組成。其中,F(xiàn)PGA是整個(gè)數(shù)據(jù)采集部分的核心,其主要功能包括:實(shí)現(xiàn)了ADC控制邏輯和時(shí)序生成;配置了FIFO寄存器,緩沖了ADC與DSP之間的轉(zhuǎn)換數(shù)據(jù);擴(kuò)展了UART串口,以實(shí)現(xiàn)系統(tǒng)的外部信息接口。在完成電路設(shè)計(jì)的基礎(chǔ)上,對(duì)各功能模塊進(jìn)行了全面的半實(shí)物仿真,驗(yàn)證了系統(tǒng)方案及各主要功能模塊的可行性。    論文簡(jiǎn)述了慣性導(dǎo)航系統(tǒng)的應(yīng)用背景及發(fā)展?fàn)顩r,介紹了捷聯(lián)慣導(dǎo)系統(tǒng)的基本原理,設(shè)計(jì)了基于DSP/FPGA的捷聯(lián)慣導(dǎo)系統(tǒng)方案,實(shí)現(xiàn)了系統(tǒng)各部分硬件電路以及FPGA功能模塊,并通過(guò)搭建硬件驗(yàn)證平臺(tái)和利用第三方仿真軟件,對(duì)傳感器的性能以及FPGA各功能模塊進(jìn)行了較全面的驗(yàn)證和仿真。結(jié)果表明:基于DSP/FPGA的捷聯(lián)慣導(dǎo)系統(tǒng)能夠滿足應(yīng)用的要求,并在小型化、低成本和高性能等方面有一定的優(yōu)勢(shì)。

    標(biāo)簽: DSPFPGA 捷聯(lián) 慣性導(dǎo)航 系統(tǒng)設(shè)計(jì)

    上傳時(shí)間: 2013-04-24

    上傳用戶:1966640071

  • 《高性能交換機(jī)及路由器》

    ·《高性能交換機(jī)及路由器》(High Performance Switches and Routers)PDF

    標(biāo)簽: 性能 交換機(jī) 路由器

    上傳時(shí)間: 2013-04-24

    上傳用戶:tmin392599868

  • USBCAN-I/II智能CAN接口卡驅(qū)動(dòng)庫(kù)

    USBCAN-I/II 智能CAN接口卡驅(qū)動(dòng)庫(kù) V1.3

    標(biāo)簽: USBCAN-I CAN II 接口卡

    上傳時(shí)間: 2013-07-11

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  • 用VC編寫(xiě)的基于K-means的車(chē)牌識(shí)別程序

    ·用VC編寫(xiě)的基于K-means的車(chē)牌識(shí)別程序

    標(biāo)簽: K-means 編寫(xiě) 程序 車(chē)牌識(shí)別

    上傳時(shí)間: 2013-08-06

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  • 單片K型熱電偶放大與數(shù)字轉(zhuǎn)換器

    本文介紹了單片K型熱電偶放大與數(shù)字轉(zhuǎn)換器MAX6675的使用方法。

    標(biāo)簽: 熱電偶 放大 數(shù)字轉(zhuǎn)換器

    上傳時(shí)間: 2013-05-21

    上傳用戶:wxhwjf

  • 《深入理解Android:卷I》

    《深入理解Android:卷I》,講述android開(kāi)發(fā)中的要點(diǎn),免分分享個(gè)大家!

    標(biāo)簽: Android

    上傳時(shí)間: 2013-04-24

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  • 開(kāi)關(guān)電源基本原理介紹

    開(kāi)關(guān)電源基本原理與設(shè)計(jì)介紹,臺(tái)達(dá)的資料,很好的

    標(biāo)簽: 開(kāi)關(guān) 電源基本

    上傳時(shí)間: 2013-04-24

    上傳用戶:cursor

  • 用于FPGA的N+0.5分頻代碼

    用于FPGA的N+0.5分頻代碼,可以用來(lái)進(jìn)行非整數(shù)分頻!

    標(biāo)簽: FPGA 0.5 分頻 代碼

    上傳時(shí)間: 2013-08-06

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