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高數(shù)(shù)

高精度電網(wǎng)功率因數(shù)測(cè)量加權(quán)插值FFT優(yōu)化算法

高精度電網(wǎng)功率因數(shù)測(cè)量加權(quán)插值FFT優(yōu)化算法

標(biāo)簽： FFT 高精度電網(wǎng) 功率因數(shù)

上傳時(shí)間： 2013-05-22

上傳用戶：88mao
高質(zhì)量C編程指南

高質(zhì)量C編程指南是具有一定C基礎(chǔ)的，進(jìn)入更高層次的最佳選擇

標(biāo)簽： 高質(zhì)量編程指南

上傳時(shí)間： 2013-04-24

上傳用戶：wangrijun
高吞吐量LDPC碼編碼構(gòu)造及其FPGA實(shí)現(xiàn)

低密度校驗(yàn)碼（LDPC，Low Density Parity Check Code）是一種性能接近香農(nóng)極限的信道編碼，已被廣泛地采用到各種無(wú)線通信領(lǐng)域標(biāo)準(zhǔn)中，包括我國(guó)的數(shù)字電視地面?zhèn)鬏敇?biāo)準(zhǔn)、歐洲第二代衛(wèi)星數(shù)字視頻廣播標(biāo)準(zhǔn)（DVB-S2，Digital Video Broadcasting-Satellite 2）、IEEE 802.11n、IEEE 802.16e等。它是3G乃至將來(lái)4G通信系統(tǒng)中的核心技術(shù)之一。當(dāng)今LDPC碼構(gòu)造的主流方向有兩個(gè)，分別是結(jié)合準(zhǔn)循環(huán)（QC，Quasi Cyclic）移位結(jié)構(gòu)的單次擴(kuò)展構(gòu)造和類似重復(fù)累積（RA，Repeat Accumulate）碼構(gòu)造。相應(yīng)地，主要的LDPC碼編碼算法有基于生成矩陣的算法和基于迭代譯碼的算法。基于生成矩陣的編碼算法吞吐量高，但是需要較多的寄存器和ROM資源；基于迭代譯碼的編碼算法實(shí)現(xiàn)簡(jiǎn)單，但是吞吐量不高，且不容易構(gòu)造高性能的好碼。本文在研究了上述幾種碼構(gòu)造和編碼算法之后，結(jié)合編譯碼器綜合實(shí)現(xiàn)的復(fù)雜度考慮，提出了一種切實(shí)可行的基于二次擴(kuò)展（Dex，Duplex Expansion）的QC-LDPC碼構(gòu)造方法，以實(shí)現(xiàn)高吞吐量的LDPC碼收發(fā)端；并且充分利用該類碼校驗(yàn)矩陣準(zhǔn)循環(huán)移位結(jié)構(gòu)的特點(diǎn)，結(jié)合RU算法，提出了一種新編碼器的設(shè)計(jì)方案。基于二次擴(kuò)展的QC-LDPC碼構(gòu)造方法，是通過(guò)對(duì)母矩陣先后進(jìn)行亂序擴(kuò)展（Pex，Permutation Expansion）和循環(huán)移位擴(kuò)展（CSEx，Cyclic Shift Expansion）實(shí)現(xiàn)的。在此基礎(chǔ)上，為了實(shí)現(xiàn)可變碼長(zhǎng)、可變碼率，一般編譯碼器需同時(shí)支持多個(gè)亂序擴(kuò)展和循環(huán)移位擴(kuò)展的擴(kuò)展因子。本文所述二次擴(kuò)展構(gòu)造方法的特點(diǎn)在于，固定循環(huán)移位擴(kuò)展的擴(kuò)展因子大小不變，支持多個(gè)亂序擴(kuò)展的擴(kuò)展因子，使得譯碼器結(jié)構(gòu)得以精簡(jiǎn)；構(gòu)造得到的碼字具有近似規(guī)則碼的結(jié)構(gòu)，便于硬件實(shí)現(xiàn)；（偽）隨機(jī)生成的循環(huán)移位系數(shù)能夠提高碼字的誤碼性能，是對(duì)硬件實(shí)現(xiàn)和誤碼性能的一種折中。新編碼器在很大程度上考慮了資源的復(fù)用，使得實(shí)現(xiàn)復(fù)雜度近似與碼長(zhǎng)成正比。考慮到吞吐量的要求，新編碼器結(jié)構(gòu)完全拋棄了RU算法中串行的前向替換（FS，F(xiàn)orward Substitution）模塊，同時(shí)簡(jiǎn)化了流水線結(jié)構(gòu)，由原先RU算法的6級(jí)降低為4級(jí)；為了縮短編碼延時(shí)，設(shè)計(jì)時(shí)安排每一級(jí)流水線計(jì)算所需的時(shí)鐘數(shù)大致相同。這種碼字構(gòu)造和編碼聯(lián)合設(shè)計(jì)方案具有以下優(yōu)勢(shì)：相比RU算法，新方案對(duì)可變碼長(zhǎng)、可變碼率的支持更靈活，吞吐量也更大；相比基于生成矩陣的編碼算法，新方案節(jié)省了50％以上的寄存器和ROM資源，單位資源下的吞吐量更大；相比類似重復(fù)累積碼結(jié)構(gòu)的基于迭代譯碼的編碼算法，新方案使高性能LDPC碼的構(gòu)造更為方便。以上結(jié)果都在Xilinx Virtex II pro 70 FPGA上得到驗(yàn)證。通過(guò)在實(shí)驗(yàn)板上實(shí)測(cè)表明，上述基于二次擴(kuò)展的QC-LDPC碼構(gòu)造和相應(yīng)的編碼方案能夠?qū)崿F(xiàn)高吞吐量LDPC碼收發(fā)端，在實(shí)際應(yīng)用中具有很高的價(jià)值。目前，LDPC碼正向著非規(guī)則、自適應(yīng)、信源信道及調(diào)制聯(lián)合編碼方向發(fā)展。跨層聯(lián)合編碼的構(gòu)造方法，及其對(duì)應(yīng)的編碼算法，也必將成為信道編碼理論未來(lái)的研究重點(diǎn)。

標(biāo)簽： LDPC FPGA 吞吐量編碼

上傳時(shí)間： 2013-07-26

上傳用戶：qoovoop
高動(dòng)態(tài)GPS接收機(jī)CA碼的接收

GPS（全球定位系統(tǒng)）是美國(guó)建立的高精度衛(wèi)星定位導(dǎo)航系統(tǒng)，高動(dòng)態(tài)GPS接收機(jī)可應(yīng)用于衛(wèi)星、飛機(jī)、高速列車等許多場(chǎng)合。高動(dòng)態(tài)給GPS信號(hào)帶來(lái)很大的多普勒頻移和多普勒頻移變化率，普通民用接收機(jī)無(wú)法正常工作。適用于高動(dòng)態(tài)條件的接收機(jī)可以有效消除多普勒頻移及其變化率對(duì)信號(hào)接收的影響，提高導(dǎo)航定位精度。本文在深入研究GPS的系統(tǒng)組成、工作原理以及信號(hào)格式的基礎(chǔ)上，重點(diǎn)研究高動(dòng)態(tài)條件下C/A碼和載波的捕獲與跟蹤方案。論文的主要工作如下： 1．深入研究擴(kuò)頻信號(hào)的各種捕獲算法，提出了一種適用于高動(dòng)態(tài)的基于FFT的C/A碼快速捕獲算法； 2．研究擴(kuò)頻碼跟蹤和載波跟蹤技術(shù)，設(shè)計(jì)了載波輔助的碼跟蹤環(huán)路——數(shù)字延遲鎖定環(huán)（DLL）及一種叉積自動(dòng)頻率跟蹤環(huán)（CPAFC）與科斯塔斯（Costas）環(huán)相結(jié)合的載波跟蹤方案，并在MATLAB環(huán)境下建立系統(tǒng)模型，對(duì)環(huán)路參數(shù)進(jìn)行了詳細(xì)的設(shè)計(jì)； 3．初步完成了GPS接收機(jī)基帶處理模塊核心單元的FPGA設(shè)計(jì)和功能仿真。

標(biāo)簽： GPS 動(dòng)態(tài) 接收機(jī) 接收

上傳時(shí)間： 2013-07-10

上傳用戶：suxuan110425
高清視頻編解碼系統(tǒng)控制模塊設(shè)計(jì)

在航空航天，遙感測(cè)量，安全防衛(wèi)以及家用影視娛樂等領(lǐng)域，要求能及時(shí)保存高清晰度的視頻信號(hào)供后期分析、處理、研究和欣賞。因此，研究一套處理速度快，性能可靠，使用方便，符合行業(yè)相關(guān)規(guī)范的高清視頻編解碼系統(tǒng)是十分必要的。本文首先介紹了高清視頻的發(fā)展歷史。并就當(dāng)前相關(guān)領(lǐng)域的發(fā)展闡述了高清視頻編解碼系統(tǒng)的設(shè)計(jì)思路，提出了可行的系統(tǒng)設(shè)計(jì)方案。基于H.264的高清視頻編碼系統(tǒng)對(duì)處理器的要求非常高，一般的DSP和通用處理器難以達(dá)到性能要求。本系統(tǒng)選擇富士通公司最新的專用視頻編解碼芯片MB86H51，實(shí)時(shí)編解碼分辨率達(dá)到1080p的高清視頻。芯片具有壓縮率高，功耗低，體積小等優(yōu)點(diǎn)。系統(tǒng)的控制設(shè)備由三塊FPGA芯片和ARM控制器共同完成。FPGA芯片分別負(fù)責(zé)視頻輸入輸出，碼流輸入輸出和主編解碼芯片的控制。ARM作為上層人機(jī)交互的控制器，向系統(tǒng)使用者提供操作界面，并與主控FPGA相連。方案實(shí)現(xiàn)了高清視頻的輸入，實(shí)時(shí)編碼和碼流存儲(chǔ)輸出等功能于一體，能夠編碼1080p的高清視頻并存儲(chǔ)在硬盤中。系統(tǒng)開發(fā)的工作難點(diǎn)在于FPGA的程序設(shè)計(jì)與調(diào)試工作。其次，詳細(xì)介紹了FPGA在系統(tǒng)中的功能實(shí)現(xiàn)，使用的方法和程序設(shè)計(jì)。使用VHDL語(yǔ)言編程實(shí)現(xiàn)I2C總線接口和接口控制功能，利用stratix系列FPGA內(nèi)置的M4K快速存儲(chǔ)單元實(shí)現(xiàn)128K的命令存儲(chǔ)ROM，并對(duì)設(shè)計(jì)元件模塊化，方便今后的功能擴(kuò)展。編程實(shí)現(xiàn)了PIO模式的硬盤讀寫和SDRAM接口控制功能，實(shí)現(xiàn)高速的數(shù)據(jù)存儲(chǔ)功能。利用時(shí)序狀態(tài)機(jī)編程實(shí)現(xiàn)主芯片編解碼控制功能，完成編解碼命令的發(fā)送和狀態(tài)讀取，并對(duì)設(shè)計(jì)思路，調(diào)試結(jié)果和FPGA資源使用情況進(jìn)行分析。著重介紹設(shè)計(jì)中用到的最新芯片及其工作方式，分析設(shè)計(jì)過(guò)程中使用的最新技術(shù)和方法。有很強(qiáng)的實(shí)用價(jià)值。最后，論文對(duì)系統(tǒng)就不同的使用情況提出了可供改進(jìn)的方案，并對(duì)與高清視頻相關(guān)的關(guān)鍵技術(shù)作了分析和展望。

標(biāo)簽： 高清視頻編解碼系統(tǒng)控制模塊設(shè)計(jì)

上傳時(shí)間： 2013-07-26

上傳用戶：shanml
基于AD9833的高精度可編程波形發(fā)生器系統(tǒng)設(shè)計(jì)

基于AD9833的高精度可編程波形發(fā)生器系統(tǒng)設(shè)計(jì):介紹一種基于AD9833的高精度可編程波形發(fā)生器系統(tǒng)解決方案，該系統(tǒng)具有可編程設(shè)置、波形頻率和峰峰值等功能，從而解決DDS輸出波形峰峰值不能直接

標(biāo)簽： 9833 AD 高精度可編程

上傳時(shí)間： 2013-04-24

上傳用戶：ecooo
基于FPGA的高分辨率圖像采集卡

隨著計(jì)算機(jī)科學(xué)和視頻技術(shù)的廣泛發(fā)展,數(shù)字圖像采集在電子通信與信息處理領(lǐng)域得到了廣泛的應(yīng)用,例如廣播電視的數(shù)字化、網(wǎng)絡(luò)視頻、監(jiān)視監(jiān)控系統(tǒng)等. 視頻圖像采集卡作為計(jì)算機(jī)視頻應(yīng)用的前端設(shè)備,承擔(dān)著模擬視頻信號(hào)向數(shù)字視頻信號(hào)轉(zhuǎn)換的任務(wù),在多媒體時(shí)代占據(jù)著重要的位置.設(shè)計(jì)一種功能靈活,使用方便,便于嵌入到系統(tǒng)中的視頻信號(hào)采集電路具有重要的實(shí)用意義. 本文首先介紹數(shù)字圖像采集系統(tǒng)的發(fā)展現(xiàn)狀和前景,提出了本次設(shè)計(jì)的目標(biāo): 完成基于PCI總線的高分辨率圖像采集卡設(shè)計(jì).然后簡(jiǎn)單介紹了本次設(shè)計(jì)用到的基本理論:數(shù)據(jù)采集理論,特別說(shuō)明了采樣和量化的定義與區(qū)別,以及量化的幾種方式和量化與AD技術(shù)之間的關(guān)系. 圖像采集系統(tǒng)的基本構(gòu)成,是以數(shù)字信號(hào)處理器為核心,控制外圍的A/D、D/A轉(zhuǎn)換器和外圍存儲(chǔ)器.本文對(duì)比了當(dāng)下流行的DSP芯片和IFPGA芯片作為數(shù)字處理核心的優(yōu)缺點(diǎn),并根據(jù)系統(tǒng)實(shí)際需要,選用FPGA作為數(shù)字信號(hào)處理器.然后列舉了幾款常用A/D視頻芯片,還介紹了SDRAM控制的基本流程,最后提出了系統(tǒng)的整體設(shè)計(jì)方案. 圖像采集卡的硬件設(shè)計(jì)分為A/D前端模擬通道設(shè)計(jì)和FPGA數(shù)字信號(hào)傳輸及外圍電路設(shè)計(jì).本文重點(diǎn)介紹了A/D芯片外圍電路連接和使用方法,對(duì)PCI總線和它的控制電路也做了詳細(xì)闡述.對(duì)圖像采集卡的PCB布局布線也有詳細(xì)說(shuō)明. 圖像采集卡FPGA內(nèi)部程序構(gòu)成也是本文的一個(gè)重點(diǎn).本次的程序設(shè)計(jì)主要分為數(shù)據(jù)采集模塊,即與A/D接口模塊,數(shù)據(jù)暫存模塊,即SDRAM讀寫控制模塊,數(shù)據(jù)處理模塊和數(shù)據(jù)傳輸模塊,即PCI控制模塊.重點(diǎn)在于對(duì)的SDRAM的連續(xù)讀寫控制和各個(gè)模塊間的協(xié)調(diào)工作.說(shuō)明了.A/D采集數(shù)據(jù)從接收到存儲(chǔ)詳細(xì)過(guò)程,以及對(duì)SDRAM讀寫狀態(tài)機(jī)和PCI總線的操控. 最后介紹了硬件調(diào)試和FPGA程序驗(yàn)證結(jié)果.詳細(xì)說(shuō)明了以Modelsim為平臺(tái)的前端功能仿真和后端時(shí)序仿真,以及以SignalTapⅡ?yàn)槠脚_(tái),程序下載到FPGA中進(jìn)行的實(shí)時(shí)驗(yàn)證.結(jié)果表明整個(gè)圖像采集系統(tǒng)基本達(dá)到了系統(tǒng)設(shè)計(jì)中所給出的性能指標(biāo),證明了整個(gè)系統(tǒng)設(shè)計(jì)的正確性和合理性.

標(biāo)簽： FPGA 高分辨率圖像采集卡

上傳時(shí)間： 2013-04-24

上傳用戶：amandacool
一種高分辨率的單相交流調(diào)壓電源設(shè)計(jì)

摘要院提出了一種采用IPM大功率模塊實(shí)現(xiàn)的高分辨率調(diào)壓電源的設(shè)計(jì)方法。該方法采用粗堯細(xì)調(diào)節(jié)的方式實(shí)現(xiàn)了高分辨率的電壓調(diào)節(jié)。重點(diǎn)介紹了逆變方式下粗細(xì)調(diào)節(jié)部分相位一致問(wèn)題，驗(yàn)結(jié)果表明這種方法切實(shí)可行。

標(biāo)簽： 高分辨率單相交流調(diào)壓電源設(shè)計(jì)

上傳時(shí)間： 2013-07-01

上傳用戶：linlin
高精度地震勘探數(shù)據(jù)采集系統(tǒng)

本文分析了當(dāng)代高精度地震勘探數(shù)據(jù)采集系統(tǒng)的發(fā)展現(xiàn)狀，研究了數(shù)據(jù)采集的A/D方法及理論、現(xiàn)場(chǎng)可編程門陣列(Field Programmable GateArray，F(xiàn)PGA)技術(shù)的發(fā)展及原理，串口通信的原理及實(shí)現(xiàn)。在此基礎(chǔ)上，探討了采用FPGA控制24位△∑模數(shù)轉(zhuǎn)換器來(lái)實(shí)現(xiàn)高精度地震勘探數(shù)據(jù)采集系統(tǒng)的實(shí)現(xiàn)思路，對(duì)探測(cè)傳感器或檢波器后端數(shù)據(jù)采集系統(tǒng)的信號(hào)A/D轉(zhuǎn)換、FPGA與外部接口設(shè)計(jì)、串口數(shù)據(jù)通信做了詳細(xì)的研究，尤其是在用FPGA來(lái)完成與外部ADC的接口控制上做了深入的開發(fā)和設(shè)計(jì)，整個(gè)接口控制模塊采用VHDL語(yǔ)言編寫，并同時(shí)將ROM、FIFO等數(shù)字邏輯模塊一起集成到一片F(xiàn)PGA芯片當(dāng)中，并在Quartus Ⅱ6.0的開發(fā)平臺(tái)上通過(guò)了軟件仿真，時(shí)序仿真結(jié)果達(dá)到了系統(tǒng)要求。

標(biāo)簽： 高精度地震勘探數(shù)據(jù)采集系統(tǒng)

上傳時(shí)間： 2013-05-21

上傳用戶：yuele0123
高精度智能測(cè)時(shí)儀的設(shè)計(jì)

區(qū)截裝置測(cè)速法是現(xiàn)代靶場(chǎng)中彈丸測(cè)速的普遍方法，測(cè)時(shí)儀作為區(qū)截裝置測(cè)速系統(tǒng)的主要組成部分，其性能直接影響彈丸測(cè)速的可靠性和精度。本文根據(jù)測(cè)時(shí)儀的發(fā)展現(xiàn)狀，按照設(shè)計(jì)要求，設(shè)計(jì)了一種基于單片機(jī)和FPGA的高精度智能測(cè)時(shí)儀，系統(tǒng)工作穩(wěn)定、操作方便、測(cè)時(shí)精度可達(dá)25ns。本文詳細(xì)給出了系統(tǒng)的設(shè)計(jì)方案。該方案提出了一種在后端用單片機(jī)處理干擾信號(hào)的新方法，簡(jiǎn)化了系統(tǒng)硬件電路的設(shè)計(jì)，提高了測(cè)時(shí)精度；提出了一種基于系統(tǒng)基準(zhǔn)時(shí)間的測(cè)時(shí)方案，相對(duì)于傳統(tǒng)的測(cè)時(shí)方法，該方案為分析試驗(yàn)過(guò)程提供了有效數(shù)據(jù)，進(jìn)一步提高了系統(tǒng)工作的可靠性；給出了一種輸入信息處理的有效方法，保證了系統(tǒng)工作的穩(wěn)定性。本文設(shè)計(jì)了系統(tǒng)FPGA邏輯電路，包括輸入信號(hào)的整形濾波、輸入信號(hào)的捕捉、時(shí)基模塊、異步時(shí)鐘域間數(shù)據(jù)傳遞、與單片機(jī)通信、單片機(jī)I/O總線擴(kuò)展等；實(shí)現(xiàn)了系統(tǒng)單片機(jī)程序，包括單片機(jī)和。FPGA的數(shù)據(jù)交換、干擾信號(hào)排除和彈丸測(cè)速測(cè)頻算法的實(shí)現(xiàn)、LCD液晶菜單的設(shè)計(jì)和打印機(jī)的控制、FLASH的讀寫、上電后對(duì)FPGA的配置、與上位機(jī)的通信等；分析了系統(tǒng)的誤差因素，給出了系統(tǒng)的誤差和相對(duì)誤差的計(jì)算公式；通過(guò)實(shí)驗(yàn)室模擬測(cè)試以及靶場(chǎng)現(xiàn)場(chǎng)測(cè)試，結(jié)果表明系統(tǒng)工作可靠、精度滿足設(shè)計(jì)要求、人機(jī)界面友好。

標(biāo)簽： 高精度儀的設(shè)計(jì)

上傳時(shí)間： 2013-07-25

上傳用戶：pwcsoft

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