由于其很強的糾錯性能和適合硬件實現的編譯碼算法，卷積編碼和軟判決維特比譯碼目前已經廣泛應用于衛星通信系統。然而隨著航天事業的發展，衛星有效載荷種類的增多和分辨率的不斷提高，信息量越來越大。如何在低信噪比的功率受限信道條件下提高傳輸速率成為目前亟待解決的問題。本論文結合在研項目，在編譯碼算法、編譯碼器的設計與實現、編譯碼器性能提高三個方面對卷積編碼和維特比譯碼進行了深入研究，并進一步介紹了使用VHDL語言和原理圖混合輸入的方式，實現一種(7,3/4)增信刪余方式的高速卷積編碼器和維特比譯碼器的詳細過程；然后將設計下載到XILINX的Virtex2 FPGA內部進行功能和時序確認，最終在整個數據傳輸系統中測試其性能。本文所實現的維特比譯碼器速率達160Mbps，遠遠高于目前國內此領域內的相關產品速率。 首先，論文具體介紹了卷積編碼和維特比譯碼的算法，研究卷積碼的各種參數(約束長度、生成多項式、碼率以及增信刪余等)對其譯碼性能的影響；針對項目需求，確定卷積編碼器的約束長度、生成多項式格式、碼率和相應的維特比譯碼器的回歸長度。 其次，論文介紹了編解碼器的軟、硬件設計和調試一根據已知條件，使用VHDL語言和原理圖混合輸入的方式設計卷積編碼和維特比譯碼的源代碼和原理圖，分別采用功能和電路級仿真，確定卷積編碼和維特比譯碼分別需要占用的資源，考慮卷積編碼器和維特比譯碼器的具體設計問題，包括編譯碼的基本結構，各個模塊的功能及實現策略，編譯碼器的時序、邏輯綜合等；根據軟件仿真結果，分別確定卷積編碼器和維特比譯碼器的接口、所需的FPGA器件選型和進行各自的印制板設計。利用卷積碼本身的特點，結合FPGA內部結構，采用并行卷積編碼和譯碼運算，設計出高速編譯碼器；對軟、硬件分別進行驗證和調試，并將驗證后的軟件下載到FPGA進行電路級調試。 最后，論文討論了卷積編碼和維特比譯碼的性能：利用已有的測試設備在整個數據傳輸系統中測試其性能(與沒有采用糾錯編碼的數傳系統進行比對)；在信道中加入高斯白噪聲，模擬高斯信道，進行誤碼率和信噪比測試。
標簽： FPGA 卷積 編碼 譯碼
上傳時間： 2013-04-24
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基于FPGA的調頻高斯濾波器介紹了用FPGA實現的調頻高斯濾波器。
標簽： FPGA 調頻 濾波器 高斯
上傳時間： 2013-08-17
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對傳統混合高斯背景模型作了改進，消除了緩慢運動目標對背景模型的影響，其中提出了目標間差分方法區分出前后幀變化區，對不同區域采用不同的學習權重更新策略。通過實驗證明，該改進算法提高了背景模型的健壯性，在跟蹤系統中獲得較好效果。
標簽： 高斯模型 運動目標跟蹤
上傳時間： 2015-01-03
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勒讓德-高斯求積法求磁感應強度
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大地左邊與高斯平面坐標轉換程序
標簽： 高斯 坐標轉換 程序
上傳時間： 2014-01-15
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這事高斯法解方程組實例
標簽： 高斯 方程
上傳時間： 2013-12-23
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按列選主高斯消元,高斯消元算法
標簽： 高斯 算法
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列主元的高斯算法
上傳時間： 2013-11-28
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