溫度的測量在工業領域最為常見，隨著電子技術、計算機技術的飛速發展，對現場溫度的測量也由過去的模擬刻度溫度計、指針溫度計向數字顯示的智能溫度計發展，而且，對測量的精度要求也越來越高。目前，盡管市場上也有高精度的溫度測量儀，但一般價格都很昂貴。傳統的8位單片機已經越來越不能適應日漸復雜的應用需求。友好的交互界面、網絡互聯功能、智能化的軟件、高效的數據處理幾乎成了智能化系統的共同需求。隨著嵌入式系統的迅猛發展，這種應用系統正逐步取代傳統的以PC為中心的應用，成為未來智能化儀表中的主力軍。本文立足于設計一種通用性強的測溫系統，可以在軟硬件兩方面適應多種測溫元件，為系統日后升級帶來方便。 本論文以對通用Linux操作系統在32位ARM微處理器上進行移植并對其實時性進行了改造。研制了鉑熱電阻高精度溫度監測系統，闡述了其具體技術指標及相關實現方法。系統以S3C2410為硬件核心，開發了主板及數據采集調理電路。構建了以微處理器S3C2410、閃存FLASH、存儲器SRAM、A/D、鍵盤、顯示器為一體的溫度監測的硬件平臺。在此硬件平臺上嵌入RT—Linux嵌入式實時操作系統，構建系統的多任務管理，最終完成了本課題的設計開發。
上傳時間： 2013-06-07
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運動控制系統是機器人控制系統的重要組成部分。本文將ARM與CPLD技術應用于機器人運動控制系統，使控制系統更加開放、更加模塊化，同時ARM芯片的高速大容量的數據處理能力以及CPLD的高集成度，可編程性，能夠逾越以往控制系統中實時、高速、高精度的技術瓶頸. 嵌入式技術是當今最熱門的技術之一，由于簡潔、高效等優點，使得其廣泛應用在各個領域；所謂嵌入式系統就是以應用為中心，以計算機技術為基礎，并且軟硬件可裁剪，適用于應用系統對功能、可靠性、成本、體積、功耗有嚴格要求的專用計算機系統。它一般由嵌入式微處理器、外圍硬件設備、嵌入式操作系統以及用戶的應用程序等四個部分組成，用于實現對其它設備的控制、監視或管理等功能。 本文主要闡述了基于嵌入式處理器S3C44B0X的機器人控制器的設計過程。文章首先介紹了機器人本體規劃、嵌入式系統和嵌入式微處理器S3C44B0X的結構特點；接著介紹了基于S3C44B0X的智能控制器的設計，包括硬件設計和CPLD軟件設計。其中控制器硬件平臺擴展了外部存儲器、串行口，通過輸出PWM信號進入驅動電路模塊，從而實現控制機器人運動的目的。在CPLD設計過程中，引入JTAG調試接口，方便系統程序的下載和調試，通過自上而下、分塊設計的思想給出了QUARTUSⅡ設計環境下的軟件代碼。本系統利用不同任務間的切換來實現通信過程，而不再采用無操作系統的工程文件的形式，這樣不但有利于項目的調試，也有利于對其它接口的擴展。最后對該控制器進行了測試和分析。
上傳時間： 2013-07-19
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針對儀器儀表向高端產品的發展趨勢，課題提出并設計實現了一種基于嵌入式μC/OS-Ⅱ操作系統和ARM7微處理器為核心的控制平臺，使儀表的使用更加方便、智能。系統融合了嵌入式系統、USB通信、LAN通信、顯示等多項快速發展的技術，通過USB模塊和LAN網絡的數據傳輸，實現了高端儀表與外部設備的通信，整個平臺具有高速、實時傳輸數據等特性，能夠廣泛地應用于多種行業的現場測量中。 硬件方面，課題采用具有ARM7TDMI核的LPC2220微處理器作為系統的控制平臺，并結合應用設計出了顯示模塊、USB通信模塊、LAN通信模塊。控制平臺通過USB通信模塊和LAN通信模塊，建立與外部設備的數據處理通道，將與SPI接口連接的儀表數據進行傳輸處理。USB接口電路采用了Cypress公司的CY7C68001芯片，LAN通信模塊則采用了CIRRUSLOGIC的以太網控制器CS8900實現底層驅動。 軟件方面，首先將μC/OS-Ⅱ操作系統移植到ARM7上，并在嵌入式μC/OS-Ⅱ環境下編寫了各硬件模塊的驅動程序。在驅動程序的基礎上設計了VFD顯示程序、USB通信和網絡通信等應用模塊，驗證了數據處理平臺具有的各項功能。網絡通信模塊中，WEB SERVER在控制平臺實現，在上位PC上輸入服務器的固定IP地址，實現控制命令的發送、數據包的接收等功能。 經測試，系統運行正常，較好的實現了各項設計目標，從而證明了本文的方法是可行的。本系統為高端儀表的數據處理提供了一個有效的解決方案，具有良好的應用前景。
上傳時間： 2013-06-06
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嵌入式系統是以應用為中心，以計算機技術為基礎，軟硬件可裁減，適應應用系統，對功能，可靠性，成本，體積，功耗嚴格要求的專用計算機系統[1]。廣泛應用于軍事，信息家電，無線通信設備，消費類電子產品，移動計算平臺等諸多領域，是當今熱門的計算機開發技術。 隨著科學技術發展，人們生活水平提高，數字高清電視逐漸普及，在各大賣場，對銷售過程中展示設備也隨之提出了更高的要求。但據調查，在中國現有的高清播放系統普遍存在價格昂貴，損耗高，壽命短及外部接口少等缺陷，導致無法普及。 針對這一現狀，本課題設計了一種以嵌入式處理器ARM系列32位嵌入式EM8623芯片為硬件平臺，嵌入式實時操作系統uclinux為系統軟件平臺的高清播放系統。 ARM(Advanced RISC Machines)既是一種處理器架構，又是公司的名稱，該公司主要設計處理器架構，并將其技術授權給其他芯片廠商。該處理器架構具有外型小，性能高等特點，多用于便攜式通訊工具，多媒體數字式消費類儀器和嵌入式系統解決方案等領域。本課題在充分考慮系統實用性和開發成本的基礎上，采用EM8623芯片為CPU，片外擴展FLASH和SDRAM存儲器。 uclinux系統從Linux2.0/2.4內核派生而來，雖然是為了支持沒有MMU(虛擬內存管理單元)的處理器而設計，但保留了操作系統的所有特性，為硬件平臺更好地運行提供了保證，也降低了軟件設計復雜度，提高了系統的實時性和靈活性，縮短了開發周期。 該高清播放系統具有工作時間長，性能穩定等特點，采用面向對象和面向過程綜合編程方法，ASM，C，C++多種語言混合編程方式實現，使系統具有很高的健壯性和可擴展性。 基于ARM的高清播放系統在現場運行穩定可靠，達到了預期的效果和實際要求。而且由于該高清播放系統外接接口豐富(包括常見的HDMI，S-Video，VGA，YPbPr，YCbCr)，連接使用方便，所以具有很好的市場價值，可廣泛應用于電視銷售柜臺，化妝品展示柜臺，聯網廣告機等領域。
上傳時間： 2013-04-24
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二次雷達(Secondary Surveillance Radar)是民航空中管制(Air Traffic Control)和軍事敵我識別(Identification Friend or Foe)系統中的關鍵部分,由于這兩個應用領域都要求很高的可靠性和穩定性,因此,二次雷達一直是國內外雷達信號處理領域的研究熱點.傳統的機載二次雷達應答器普遍采用中小規模集成電路和分立元件設計,其穩定性和可靠性差,實時處理能力也很有限,無法完成高密度、大容量的應答.針對這些缺陷,本論文提出一種全新的應答數字信號處理器硬件結構,即FPGA+DSP的混合結構.這種硬件體系結構的特點是可靠性高,集成度高,通用性強,適于模塊化設計,處理速度快,能實時處理多個應答信號,以及進行置信度分析和生成報表.此項目中,本文作者主要負責FPGA部分硬件設計.FPGA主要完成雙通道數據采集、產生視頻信號和旁瓣抑制信號、計算當前飛機相對本地接收天線的方位和距離、與DSP實時交換數據、上傳報表等功能.論文詳細分析了接收機信號處理算法在FPGA中的硬件實現方案,在提高系統可靠性、堅固性以及FPGA資源的合理利用方面做了深入的探討.同時給出不同層次關鍵模塊的HDL實現及其時序仿真結果.
上傳時間： 2013-04-24
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隨著圖像處理和模式識別技術的進步，基于生物特征的識別技術成為蓬勃發展的高技術之一，根據IBG(InternationalBiometricGroup)組織對生物特征市場的統計和預測，該領域的收入的年增長率30-50％，到2008年，全球總收入將達到46.39億美元。而基于指紋特征的識別技術由于其獨特的可靠性，穩定性，方便快捷的特點，恰好符合了市場的需求。目前指紋識別技術是生物識別領域中應用最廣泛的識別技術，也是研究與應用的一個熱點。 SOPC片上可編程系統和嵌入式系統是當前電子設計領域中最熱門的概念。NiosⅡ是Altera公司開發的一種采用流水線技術、單指令流的RISC嵌入式處理器軟核，可以將它嵌入FPGA內部，與用戶自定義邏輯結合構成一個基于FPGA的片上系統。與嵌入式硬核相比較，嵌入式軟核具有更大的靈活性。而FPGA的高速性、恰恰滿足了指紋識別系統對速度的要求。 本文對指紋識別技術中各個環節的算法進行了較為深入的研究，結合NiosⅡ嵌入式處理器的特點，對算法進行了合理的選擇與優化，形成了一套完整的指紋識別算法，并提出了一種基于FPGA的指紋識別系統硬件設計方案。 論文的內容主要包括以下幾個方面： 1、對指紋圖像預處理、后處理和匹配算法進行了改進，提高了算法的性能；設計了一種適用于快速匹配的指紋特征數據結構；提出了一套基于特征點匹配的指紋識別算法。實驗結果表明該算法速度快、誤識率較低、可靠性較高，可以滿足實用的要求。 2、本著增加系統集成度、減小系統體積、提高便攜性、降低功耗和成本，同時提升系統的性能的原則，使用Altera公司提供的外圍設備IP核配合NiosⅡ處理器軟核搭建了一個單片嵌入式系統，然后以內嵌NiosⅡ軟核的FPGA和FPS200指紋采集器為核心芯片，外配片外RAM和Flash存儲器以及小鍵盤和LCD顯示屏等器件，設計了一個便攜式指紋識別系統，提出了一套基于FPGA的硬件設計方案。 3、利用NiosⅡ開發板對硬件設計方案進行了初步的驗證，實現了指紋采集芯片FPS200與FPGA的接口，并進行了算法的移植。 實驗結果表明本文所提出的系統設計方案是可行的。基于FPGA的自動指紋識別系統在速度、功耗、體積、擴展性方面有著獨特的優勢，具有廣闊的發展空間。最后提出了對這一設計繼續改進的思路和下一步研究的內容。
上傳時間： 2013-07-28
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DFT(Discrete Fourier Transformation)是數字信號分析與處理如圖形、語音及圖像等領域的重要變換工具,直接計算DFT的計算量與變換區間長度N的平方成正比.當N較大時,因計算量太大,直接用DFT算法進行譜分析和喜好的實時處理是不切實際的.快速傅里葉變換(Fast Fourier Transformation,簡稱FFT)使DFT運算效率提高1~2個數量級.本文的目的就是研究如何應用FPGA這種大規模可編程邏輯器件實現FFT的算法.本設計主要采用先進的基-4DIT算法研制一個具有實用價值的FFT實時硬件處理器.在FFT實時硬件處理器的設計實現過程中,利用遞歸結構以及成組浮點制運算方式,解決了蝶形計算、數據傳輸和存儲操作協調一致問題.合理地解決了位增長問題.同時,采用并行高密度乘法器和流水線(pipeline)工作方式,并將雙端口RAM、只讀ROM全部內置在FPGA芯片內部,使整個系統的數據交換和處理速度得以很大提高,實際合理地解決了資源和速度之間相互制約的問題.本設計采用Verilog HDL硬件描述語言進行設計,由于在設計中采用Xilinx公司提供的稱為Core的IP功能塊極大地提高了設計效率.
上傳時間： 2013-06-20
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低密度校驗碼（LDPC，Low Density Parity Check Code）是一種性能接近香農極限的信道編碼，已被廣泛地采用到各種無線通信領域標準中，包括我國的數字電視地面傳輸標準、歐洲第二代衛星數字視頻廣播標準（DVB-S2，Digital Video Broadcasting-Satellite 2）、IEEE 802.11n、IEEE 802.16e等。它是3G乃至將來4G通信系統中的核心技術之一。 當今LDPC碼構造的主流方向有兩個，分別是結合準循環（QC，Quasi Cyclic）移位結構的單次擴展構造和類似重復累積（RA，Repeat Accumulate）碼構造。相應地，主要的LDPC碼編碼算法有基于生成矩陣的算法和基于迭代譯碼的算法。基于生成矩陣的編碼算法吞吐量高，但是需要較多的寄存器和ROM資源；基于迭代譯碼的編碼算法實現簡單，但是吞吐量不高，且不容易構造高性能的好碼。 本文在研究了上述幾種碼構造和編碼算法之后，結合編譯碼器綜合實現的復雜度考慮，提出了一種切實可行的基于二次擴展（Dex，Duplex Expansion）的QC-LDPC碼構造方法，以實現高吞吐量的LDPC碼收發端；并且充分利用該類碼校驗矩陣準循環移位結構的特點，結合RU算法，提出了一種新編碼器的設計方案。 基于二次擴展的QC-LDPC碼構造方法，是通過對母矩陣先后進行亂序擴展（Pex，Permutation Expansion）和循環移位擴展（CSEx，Cyclic Shift Expansion）實現的。在此基礎上，為了實現可變碼長、可變碼率，一般編譯碼器需同時支持多個亂序擴展和循環移位擴展的擴展因子。本文所述二次擴展構造方法的特點在于，固定循環移位擴展的擴展因子大小不變，支持多個亂序擴展的擴展因子，使得譯碼器結構得以精簡；構造得到的碼字具有近似規則碼的結構，便于硬件實現；（偽）隨機生成的循環移位系數能夠提高碼字的誤碼性能，是對硬件實現和誤碼性能的一種折中。 新編碼器在很大程度上考慮了資源的復用，使得實現復雜度近似與碼長成正比。考慮到吞吐量的要求，新編碼器結構完全拋棄了RU算法中串行的前向替換（FS，Forward Substitution）模塊，同時簡化了流水線結構，由原先RU算法的6級降低為4級；為了縮短編碼延時，設計時安排每一級流水線計算所需的時鐘數大致相同。 這種碼字構造和編碼聯合設計方案具有以下優勢：相比RU算法，新方案對可變碼長、可變碼率的支持更靈活，吞吐量也更大；相比基于生成矩陣的編碼算法，新方案節省了50％以上的寄存器和ROM資源，單位資源下的吞吐量更大；相比類似重復累積碼結構的基于迭代譯碼的編碼算法，新方案使高性能LDPC碼的構造更為方便。以上結果都在Xilinx Virtex II pro 70 FPGA上得到驗證。 通過在實驗板上實測表明，上述基于二次擴展的QC-LDPC碼構造和相應的編碼方案能夠實現高吞吐量LDPC碼收發端，在實際應用中具有很高的價值。 目前，LDPC碼正向著非規則、自適應、信源信道及調制聯合編碼方向發展。跨層聯合編碼的構造方法，及其對應的編碼算法，也必將成為信道編碼理論未來的研究重點。
上傳時間： 2013-07-26
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波前處理機是自適應光學系統中實時信號處理和運算的核心，隨著自適應光學系統得發展，波前傳感器的采樣頻率越來越高，這就要求波前處理機必須有更強的數據處理能力以保證系統的實時性。在整個波前處理機的工作流程中，對CCD傳來的實時圖像數據進行實時處理是第一步，也是十分重要的一步。如果不能保證圖像處理的實時性，那么后續的處理過程都無從談起。因此，研制高性能的圖像處理平臺，對波前處理機性能的提高具有十分重要的意義。 論文介紹了本研究課題的背景以及國內外圖像處理技術的應用和發展狀況，接著介紹了傳統的專用和通用圖像處理系統的結構、特點和模型，并通過分析DSP芯片以及DSP系統的特點，提出了基于DSP和FPGA芯片的實時圖像處理系統。該系統不同于傳統基于PC機模式的圖像處理系統，發揮了DSP和FPGA兩者的優勢，能更好地提高圖像處理系統實時性能，同時也最大可能地降低成本。 論文根據圖像處理系統的設計目的、應用需求確定了器件的選型。介紹了主要的器件，接著從系統架構、邏輯結構、硬件各功能模塊組成等方面詳細介紹了DSP+FPGA圖像處理系統硬件設計，并分析了包括各種參數指標選擇、連接方式在內的具體設計方法以及應該注意的問題。 論文在闡述傳輸線理論的基礎上，在制作PCB電路板的過程中，針對高速電路設計中易出現的問題，詳細分析了高速PCB設計中的信號完整性問題，包括反射、串擾等，說明了高速PCB的信號完整性、電源完整性和電磁兼容性問題及其解決方法，進行了一定的理論和技術探討和研究。 論文還介紹了基于FPGA的邏輯設計，包括了圖像采集模塊的工作原理、設計方案和SDRAM控制器的設計，介紹了SDRAM的基本操作和工作時序，重點闡述系統中可編程器件內部模塊化SDRAM控制器的設計及仿真結果。 論文最后描述了硬件系統的測試及調試流程，并給出了部分的調試結果。 該系統主要優點有：實時性、高速性。硬件設計的執行速度，在高速DSP和FPGA中實現信號處理算法程序，保證了系統實時性的實現；性價比高。自行研究設計的電路及硬件系統比較好的解決了高速實時圖像處理的需求。
上傳時間： 2013-04-24
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隨著計算機科學和視頻技術的廣泛發展,數字圖像采集在電子通信與信息處理領域得到了廣泛的應用,例如廣播電視的數字化、網絡視頻、監視監控系統等. 視頻圖像采集卡作為計算機視頻應用的前端設備,承擔著模擬視頻信號向數字視頻信號轉換的任務,在多媒體時代占據著重要的位置.設計一種功能靈活,使用方便,便于嵌入到系統中的視頻信號采集電路具有重要的實用意義. 本文首先介紹數字圖像采集系統的發展現狀和前景,提出了本次設計的目標: 完成基于PCI總線的高分辨率圖像采集卡設計.然后簡單介紹了本次設計用到的基本理論:數據采集理論,特別說明了采樣和量化的定義與區別,以及量化的幾種方式和量化與AD技術之間的關系. 圖像采集系統的基本構成,是以數字信號處理器為核心,控制外圍的A/D、D/A轉換器和外圍存儲器.本文對比了當下流行的DSP芯片和IFPGA芯片作為數字處理核心的優缺點,并根據系統實際需要,選用FPGA作為數字信號處理器.然后列舉了幾款常用A/D視頻芯片,還介紹了SDRAM控制的基本流程,最后提出了系統的整體設計方案. 圖像采集卡的硬件設計分為A/D前端模擬通道設計和FPGA數字信號傳輸及外圍電路設計.本文重點介紹了A/D芯片外圍電路連接和使用方法,對PCI總線和它的控制電路也做了詳細闡述.對圖像采集卡的PCB布局布線也有詳細說明. 圖像采集卡FPGA內部程序構成也是本文的一個重點.本次的程序設計主要分為數據采集模塊,即與A/D接口模塊,數據暫存模塊,即SDRAM讀寫控制模塊,數據處理模塊和數據傳輸模塊,即PCI控制模塊.重點在于對的SDRAM的連續讀寫控制和各個模塊間的協調工作.說明了.A/D采集數據從接收到存儲詳細過程,以及對SDRAM讀寫狀態機和PCI總線的操控. 最后介紹了硬件調試和FPGA程序驗證結果.詳細說明了以Modelsim為平臺的前端功能仿真和后端時序仿真,以及以SignalTapⅡ為平臺,程序下載到FPGA中進行的實時驗證.結果表明整個圖像采集系統基本達到了系統設計中所給出的性能指標,證明了整個系統設計的正確性和合理性.
上傳時間： 2013-04-24
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